본 연구에서는 비대칭 이중게이트 MOSFET의 채널길이와 채널두께의 비에 따른 드레인 유도 장벽 감소 현상의 변화에 대하여 분석하고자한다. 드레인 전압이 소스 측 전위장벽에 영향을 미칠 정도로 단채널을 갖는 MOSFET에서 발생하는 중요한 이차효과인 드레인 유도 장벽 감소는 문턱전압의 이동 등 트랜지스터 특성에 심각한 영향을 미친다. 드레인 유도 장벽 감소현상을 분석하기 위하여 포아송방정식으로부터 급수형태의 전위분포를 유도하였으며 차단전류가 $10^{-7}A/m$일 경우 비대칭 이중게이트 MOSFET의 상단게이트 전압을 문턱전압으로 정의하였다. 비대칭 이중게이트 MOSFET는 단채널효과를 감소시키면서 채널길이 및 채널두께를 초소형화할 수 있는 장점이 있으므로 본 연구에서는 채널길이와 두께 비에 따라 드레인 유도 장벽 감소를 관찰하였다. 결과적으로 드레인 유도 장벽 감소 현상은 단채널에서 크게 나타났으며 하단게이트 전압, 상하단 게이트 산화막 두께 그리고 채널도핑 농도 등에 따라 큰 영향을 받고 있다는 것을 알 수 있었다.
결정질 실리콘 태양전지의 원가에서 Wafer는 60~70%의 매우 높은 비중을 차지하고 있다. 많은 연구들이 원가 절감을 위하여 Wafer의 두께를 감소시키는 것에 집중하고 있다. 그러나 Wafer 두께의 감소는 태양전지의 효율 감소와 공정 진행 중에 파손율이 상승하는 등의 문제가 발생한다. 이에 본 논문에서는 결정질 태양전지 구조 중에서 24.7% 이상의 최고 변환 효율을 갖는 PERL(Passivated Emitter, Rear Locally diffuse) 구조를 대상으로 wafer 두께 감소에 따른 변환 효율 감소의 원인과 해결 방안을 제시하고자 한다. Simulation으로 확인한 결과 370 um 두께의 wafer에서 24.2 %의 효율은 50 um 두께의 wafer에서는 20.8 %로 감소함을 확인할 수 있었다. 얇아진 wafer에서 감소한 효율을 개선하기 위하여 후면 recombination velocity, 후면 fixed charge density, 후면 산화막 두께 등을 다양화하여, 각각의 경우에 대한 cell의 효율 변화를 살펴보았다. 그 결과 후면 recombination velocity, 후면 fixed charge density, 후면 산화막 두께를 최적화 하여, 각각 2.8 %p, 1.5 %p, 2.8 %p의 효율 개선 효과를 얻었다. 위 세 가지 효과를 동시에 적용하면 50 um wafer에서 370 um wafer 효율의 결과와 근접한 24.2 %의 효율을 얻을 수 있었다. 향후에는 위의 결과를 바탕으로 실제 실험을 통하여 확인할 계획이다.
본 연구에서는 비대칭 이중게이트 MOSFET의 상하단 게이트 산화막 두께에 대한 드레인 유도 장벽 감소 현상에 대하여 분석하고자한다. 드레인 유도 장벽 감소 현상은 단채널 MOSFET에서 드레인전압에 의하여 소스측 전위장벽이 낮아지는 효과를 정량화하여 표현한다. 소스 측 전위장벽이 낮아지면 결국 문턱전압에 영향을 미치므로 드레인전압에 따른 문턱전압의 변화를 관찰할 것이다. 비대칭 이중게이트 MOSFET는 상단과 하단의 게이트 산화막 두께를 다르게 제작할 수 있는 특징이 있다. 그러므로 본 연구에서는 상단과 하단의 게이트 산화막 두께변화에 따른 드레인 유도 장벽 감소 현상을 포아송방정식의 해석학적 전위분포를 이용하여 분석하였다. 결과적으로 드레인 유도 장벽 감소 현상은 상하단 게이트 산화막 두께에 따라 큰 변화를 나타냈다. 또한 도핑농도에 따라 드레인유도장벽감소 현상이 큰 영향을 받고 있다는 것을 알 수 있었다.
본 논문에서는 비대칭 이중게이트 MOSFET의 상하단 게이트 산화막 두께에 대한 드레인 유도 장벽 감소 현상을 분석하기 위하여 전위장벽에 영향을 미치는 드레인전압에 따른 문턱전압의 변화를 관찰할 것이다. 비대칭 이중게이트 MOSFET는 상단과 하단의 게이트 산화막 두께를 다르게 제작할 수 있는 특징이 있다. 상단과 하단의 게이트 산화막 두께 변화에 따른 드레인 유도 장벽 감소 현상에 대하여 포아송방정식을 이용하여 분석하였다. 결과적으로 드레인 유도 장벽 감소 현상은 상하단 게이트 산화막 두께에 따라 큰 변화를 나타냈다. 상단과 하단 게이트 산화막 두께가 작을수록 드레인 유도 장벽은 선형적으로 감소하였다. 채널길이에 대한 드레인 유도 장벽 감소 값은 비선형적인 관계가 있었다. 고농도 채널도핑의 경우 상단 산화막 두께가 하단 산화막 두께보다 드레인 유도 장벽 감소에 더 큰 영향을 미치고 있었다.
최근 CMOS(Complementary Metal Oxide Semiconductor) 능동소자에 사용되는 MOS-FET (Metal Oxide Semiconductror Field Effect Transitror)의 전체적인 크기 감소추세에 따라 금속 전극과 반도체 사이의 절연층 두께 감소가 요구되고 있다. 현재 보편적으로 사용되고 있는 SiO$_2$층은 두께 감소에 따른 터널링 전류의 증가로 더 이상의 두께 감소를 기대하기 어려운 상태이다. 이러한 배경에서 최근 터널링 전류를 충분히 감소시키면서 요구되는 절연특성을 얻을 수 있는 새로운 고유전 물질 (high-k dielectric material)에 대한 연구가 이루어지고 있다. 현재까지 연구되어온 고유전 물질 중, 고유전 상수, 큰 밴드갭, Si과의 열적 안정성을 갖는 물질로 ZrO$_2$가 주목을 받고 있다. 본 연구에서는 Metal Organic Molecular Beam Epitaxy (MOMBE) 방법을 이용한 ZrO$_2$ 층의 성장조건 및 특성을 평가하고자 한다.
태양전지의 효율을 증가시키는 방법에는 표면 패시베이션, 접촉면적의 가변, back contact의 두께 가변 등이 있다. 특히, back contact 두께의 가변을 통하여 open circuit voltage의 감소를 최소화 할 수 있을 것이라고 전망 되고 있다. open circuit voltage 은 회로가 개방된 상태로, 무한대의 임피던스가 걸린 상태에서 빛을 받았을 때 태양전지의 양단에 전위차가 형성된다. 본 연구에서는 back contact 두께 가변에 따른, open circuit voltage의 변화를 확인하고 분석하는 것에 그 일차적인 초점을 두었다. 또한, open circuit voltage 뿐만 아니라, short circuit current density, fill factor, series resistance 등의 분석을 하였으며, efficiency를 계산하여 back contact 두께의 가변에 따른 소자 특성의 변화 분석을 통하여 최적화된 back contact위 두께를 연구하였다. 접촉면적에 따른 소자의 성능 변화는 후면 $SiN_X$ 70nm가 open circuit voltage를 15mV ~ 20mV 감소시키는 것을 확인 할 수 있었다. 그 이유는 $SiN_X$가 너무 두꺼우면 BSF 덜 형성되기 때문이다. 최종적으로 $SiN_X$ 두께를 얇게하면 open circuit voltage 의 감소를 최소화 할 수 있을 것이라는 판단을 할 수 있다. 이에, back contact인 $SiN_X$ 두께 가변에 따른 open circuit voltage의 변화를 확인하였다. $SiN_X$ 두께가 증가함에 따라, Positive charges 와 Hydrogen 함유량이 증가하며, 이에 BSF 두께 감소하였다. 또한, $SiN_X$ 두께가 감소함에 따라 Doping barrier로서 역할을 못하게 되어 후면에 n+층 형성되어 open circuit voltage가 급격히 하락하였다. 본 연구에서는 back contact인 $SiN_X$ 두께를 10nm, 30nm, 50nm, 80nm 로 가변하며 실험을 진행하였다.
SiOC 박막은 화학적 증착 방법에 의해 여러 가지 유량비를 다르게 하여 증착되었다. SiOC 박막에서 유전상수의 감소원인에 대하여 조사하고 샘플들은 박막의 두께와 유전상수사이의 상관성에 대하여 분석하였다. 증착한 샘플에서 박막의 두께는 굴절률에 비례하는 경향성이 있으며, 유전상수가 가장 낮은 샘플에서 두께는 감소되었다. 굴절률은 열처리 후 감소하였는데, 열처리 하면서 박막의 두께가 감소되었기 때문이다.
본 연구에서는 비대칭 이중게이트 MOSFET의 채널길이와 채널두께의 비에 따른 드레인 유도 장벽 감소 현상의 변화에 대하여 분석하고자한다. 드레인 전압이 소스 측 전위장벽에 영향을 미칠 정도로 단채널을 갖는 MOSFET에서 발생하는 중요한 이차효과인 드레인 유도 장벽 감소는 문턱전압의 이동 등 트랜지스터 특성에 심각한 영향을 미친다. 드레인 유도 장벽 감소현상을 분석하기 위하여 포아송방정식으로부터 급수형태의 전위분포를 유도하였으며 차단전류가 10-7 A/m일 경우 비대칭 이중게이트 MOSFET의 상단게이트 전압을 문턱전압으로 정의하였다. 비대칭 이중게이트 MOSFET는 단채널 효과를 감소시키면서 채널길이 및 채널두께를 초소형화할 수 있는 장점이 있으므로 본 연구에서는 채널길이와 두께 비에 따라 드레인 유도 장벽 감소를 관찰하였다. 결과적으로 드레인 유도 장벽 감소현상은 단채널에서 크게 나타났으며 하단게이트 전압, 상하단 게이트 산화막 두께 그리고 채널도핑 농도 등에 따라 큰 영향을 받고 있다는 것을 알 수 있었다.
퇴적층의 두께와 형성 기간을 분석하는 것은 퇴적분지의 발달사를 이해하기 위한 분지 해석과 모델링 연구에서 중요하다. 분지 발달 과정에서 퇴적층은 깊이가 증가함에 따라 다짐 작용에 의해 두께가 감소하고, 이 두께 변화는 깊이에 따른 공극률 변화 경향(다짐 작용 경향)을 통해 계산이 가능하다. 이 연구에서는 대표적인 퇴적암상인 사암, 셰일, 탄산염암의 깊이에 따른 공극률 변화 자료를 기반으로, 암상에 따른 다짐 작용 경향의 범위를 지수 함수를 이용하여 정량화하였다. 그리고 다짐 작용이 퇴적층의 공극률과 두께 변화에 미치는 영향을 수치해석적 방법을 이용해 평가하였다. 사암은 초기 공극률의 범위가 좁고 깊이 증가에 따른 공극률 감소 경향이 비교적 일정하여, 다짐 작용에 의한 층두께의 변화 범위가 작다. 셰일은 약 2,000 m 깊이까지 공극률이 빠르게 감소한 후, 급격히 낮아진 감소율을 보이며 이는 퇴적층의 두께 변화에도 반영된다. 탄산염암은 초기 공극률의 범위가 넓고, 깊이 증가에 따른 공극률 감소 양상의 차이가 커서, 결과적으로 다짐 작용에 의해 감소한 퇴적층 두께 차이의 범위도 크게 나타난다. 이 수치 해석적 다짐 작용 연구의 정량적 분석 결과에서 나타난 각 암상들의 다짐 작용에 따른 공극률과 층두께 감소의 특징들은 퇴적분지의 생성과 발달 과정을 이해하기 위해 필요한 퇴적층 두께 복원과 침강사 그리고 지열 작용 분석에 영향을 끼치며, 이는 다짐 작용 경향이 분지 모델링 연구에서 중요한 요소이며 적절한 적용이 필요함을 보여준다.
편광에 따른 성능 변화가 작은 deep-ridge 도파관 구조에 제작이 용이한 double-sided 프로세스를 이용하여 구현할 수 있는 편광에 무관한 매우 짧은 결합 길이를 가지는 double-sided deep-ridge 도파관 구조를 가지는 새로운 수직 방향성 결합기를 제안하고 여러 가지 구조 파라미터들이 결합길이에 미치는 영향에 대하여 연구하였다. 도파관 폭의 변화에 대한 결합길이의 변화는 코어 두께의 변화에 대한 결합길이의 변화보다 작게 나타나는 것을 볼 수 있었다. 내부 클래딩 영역의 두께가 감소할수록, 코어 두께가 감소할수록 결합 길이가 감소함을 볼 수 있었다. 또한 같은 코어 두께에 대해서는 내부 클래딩 영역의 두께가 감소할수록, 같은 내부 클래딩 영역의 두께에 대해서는 코어 두께가 감소할수록 편광에 관계없이 결합 길이가 같아지는 도파관 폭이 작아짐을 볼 수 있었다.
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[게시일 2004년 10월 1일]
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