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Ku-대역 50 W급 GaN HEMT 내부 정합 전력증폭기 (Ku-Band 50-W GaN HEMT Internally-Matched Power Amplifier)

  • 김세일;이민표;홍성준;임준수;김동욱
    • 한국전자파학회논문지
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    • 제30권1호
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    • pp.8-11
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    • 2019
  • 본 논문에서는 Wolfspeed사(社)의 CGHV1J070D GaN HEMT를 사용하여 Ku-대역에서 동작하는 50 W급 내부 정합 전력증폭기를 설계하고 제작하였다. 전력 트랜지스터를 구성하는 단위 트랜지스터 셀의 출력 신호 간 크기와 위상을 맞추기 위해 슬릿과 비대칭 T-junction을 입출력 정합회로에 사용하였다. 비유전율이 40과 9.8인 두 종류의 박막 기판을 사용하여 제작된 내부 정합 전력증폭기는 펄스 주기 $330{\mu}s$, 듀티 6 %의 펄스 모드 조건에서 전력 성능이 측정되었으며, 16.2~16.8 GHz에서 50~73 W의 포화 출력 전력과 35.4~46.4 %의 드레인 효율, 4.5~6.5 dB의 전력 이득을 보였다.

가시광 통신을 이용한 사용자 인식 시스템 (An User-aware System using Visible Light Communication)

  • 김종수;이원영
    • 한국전자통신학회논문지
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    • 제14권4호
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    • pp.715-722
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    • 2019
  • 본 논문은 가시광 통신을 이용한 사용자 인식 시스템의 구현 방법과 시스템 동작 결과를 소개하고 있다. 가시광 통신을 이용한 사용자 인식 시스템은 안드로이드 시스템 기반의 송신부와 오픈소스 컨트롤러 기반의 수신부로 나뉘어져 있다. 송신부 모듈에서는 사용자의 개인 인식 정보 데이터를 코드로 변환하고 이를 안드로이드 기반의 스마트폰 카메라 인터페이스를 사용하여 가시광으로 변환하여 수신부로 전송한다. 수신부에서는 포토다이오드 모듈을 통해 가시광을 수신하고 이를 전기신호로 변환한다. 수신 데이터에 대한 프로세싱 모듈역할은 오픈소스 컨트롤러가 맡게 되며, 본 시스템에서는 AVR 마이크로 컨트롤러 기반의 아두이노를 사용하였다. 버스트모드(burst mode) 방식의 통신이 가능하도록 0111의 비트 패턴을 스타트비트로 설정하고 이를 인식하도록 하였다. 실험 결과, 제안하는 시스템은 가시광을 매개로 맨체스터 데이터 인코딩 (Manchester data encoding)방식의 데이터 송신과 수신이 가능함을 확인하였다.

에어 하키 게임을 위한 2축 직교 좌표 로봇 최적화 (2-Axis Cartesian Coordinate Robot Optimization for Air Hockey Game)

  • 김희연;이원재;유윤섭;김남호
    • 한국정보통신학회:학술대회논문집
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    • 한국정보통신학회 2019년도 춘계학술대회
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    • pp.436-438
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    • 2019
  • 에어하키 로봇은 머신 비전 시스템으로 하키 공을 카메라를 통해 인식하여 사용자와 플레이를 할 수 있다. 하키 공의 위치 감지는 OpenCV 라이브러리를 사용하여 공의 색 정보를 이용하여 인식하게 구현하였다. 하키 공의 위치를 감지하고 또한 그 궤적을 예측하여 결과를 ARM Cortex-M 보드로 전송한다. ARM Cortex-M보드는 2축 직교 로봇을 제어하여 에어 하키 경기를 진행한다. 에어 하키 로봇의 전략에 따라 수비, 공격, 수비과 공격 모드로 동작시킬 수 있다. 본 논문에서는 비전 시스템 개발과 궤적 예측 시스템에 관해 기술하고 에어 하키 경기를 진행하는 2축 직교 로봇을 제어하는 새로운 방법을 제시한다.

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Cortex-M0 기반의 보안 SoC 프로토타입 설계 (A Design of Security SoC Prototype Based on Cortex-M0)

  • 최준백;최준영;신경욱
    • 한국정보통신학회:학술대회논문집
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    • 한국정보통신학회 2019년도 춘계학술대회
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    • pp.251-253
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    • 2019
  • 마이크로프로세서에 블록암호 크립토 코어를 인터페이스한 보안 SoC (System-on-Chip) 프로토타입 구현에 대해 기술한다. 마이크로프로세서로 Cortex-M0를 사용하였고, ARIA와 AES를 단일 하드웨어에 통합하여 구현한 크립토 코어가 IP로 사용되었다. 통합 ARIA-AES 크립토 코어는 ECB, CBC, CFB, CTR, OFB의 5가지 운영모드와 128-비트, 256-비트의 두 가지 마스터키 길이를 지원한다. 통합 ARIA-AES 크립토 코어를 Cortex-M0의 AHB-light 버스 프로토콜에 맞게 동작하도록 인터페이스 하였으며, 보안 SoC 프로토타입은 BFM 시뮬레이션 검증 후, FPGA 디바이스에 구현하여 하드웨어-소프트웨어 통합검증을 하였다.

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고준위방사성폐기물 처분장 모니터링용 피에조센서의 온도 스트레스에 관한 가속수명시험 설계 (Design of accelerated life test on temperature stress of piezoelectric sensor for monitoring high-level nuclear waste repository)

  • 황현중;박창희;홍창호;김진섭;조계춘
    • 한국터널지하공간학회 논문집
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    • 제24권6호
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    • pp.451-464
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    • 2022
  • 고준위방사성폐기물 처분장은 심지층 처분시스템으로 사용후핵연료를 취급하는 특성상 고온, 방사선 및 지하수 등의 복합적인 환경조건에 노출되어 있다. 지속적인 노출에 의해 시간이 지남에 따라 구조물의 균열 및 열화가 발생할 수 있다. 한편 고준위방사성폐기물 처분장은 초장기 기대수명이 요구되며 이에 따른 장기적인 구조물 건전성 모니터링이 필수적이다. 구조물 건전성 모니터링에는 가속도계, 토압계, 변위계 등 다양한 센서들이 활용될 수 있으며, 이 중 일반적으로 피에조센서가 사용된다. 따라서 피에조센서의 내구성 평가를 바탕으로 고내구성 센서를 개발할 필요가 있다. 본 연구에서는 피에조센서의 내구성 평가 및 수명예측을 위한 가속수명시험을 설계하였다. 문헌연구를 바탕으로 단일 스트레스 인자에 대한 가속 스트레스 수준 수 및 각 수준 별 시료 수를 선정하였다. 또한 고준위방사성폐기물 처분장 환경조건에서 발생할 수 있는 피에조센서의 고장모드 및 고장메커니즘을 분석하였다. 온도 스트레스 인자에 대한 최대 가혹조건 탐색 실험을 두 가지 방법으로 제안하였으며 피에조센서의 신뢰도 높은 동작한계를 도출하였다. 이를 이용하여 가속수명시험의 합리적인 가속 스트레스 수준을 설정하였다. 본 연구에서 제시된 최대 가혹조건 탐색 실험방법은 경제적이며 실용적인 아이디어를 담고 있으며, 추후 피에조센서의 가속수명시험 설계에 널리 활용될 수 있을 것으로 판단된다.

대면적 APD를 이용한 LADAR용 광대역 광수신기 (Wideband Receiver Module for LADAR Using Large Area InGaAs Avalanche Photodiode)

  • 박찬용;김덕봉;김충환;권용준;강응철;이창재;최순규;라종필;고진신
    • 한국광학회지
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    • 제24권1호
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    • pp.1-8
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    • 2013
  • 본 논문에서는 3차원 영상을 위한 LADAR(LAser Detection And Ranging)용 광검출기 모듈을 설계-제작하고 그 특성을 측정한 결과를 보고한다. 광검출기 모듈은 광파이버 어레이와 접속될 수 있도록 200 um 직경을 갖는 InGaAs APD(Avalanche Photodiode)로 설계-제작하였으며, 선형모드 동작 특성을 만족하도록 TIA(Trans-impedance Amplifier)를 설계-제작하였다. 광검출기 모듈을 구성하는 핵심부품들은 12개의 lead pin을 갖는 TO8 상에 집적되었으며, 집적에 필요한 APD 서브마운트 및 TIA 회로 등을 자체적으로 설계-제작하여 사용하였다. 제작한 광검출기 모듈은 450 ps의 rising time과 780 MHz의 대역폭 특성을 보였으며, 0.8 mV 이하의 잡음 특성과, 150 nW의 MDS(Minimum Detectable Signal) 신호 크기에 대해 15 이상의 신호대 잡음비(SNR)를 보임으로써 설계한 모든 특성을 만족하였는데, 이는 저자들이 아는 한 200 um 직경의 대면적 InGaAs APD를 이용한 광수신기에서 가장 우수한 특성을 나타낸 것이다.

굽힘응력을 받는 유연전자소자에서 중립축 위치의 제어 (Control of Position of Neutral Line in Flexible Microelectronic System Under Bending Stress)

  • 서승호;이재학;송준엽;이원준
    • 마이크로전자및패키징학회지
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    • 제23권2호
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    • pp.79-84
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    • 2016
  • 유연전자소자가 외부힘에 의해 변형될 경우 반도체 다이가 기계적 응력 때문에 변형되거나 파괴되고 이러한 변형이나 파괴는 channel의 전자이동도를 변화시키거나 배선의 저항을 증가시켜 집적회로의 동작 오류를 발생시킨다. 따라서 반도체 집적회로는 굽힘 변형이 발생해도 기계적 응력이 발생하지 않는 중립축에 위치하는 것이 바람직하다. 본 연구에서는 굽힘변형을 하는 flip-chip 접합공정이 적용된 face-down flexible packaging system에서 중립축의 위치와 파괴 모드를 조사하였고 반도체 집적회로와 집중응력이 발생한 곳의 응력을 감소시킬 수 있는 방법을 제시하였다. 이를 위해, 설계인자로 유연기판의 두께 및 소재, 반도체 다이의 두께를 고려하였고 설계인자가 중립축의 위치에 미치는 영향을 조사한 결과 유연기판의 두께가 중립축의 위치를 조절하는데 유용한 설계인자임을 알 수 있었다. 3차원 모델을 이용한 유한요소해석 결과 반도체 다이와 유연기판 사이의 Cu bump 접합부에서 항복응력보다 높은 응력이 인가될 수 있음을 확인하였다. 마지막으로 flexible face-down packaging system에서 반도체 다이와 Cu bump 의 응력을 감소시킬 수 있는 설계 방법을 제안하였다.

공급 전압 변화에 둔감한 Gbps급 저전력 LVDS I/O회로 (Power Supply-Insensitive Gbps Low Power LVDS I/O Circuits)

  • 김재곤;김삼동;황인석
    • 대한전자공학회논문지SD
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    • 제44권6호
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    • pp.19-27
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    • 2007
  • 본 논문에서는 공급전압 변화에 둔감한 Gbps급 저전력 LVDS I/O회로를 설계하였다. 제안된 LVDS I/O는 1.8 V, $0.18\;{\mu}m$ TSMC 공정을 이용하여 설계, 시뮬레이션 및 검증하였다. 설계된 LVDS I/O회로는 송신단과 수신단을 포함한다. 제안하는 송신단은 phase splitter와 SC-CMFB를 이용한 출력버퍼로 구성된다. phase splitter의 출력은 공급 전압이 변화하여도 $50{\pm}2%$의 duty cycle을 가지며 $180{\pm}0.2^{\circ}$의 위상차를 가진다. 출력 버퍼는 SC-CMFB를 이용하여 허용 가능한 $V_{CM}$ 전압 값인 $1.2{\pm}0.1V$을 유지하도록 설계하였다. $V_{OD}$전압 또한 허용범위에서 최소값인 250 mV를 갖도록 설계하여 저전력 동작이 가능하도록 구성하였다 수신단은 38 mV의 히스테리시스 전압값을 가지면서 DC옵셋 전압값이 $0.2{\pm}2.6 V$로 넓은 공통 모드전압 범위가 가능하도록 설계하였고 공급전압 변화에도 rail-to-rail로 복원할 수 있는 기능을 가지고 있다. 또한, 수신단은 1 GHz에서 38.9 dB의 높은 전압 이득을 갖도록 설계하였다.

고성능 디스플레이 응용을 위한 8b 240 MS/s 1.36 ㎟ 104 mW 0.18 um CMOS ADC (An 8b 240 MS/s 1.36 ㎟ 104 mW 0.18 um CMOS ADC for High-Performance Display Applications)

  • 이경훈;김세원;조영재;문경준;지용;이승훈
    • 대한전자공학회논문지SD
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    • 제42권1호
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    • pp.47-55
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    • 2005
  • 본 논문에서는 각종 고성능 디스플레이 등 주로 고속에서 저전력과 소면적을 동시에 요구하는 시스템 응용을 위한 임베디드 코어 셀로서의 8b 240 MS/s CMOS A/D 변환기 (ADC)를 제안한다. 제안하는 ADC는 아날로그 입력, 디지털 출력 및 전원을 제외한 나머지 모든 신호는 칩 내부에서 발생시켰으며, 본 설계에서 요구하는 240 MS/s 사양에서 면적 및 전력을 동시에 최적화하기 위해 2단 파이프라인 구조를 사용하였다. 특히 입력 단에서 높은 입력 신호 대역폭을 얻기 위해 개선된 부트스트래핑기법을 제안함과 동시에 잡음 성능을 향상시키기 위해 제안하는 온-칩 전류/전압 발생기를 온-칩 RC 저대역 필터와 함께 칩 내부에 집적하였으며, 휴대 응용을 위한 저전력 비동작 모드 등 각종 회로 설계 기법을 적절히 응용하였다. 제안하는 시제품 ADC는 듀얼모드 입력을 처리하는 DVD 시스템의 핵심 코어 셀로 집적되었으며, 성능 검증을 위해 0.18um CMOS 공정으로 별도로 제작되었고, 측정된 DNL과 INL은 각각 0.49 LSB, 0.69 LSB 수준을 보여준다. 또한, 시제품측정 결과 240 MS/s 샘플링 속도에서 최대 53 dB의 SFDR을 얻을 수 있었고, 입력 주파수가 Nyquist 입력인 120 MHz까지 증가하는 동안 38 dB 이상의 SNDR과 50 dB 이상의 SFDR을 유지하였다. 시제품 ADC의 칩 면적은 1.36 ㎟이며, 240 MS/s 에서 측정된 전력 소모는 104 mW이다.

2.4GHz RFID 태그용 고조파 억제를 위한 저역통과필터의 설계 (A Low-pass filter design for suppressing the harmonics of 2.4GHz RFID tag)

  • 조영빈;김병수;김장권
    • 대한전자공학회논문지TE
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    • 제39권3호
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    • pp.59-64
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    • 2002
  • ISM 대역을 사용하는 RFID 시스템에서 대상물에 장착되는 태그는 내장된 컨트롤러와 메모리를 동작시키기 위해서 소형 안테나로부터 들어온 전파 신호를 쇼트키 다이오드로 정류하여 전원으로 사용하게 된다. 반도체 소자의 비선형성에 의한 고조파 성분과 안테나의 고차 모드의 공진으로 여기되는 불요파는 태그의 성능 저하를 가져온다. 본 논문에서는 2차 고조파 성분을 제거함으로써 시스템 효율을 개선하기 위하여 "스터브 I 형 DGS 슬롯 구조"를 이용한 새로운 형태의 저역통과 필터를 구현하였다. 스터브 폭과 I 형 슬롯의 연결 폭을 조정하여 최적의 통과대역 및 저지대역 주파수 특성을 갖도록 설계하고 제작하였다. 제작된 저역통과 필터의 측정결과는 차단 주파수는 3.25 GHz 이고 2.4 GHz~2.5 GHz 의 대역에서 삽입손실은 -0.29~-0.3 dB 이고 반사손실은 -27.688~-33.665 dB 로 비교적 양호한 특성을 보여주고 있으며, 2배 고조파의 대역인 4.9 GHz 에서의 저지특성은 약 -19.367 dB를 보여준다. 이 구조의 필터를 이용하여 RFID, WLAN 등의 응용에 적용되어 고조파와 불요파를 제거함으로서 시스템 효율의 개선에 사용할 수 있을 것이다.