• 한국추진공학회지
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• 제16권4호
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• pp.23-32
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• 2012

본 연구에서는 가변 안내익과 가변 정익을 가진 압축기가 적용된 소형 터보팬엔진의 통합성능해석법에 대한 연구를 수행하였다. 통합해석을 위해 Isight를 이용하여 엔진성능해석프로그램(NPSS)과 압축기탈 설계점 성능프로그램(STGSTK)을 연계하여 해석할 수 있는 절차 및 연계프로그램을 구축하였다. 각각의 해석프로그램은 실험데이터와 비교하여 타당성을 검증하였다. 이러한 통합 해석법을 적용한 결과 탈설계점에서 요구되는 서지마진을 가지는 가변시스템의 작동 조건을 예측할 수 있었다.

• 한국지능시스템학회:학술대회논문집
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• 한국퍼지및지능시스템학회 2000년도 추계학술대회 학술발표 논문집
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• pp.363-366
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• 2000

본 논문에서는 브러쉬없는 직류전동기의 위치제어를 위한 직접적응 퍼지가변구조제어기를 설계한다. 가변구조제어는 시스템의 파라메터 변화나 외란에 둔감한 특성을 갖는 반면 떨림현상의 문제점을 가지고 있다. 떨림현상의 진폭은 시스템의 불확실정보를 최악의 상태로 가정한 후 결정되므로, 기존의 가변구조제어에서는 그 크기가 너무 크다. 또한 이런 불확실한 요소들의 최대값은 찾아내기도 어렵다. 본 논문에서는 불확실한 요소의 최대값을 최적으로 추정하기 위하여 퍼지 추론 기법을 사용한다. 아울러 소속함수의 원소들을 직접적응 기법에 의하여 자동 조정할 수 있는 기법을 추가한다. 이를 통하여 우수한 제어 성능을 얻을 수 있음을 확인한다.

• 한국전자파학회:학술대회논문집
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• 한국전자파학회 2000년도 종합학술발표회 논문집 Vol.10 No.1
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• pp.146-149
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• 2000

SiGe HUT뜰 이용하여 Cellular 주파수 대역(824-849 MHz)에서 MMIC 상향 주파수 혼합기와 가변이득 증폭기를 설계하였다. 동작 전압은 2.7 V 이며, 이중평형 구조의 상향 주파수 혼합기는 12 dB의 변환이득, -0.6 dBm의 1dB 이득압축 출력전력, 30 dB 이상의 LO-RF 단자 격리도 특성, 1.25의 LO-VSWR. 1.34의 RF-VSWR을 가지며, 상호컨덕턴스형 가변이득 증폭기는 35 dB의 최대 선형이득, 13 dBm의 1dB 이득압축 출력전력, 42dB의 가변이득, 23dB의 3차 상호변조 교점 출력전력(OIP$_3$), 1.27의 입력 VSWR, 1.1의 출력 VSWR 특성을 보인다.

• 한국수자원학회:학술대회논문집
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• 한국수자원학회 2006년도 학술발표회 논문집
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• pp.1651-1655
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• 2006

일반적인 하천에서 이 치수를 위한 하천 구조물설계를 위해서는 흐름해석이 매우 중요한 작업 중 하나이다. 하천의 흐름해석은 주어진 유량에 대해 등류 또는 부등류, 부정류 계산을 통하여 해석을 하게 되는데, 이때 조도계수는 매우 중요한 매개변수이며, 조도계수에 의해 흐름해석의 결과가 크게 좌우된다. 이러한 조도계수는 어느 특정의 확정적인 요소에 의해 결정되어지지 않고, 복합적인 요소에 의해 결정되어지며, 특히, 유량에 대해 가변성을 갖는다. 본 연구에서는 조도계수의 유량에 대한 가변적인 특성을 분석하고자, 각각 다른 하상경사를 가지는 하천들에 대해 조도계수를 산정하였다. 그 결과, 조도계수는 유량에 대해 가변성을 갖는 것을 확인할 수 있었다. 그리고 하상경사가 완만한 하천일수록 유량에 대한 조도계수의 가변성이 크게 나타났으며, 하상경사가 급할수록 유량에 대한 조도계수의 가변성이 적게 나타나는 결과를 도출하여 유량에 대한 조도계수의 가변성이 하상경사에 민감하게 반응하는 것을 확인할 수 있었다.

• 한국산업정보학회:학술대회논문집
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• 한국산업정보학회 1998년도 춘계공동학술대회 발표논문집 IMF시대의정보화 추진전략
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• pp.313-319
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• 1998

본 논문에서는 슬라이딩모드 제어이득을 실시간으로 계산하여 적응시키는 적응 가변구조제어기 설계방법을 제시한다. 제시된 방법은 간단한 계산으로 슬라이딩모드제어의 조건을 만족시키도록 제이이득을 변화시키므로 채터링을 감소시키고 추적오차성능을 개선시킨다. 계산시간이 적어 실시간 제어에 적용이 쉬운 장점이 있다. 제시된 제어방법을 기존의 방법과 비교하여 설계의 예를 보였고 시뮬레이션을 통하여 제시된 방법의 유용성을 보였다.

• 전자공학회논문지C
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• 제35C권11호
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• pp.39-47
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• 1998

본 논문에서는 공유 버퍼 ATM 스위치를 위한 파이프라인 방식의 고속 메모리 구조를 제안하고 설계하였다. 제안된 메모리 구조는 빠른 동작 속도와 용량 가변성을 지원하여 공유 버퍼 ATM 스위치가 가지는 메모리 cycle time의 제한을 극복하였다. 본 메모리 구조가 지원하는 용량 가변성은 ATM 스위치에서의 교환 성능 가변성을 제공한다. 본 메모리 구조는 작은 메모리 bank들로 이루어진 2차원 배열 구조를 가진다. 메모리 용량은 부가적인 메모리 bank들을 추가하여 메모리 bank들의 배열 크기를 증가 시킴으로 인해 증가된다. 설계된 파이프라인 방식의 메모리는 4160 bit 메모리 bank를 16개 이용하여 4 × 4의 배열로 설계하였고 전체 용량은 65 Kbit이다. 레이아웃후 시뮬레이션을 통한 최대 동작 속도는 5 VV/sub dd/ 및 25℃에서 4ns이다. 설계된 메모리는 공유 가변 버퍼 ATM 스위치의 시험 설계된 칩에 내장되었다. 시험 설계된 칩은 0.6 ㎛ 2-metal 1-poly CMOS 공정 기술을 이용하여 설계하였다.

• 대한전기학회:학술대회논문집
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• 대한전기학회 2008년도 제39회 하계학술대회
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• pp.1927-1928
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• 2008

가변 이득 및 차단주파수 특성을 가지는 5차 CMOS Gm-C 필터를 설계하였다. 설계된 필터는 CMOS 차동 트랜스컨덕터들로 구성하였으며 트랜스컨덕터들은 각각 전압 조정에 의하여 트랜스컨덕턴스 값이 변환되도록 설계하였다. 가변 차단주파수 특성은 외부잡음으로 발생할 수 있는 필터 차단주파수의 변형을 보상할 수 있고 한 개의 필터로써 다중대역 수신 단에 적용할 수 있도록 하고자 하였다. HSPICE 시뮬레이션 결과, 1.5MHz$\sim$3.5MHz의 차단주파수의 조정이 가능하였고 이득은 -2.8dB$\sim$2.6dB으로의 조정이 가능하였다.

• 한국전자파학회논문지
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• 제11권1호
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• pp.76-83
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• 2000

본 논문에서는 세라믹 동축 공진기와 Varactor Diode를 이용하여 800MHz~900MHz에서 2단 가변 대역통과 여파기를 설계 제작하였다. ABCD Parameter를 이용하여 $\pi$형 Inverter를 T형 등가회로로 변환하여 Varactor Diode 수를 2개로 최적화하였다. 가변대역은 800MHz~900MHz이며 삽입손실을 $405dB\pm0.5dB$ 이내 반사손실은 15dB 이상으로 설계하였다. 제작된 대역통과 여파기는 Simulation 결과와 잘 일치하였다.

• 한국통신학회논문지
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• 제32권5A호
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• pp.497-502
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• 2007

피드포워드 방식을 이용하여 광대역, 선형 이득 제어 특성을 갖는 SiGe HBT 가변 이득 증폭기를 설계 및 제작하였다. 가변 이득 증폭기는 능동 발룬, 차동형 주 증폭기, 피드포워드 블록, 전압 조절부로 구성 되었으며, 주 증폭기와 피드포워드 블록의 신호가 역위상으로 상쇄되어 광대역의 선형 이득 제어가 가능하도록 각 부분을 최적화 시켰다. 설계된 가변 이득 증폭기는 STMicroelectronics사(社)의 0.35 ${\mu}m$ Si-BiCMOS 공정을 이용하여 제작하였다. 제작 및 측정 결과, 피드포워드 방식의 가변 이득 증폭기는 4 GHz($4\;GHZ{\sim}8\;GHz$)의 광대역 특성을 나타내었다. 또한, 제작된 가변 이득 증폭기는 6 GHz에서 9.3 dB의 최대 이득과 0.6 - 2.6 V의 조절 전압 인가시 19.6 dB의 이득 조절 범위 특성을 나타내었으며, 8 GHz에서 -3 dBm의 출력 전력 특성을 각각 나타내었다.

• 대한전자공학회논문지SD
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• 제48권7호
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• pp.23-29
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• 2011

본 논문에서는 GPS 수신기를 위한 dB-선형 특성이 개선된 가변 이득 증폭기 회로를 제안한다. 제안된 dB-선형 전류 발생기는 dB-선형성 오차가 ${\pm}0.15$dB 이내로 개선되었다. 개선된 dB-선형 전류 발생기를 사용하여 GPS 수신기를 위한 가변 이득 증폭기를 설계였다. GPS 수신기의 IF 주파수는 4MHz를 가정하였고, 선형성 요구조건을 도출하여 만족하기 위해 최소 이득일때 24dBm의 IIP3를 만족하도록 하였다. 가변이득 증폭기는 3단으로 구성되어 있으며 DC-오프셋 제거 루프를 통하여 회로의 오프셋 전압을 보상하였다. 설계된 가변 이득 증폭기의 이득은 -8dB~52dB의 범위를 가지며 이득의 dB-선형성은 ${\pm}0.2$dB 이내를 충족한다. 3-dB 주파수 대역폭은 이득에 따라 35MHz~106MHz를 보인다. 가변 이득 증폭기는 CMOS 0.18${\mu}m$ 공정을 이용하여 설계되었으며 전력은 1.8V 전원 전압에서 3mW를 소비한다.