Up today, nationally published research results on the methods used in HA modems have studied and shown the major methods; the ASK method and the DS/SS method. In this paper, we applied the DPSK reception method on the PSK method so that solved the acquisition and tracking problem of the signal synchronization which is the defect of PSK. Also, it has been designed to fit in the CISRP and CENELEC specification so that make sure of no effects on other part of the system.
본 논문에서는 binary offset carrier (BOC) 신호를 위한 새로운 상관함수 주변첨두 제거 기법을 제안한다. 제안한 기법은 BOC 자기상관함수를 구성하는 부상관함수의 결합에 기반을 두고 있으며, 수신기에서 보조 신호를 필요로 하지 않고, sine 위상 및 cosine 위상 BOC 신호에 모두 적용이 가능하다. 또한 모의실험 결과를 통해 제안한 기법이 기존의 기법들에 비해 더 좋은 신호 추적 성능을 가짐을 보인다.
The series connection of power switching semiconductor elements is essential when a high voltage converter is made, so researches are being conducted to further develop this technology. In the series connection of power switching semiconductor elements, the main problem is that simultaneous conduction at turn-on and simultaneous blocking at turn-off together with voltage balancing are unattainable because of the difference of their switching characteristics. In this paper a novel series connection algorithm is proposed, which can implement not only the synchronization of the points of turn-on and turn-off time but the dynamic voltage balancing in spite of the difference of each switching characteristics. The proposed method is that the compensated control signal is attained from the voltage feedback signal and applied to the series-connected power transistors independently. Computer simulation and experimental results verify its validity.
The recent summer power peak crisis has been caused by excessive use of cooling loads at daily peak time in summer. The yearly load shape of KEPCO has gradually became very steep valley. Under this situation, more efficient DSM(Demand Side Management) tools are fully required for summer peak clipping and shaving. In this paper, the KEPCO's Jeju-Do model project for DSM, especially for Demand Controller, is presented. Demand Controller was evaluated to have the very high economical efficiency against the investment in equipment, as compared with another DSM tools. There were some serious problem to apply Demand Controller to many customers in the aspect to synchronization with KEPCO's watthour meter. But these problems have solved by Keyin's new Demand Controller using vision algorithm.
본 논문에서는 Type 1 relay를 이용하는 3GPP (3rd Generation Pattnership Project) LTE Long Term Evolution)-Advanced 시스템을 위한 부분 전이중 (partial full duplex) relay 기법을 제안한다. Type 1 relay는 백홀 링크 (backhaul link)와 액세스 링크 (access link)가 같은 대역을 이용하는 inband relay로 동시에 백홀 링크와 액세스 링크에서 송수신 하는 경우에 self-interference가 발생하여 수신 성능이 크게 열화되기 때문에 동시에 송수신할 수 없다. 이와 같은 특징 때문에 Type 1 relay는 eNB (evolved NodeB)가 동기 신호를 송신할 때, 자신에게 접속하고 있는 R-UE (Relay-User Equipment)에게 동기 신호를 송신해야 하는 특정에 의해서 eNB가 송신하는 동기 신호를 수신할 수 없어 셀 ID (Identity)를 검출할 수 없는 문제점을 갖는다. 따라서, 이러한 문제점을 해결하기 위하여 본 논문에서는 eNB와 Type 1 relay가 동기 신호를 송신하는 subframe에서만 Type 1 relay가 동시에 송수신하는 부분 전이중 relay 기법을 제안한다. 또한, 동시에 Type 1 relay가 백홀 링크와 액세스 링크에서 송수신하여 발생하는 self-interference를 제거하기 위하여 Type 1 relay의 송수신 안테나 사이의 공간적 분리 (geometric isolation)와 SIC (Self-Interference Cancellation) 방식을 적용하고, SIC의 성능을 높이기 위한 정확한 채널 추정 방안으로 부분 채널 추정 (partial channel estimation) 기법을 제안하며, 다양한 환경에서의 성능 평가를 통해 제안된 방식이 Type 1 relay를 이용하는 3GPP LTE-Advanced 시스템에서 매우 유용한 것을 입증하였다.
최근 무어의 법칙을 연장시킬 시스템 집적 기술로서 Field Programmable Stateful Logic Array (FPSLA)가 제안되었다. 본 논문은 FPSLA의 설계 자동화 절차를 확립하고 논리 합성, 동기화, 물리적 매핑, 자동 배치 등의 접근 방법을 최초로 제시한다. 특히, 동기화를 통해 배치를 1차원 문제로 축소한 후 비선형 최적화 기법을 개량한 개략 배치 모델 및 하향식 계층적 2분법을 이용한 배치 적법화 알고리즘을 제안하였다. 또한, 제안된 모델 및 알고리즘을 소프트웨어로 구현하여 ACM/SIGDA 벤치 마크 예제에 적용함으로써 그 유효성을 입증하였다. 이 소프트웨어에는 Fanout 수만큼 출력 상태를 같은 단의 멤리스터성 스위치에 복사해야 하는 FPSLA의 특성을 고려하여 최적화 단계 별로 넷을 하이퍼에지로 통합했다가 다시 에지로 분리하는 기법이 제안되었으며 약 18.4%의 추가적 최적화를 이룩했다. FPSLA의 출력 상태 복사는 논리 단 일부에 셀 밀도가 집중되는 문제를 노출했으며 단위 논리 게이트의 Fanin을 제한하는 기법으로 18.5% 감소 효과를 얻었다. FPSLA의 실용성 확보를 위해서는 우선 논리 합성 시 Fanin의 수가 일부 단에 집중되지 않도록 제약하는 방안을 개발하여야 한다. 또한, FPSLA 패브릭 구조를 이식하기 위해 대칭성이 감소된 나노와이어 크로스바가 형성하는 복잡한 그래프 상에서 수행되어야 하는 자동 배선의 효율성 연구도 필요하다. 이러한 툴 개발은 설계 자동화 자체뿐만 아니라 FPSLA의 패브릭 구조 개선에 필요한 실험에 유용한 평가 도구로서도 큰 역할을 할 것이다.
사용자 고유번호와 패스워드 기반의 사용자 인증 매커니즘을 수행하는 네트워크 시스템 환경에서는 스니퍼 프로그램 등을 이용하여 불법 도청함으로써 쉽게 사용자의 패스워드를 알아낼 수 있다. 이러한 불법적인 도청에 의한 패스워드 노출 문제를 해결하는 방법으로 일회용 패스워드, Challenge-Response 인증 방식이 유용하게 사용되며, 클라이언트/서버 환경에서는 별도 동기가 필요 없는 시간을 이용한 일회용 패스워드 방식이 특히 유용하게 사용될 수 있다. 안전성은 Square root problem에 기초를 두고 있고, 프리플레이 공격, 오프라인 사전적 공격 그리고 서버 등을 포함하여 지금까지 잘 알려진 공격들에 대해서 안전성을 높이기 위한 OPI(One Pass Identification)을 제안한다. OPI는 패스워드를 생성하는데 특별한 키를 생성할 필요가 없다는 것이다. OPI는 승인된 자를 확인된 데 걸리는 시간이 적게 소요되면서 뛰어났다.
This study proposes a grid voltage estimation scheme without a phase delay in the voltage-sensorless control of a grid-connected inverter to enhance its economic feasibility, such as manufacturing cost and system complexity. The proposed scheme estimates grid voltages using a disturbance observer (DOB)-based current controller to control the grid-connected inverter without grid-side voltage sensors. The proposed voltage-sensorless control scheme can be applied successfully to grid-connected inverters, which should be operated with synchronization to the grid, considering the phase angle of the grid can be effectively detected through estimating the grid voltages by DOB. However, a problem associated with the phase delay in estimated grid voltages remains because the DOB has dynamic behavior similar to low-pass filter. Hence, the estimated grid voltages are compensated by a phase lead compensator to overcome the limitation. The effectiveness of the proposed control and estimation schemes is proven through simulations and experiments using a 2 kVA prototype inverter.
유전자 알고리즘(GA: Genetic Algorithm)은 다양한 영역에서 NP 문제를 해결하는 방법으로 알려져 있다. GA는 긴 연산 시간을 필요하다는 결점 때문에 최근 GA를 하드웨어로 구현하려는 연구가 주목 받아왔다. 본 논문은 GA의 하드웨어 구현을 위한 전용 원칩 컴퓨터를 제안한다. 제안된 전용 원칩 컴퓨터는16 비트 CPU core와 하드웨어 GA로 구성되어 있다. 기존의 하드웨어 GA는 GA의 처리하는데 있어서 메인 컴퓨터에 의존적이었으나 제안된 전용 원칩 컴퓨터는 메인 컴퓨터에 독립적이다. 또한 기존의 하드웨어 GA는 염색체의 길이가 고정되어 있는 데 비해 제안된 전용 원칩 컴퓨터의 염색체의 길이는 가변이며 16 비트 단위로 Pipeline 처리를 한다. 실험 결과는 제안된 원칩 컴퓨터가 랜덤 비트 동기 회로를 위한 진화 하드웨어 설계에 적용할 수 있다는 것을 보여준다.
In UMTS (Universal Mobile Telecommunication System), a protocol called UMTS AKA is used to authenticate MSs (Mobile Stations). When an MS is in a foreign network, the serving network contacts the AuC (Authentication Center) located at the home network of the MS to authenticate it. To reduce this cost, AuC sends n AVs(Authentication Vectors) to the serving network. Although the use of AVs allows the serving network to authenticate an MS without contacting the AuC each time, there are also shortcomings such as synchronization problem. Subsequently, a set of protocols adopting the same or similar method have been proposed. In this paper, we analyze and compare authentication protocols for UMTS with respect to the use of AVs and its alternatives. We conclude that using Kerberos-like ticket key overcomes some of the drawbacks of using AVs, whereas AVs provide much better security.
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[게시일 2004년 10월 1일]
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