본 논문은 상관관계(trade-off)에 의한 CLB구조의 CPLD 저전력 기술 매핑 알고리즘을 제안하였다. 제안한 저전력 기술 매핑 알고리즘은 주어진 불린 네트워크를 DAG로 구성하여 소모전력 계산을 위한 TD(Transition Density) 계산 단계와 매핑 가능 클러스터 생성, CLB 패킹의 단계로 구성하였다. TD 계산 단계는 DAG를 구성하고 있는 각 노드들에 대한 스위칭 동작을 계산하여 전체 소모 전력을 계산하는 단계이다. 매핑 가능 클러스터 생성 단계는 주어진 CPLD의 CLB에 대한 입출력의 수와 OR 텀수를 고려하여 매핑 가능 클러스터를 생성하는 단계이다. 매핑 가능 클러스터를 생성하기 위하여 공통 노드 클러스터 병합과 노드 분할, 노드 복제의 방법을 이용한다. 제안된 알고리즘을 SIS에서 제공되는 벤치마크에 적용하여 실험한 결과 OR 텀수를 5로 했을 경우 기존의 CPLD 기술 매핑 알고리즘인 TEMPLA에 비해 30.73$\%$의 소모전력이 감소되었으며, PLAmap에 비해 17.11$\%$감소되었다.
이 논문에서는 CATV 수신기에서 QAM 복조에 널리 이용되는 stop-and-go 알고리즘을 기본으로 한 블라인드 등화기의 상호 절충(trade-off)문제를 해결하였다. Stop-and-go 알고리즘은 탭 가중치의 적응 과정에서 최소 제곱 평균(least mean square) 알고리즘을 이용하였기 때문에 등화기의 구조가 간단하기는 하지만 전형적인 최소 제곱 평균 알고리즘과 같이 수렴 속도와 정상 상태 오차 사이에 상호 절충 문제가 존재한다. 정상 상태 오차를 일정한 수준으로 유지하면서 수렴 속도를 높이기 위해 가변 스텝 크기 알고리즘을 이용하였다. 동일 수준의 정상 상태 오차를 기준으로 하였을 때, 가변 스텝 크기 알고리즘을 이용한 stop-and-go 알고리즘이 상수 스텝 크기를 이용한 알고리즘에 비해 수렴 속도가 $36%{\sim}56%$ 향상되었다.
The purpose of this study was to analyze the kinematics of the men's triple jump at the 2011 Daegu World Championships by comparing the results to those at the 2009 Berlin World Championships. The kinematic data were gathered from two steps before take off to the landing using a seven panorama system, and these data were divided into 3 phases for 8 participants. The average jump for the finalists was longer in the Daegu championships (17.46 m) than in the Berlin championships (17.28 m). The longest jump record was increased by 23 cm. The step was the longest at 36% of the total distance, followed by the hop at 30% and the jump at 34%. The first and third phases were substantially longer than the second phase (the step). The horizontal speed at take-off increased in the order hop, step, and jump. Overall, in comparison with the results from Berlin, the horizontal velocity increased, the vertical velocity decreased, and the landing angle decreased.
본 논문은 분산자원 집합 거래시장의 활성화와 에너지 관리의 중요성이 증가되면서 에너지 관리 모니터링 기술로서 합산된 전체 전력으로부터 각각의 가전제품의 전력을 찾아내는 비 침입 부하 모니터 기법을 제안한다. 본 논문에서는 데이터 전처리를 통해 각 가전제품들의 power on-off상태가 나오도록 한다. 이러한 데이터를 LSTM을 모델로 사용하여 각 가전제품들의 power on-off 상태를 예측한다. 예측한 상태들을 데이터 후처리를 한 후, 실제 상태들과 비교하여 정확도를 측정한다. 본 논문에서는 전자제품의 개수, 데이터 후처리 방법과 Time step size를 다르게 하여 정확도를 측정하여 비교한다. 전자 제품의 개수가 6개이고, Round함수로 데이터 후처리 방법을 사용하고, Time step size는 6으로 설정하였을 때, 가장 높은 정확도가 나온 것으로 측정되었다.
In this study using two-dimensional system of the analysis of image, when normal males in their twenties who have normal foot and step with heel first are walking and running, they who are wearing running shoes or barefoot are testing and comparing the exchange factors of heel control. There are following results of this test by verifying them with T-Test. 1) When they are running, there are two big different gap which is $6.05^{\circ}$ between barefoot and wearing the running shoes. The former is $174.79^{\circ}{\pm}6.31$ and the latter is $180.84^{\circ}{\pm}4.69$. But it is not statistically significant. The angle of first step with heel is $100.42^{\circ}{\pm}3.95$ with barefoot and $93.97^{\circ}{\pm}094$ with wearing the running shoes. In this case, it is statistically significant(p<.01) 2) When they are running, the angle of the Achilles' tendon has different gap which is $5.24^{\circ}$ between barefoot and wearing the running shoes. The former is $179.70^{\circ}{\pm}4.23$ and the latter is $184.94^{\circ}{\pm}4.09$. It is not statistically significant. The angle of minimal step with heel is $96.30^{\circ}{\pm}3.07$ with barefoot and $90.84^{\circ}{\pm}0.44$ with wearing the running shoes. In this case, it is statistically significant(p<.01). 3) In the angle of the Achilles' tendon and the angle of first step with heel, when they are walking, the angle of the Achilles' tendon has different gap which is $1.81^{\circ}$ between barefoot and wearing the running shoes. The former is $6.39^{\circ}{\pm}0.83$ and the latter is $8.20^{\circ}{\pm}1.85$. It is not statistically significant. The angle of first step with heel is $2.32^{\circ}{\pm}0.51$ with barefoot and $3.22^{\circ}{\pm}1.44$ with wearing the running shoes. It is not statistically significant. 4) In the angle of the take-off of Achilles' tendon, when they are walking, the angle of the take-off of Achilles' tendon has different gap which is $3.88^{\circ}$ between barefoot and wearing the running shoes. The former is $177.62^{\circ}{\pm}8.78$ and the latter is $173.74^{\circ}{\pm}16.31$. It is statistically significant(p<.05). Therefore, they are running, the angle of the take-off of Achilles' tendon is $178.37^{\circ}{\pm}19.28$ with barefoot and $171.26^{\circ}{\pm}12.18$ with wearing the running shoes. It is statistically significant(p<.05).
The air traffic are getting a lot of the impact of the weather delays, cancellations, etc. occur frequently. In particular, the phenomenon of global warming, extreme weather events have not experienced one after another and the various damage to users and operators are constantly occurring. In this respect, Take-off Minima of this study are presented need for standardization of ICAO Doc 9365(All Weather Operations). And Incheon International Airport to the introduction of a comprehensive improvement process will be introduced in the future to look forward to take advantage of domestic and international airport officials. In addition, implementation of the Take-off Minima to get direct and indirect economic effects, and will be introduced.
Stranski-Krastanow 자발형성 방법에 의한 양자점의 성장은 다른 공정에 비해 결함이 적은 반면에 크기와 위치를 조절하기 어렵다. 최근 20-off GaAs 기판을 이용한 양자점의 성장은 다른 공정과는 달리 성장조건만으로 선택적인 성장을 얻을 수 있으며 양자점의 크기가 terrace width를 벗어나지 않으므로 uniformity를 향상시킬 수 있다. 20-off GaAs 기판의 trrrace 넓이는 약 99 이지만 성장조건하에 Ga의 diffusion에 의한 step bunching 효과에 의하여 그 넓이는 변화하며 특히, 성장 두께에 따라 넓이는 증가한다. 이러한 현상을 바탕으로 20-off 기판위에 GaAs buffer 층을 1000 , 22 을 갖게 되었다. 이로써 20-off 기판을 이용할 경우,GaAs buffer 층의 두께만으로 양자점의 크기를 조절할 수 있다.
a-측으로 배향된 $YBa_2Cu_3O_{7-\delta}$ 고온 초전도 박막을 $LaAIO_{3}$(100)단결정 기판에 이중 타게트 off-axis rf마그네트론 스퍼터링법으로 증착하였다. 박막은 기판온도(Ts)$590^{\circ}C$와 $680^{\circ}C$사이에서 단일공정으로 증착하는 one-step방법과, $590^{\circ}C$의 저온에서 a-축으로 배향된 YBCO박막(두께-30nm)을 면저 만들어 틀로 작용시킨 후 그 틀위에 나머지 부분을 기판온도를 승온하면서 증착하는 방법인 two-step방법 등 두 가지 방법을 사용하여 증착시켰다. one-step방법에서는 $T_s$가 증가함에 따라 감소하였으며, ($00 \ell$)피크는 증가하였다. Two-step방법으로 증착한 박막은 증착속도가 감소함에 따라 (h00)피크가 우세하게 나타났다. 박막의 미세구조는 a-축, c- 축 배향성이 혼재하여 핀홀과 같은 결함들이 생성되었다. 모든 경우 $T_s$가 감소함에 따라 a-축 배향성은 우세하였으나 전기적 특성은 저하되었고, 긴 전이온도 폭을 가졌다.
The recent use of distributed power generation systems constructed with DC-DC converters has become extremely popular owing to the rising need for environment friendly energy generation power systems. In this study, a new single-phase five-level inverter for off-grid applications constructed with a multilevel DC-DC step-up converter is proposed to boost a low-level DC voltage (36 V-64 V) to a high-level DC bus (380 V) and invert and connect them with a single-phase 230 V rms AC load. Compared with other traditional multilevel inverters, the proposed five-level inverter has a reduced number of switching devices, can generate high-quality power with lower THD values, and has balanced voltage stress for DC capacitors. Moreover, the proposed topology does not require multiple DC sources. Finally, the performance of the proposed topology is presented through the simulation and experimental results of a 400 W hardware prototype.
IEIE Transactions on Smart Processing and Computing
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제2권4호
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pp.248-254
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2013
The size and power consumption of digital circuits including the dimming circuit part will increase for high-performance solid state lighting (SSL) systems in the future. This study examined the low-power consumption of adiabatic dynamic CMOS logic (ADCL) due to the principles of adiabatic charging. Furthermore, the designed low-power ADCL digital pulse width modulation (PWM) was optimized for SSL dimming systems. For this purpose, an ADCL digital 3-bit PWM was optimized in two steps. In the first step, the architecture of the ADCL digital 3-bit PWM was miniaturized. In the second step, the clock cut-off circuit was designed and added to the ADCL PWM. As a result, compared to the original configuration, 60 transistors and 15 capacitors of ADCL digital 3-bit PWM were reduced for miniaturization. Moreover, the clock cut-off circuit, which controls wake-up and sleep mode of ADCL D-FFs, was designed. The power consumption of an optimized ADCL digital PWM for all bit patterns decreased by 54 %.
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[게시일 2004년 10월 1일]
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