• Title/Summary/Keyword: nitride

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The Study on Thin Film Fabrication using UHV-LCVD System (I) (UHV-LCVD 장치를 이용한 박막제작에 관한 연구 (I) - 장치 제작을 중심으로 -)

  • Choi, Won-Kook;Yun, Dug-Ju;Gong, Byung-In;Kim, Chang-Hyun;Whang, Chung-Nam;Jeong, Kwang-Ho
    • Journal of the Korean Vacuum Society
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    • v.2 no.2
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    • pp.255-260
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    • 1993
  • UHV-LCVD system was constructed for high quality silicon nitride thin film fabrication. This system consisted of a reaction chamber, an introduction chamber with sample load lock entry, a carbinet for gas manipulation controlling gas flow, a $CO_2$ laser and a Fourier transform mass spectrometer. Although the UHV-LCVD system construction was more sophisticated than low pressure CVD, highly pure thin films were fabricated by controlling gas mixing ratio and flow rate in ultra high vacuum surroundings.

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SOI 기판 위에 SONOS 구조를 가진 플래쉬 메모리 소자의 subthreshold 전압 영역의 전기적 성질

  • Yu, Ju-Tae;Kim, Hyeon-U;Yu, Ju-Hyeong;Kim, Tae-Hwan
    • Proceedings of the Korean Vacuum Society Conference
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    • 2010.08a
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    • pp.216-216
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    • 2010
  • Floating gate를 이용한 플래시 메모리와 달리 질화막을 트랩 저장층으로 이용한 silicon-oxide-silicon nitride-oxide silicon (SONOS) 구조의 플래시 메모리 소자는 동작 전압이 낮고, 공정과정이 간단하며 비례 축소가 용이하여 고집적화하는데 유리하다. 그러나 SONOS 구조의 플래시 메모리소자는 비례 축소함에 따라 단 채널 효과와 펀치스루 현상이 커지는 문제점이 있다. 비례축소 할 때 발생하는 문제점을 해결하기 위해 플래시 메모리 소자를 FinFET과 같이 구조를 변화하는 연구는 활발히 진행되고 있으나, 플래시 메모리 소자를 제작하는 기판의 변화에 따른 메모리 소자의 전기적 특성 변화에 대한 연구는 많이 진행되지 않았다. 본 연구에서는 silicon-on insulator (SOI) 기판의 유무에 따른 멀티비트를 구현하기 위한 듀얼 게이트 가진 SONOS 구조를 가진 플래시 메모리 소자의 subthreshold 전압 영역에서의 전기적 특성 변화를 조사 하였다. 게이트 사이의 간격이 감소함에 따라 SOI 기판이 있을 때와 없을 때의 전류-전압 특성을 TCAD Simulation을 사용하여 계산하였다. 전류-전압 특성곡선에서 subthreshold swing을 계산하여 비교하므로 SONOS 구조의 플래시 메모리 소자에서 SOI 기판을 사용한 메모리 소자가 SOI 기판을 사용하지 않은 메모리 소자보다 단채널효과와 subthreshold swing이 감소하였다. 비례 축소에 따라 SOI 기판을 사용한 메모리 소자에서 단채널 효과와 subthreshold swing이 감소하는 비율이 증가하였다.

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Role of gas flow rate during etching of hard-mask layer to extreme ultra-violet resist in dual-frequency capacitively coupled plasmas

  • Gwon, Bong-Su;Lee, Jeong-Hun;Lee, Nae-Eung
    • Proceedings of the Korean Vacuum Society Conference
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    • 2010.08a
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    • pp.132-132
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    • 2010
  • In the nano-scale Si processing, patterning processes based on multilevel resist structures becoming more critical due to continuously decreasing resist thickness and feature size. In particular, highly selective etching of the first dielectric layer with resist patterns are great importance. In this work, process window for the infinitely high etch selectivity of silicon oxynitride (SiON) layers and silicon nitride (Si3N4) with EUV resist was investigated during etching of SiON/EUV resist and Si3N4/EUV resist in a CH2F2/N2/Ar dual-frequency superimposed capacitive coupled plasma (DFS-CCP) by varying the process parameters, such as the CH2F2 and N2 flow ratio and low-frequency source power (PLF). It was found that the CH2F2/N2 flow ratio was found to play a critical role in determining the process window for ultra high etch selectivity, due to the differences in change of the degree of polymerization on SiON, Si3N4, and EUV resist. Control of N2 flow ratio gave the possibility of obtaining the ultra high etch selectivity by keeping the steady-state hydrofluorocarbon layer thickness thin on the SiON and Si3N4 surface due to effective formation of HCN etch by-products and, in turn, in continuous SiON and Si3N4 etching, while the hydrofluorocarbon layer is deposited on the EUV resist surface.

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Thermal Fatigue Analysis of Wafer Level Embedded SiP by Changing Mold Compounds and Chip Sizes (몰드물성 종류 및 칩 크기 변화에 따른 웨이퍼 레벨 Sip에서의 열 피로 해석)

  • Jang, Chong Min;Kim, Seong Keol
    • Journal of the Korean Society of Manufacturing Technology Engineers
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    • v.22 no.3_1spc
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    • pp.504-508
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    • 2013
  • This paper describes in detail the life prediction models and simulations of thermal fatigue under different mold compounds and chip sizes for wafer-level embedded SiP. Three-dimensional finite element models are built to simulate the viscoplastic behaviors for various mold compounds and chip sizes. In particular, the bonding parts between a mold and silicon nitride (Si3N4) are carefully modeled, and the strain distributions are studied. Three different chip sizes are used, and the effects of the mold compounds are observed. Through the numerical studies, it is found that type-C, which has a relatively lower Young's modulus and higher CTE, has a better fatigue life than the other mold compounds. In addition, the $4{\times}4$ chip has a shorter life than the $6{\times}6$ and $8{\times}8$ chips.

A study on ohmic contact to p-type GaN

  • ;;;;;Yuldashev
    • Proceedings of the Korean Vacuum Society Conference
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    • 2000.02a
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    • pp.114-114
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    • 2000
  • III-nitride 게 물질들은 blue와 UV 영역의 LED, LD와 같은 광소자뿐만 아니라 HBT, FET와 같은 전자소자로도 널리 응용되고 있다. 이와 같은 물질을 이용한 소자를 제작할 경우 낮은 저항의 ohmic contact은 필수적이다. p-GaN의 ohmic contact은 아직까지 많은 문제점을 내포하고 있다. 그 중의 하나는 높은 doping 농도(>1018cm-3)의 p-GaN 박막을 성장하기가 어렵다는 것이며, 또 하나는 낮은 접촉 비저항을 얻기 위해선 7.5eV 이상의 큰 재가 function을 지닌 금속을 선택해야 한다. 그러나 5.5eV 이상의 재가 function을 갖는 금속은 존재하지 않는다. 위와 같은 문제점들은 p-GaN의 접촉 비저항이 10-2$\Omega$cm2이상의 높은 값을 갖게 만들고 있으며 이에 대한 해결방안으로는 고온의 열처리를 통하여 p-GaN와 금속사이에서 화학적 반응을 일으킴으로써 표면근처에서 캐리어농도를 증가시키고, 캐리어 수송의 형태가 tunneling 형태로 일어날 수 있도록 하는 tunneling current mechaism을 이용하는 것이다. 이에 본 연구에서는 MOCVD로 성장된 p-GaN 박막을 Mg의 activation을 증가시키기 위해 N2 분위기에서 4분간 80$0^{\circ}C$에서 RTA로 annealing을 하였으며, ohmic 접촉을 위한 금속으로 높은 재가 function과 좋은 adhesion 그리고 낮은 자체저항을 가지고 있는 Ni/ZSi/Ni/Au를 ohmic metal로 하여 contact한 후에 $700^{\circ}C$에서 1분간 rapid thermal annealing (RTA) 처리를 했다. contact resistance를 계산하기 위해 circular-TLM method를 이용하여 I-V 특성을 조사하였고, interface interaction을 알아보기 위해 SEM과 EDX, 그리고 XRD로 분석하였다. 또한 추가적으로 Si 계열의 compound metal인 PdSi와 PtSi에 대한 I-V 특성도 조사하여 비교하여 보았다.

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Efficiency of an SCM415 Alloy Surface Layer Implanted with Nitrogen Ions by Plasma Source Ion Implantation

  • Lyu, Sung-Ki;He, Hui-Bo;Lu, Long;Youn, Il-Joong
    • International Journal of Precision Engineering and Manufacturing
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    • v.7 no.4
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    • pp.47-50
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    • 2006
  • SCM415 alloy was implanted with nitrogen ions using plasma source ion implantation (PSII), at a dose range of $1{\times}10^{17}\;to\;6{\times}10^{17}\;N^+cm^{-2}$ Auger electron spectrometry (AES) was used to investigate the depth profile of the implanted layer. Friction and wear tests were carried out on a block-on-ring wear tester. Scanning electron microscopy (SEM) was used to observe the micro-morphology of the worn surface. The results revealed that after being implanted with nitrogen ions, the frictional coefficient of the surface layer decreased, and the wear resistance increased with the nitrogen dose. The tribological mechanism was mainly adhesive, and the adhesive wear tended to become weaker oxidative wear with the increase in the nitrogen dose. The effects were mainly attributed to the formation of a hard nitride precipitate and a supersaturated solid solution of nitrogen in the surface layer.

Tribological characteristics of WC/C multilayer films with various environments (WC/C 박막 코팅의 환경변화에 따른 트라이볼로지적 특성)

  • 이은성;김석삼;김종국
    • Proceedings of the Korean Society of Tribologists and Lubrication Engineers Conference
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    • 2001.11a
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    • pp.78-87
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    • 2001
  • The friction and wear behaviors of WC/C multilayer coating were investigated by using a pin on disk type tester. The experiment was conducted by using silicon nitride (S $i_{3}$ $N_{4}$) as a pin material and WC/C multilayer coating on bearing steel (STB2) as a disk material, under various environments that are atmospheric conditions of high vacuum( 1,3$\times$10$^{-4}$ Pa), medium vacuum( 1.3$\times$10$^{-l}$Pa). ambient air( 10$^{5}$ pa)(3 types) and relative humidity(2~98%) conditions. The results showed that WC/C coating fracture was suddenly increased with increasing degree of vacuum, because of high adhesion. So, WC/C coating could not be displayed their ability as solid lubricant. WC/C coating could be displayed better abilitv as solid lubricant with increasing relative humidity. because of oxide film, size and shape of wear debris. The friction coefficient and specific wear rate became better about RH 50%.%.

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A study on Zn corrosion resistance of WC spray coating sealed with carbon nanotube suspensions (탄소 나노튜브 혼합액으로 봉공처리된 텅스텐 카바이드 용사층의 아연 내부식성에 대한 연구)

  • Kim, Bong-Hun;Lee, Bo-Young
    • Journal of Welding and Joining
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    • v.33 no.1
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    • pp.49-53
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    • 2015
  • An experimental study was conducted to investigate the effect of carbon nanotubes on the zinc corrosion resistance of sealing layer formed on the Tungsten Carbide spray coating. Using the nanotubes, a sealing agent in the form of solid-liquid suspensions was made and applied to the surface of spray coating. A series of experiments, consisted of three stages such as preparation of test piece, molten-pot immersion test, and evaluation of micro structure, were undertaken to demonstrate complicated interaction existing between zinc ions and sealing layer containing the nanotubes. Experimental results showed newly developed sealing layer were less susceptible to corrosion and thus coated layer was well protected even in the case of 10 days exposure. Comparison of the micro structure after molten pot test also indicated that carbon nanotubes still remained in the matrix and organized more reliable frame work constituted with boron nitride and chromium compound. It was revealed that carbon nanotubes in the sealing layer played positive role to enhance zinc corrosion resistance in the perspective of both fibrous structure and inherent chemical stability.

The Brazing Characters of cBN Grit with Ag-based Filler Alloys (cBN 지립과 Ag계 필러합금에서의 브레이징 특성)

  • Song, Min-Seok;An, Sang-Jae;Jeong, Gi-Jeong
    • Proceedings of the KWS Conference
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    • 2007.11a
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    • pp.215-217
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    • 2007
  • 철계 피삭재 가공 시 적용되는 cBN(cubic Boron-Nitride)의 경우 열적/구조적 안정성으로 인해 융착 시 계면에서 화학적 결합이 어려워, 지립이 단일층으로 형성되어야 하는 융착 공구의 경우 적용되질 못하고 있다. 이러한 문제를 해결하기 위해 세라믹과의 젖음성이 우수한 Ti 성분이 포함된 67Ag+28Cu+5Ti(wt.%) 조성의 합금분말을 이용하여 cBN을 접합을 하였으며, 이때 융착조건은 진공 분위기($6{\times}10^{-6}$Torr), $900^{\circ}C$ 온도에서 5분간 유지하여 융착을 실시하였다. 본 연구의 주목적은 Ti 합금화 된 Ag계 합금분말 및 cBN의 융착 계면에서의 융착 계면거동해석을 통한 건전한 접합공정을 찾는데 있다. 이에 온도 $900^{\circ}C$, 유지시간 5분에서 건전한 융착층을 형성함을 알 수 있었다. 또한 결합력 측정기를 이용하여 결합력을 측정한 결과 diamond와 융착하였을 때가 123N, cBN을 융착하였을 때 107N으로써, cBN 융착이 diamond 융착의 87%정도의 결합력을 보임을 알 수 있었다. 한편 cBN과 Ag-Cu-Ti계 브레이징 필러의 계면에서의 미세조직 및 화학반응의 메커니즘은 SEM, EDS를 이용하여 분석하였다.

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Channel Recessed 1T-DRAM with ONO Gate Dielectric

  • Park, Jin-Gwon;Jo, Won-Ju
    • Proceedings of the Korean Vacuum Society Conference
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    • 2011.08a
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    • pp.264-264
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    • 2011
  • 1T-1C로 구성되는 기존의 dynamic random access memory (DRAM)는 데이터를 저장하기 위해 적절한 커패시턴스를 확보해야 한다. 따라서 커패시터 면적으로 인한 집적도의 한계에 직면해있으며, 이를 대체하기 위한 새로운 DRAM인 1T- DRAM이 연구되고 있다. 기존의 DRAM과 달리 silicon-on-insulator (SOI) 기술을 이용한 1T-DRAM은 데이터 저장을 위한 커패시터가 요구되지 않는다. 정공을 채널의 중성영역에 축적함으로서 발생하는 포텐셜 변화를 이용하며, 이때 발생하는 드레인 전류차를 이용하여 '0'과 '1'을 구분한다. 기존의 완전공핍형 평면구조의 1T-DRAM은 소스 및 드레인 접합부분에서 발생하는 누설전류로 인해 '0' 상태의 메모리 유지특성이 열화되는 단점을 가지고 있다. 따라서 메모리의 보존특성을 향상시키기 위해 소스/드레인 접합영역을 줄여 누설전류를 감소시키는 구조를 갖는 1T-DRAM의 연구가 필요하다. 또한 고유전율을 가지는 Si3N4를 이용한 oxide-nitride-oxide (ONO)구조의 게이트 절연막을 이용하면 동일한 두께에서 더 낮은 equivalent oxide thickness (EOT)를 얻을 수 있기 때문에 보다 저 전압에서 1T-DRAM 동작이 가능하여 기존의 SiO2 단일층을 이용한 1T-DRAM보다 동일 전압에서 더 큰 sensing margin을 확보할 수 있다. 본 연구에서는 누설전류를 감소시키기 위하여 소스 및 드레인이 채널위로 올려진 recessed channel 구조에 ONO 게이트 절연막을 적용한 1T-DRAM을 제작 및 평가하고, 본 구조의 1T-DRAM적용 가능성 및 ONO구조의 게이트 절연막을 이용한 sensing margin 개선을 확인하였다.

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