• 제목/요약/키워드: min-sum

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비트-직렬 LDPC 복호를 위한 효율적 AT 복잡도를 가지는 두 최소값 생성기 (Efficient AT-Complexity Generator Finding First Two Minimum Values for Bit-Serial LDPC Decoding)

  • 이재학;선우명훈
    • 전자공학회논문지
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    • 제53권12호
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    • pp.42-49
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    • 2016
  • 논문은 저면적 비트-직렬 두 최소값 생성기를 제안한다. Min-sum 복호 알고리즘을 적용한 LDPC 복호기에서 두 최소값 생성기가 가장 큰 하드웨어 복잡도를 가지기 때문에, 두 최소값 생성기의 저면적 구현이 매우 중요하다. 하드웨어 면적을 줄이기 위해 비트-직렬 방식의 LDPC 복호기가 제안되었다. 하지만 기존의 비트-직렬 방식의 생성기는 하나의 최소값만 찾을 수 있어 BER 성능이 감소되었다. 제안하는 생성기는 두 최소값을 모두 찾을 수 있어 BER 성능열화를 극복하고 저면적의 LDPC 복호기 구현이 가능하다. 또한 기존의 두 최소값 생성기들과 비교하여 면적-시간 복잡도에서 가장 좋은 성능을 보인다.

개선된 정규화 최소합 알고리듬을 적용한 WiMAX/WLAN용 LDPC 복호기 (LDPC Decoder for WiMAX/WLAN using Improved Normalized Min-Sum Algorithm)

  • 서진호;신경욱
    • 한국정보통신학회논문지
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    • 제18권4호
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    • pp.876-884
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    • 2014
  • 본 논문에서는 개선된 정규화 최소합(improved normalized min-sum) 복호 알고리듬을 적용한 LDPC 복호기를 설계하였다. 설계된 LDPC 복호기는 IEEE 802.16e 모바일 WiMAX 표준의 19가지 블록길이(576~2304)에 따른 6가지 부호율(1/2, 2/3A, 2/3B, 3/4A, 3/4B, 5/6)과 IEEE 802.11n 무선 랜 표준의 3가지 블록길이(648, 1296, 1944)에 따른 4가지 부호율(1/2, 2/3, 3/4, 5/6)을 지원한다. INMS 복호 알고리듬과 SM(sign-magnitude) 수체계 연산을 기반으로 하는 DFU(decoding function unit)을 구현하여 하드웨어 복잡도와 복호 성능을 최적화시켰다. 설계된 LDPC 복호기는 0.18-${\mu}m$ CMOS 셀 라이브러리를 이용하여 100 MHz 동작 주파수로 합성한 결과, 284,409 게이트와 62,976 비트의 메모리로 구현되었으며, FPGA 구현을 통해 하드웨어 동작을 검증하였다. 1.8V 전원전압에서 100 MHz로 동작 가능할 것으로 평가되며, 부호율과 블록길이에 따라 약 82~218 Mbps의 성능을 가질 것으로 예상된다.

시공간 데이타베이스에서 영역 합 질의를 위한 색인 기법 (An Indexing Technique for Range Sum Queries in Spatio - Temporal Databases)

  • 조형주;최용진;민준기;정진완
    • 한국정보과학회논문지:데이타베이스
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    • 제32권2호
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    • pp.129-141
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    • 2005
  • 시공간 데이타베이스는 최근에 많은 주목을 받았지만, 영역 합 질의에 대한 연구는 그 중요성에 비하여 많이 부족하다. 영역 합 질의를 처리하기 위하여, 많은 양의 데이타에 대한 직접적인 접근은 엄청난 계산 비용을 야기하기 때문에, 최근에 기존 색인 기법을 활용한 materialization 방법이 제안되었다. 간단하면서 효과적인 방법은 시공간 조건을 가지는 윈도우 질의를 효율적인 처리하는 MVR-tree에 materialization 방법을 적용하는 것이다. 그러나, MVR-tree는 노드들 사이의 존재하는 원형 경로 때문에, 중간 노드에 미리 계산된 합을 유지하는 것이 불가능하다. 다른 색인 구조들에 기초한 집합적 구조(aggregate structures)는 만족스러운 질의 성능을 제공하지 못 한다. 본 논문에서는 적응적 분할 기법을 사용하는 새로운 색인 기법(Adaptive Partitioned Aggregate R-Tree, APART)과 다양한 환경에서 영역합 질의를 효율적으로 처리하는 질의 처리 알고리즘을 제안한다. 실험 결과는 APART의 성능이 다양한 상황에서 기존의 집합적 색인 기법들보다 2배 이상 우월하다는 것을 보여준다.

GLCM알고리즘을 이용한 경직장 초음파 영상의 정량적 평가 (Quantitative assessment of Endorectal Ultrasonography by using GLCM Algorithm)

  • 노다정;강민지;김유경;서아름;이인호;정희성;조진영;고성진
    • 한국정보통신학회:학술대회논문집
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    • 한국정보통신학회 2015년도 춘계학술대회
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    • pp.383-387
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    • 2015
  • 현대인들의 불규칙한 생활과 서구화된 식습관에 의해 대장 및 직장 질환이 증가하고 있는 추세로, 특히 직장암은 전체 대장암의 50%를 차지하고 있다. 초기 직장암의 경우 표면으로 돌출되는 부분이 없으므로 초음파로 조직 내부를 보지 않으면 직장 농양으로 오진하는 오류를 범하기도 한다. 그러나 초음파 진단을 하더라도 직장암의 병기에 따라 농양과 육안으로 구별이 어려운 경우가 있기 때문에 보다 정확한 진단이 필요하다. 그러므로 본 연구에서는 직장암과 농양 영상에 대한 컴퓨터 알고리즘을 이용하여 정량적인 분석을 하였다. GLCM을 적용하여 정상 20증례와 농양, 직장암 각 20증례를 분석영역($50{\times}50$ 픽셀)으로 설정하고, 각 영상에서 Autocorrelation, Max probability, Sum average, Sum variance 4가지 파라미터를 비교하여 분석하였다. 결과적으로 Autocorrelation, Max probability, Sum variance 3개의 파라미터에서는 100%, Sum average 파라미터에서는 암 95%, 농양에서 90% 이상의 높은 병변 질감 검출 효율이 나타났다. 이러한 파라미터들이 직장에서의 정상조직, 농양조직, 암조직 간의 판별의 기준으로 가치가 있다고 사료된다. 임상에서의 활용정도에 따라 컴퓨터 보조진단으로서의 충분한 유용성을 볼 수 있을 것이다.

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Transceiver Design Using Local Channel State Information at Relays for A Multi-Relay Multi-User MIMO Network

  • Cho, Young-Min;Yang, Janghoon;Kim, Dong Ku
    • KSII Transactions on Internet and Information Systems (TIIS)
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    • 제7권11호
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    • pp.2616-2635
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    • 2013
  • In this paper, we propose an iterative transceiver design in a multi-relay multi-user multiple-input multiple-output (MIMO) system. The design criterion is to minimize sum mean squared error (SMSE) under relay sum power constraint (RSPC) where only local channel state information (CSI)s are available at relays. Local CSI at a relay is defined as the CSI of the channel between BS and the relay in the $1^{st}$ hop link, and the CSI of the channel between the relay and all users in the $2^{nd}$ hop link. Exploiting BS transmitter structure which is concatenated with block diagonalization (BD) precoder, each relay's precoder can be determined using local CSI at the relay. The proposed scheme is based on sequential iteration of two stages; stage 1 determines BS transmitter and relay precoders jointly with SMSE duality, and stage 2 determines user receivers. We verify that the proposed scheme outperforms simple amplify-and-forward (SAF), minimum mean squared error (MMSE) relay, and an existing good scheme of [13] in terms of both SMSE and sum-rate performances.

Distributed Uplink Resource Allocation in Multi-Cell Wireless Data Networks

  • Ko, Soo-Min;Kwon, Ho-Joong;Lee, Byeong-Gi
    • Journal of Communications and Networks
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    • 제12권5호
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    • pp.449-458
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    • 2010
  • In this paper, we present a distributed resource allocation algorithm for multi-cell uplink systems that increases the weighted sum of the average data rates over the entire network under the average transmit power constraint of each mobile station. For the distributed operation, we arrange each base station (BS) to allocate the resource such that its own utility gets maximized in a noncooperative way. We define the utility such that it incorporates both the weighted sum of the average rates in each cell and the induced interference to other cells, which helps to instigate implicit cooperation among the cells. Since the data rates of different cells are coupled through inter-cell interferences, the resource allocation taken by each BS evolves over iterations. We establish that the resource allocation converges to a unique fixed point under reasonable assumptions. We demonstrate through computer simulations that the proposed algorithm can improve the weighted sum of the average rates substantially without requiring any coordination among the base stations.

개선된 조건 합 가산기를 이용한 $54{\times}54$-bit 곱셈기의 설계 (Design of a $54{\times}54$-bit Multiplier Based on a Improved Conditional Sum Adder)

  • 이영철;송민규
    • 대한전자공학회논문지SD
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    • 제37권1호
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    • pp.67-74
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    • 2000
  • 개선된 조건 합 가산기를 이용한 저전력 고속 $54{\times}54$-bit 곱셈기를 설계했다. 지연시간을 감소시키기 위해, Booth's Encoder 없이 높은 압축 율을 갖는 압축기들과 Carry 발생블록을 분리시킨 108-bit 조건 합 가산기를 제안하였다. 또한, 지연시간과 전력소모를 최적화하기 위해 패스 트랜지스터로직을 사용한 설계기법을 제안하였다. 제안된 곱셈기는 기존 곱셈기구조에 비해 약 12%의 지연시간과 5%의 전력소모가 감소하였으며, 0.65${\mu}m$ CMOS(Single-poly, triple-metal)공정을 사용하여 $6.60{\times}6.69mm^2$의 칩 크기와 공급전압 3.3V에서 13.5ns의 지연시간을 갖는다.

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반도체 광증폭기에 기반을 둔 10 Gb/s 전광 반가산기 (10 Gb/s All-optical half adder by using semiconductor optical amplifier based devices)

  • 김재헌;전영민;변영태;이석;우덕하;김선호
    • 한국광학회지
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    • 제13권5호
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    • pp.421-424
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    • 2002
  • 반도체 광증폭기에 기반을 둔 소자들을 이용한 전광 반가산기가 처음으로 구현되었다. 전광 반가산기의 동작속도와 신호 형식은 각각 10Gb/s와 RZ였다. 전광 반가산기의 SUM과 CARRY의 동작에는 각각 전광 XOR 논리소자와 전광 AND 논리 소자가 이용되었으며 두 연산이 동시에 구현되었다.

묵사집산법의 수열

  • 허민
    • 한국수학사학회지
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    • 제17권1호
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    • pp.15-32
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    • 2004
  • In this article we survey the sequences and the series in Mooksajipsanbup(默思集算法) which is the seventeenth century mathematics book of Chosun dynasty. First, we classify them into three categories: arithmetics, geometric, and general sequences (series). And then we explore the old methods to find the values of terms and the sum of terms.

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최적 보급수송로 선정을 위한 다항시간 알고리듬 (A Polynomial-time Algorithm for Choosing the Shortest Transportation Path of Logistic Material)

  • 서성철;정규련
    • 한국국방경영분석학회지
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    • 제23권2호
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    • pp.103-119
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    • 1997
  • This paper considers the shortest path problem combined with Min-Min-Sum objective for solving the problem of the military logistics. This paper develops a polynomial-time algorithm for the optimal solution. To analyze the real combat situation, the ability time and distance time of communication line are considered. The complexities of algorithm between previous study and the algorithm developed in this paper is presented. Finally we provide a simple example of application with randomly generated problem.

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