Recently, scaling down of ULSI (Ultra Large Scale Integration) circuit of CMOS (Complementary Metal Oxide Semiconductor) based electronic devices become much faster speed and smaller size than ever before. However, very narrow interconnect line width causes some drawbacks. For example, deposition of conformal and thin barrier is not easy moreover metallization process needs deposition of diffusion barrier and glue layer. Therefore, there is not enough space for copper filling process. In order to overcome these negative effects, simple process of copper metallization is required. In this research, Cu-V thin alloy film was formed by using RF magnetron sputter deposition system. Cu-V alloy film was deposited on the plane $SiO_2$/Si bi-layer substrate with smooth and uniform surface. Cu-V film thickness was about 50 nm. Cu-V layer was deposited at RT, 100, 150, 200, and $250^{\circ}C$. XRD, AFM, Hall measurement system, and XPS were used to analyze Cu-V thin film. For the barrier formation, Cu-V film was annealed at 200, 300, 400, 500, and $600^{\circ}C$ (1 hour). As a result, V-based thin interlayer between Cu-V film and $SiO_2$ dielectric layer was formed by itself with annealing. Thin interlayer was confirmed by TEM (Transmission Electron Microscope) analysis. Barrier thermal stability was tested with I-V (for measuring leakage current) and XRD analysis after 300, 400, 500, 600, and $700^{\circ}C$ (12 hour) annealing. With this research, over $500^{\circ}C$ annealed barrier has large leakage current. However V-based diffusion barrier annealed at $400^{\circ}C$ has good thermal stability. Thus, thermal stability of vanadium-based thin interlayer as diffusion barrier is good for copper interconnection.
본 연구에서는 DRAM 제조 집적공정의 금속배선으로 사용하는 구리의 자기 열처리(self-annealing) 후 박막 특성 변화에 대한 연구를 진행하였다. 구리를 증착하고 상온에서 시간이 경과하면 구리가 성장하여 결정체 크기 변화가 생기는데 이를 자기 열처리라고 부른다. 구리 금속의 증착은 전기 도금법(electroplating)을 사용하였다. 구리 도금액으로 유기 첨가물이 다른 두 가지 시료인 기준 도금액과 평가 도금액 두 용액에 대해 평가 하였다. 자기 열처리 시간이 경과함에 따라 시간에 대해 면 저항 값의 변화가 없는 영역과 이후 급격하게 떨어지는 구간으로 나누어지고 최종적으로 포화면 저항 값을 보인다. 최종적인 면 저항 값은 초기 값 대비 20% 개선 효과를 보인다. 평가 전해액의 자기 열처리 효과가 기준 용액 대비 더 빠른 시간 안에 이루어졌는데 이는 유기 첨가물의 차이 때문이다. 개선의 효과 분석으로 TEM 장비를 이용하여 결정체 변화를 관찰하였고 자기 열처리 공정에 의해 효과적인 결정체 성장이 이루어졌음을 발견했다. 또한 단면 TEM 측정 결과 자기 열처리 된 시료는 전류 방향으로의 결정체 경계면 숫자가 줄어드는 bamboo 구조를 보인다. 열적 열하 특성(thermal excursion characteristics) 측정 결과 고온 열처리 대비 자기 열처리 시료가 hillock 특성이 보이지 않고 이는 박막의 신뢰성 특성을 향상 시킨다. Electron backscattered diffraction (EBSD) 측정 결과 결정체가 $2{\mu}m$까지 성장한 결정체를 관찰하였고 스트레스에 의한 void를 억제하는데 유리한 (100) 면 비중이 증가하는 방향으로 결정체 성장이 이루어짐을 알 수 있다.
In this study, the reflow characteristics of copper thin films which is expected to be used as interconnection materials in the next generation semiconductor devices were investigated. Cu thin films were deposited on the TaN diffusion barrier by metal organic chemical vapor deposition (MOCVD) and annealed at the temperature between 250℃ and 550℃ in various ambient gases. When the Cu thin films were annealed in the hydrogen ambience compared with oxygen ambience, sheet resistance of Cu thin films decreased and the breakdown of TaN diffusion barrier was not occurred and a stable Cu/TaN/Si structure was formed at the annealing temperature of 450℃. In addition, reflow properties of Cu thin films could be enhanced in H₂ ambient. With Cu reflow process, we could fill the trench patterns of 0.16~0.24 11m with aspect ratio of 4.17~6.25 at the annealing temperature of 450℃ in hydrogen ambience. It is expected that Cu reflow process will be applied to fill the deep pattern with ultra fine structure in metallization.
The Wafer Level Packaging is one of the most important technologies in the semiconductor industry today. Its primary advantages are its small form factor and low cost potential for manufacturing including test procedure. The CASIO's WLP samples, application example and the structure are shown in Fig.1, 2&3. There are dielectric layer , under bump metal, re-distribution layer, copper post , encapsulation material and terminal solder .The key technologies are 'Electroplating thick copper process' and 'Unique wafer encapsulation process'. These are very effective in getting electrical and mechanical advantages of package. (Fig. 4). CASIO and CMK are developing a new System Packaging technology called the Embedded Wafer Level Package (EWLP) together. The active components (semiconductor chip) in the WLP structure are embedded into the Printed Wiring Board during their manufacturing process. This new technical approach has many advantages that can respond to requirements for future mobile products. The unique feature of this EWLP technology is that it doesn't contain any solder interconnection inside. In addition to improved electrical performance, EWLP can enable the improvement of module reliability. (Fig.5) The CASIO's WLP Technology will become the effective solution of 'KGD problem in System Packaging'. (Fig. 6) The EWLP sample shown in Fig.7 including three chips in the WLP form has almost same structure wi_th SoC's. Also, this module technology are suitable for RF and Analog system applications. (Fig. 8)
The production of multipurpose cotton fabrics aimed at elevating the quality of aerobic and dance sportswear is explored in this study. Powder metallurgy, known for its high efficiency in manufacturing technological components with minimal waste, is employed as a method for fabricating brush ferrules for painting. The utilization of iron-copper material, prepared through powder metallurgy, enhances the strength and quality of the brush ferrules. A microscopic analysis reveals a robust interconnection between the particles of each layer achieved through isostatic pressure, resulting in a favorable microstructure. The relative density and strength of parts produced from copper-iron powder exhibit an increase with higher pressure levels. The application of this material in brush ferrules ensures their durability and longevity, thereby supporting the creation of artwork. The evolution of art over time reflects changing ideas and possibilities, and technological advancements have significantly improved artistic tools. The role of tools in artistic expression is paramount, and the integration of powder metallurgy materials in brush ferrules fortifies their artistic importance. In summary, this study underscores the advantages of powder metallurgy in augmenting the quality of art tools and facilitating artistic creation.
To understand how reactivity between reinforcing nanoparticles and aqueous solution affects electrodeposited Cu thin films, two types of commercialized cerium oxide (ceria, $CeO_2$) nanoparticles were used with copper sulfate electrolyte to form in-situ nanocomposite films. During this process, we observed variation in colors and pH of the electrolyte depending on the manufacturer. Ceria aqueous solution and nickel sulfate ($NiSO_4$) aqueous solutions were also used for comparison. We checked several parameters which could be key factors contributing to the changes, such as the oxidation number of Cu, chemical impurities of ceria nanoparticles, and so on. Oxidation number was checked by salt formation by chemical reaction between $CuSO_4$ solution and sodium hydroxide (NaOH) solution. We observed that the color changed when $H_2SO_4$ was added to the $CuSO_4$ solution. The same effect was obtained when $H_2SO_4$ was mixed with ceria solution; the color of ceria solution changed from white to yellow. However, the color of $NiSO_4$ solution did not show any significant changes. We did observe slight changes in the pH of the solutions in this study. We did not obtain firm evidence to explain the changes observed in this study, but changes in the color of the electrolyte might be caused by interaction of Cu ion and the by-product of ceria. The mechanical properties of the films were examined by nanoindentation, and reaction between ceria and electrolyte presumably affect the mechanical properties of electrodeposited copper films. We also examined their crystal structures and optical properties by X-ray diffraction (XRD) and UV-Vis spectroscopy.
SiP의 3D패키지에 있어서 구리도금은 매우 중요한 역할을 한다 이러한 구리 도금의 조건을 알아보기 위하여 조건이 다른 전해질에서 전기화학적 I-V특성을 분석하였다. 첨가제로 억제제와 촉진제의 특성을 분석하였다. 3D 패키지에 있어서 직경 50, 75, $100{\mu}m$의 via를 사용하였다. Via의 높이는 $100{\mu}m$로 동일하였다. Via의 내부는 확산방지층으로 Ta을 전도성 씨앗층으로 Cu를 magnetron 스퍼터링 방법으로 도포하였다. 직류, 펄스, 펄스-역펄스 등 전류의 파형을 변화시키면서 구리 도금을 하였다. 직류만 사용하였을 경우에는 결함 없이 via가 채워지지 않았으며 펄스도금을 한 경우 구리 충진이 개선을 되었으나 결함이 발생하였다. 펄스-역펄스를 사용한 경우 결함 없는 구리 충진층을 얻을 수 있었다.
We have demonstrated the production of thin films containing multilayer graphene-coated copper nanoparticles (MGCNs) by a commercial electrodeposition method. The MGCNs were produced by electrical wire explosion, an easily applied technique for creating hybrid metal nanoparticles. The nanoparticles had average diameters of 10-120 nm and quasi-spherical morphologies. We made a complex-electrodeposited copper thin film (CETF) with a thickness of $4.8{\mu}m$ by adding 300 ppm MGCNs to the electrolyte solution and performing electrodeposition. We measured the electric properties and performed corrosion testing of the CETF. Raman spectroscopy was used to measure the bonding characteristics and estimate the number of layers in the graphene films. The resistivity of the bare-electrodeposited copper thin film (BETF) was $2.092{\times}10^{-6}{\Omega}{\cdot}cm$, and the resistivity of the CETF after the addition of 300 ppm MGCNs was decreased by 2% to ${\sim}2.049{\times}10^{-6}{\Omega}{\cdot}cm$. The corrosion resistance of the BETF was $9.306{\Omega}$, while that of the CETF was increased to 20.04 Ω. Therefore, the CETF with MGCNs can be used in interconnection circuits for printed circuit boards or semiconductor devices on the basis of its low resistivity and high corrosion resistance.
전자 통신 산업이 발달하면서 도전성 재료의 사용이 증가하게 되었다. 그에 따라 주로 사용되어오던 귀금속들을 대신할 저렴한 재료들이 필요하게 되었다. 그 중 구리는 귀금속에 비해 값이 저렴하고, 유사한 열 전기적 특성을 가졌지만 대기 중에서 쉽게 산화가 되는 문제점이 있다. 산화를 방지하기 위해서는 제조공정이 복잡해져 사용에 제한이 되어왔다. 구리의 산화 방지를 위한 방법 중 하나로 산화에 강한 금속을 Core-Shell 구조로 도금시켜 고유의 특성을 유지하며 산화를 방지하는 방법이 있다. 본 연구에서는 무전해 도금법으로 구리분말에 주석(Sn) 도금을 했고, 도금에 영향을 주는 인자들에 대해서 연구했다. XRD, FE-SEM, FIB, 4-Point Probe 등의 분석결과 구리 표면에 치밀한 주석피막이 도금되었고, 대기 중에서 산화가 되지 않았다. 분석결과를 바탕으로 최적의 도금 조건을 도출했고, 추가적으로, 도전성 필러 응용 가능성에 대한 실험을 했다. 합성된 분말을 pellet 형태로 압분 성형한 후 저온 열처리 전과 후의 변화를 분석했다. 그 결과 저온 치밀화를 통해 용융된 주석이 구리 입자들을 상호연결 시켰고, 전기 전도가 향상되었다.
Cleaning is required following CMP (chemical mechanical planarization) to remove particles. The minimization of particle residue is required with each successive technology generation, and the cleaning of wafers becomes more complicated. In copper damascene process for interconnection structure, it utilizes 2-step CMP consists of Cu and barrier CMP. Such a 2-steps CMP process leaves a lot of abrasive particles on the wafer surface, cleaning is required to remove abrasive particles. In this study, the chemical mechanical cleaning(CMC) is performed various conditions as a cleaning process. The CMC process combined mechanical cleaning by friction between a wafer and a pad and chemical cleaning by CMC solution consists of tetramethyl ammonium hydroxide (TMAH) / benzotriazole (BTA). This paper studies the removal of abrasive on the Cu wafer and the cleaning efficiency of CMC process.
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[게시일 2004년 10월 1일]
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