Journal of Information Science Theory and Practice
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제12권4호
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pp.36-49
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2024
In recent years, the concept of a configurable process model has made many contributions, with the need for generic and reusable models. The high demand for this type of generic model is accompanied by quality requirements, as these models must be as comprehensive as possible to facilitate the task of customization. Many approaches exist to deal with configurable process models, especially in the field of process mining, including its three types of techniques: discovery, conformance, and enhancement. However, there is a lack of semantic representation in the resulting models. In this study, we propose a novel automated approach based on the extension of the Inductive Miner algorithm used to discover business process models. This method discovers a semantically annotated configurable process model using two ontologies: variability ontology and domain ontology-related concepts, which will improve and facilitate the configurable process model customization.
An application specific processor for an H.264 decoder with a configurable embedded processor is designed in this research. The motion compensation, inverse integer transform, inverse quantization, and entropy decoding algorithm of H.264 decoder software are optimized. We improved the performance of the processor with instruction-level hardware optimization, which is tailored to configurable embedded processor architecture. The optimized instructions for video processing can be used in other video compression standards such as MPEG 1, 2, and 4. A significant performance improvement is achieved with high flexibility. Experimental results show that we could achieve 300% performance for the H.264 baseline profile level 2 decoder.
A novel approach of embedded systems for video coding is introduced with the main theme focused on logic-enhanced DRAM and configurable processor. This approach is aiming at reducing high computational costs and frequent memory accessing, which embedded systems are suffering with in the execution of video coding. According Co the software execution analysis, large size functions with intensive memory accesses are tuned to be executed by the logic-enhanced DRAM while small size functions repeatedly called are to be executed by dedicated instructions, which are newly introduced in the configurable processor. The proposed system can speed up H.263 video coding algorithm 7.4 times in comparison with the conventional embedded processor based system.
A new architecture of field programmable gate array for high-speed datapath applications is presented. Its implementation is facilitated by a configurable interconnect technology based on a one-time, two-terminal programmable, very low-impedance anti-fuse and by a configurable logic module optimized for datapath applications. The configurable logic module can effectively implement diverse logic functions including sequential elements such as latches and flip-flops, and arithmetic functions such as one-bit full adder and two-bit comparator. A novel programming architecture is designed for supplying large current through the anti-fuse element, which drops the on-resistance of anti-fuse below $20{\Omega}$. The chip has been fabricated using a $0.8-{\mu}m$ n-well complementary metal oxide semiconductor technology with two layers of metalization.
구성가능한 소프트웨어 제품라인 시험은 모든 멤버제품들에 포함되는 공통 부분과 일부 또는 단일 제품에 포함되는 가변 부분을 고려해야 하기 때문에 단일 제품 시험 방법들을 그대로 적용하기 어렵다. 소프트웨어 시스템 시험에서 시험 커버리지는 수행된 시험의 적절성을 측정하는 척도이다. 구성가능한 소프트웨어 제품라인으로부터 생성될 수 있는 멤버제품들은 수백 개에 이를 수 있기 때문에 시험 커버리지 측정은 소프트웨어 제품라인 수준에서 시험의 적절성을 평가하기 위해 중요하다. 이 논문은 구성가능한 소프트웨어 제품라인 시험에서 제품라인 수준의 코드 커버리지 측정 방법을 제안한다. 제안한 방법은 피처 집합의 포함 관계를 기준으로 제품들을 계층화한 후 제품라인의 멤버제품들을 시험하고, 시험으로부터 얻어진 각 제품의 시험 커버리지들을 종합하여 SPL 시험 커버리지를 정량화한다. 제안한 방법을 11개의 구성가능한 소프트웨어 제품라인 사례에 적용하여 검증한 결과, 제안한 방법은 SPL 시험이 얼마나 철저하게 수행되었는지를 정량적으로 기술하여 SPL 시험의 적정성을 확인할 수 있도록 도왔다. 또한, 새로 추가된 SPL 멤버제품의 시험이 이전 멤버제품 시험 대비 커버리지를 증가시키는 방향인지 확인할 수 있어 새로운 시험케이스들이 멤버제품들 간의 차이를 커버하는 방향으로 시험이 이루어지고 있는지 확인할 수 있었다.
본 논문에서는 소형 와이브로 기지국을 실내에서 운용하고자 할 때 중앙 관리 서버를 통해 기지국의 무선 파라미터를 최적화하는 방법에 대해 논의한다. 운용요원에 의해 수동으로 기지국의 무선 파라미터가 설정되던 기존의 방식과는 달리, 원격 컨트롤러를 통해 자동으로 무선 파라미터들이 설정된다는 점에서 소형 와이브로 기지국은 자가 설정 기지국 (Self-Configurable Radio Access Station: SC-RAS)으로도 명명된다. 이러한 실내 SC-RAS 망을 도입하는 주된 목적이 전송 전력의 세기를 높여 건물 안에서 발생하는 음영지역 문제를 해결하기 위함이지만, 동시에 한 가지 고려해야 하는 점은 SC-RAS가 기존 와이브로 망에 미치는 신호 간섭을 최소화해야 한다는 것이다. 결과적으로 SC-RAS의 전송 전력과 주파수 (Frequency Assignment :FA)를 올바르게 선택하는 것이 매우 중요하다. 본 논문에서는 이 SC-RAS의 무선 파라미터 최적화 문제를 혼합 정수 계획법 (Mixed Integer Programming: MIP)을 이용하여 풀고, SC-RAS 설치 전과 후의 성능을 비교 및 분석한다.
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[게시일 2004년 10월 1일]
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