Ta-silicide의 게이트 전극 및 비트라인(bit line)으로의 사용가능성을 알아보기 위하여 As, P, $BF_2$가 $5{\times}10^15cm^-2$의 농도로 이온주입된 다결정 실리콘에 탄탈륨을 스퍼터링으로 증착한 후 급속 열처리로 Ta-silicide를 형성하였다. 형성된 Ta-silicide의 특성은 4-탐침법, X-rayghlwjf, SEM 단면사진과 ${\alpha}$-step으로 조사하였으며, 불순물들의 거동은 Secondary Ion Mass Spectroscopy(SIMS)로 알아보았다. $TaSi_2$의 형성은 $800^{\circ}C$에서 시작하며 $1000^{\circ}C$ 이상에서 완료됨을 알았다. 형성된 $TaSi_2$층으로 out-diffusion 하였다.
사파이어 (0001) 기판의 활성화 이온빔 (RIB) 처리 후 MOCVD에서 성장한 GaN박막의 열처리를 통한 구조 변화를 살펴보고, 전기적 성질의 변화를 관찰하기 위하여 전기로를 이용하여 열처리를 하였다. 시편의 분석을 위하여 DCXRD, Hall, TEM을 사용하였다. 100$0^{\circ}C$에서 시간을 변화시키면서 열처리한 시편에서 DCXRD의 FWHM는 약 50 arc-sec 정도 감소하였고, Hall 이동도는 약 80$\textrm{cm}^2$/V.sec 정도 향상되었다. 가장 좋은 Hall 이동도를 보인 처리된 시편과 처리 전 시편의 TEM 비교 관찰에서 전위 밀도는 56~69% 정도 감소하였고 격자의 변형도 줄어들었다. 이것은 결정의 질과 전기적 성질 사이의 상관관계를 암시하며, 기판의 RIB 처리와 성장 후 적절한 열처리의 조합이 MOCVD로 성장시킨 GaN 박막의 특성을 개선시키는 것을 명확하게 보여준다.
원거리 플라즈마 화학증착법을 이용하여 저온에서 이산화규소박막을 제조하였다. 본 연구 에서는 공정변수인 기판의 온도, 반응기체의 조성 및 분압과 플라즈마 전력에 따른 산화막의 재료적인 물성을 평가하였다. XPS결과에서 산화막은 양론비(O/Si=2)보다 약간 적어 실리콘이 많이 함유된 막으로 나타났다. 이 경우 굴절율과 ESR분석에 의해 미결합된 실리콘의 양이 증가함을 알 수 있었다. SIMS분석에 의해 미량의 질소성분이 계면에 존재하는 것과 실리콘 미결함을 관찰하였다. FT-IR로부터 막내 수소량을 정량화하였으며 결합각 분포는 20$0^{\circ}C$이상에서 열산화막과 비슷한 값을 얻었다. 하지만 열산화막에 비해 높은 식각율을 보여 계면 스트레스에 의해 막내의 결합력이 약해진 것으로 생각된다.
KIEE International Transactions on Electrophysics and Applications
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제11C권3호
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pp.70-74
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2001
Admittance or impedance spectroscopy is one of the powerful tools to study dielectric relaxation and loss processes in organic and inorganic materials. In this study, the frequency dependent properties of an indium tin oxide/tris(8-hydroxyquinoline) aluminum($Alq_3$)/aluminum structure have been studied. The conductance of the $Alq_3$ film increases with the DC applied voltage up to 4V and decreases above 4V in the low frequency region. This indicates that the resistance of the device decreases with the applied bias due to the carrier injection enhancement, thereafter the injected carriers form the space charge and the additional injection of carriers is prevented. The Cole-Cole plot of the admittance takes a one-semicircle shape, which means that the device can be modeled as a parallel resistor-capacitor network. The resistance and capacitance were estimated as 8.62k${\Omega}$ and 2.7nF, respectively, at 3V in the low frequency region. The dielectric constant ( ${\epsilon}'$ ) of the $Alq_3$ film is independent of the frequency in the low frequency region below 100kHz, while the frequency dependency was observed at above 100kHz. The dielectric loss factor ( ${\epsilon}"$ ) of the $Alq_3$ film shows the dielectric dispersion below 100kHz and dielectric absorption in higher frequency domain. The dispersion is thought to be related to the hopping process of the carriers. The ${\epsilon}"$ is proportional to the reciprocal of the frequency. The dielectric relaxation time was extracted to about 0.318${\mu}s$ from the dielectric absorption spectrum.
We fabricated a resistive superconducting fault current limiter (SFCL) of a meander type based on a YBCO film with the meander cross section of 5 $\times$$10^{-6}$$cm^2$, and performed current limitation experiments. The film was coated quench current was 9.6 Apeak at 60 Hz, and the fast quench time was 0.63 msec. The resistance of the limiter continuously increased for three cycles dut to the temperature rise in the gold layer. The temperature of the current limiting element reached the room temperature in 11 msec, $150^{\circ}C$ in 54 msec after quench, and was saturated afterwards. For $45^{\circ}$and $90^{\circ}$faults the fast quench times were 0.56 msec and 0.26 msec, respectively. The quench time is believed to be reduced because the fault occurred when the current was either increasing or at the peak value. This limiter effectively limited the fault current to about 1/5 of the potential current with no SFCL right after the fault and to about 1/8.5 in three cycles. We confirmed that the gold layer effectively carried out the role of heat dissipation as the SFCL was quenched.
The composite SiO$_2$/Si$_3$N$_4$/SiO$_2$(ONO) film formed by oxidation on nitride film has been widely studied as DRAM stacked capacitor multi-dielectric films. Load lock(L/L) LPCVD system by HF cleaning is used to improve electrical capacitance and to scale down of effective thickness for memory device, but is brings a new problem. Nitride film deposited using HF cleaning shows selective deposition on poly silicon and oxide regions of capacitor. This problem is avoidable by carpeting chemical oxide using $H_2O$$_2$cleaning before nitride deposition. In this paper, we study the limit of nitride thickness for abnormal oxidation and the initial deposition time for nitride deposition dependent on underlayer materials. We proposed an advanced fabrication process for stacked capacitor in order to avoid selective deposition problem and show the usefulness of nitride deposition using L/L LPCVD system by $H_2O$$_2$cleaning. The natural oxide thickness on polysilicon monitor after HF and $H_2O$$_2$cleaning are measured 3~4$\AA$, respectively. Two substrate materials have the different initial nitride deposition times. The initial deposition time for polysilicon is nearly zero, but initial deposition time for oxide is about 60seconds. However the deposition rate is constant after initial deposition time. The limit of nitride thickness for abnormal oxidation under the HF and $H_2O$$_2$cleaning method are 60$\AA$, 48$\AA$, respectively. The results obtained in this study are useful for developing ultra thin nitride fabrication of ONO scaling and for avoiding abnormal oxidation in stacked capacitor application.
(Bi$_2$O$_2$)$^{2+}$층 사이에 두 개의 Ta-O 팔면체로 연결된 Bi 계의 층상 페로브스카이트 구조인 SrBi$_2$Ta$_2$O$_{9}$ (SBT) 박막을 XPS를 이용하여 깊이별 화학 상태 변화를 분석하였다. 아르곤 이온으로 SBT 박막을 식각하면, SBT 박막의 각 구성물들은 가속 Ar$^{+}$ 이온의 에너지에 따라 변화한다. SBT 각 구성물 중 Sr 3d의 화학 상태는 Ar$^{+}$ 이온의 에너지변화에 따라 근소하게 변화한다. 반면에, Ta 4f와 Bi 4f의 화학 상태 변화는 인가되는 Ar$^{+}$ 이온 에너지에 확실하게 의존한다. 특히, Bi 4f는 Sr과 Ta에 비해 낮은 Ar$^{+}$ 이온 에너지에서도 Bi-O의 화학 상태가 금속 Bi 화학 상태로 현저하게 변화한다. 이러한 SBT 박막의 화학 상태 변화는 산호 원자의 선택적인 식각 때문에 발생하며 선택적인 식각은 SBT 박막 내에서 각 구성물과 산소간의 질량 차이와 각 구성물의 열적 안정성에 의존함을 알 수 있다.
본 연구는 에치스토퍼를 기존의 방식과 다르게 적용하여 수소화 된 비정질 실리콘 박막 트랜지스터의 제조공정을 단순화하고, 박막 트랜지스터의 게이트와 소오스-드레인간의 기생용량을 줄인다. 본 연구의 수소화 된 비정질 실리콘 박막 트랜지스터는 Inverted Staggered 형태로 게이트 전극이 하부에 있다. 실험 방법은 게이트전극, 절연층 , 전도층, 에치스토퍼 및 포토레지스터층을 연속 증착한다. 스토퍼층을 게이트 전극의 패턴으로 남기고, 그 위에 n+a-Si:H 층 및 NPR(Negative Photo Resister)을 형성시킨다. 상부 게이트 전극과 반대의 패턴으로 NPR층을 패터닝하여 그것을 마스크로 상부 n+a-Si:H 층을 식각하고, 남아있는 NPR층을 제거한다. 그 위에 Cr층을 증착한 후 패터닝하여 소오스-드레인 전극을 위한 Cr층을 형성시켜 박막 트랜지스터를 제조한다. 이렇게 제조하면 기존의 박막 트랜지스터에 비하여 특성은 같고, 제조공정은 줄어들며, 또한 게이트와 소오스-드레인간의 기생용량이 줄어들어 동작속도를 개선시킬 수 있다.
본 연구는 투명산화물반도체의 전기적인 특성과 산소공공과의 관계를 알아보기 위해서 $TiO_2$ 박막을 증착하여 MIM 구조를 만들어서 전압전류 특성을 관찰하였다. 산소공공은 XPS분석으로 이루어졌으며, 커패시턴스를 측정하여 전하의 용량이 많은 곳에서 산소공공이 어떤 영향을 주는가에 대하여도 조사하였다. 열처리를 통하여 결정질구조로 변하는 $TiO_2$ 박막은 산소공공이 가장 낮은 곳에서 커패시턴스 값이 가장 높았으며, 전하의 양이 많았다. 따라서 전하의 양이 많은 $TiO_2$박막이 $CO_2$ 가스에 대하여 가장 잘 민감하게 반응하는 것을 확인하였다.
200nm 정도의 두께를 가진 SBT 박막이 liquid delivery MOCVD 공정에 의해 (111) oriented Pt/Ti/$SiO_2$/Si 기판 위에 증착되었다 이 실험에서는 $Sr(TMHD)_2$tetraglyme, $Bi(ph)_3$ 그리고 $Ta(O^iPr)_4$(TMHD)를 출발 물질로 사용하였다. Sr 출발 물질의 열적 안정화를 위해서 adduct로 tetraglyme를 사용하여 실험하였고 유기 용매로는 n-butyl acetate를 사용하였다 Substrate temperature와 reactor pressure는 각각 $570^{\circ}C$와 5Torr로 유지시켰다. 또한 vaporizer의 용도는 $190-200^{\circ}C$, 그리고 delivery line 의 온도는 vaporizer 보다 높게 유지 $(220-230^{\circ}C)$하여 출발 용액을 분당 0.1ml로 50분간 주입하였다. 수송가스로 Ar, 산화제로 $O_2$ 가스를 사용하였다. 제조한 SBT 박막은 $750^{\circ}C$에서 열처리한 후 인가전압 3V와 5V에서 $2P_r$값이 각각 6.47, $8.98{\mu}C/cm^2$이었으며, $2E_c$값은 인가전압 3V와 5V에서 각각 2.05, 2.31V이었다 그리고 $800^{\circ}C$에서는$750^{\circ}C$에서 열처리한 SBT 박막보다 다소 우수한 이력특성을 나타내어 $2P_r$ 값은 인가전압 3V와 5V에서 각각 7.59, $10.18{\mu}C/cm^2$ 이었으며, $2E_c$값은 인가 전압 3V와 5V에서 각각 2.00, 2.21V 이었다.
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[게시일 2004년 10월 1일]
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