• 제목/요약/키워드: Synchronization

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무손실 전송선로를 가진 카오스 회로에서의 카오스 동기화 (Chaos Synchronization with Lossless Transmission Line of Chaos Circuit)

  • 배영철
    • 한국정보통신학회:학술대회논문집
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    • 한국해양정보통신학회 1999년도 추계종합학술대회
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    • pp.501-504
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    • 1999
  • Chua's circuit is a simple electronic network which exhibits a variety of bifurcation and attractors. The circuit consists of two capacitors, an inductor, a linear resistor, and a nonlinear resistor. In this paper, a transmitter and a receiver using two identical Chua's circuits are proposed and a synchronizations of lossless transmission line are investigated. Since the synchronization of the transmission system is impossible by coupled synchronization, the drive-response synchronization theory were used. As a result, the chaos synchronization has delay characteristics in the lossless transmission system caused by the line parameters L and C.

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가변메시지형식체계에서 통신보안을 위한 비트동기 정보의 전송영향 분석 (Analysis of Transmission Performance of Communication Security Bit Synchronization Information in VMF System)

  • 박영미;손영호;윤장홍;홍진권
    • 대한전기학회논문지:시스템및제어부문D
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    • 제54권7호
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    • pp.443-446
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    • 2005
  • In this paper, we analyses transmission performance of communication security(COMSEC) bit synchronization information over the single channel ground and airborne radion system in variable message format system. Experimental results demonstrate the robust characteristics of the COMSEC bit synchronization information in 10-1 $\~$ 10-5 of bit error channel and the relationship of time duration of bit synchronization and probability of synchronization detection.

펨토셀 주파수 신호 생성을 위한 IEEE 1588 기반 클록 동기화 시스템의 설계 (Design of a IEEE 1588 Based Clock Synchronization System for Femtocell Frequency Signal Generation)

  • 한지호;박용재
    • 한국산학기술학회논문지
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    • 제16권7호
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    • pp.4871-4877
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    • 2015
  • 본 논문은 펨토셀에서 요구되는 정확한 주파수 신호 생성을 위한, IEEE 1588 기반의 클록 동기화 회로 및 시스템을 제시한다. 동작 검증 및 성능 평가를 위한 프로토타입 보드와 실험 환경에 대하여 설명하고, 실험 결과가 펨토셀 동기화에 적합함을 확인한다. 펨토셀은 설치 위치의 제약이 없는 저가의 장비로 개발해야 하기 때문에, IEEE 1588 동기화 시스템의 실제 구현에 관한 연구가 매우 중요하다. 제안하는 동기화 회로를 내장한 펨토셀 기지국을 FPGA 보드에 프로그램하고, 그 기지국들의 네트워크에서 실험한 결과 -16 ~ 9 ns 이내의 동기화 오차를 보장함을 관찰하였고, 이는 3GPP의 HNB 동기화 기준을 만족하는 수준임을 확인할 수 있다.

에너지 효율적인 무선 네트워크용 상호 시각 동기화 프로토콜 (An Energy-efficient Pair-wise Time Synchronization Protocol for Wireless Networks)

  • 배시규
    • 한국멀티미디어학회논문지
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    • 제19권10호
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    • pp.1808-1815
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    • 2016
  • TPSN(Timing-sync Protocol for Sensor Networks), the representative of time synchronization protocol, has been already developed to provide time synchronization among nodes in wireless sensor networks. Even though the TPSN's method has been referenced by so many other time synchronization schemes for resource-constrained networks like wireless sensor networks or low power personal area networks, it has some inefficiency in terms of power consumption and network-wide synchronization time (or called convergence time). The main reason is that each node in TPSN needs waiting delay to solve the collision problem due to simultaneous transmission among competing nodes, which causes more power consumption and longer network convergence time for a network-wide synchronization. In this paper an improved scheme is proposed by changing message exchange method among nodes. The proposed scheme not only shortens network-wide synchronization time, but also reduce collision traffic which lead to needless power consumption. The proposed scheme's performance has been evaluated and compared with an original scheme by simulation. The results are shown to be better than the original algorithm used in TPSN.

플러딩 라우팅 프로토콜과 양방향 LTS를 결합한 센서 노드의 시간 동기화 기법 (A Time Synchronization Protocol of Sensor Nodes Combining Flooding-Routing Protocol with Bidirectional LTS)

  • 신재혁;오현수;전중남
    • 정보처리학회논문지C
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    • 제18C권2호
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    • pp.119-126
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    • 2011
  • 일반적으로 센서 네트워크에서는 라우팅 트리를 구축한 후에 시간 동기화 작업을 따로 진행하였다. 그 때문에 패킷교환의 횟수가 늘어나고 전력의 소모를 유발한다. 본 논문에서는 라우팅 트리 구축과정에서 교환하는 정방향과 역방향의 패킷에 LTS(Lightweight Time Synchronization) 알고리즘 연산에 필요한 정보를 추가하여 플러딩 라우팅 트리 구축 알고리즘과 시간 동기화 과정을 결합한 알고리즘을 제안한다. 또한, 일정한 라운드 시간을 사용하여 클럭 휨으로 인한 시간 오류를 보정하였다. 제안하는 알고리즘이 TSRA(Time Synchronization Routing Algorithm) 방식보다 센서 노드들 간의 시간을 더욱 정교하게 동기화한다는 것을 NS2 시뮬레이터를 통해서 증명하였다.

무선 센서 네트워크에서 시각 동기 정확도 분석 (Accuracy Analysis of Time Synchronization in Wireless Sensor Networks)

  • 황소영
    • 한국정보통신학회논문지
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    • 제17권6호
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    • pp.1487-1495
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    • 2013
  • 센서 네트워크의 여러 핵심 기술 요소 중에서 시각 동기 기술은 센서 네트워크 응용에 필수 요소이다. 여러 노드들로부터 같은 이벤트의 중복 감지 인식, 기록된 이벤트의 발생순서 구분, 이동체의 이동 속도 계산 등에 시각 정보는 기저 데이터가 된다. 본 논문에서는 다양한 무선 센서 네트워크 시각 동기 기법 중 대표적인 시각 동기 모델인 pair-wise 시각 동기 알고리즘을 대상으로 시각 동기 오류 요소를 추출하고 이러한 오류 요소가 시각 동기 정확도에 끼치는 영향을 이론적으로 분석하였다. 또한 시뮬레이션을 통해 이론적 분석 결과를 검증하였다. 이러한 결과는 향후 센서 네트워크 시각 동기 알고리즘의 성능 개선이나 개발에 활용될 것으로 기대된다.

생체모방 기법을 활용한 OFDMA기반 무선 메쉬 네트워크의 분산 시간 및 주파수 동기화 알고리듬의 수렴성 분석 (Convergence Analysis of Distributed Time and Frequency Synchronization Algorithm for OFDMA-Based Wireless Mesh Networks Using Bio-Inspired Technique)

  • 김미정;최주영;조용수
    • 한국통신학회논문지
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    • 제39A권8호
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    • pp.488-490
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    • 2014
  • 본 논문은 OFDMA 기반 무선 메쉬 네트워크에서 플로킹 기법을 활용한 분산 시간 및 주파수 동기화 알고리듬을 다룬다. 채널전송 지연의 영향을 고려하지 않는 기존 플로킹 기법과 달리, 본 논문에서는 실제 무선 메쉬 네트워크 환경을 고려하기 위하여 시간 및 주파수 동기를 맞추기 위한 동기화 파라미터를 설정하고, 제안된 시간 및 주파수 동기화 모델의 수렴조건과 동기화 파라미터 설정범위를 분석 도출한다. 그리고 모의실험을 통하여 동기화 파라미터에 설정에 따른 제안된 기법의 시간 및 주파수 동기화의 수렴성능을 검증한다.

OFDM 방식을 이용한 무선 LAN 시스템의 동기 (Synchronization for Wireless LAN System Using OFDM Technique)

  • 윤경석;최승국
    • 한국통신학회논문지
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    • 제27권1B호
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    • pp.79-89
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    • 2002
  • IEEE 802.11a 무선 OFDM 시스템을 위한 동기 처리 방법을 연구하였다. 먼저 수신되는 포락선 신호의 평균 전력을 계속 측정하여 대략적인 심볼 동기를 수행한다. 이때 이 심볼 동기에 대한 판정 확률과 최적의 판별 경계치가 구해졌다. 이어서 짧은 훈련 신호와 수신된 포락선 신호간의 상관성을 측정하는 방법으로 정확한 심볼 동기가 수행된다. 그 다음 긴 훈련 신호를 이용한 주파수 동기가 이루어진다. 심볼 동기 과정에서 발생되는 미세한 심볼 동기 오차에 의한 성상도의 회전 효과는 채널 보상 과정에서 잘 교정될 수 있다. 이와 같이 고안된 동기 방법을 이용하면 주파수 선택적 페이딩 채널 하에서도 특성이 우수한 동기를 획득할 수 있다.

무선 센서 네트워크에서 비잔틴 오류를 허용하는 클럭 동기화 기법 (A Byzantine Fault-tolerant Clock Synchronization Scheme in Wireless Sensor Networks)

  • 임형근;남영진;백장운;고석영;서대화
    • 한국정보과학회논문지:컴퓨팅의 실제 및 레터
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    • 제14권5호
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    • pp.487-491
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    • 2008
  • 본 논문에서는 무선 센서 네트워크에서 클럭 동기화 시 악의적인 노드의 클럭 동기화 방해 공격에 대처하기 위한 비잔틴 오류 감내 클럭 동기화 기법을 제안한다. 제안 기법은 클럭 동기화를 요구하는 노드가 m개의 악의적인 노드에 대처하기 위해 부모 노드뿐만 아니라 형제 노드로부터 3m+1개의 클럭 동기화 메시지를 수신하여 클럭동기화를 진행한다. 시뮬레이터를 이용한 성능 평가를 통하여, 제안 기법은 기존 클럭 동기화 기법에 비하여 악의적인 노드의 클럭 동기화 방해 공격 시 동기 정확도 측면에서 최대 7배 향상된 성능을 보여주었다.

동기망과 전송망에서의 동기클럭 성능 분석을 위한 시뮬레이터 개발 (Development of Simulator for Performance Analysis of Synchronization Clock in the Synchronization Network and Transmission Network)

  • 이창기
    • 정보처리학회논문지C
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    • 제11C권1호
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    • pp.123-134
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    • 2004
  • 동기 망과 전송망에서의 동기클럭 성능은 망의 안정성 화보와 데이터 전송 보장 측면에서 중요한 요소이다. 그러므로 망을 설계할 때 동기망과 전송망의 동기클럭 성능을 분석하기 위하여 다양한 파라메타를 적용할 수 있고, 그리고 최상상태에서 최악상태까지 망에서 나타날 수 있는 여러 가지 입력레벨을 적용할 수 있는 시뮬레이터가 필요하다. 따라서 본 논문에서는 동기망과 전송망에서의 동기클럭 특성을 분석할 수 있는 SNCA와 TNCA를 개발하였고, 또한 개발된 시뮬레이터를 활용하여 다양한 원더생성, 노드 수, 클럭 상태 등의 입력조건에 따른 NEl, NE2, NE3 등 전송망과 DOTS1과 DOTS2 등 동기 망에서의 동기 클럭 특성과 최대 노드수 결과를 얻었다.