본 논문에서는 전력선 통신과 조광 기술을 기반으로 에너지 절약과 적정 조도의 제어가 가능한 조명제어 스위치의 개발에 대하여 기술하였다. 개발된 스위치는 범용의 마이크로프로세서와 주변 전자기술을 이용하며, 하나의 마이크로프로세서로 전력선 통신과 조광기능을 구현함으로서 저가격 상용화가 가능하였다. 캐리어 주파수는 전송 데이터 길이와 신호감쇄를 고려하여 250kHz로 설정하였다. 저압선로에서 시제작품에 대한 시험결과, 본 스위치는 전력선의 길이와 부하용량의 변동에 대해 강인하게 동작하는 것을 확인하였다.
본 논문에서는 최근 증가 일로에 있는 자동점멸식 보안등에 대한 안전점검 방안을 제시하였다. 기술적인 측면으로서 보안등주의 하부에 안전점검을 위한 별도의 점검함을 설치하고 점검원이 누설전류, 누전차단기의 정상적인 동작 상태, 절연저항 및 접지저항을 승주하지 않고 측정할 수 있도록 하였으며, 충전부에 대한 직접 접촉의 가능성을 최대한으로 경감함으로써 감전의 위험으로부터 자유로울 수 있도록 설계하였다. 본 연구의 결과물을 실용화함으로써 보안등에 대한 점검을 최대한 안전하고 효율적으로 수행하는데 일조할 수 있을 것으로 기대한다.
본 논문은 단일형태의 버퍼 구조로 물리적인 단일 큐의 시퀀서 갖고 논리적으로 다중 큐의 형태로 구성된 ATM스위치를 제안한다. 제안된 스위치는 순환적 순위 알고리즘이 적용되도록 하드웨어로 구현된 ATM 셀의 출력 포트에 따라 ATM 셀이 정렬되도록 프로시져를 수행시킨다. 이 구조는 물리적으로 단일 버퍼를 갖지만 논리적으로는 순환적으로 순위를 결정하여 출력포트에서의 상충을 최대한 억제하도록 설계된 다중 큐의 기능을 하고 있다. 향후 이러한 형태의 구조는 다양한 구조의 라우팅을 위한 스위치로 응용되고, 시스템 구성의 확장성에 있어서도 큰 장점을 지니고 있어, 전송 효율적인 면에서도 훌륭한 구조로 평가된다.
We consider a priority-based packet-switching system with three phases of the packet transmission time. Each packet belongs to one of several priority classes, and the packets of each class arrive at a switch in a Poison process. The switch transmits queued packets on a priority basis with three phases of preemption mechanism. Namely, the transmission time of each packet consists of a preemptive-repeat part for the header, a preemptive-resume part for the information field, and a nonpreemptive part for the trailer. By an exact analysis of the associated queueing model, we obtain the Laplace-Stieltjes transform of the distribution function for the delay, i.e., the time from arrival to transmission completion, of a packet for each class. We derive a set of equations that calculates the mean response time for each class recursively. Based on this result, we plot the numerical values of the mean response times for several parameter settings. The probability generating function and the mean for the number of packets of each class present in the system at an arbitrary time are also given.
In this paper, we propose a channel allocation algorithm of MSAP(Mobile Subscriber Access Point) and data delivery scheme exploiting the symbol level network coding. The network is comprised of TS(Tactical Switch) as a backbone node, MSAPs, and TMFTs(Tactical Multi-Function Terminal). The TS performs the channel allocation considering the communication range overlapping between the neighboring MSAPs and applies the symbol level network coding, if necessary, depending on the position of the TMFTs. Assuming the number of available antennas of TMFT and MSAP will be extended to two from one, we propose two schemes: single mode and dual mode. Through the simulation, we show that the proposed delivery scheme provides higher delivery ratio and lower delivery delay compared with the legacy store-and-forward scheme.
본 논문에서는 ATM 망에서의 ADSL 정합장치 기능 구현에 대하여 기술한다. ADSL 정합장치 기능은 ADSL 모뎀에 연결되어 비대칭으로 송수신 되는 데이터의 ATM 물리 계층을 처리하는 ATM 교환기 표준 보드로 구현되었다. 기능 구현을 위해 기존 연구 결과로부터 최악의 선로 조건에서 가입자 선로의 누화, 임펄스 잡음 및 기타 가입자 선로에 가해지는 중요 전송 손실을 모델링하고, 시험 환경을 구성하여 성능 평가 시험을 하였다. 선로 시뮬레이터를 이용한 다양한 루프 및 최악의 선로 조건 시험에서 표준 규격을 만족한 것으로 나타났으며, ATM 교환기 및 ADSL 가입자 선로를 통한 고속 멀티미디어 서비스가 양호하게 수행됨을 확인하였고, 따라서 개발된 ADSL 정합장치는 ATM 망에서 기존 동선 가입자 선로를 통하여 양호한 ADSL 서비스를 제공할 수 있는 것으로 평가되었다.
This paper presents high efficiency 5A synchronous DC-DC buck converter. The proposed DC-DC buck converter works from 4.5V to 18V input voltage range, and provides up to 5A of continuous output current and output voltage adjustable down to 0.8V. This chip is packaged MCP(multi-chip package) with control chip, top side P-CH switch, and bottom side N-CH switch. This chip is designed in a 25V high voltage CMOS 0.35um technology. It has a maximum power efficiency of up to 94% and internal 3msec soft start and fixed 500KHz PWM(Pulse Width Modulation) operations. It also includes cycle by cycle current limit function, short and thermal shutdown protection circuit at 150℃. This chip size is 2190um*1130um includes scribe lane 10um.
In this paper, we introduce a new verification platform with ARM- and DSP-based multiprocessor architecture. Its simple communication interface with a crossbar switch architecture is suitable for a heterogeneous multiprocessor platform. The platform is used to verify the function and performance of a DVB-T baseband receiver using hardware and software partitioning techniques with a seamless hardware/software co-verification tool. We present a dual-processor platform with an ARM926 and a Teak DSP, but it cannot satisfy the standard specification of EN 300 744 of DVB-T ETSI. Therefore, we propose a new multiprocessor strategy with an ARM926 and three Teak DSPs synchronized at 166 MHz to satisfy the required specification of DVB-T.
This study proposes an industrial rehabilitation robot system which can exercise two joints in 3 dimensional spaces. The robot kinematics analysis and the results of studies on each joint for the rehabilitation robot could verify possibility of rehabilitation motion to exercise a joint. The force and torques sensor not only measures a rehabilitation performance of subjects between the abnormal limb and the manipulator, but also carries out an important function of safety device to prevent accidents. Also, limit sensors and emergency stop switch are used for high safety in this system. In this real test, the possibility of rehabilitation robot system is evaluated by C&R ARM I which is similar to upper-limb.
In this paper, we propoe a log N-stage ATM concentator. ATM concentrator is used in the ATM access network to concentrate the traffic offered at UNI, so that high utilization of the newtork rewources is achieved. The concetrator may be used as a construction block in the design of ATM switch. We define abasic element, named equalizer, and decribe its function and theory to construct an efficient concentrator using the element. In addition, a control scheme to enhance the concentrator to a superconcentrator is presented, which enables the concentration to start from an arbitrary output. This scheme makes it possible to construct an efficient ditributior or a barrel shifter which are often used in ATM switch and other application. The proposed concentrator has a low hardware complexity of O(N log N), thus it is economical to implement. Also, the time complexity of proposed concentrator for determining the rouging is O(N log N), which is faster than that of the existing ones.
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[게시일 2004년 10월 1일]
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