This study examined the friction and wear behavior of diamond-like carbon (DLC) films deposited from a radio frequency glow discharge using a hydrogen diluted benzene gas mixture. The DLC films were deposited on Si (100) and polished stainless steel substrates by r.f.-PACVD at hydrogen to benzene ratios, or the hydrogen dilution ratio, ranging from 0 to 2.0. The wear test was carried out in both ambient and aqueous environments using a home-made ball-on-disk type wear rig. The stability of the DLC coating in an aqueous environment was improved by diluting the benzene precursor gas with hydrogen, suggesting that hydrogen dilution during the deposition of DLC films suppress the initiation of defects in the film and improved the adhesion of the coating to the interface.
본 연구에서는 하지층으로 사용한 Mo(MoN)의 두께 변화에 따른 스핀밸브 구조의 자기적 특성과 열처리 결과를 비교 검토하였다. 사용된 스핀밸브는 Si 기판/Mo(MoN)$(t{\AA})/NiFe(21{\AA})/CoFe(28{\AA})/Cu(22{\AA})/CoFe(18{\AA})/IrMn(65{\AA})/Ta(25{\AA})$ 구조이다. 또한 본 연구에서는 MoN 하지층을 Si 기판에 증착하여 열처리후 특성을 분석하였다. Mo 박막에 비해 MoN 박막의 질소량이 증가할수록 증착률은 감소하였고, 비저항은 증가하였다. MoN 하지층을 사용한 경우 Mo의 경우보다 하지층 두께 변화($51{\AA}$까지)에 따라 자기저항비와 교환결합력의 변화는 소폭이었다. Mo 하지층의 열처리 온도별 자기저항비는 열처리 전 상온에서 2.86% 이었고, $200^{\circ}C$ 열처리 때 2.91 %로 증가하였다. 이후 열처리 온도를 $300^{\circ}C$까지 증가시키면 자기저항비는 2.91 %에서 2.16%로 감소하였다. 질소 유입량이 1 sccm인 MoN의 열처리 온도별 자기저항비는 열처리 전 상온에서 5.27%, $200^{\circ}C$일때 5.56%증가하였다. 이후 열처리 온도를 $300^{\circ}C$까지 증가시키면 자기저항비는 5.56%에서 4.9%로 감소하였다.
Polarization mode converters have been produced by utilizing Ti:LiNbO$_{3}$ channel waveguide and strain-optic effect. Shear strain for periodic perturbations of optical channel waveguides and phase matching can be obtained by an evaporated periodic SiO$_{2}$ thin film at 300.deg. C. The electrodes located on the either side of waveguide provide a means to electro-optically tune the wavelength for maximum polarization conversion via the electrooptic effect. The maximum conversion effeciency was observed at 21.deg. C for V=0 and 46.deg. C for V=30V aro the device having 7 .mu.m waveguide wiith and 350 periodic pads. The dependence of the number of pads on conversion efficiency was observed experimentally.fficiency was observed experimentally.
Organic materials have considerable attention as active semiconductors for device applications such as thin-film transistors (TFTs) and diodes. Pentacene is a p-type organic semiconducting material investigated for TFTs. In this paper, we reported the morphological and electrical characteristics of pentacene TFT films. The pentacene transistors showed the mobility of 0.8 $\textrm{cm}^2$/Vs and the grains larger than 1 ${\mu}{\textrm}{m}$. Deep-level transient spectroscopy (DLTS) measurements were carried out on metal/insulator/organic semiconductor structure devices that had a depletion region at the insulator/organic-semiconductor interface. The duration of the capacitance transient in DLTS signals was several ten of seconds in the pentacene, which was longer than that of inorganic semiconductors such as Si. Based on the DLTS characteristics, the energy levels of hole and electron traps for the pentacene films were approximately 0.24, 1.08, and 0.31 eV above Ev, and 0.69 eV below Ec.
ZnO thin films were prepared by RF magnetron sputter deposition on p-Si(100) wafer with various cooling rates of substrate temperature such as the substrates were pre-heated to $400^{\circ}C$ before the deposition and then cooled down naturally or slowly to $300^{\circ}C,\;200^{\circ}C,\;100^{\circ}C$, and R.T. by the temperature controller during the deposition. Crystalline and micro-structural characteristics of the films were investigated by XRD and SEM. ZnO films which cooled down naturally or slowly by the temperature controller during the deposition, especially the film were deposited with cooling down from $400^{\circ}C\;to\;200^{\circ}C$ slowly. showed the most outstanding c-axis preferred orientation.
본 연구는 기존의 방식으로 만든 비정질 실리콘 박막 트랜지스터의 제조공정에서 발생되는 결함에 대한 원인을 분석하고 해결함으로써 수율을 증대시키고 신뢰성을 개선하고자한다. 본 연구의 수소화 된 비정질 실리콘 박막 트랜지스터는 Inverted Staggered 형태로 게이트 전극이 하부에 있다. 실험 방법은 게이트전극, 절연층, 전도층, 에치스토퍼 및 포토레지스터층을 연속 증착한다. 스토퍼층을 게이트 전극의 패턴으로 남기고, 그 위에 n+a-Si:H층 및 NPR(Negative Photo Resister)을 형성시킨다. 상부 게이트 전극과 반대의 패턴으로 NPR층을 패터닝 하여 그것을 마스크로 상부 n+a-Si:H 층을 식각하고, 남아있는 NPR층을 제거한다. 그 위에 Cr층을 증착한 후 패터닝하여 소오스-드레인 전극을 위한 Cr층을 형성시켜 박막 트랜지스터를 제조한다. 이렇게 제조한 박막 트랜지스터에서 생기는 문제는 주로 광식각공정시 PR의 잔존이나 세척시 얇은 화학막이 표면에 남거나 생겨서 발생되며, 이는 소자를 파괴시키는 주된 원인이 된다. 그러므로 이를 개선하기 위하여 ashing이나 세척공정을 보다 엄격하게 수행하였다. 이와 같이 공정에 보다 엄격한 기준의 세척과 여분의 처리 공정을 가하여 수율을 확실히 개선 할 수 있었다.
Characteristics of methane direct-injection spark-ignition stratified combustion in lean hydrogen mixture were analyzed both in a single cylinder engine and in a constant volume combustion chamber. Combustion pressure and Instantaneous combustion chamber wall temperature during the combustion process were measured with a thin-film thermocouple and used in analyses of combustion and cooling loss. Results in this research show that the premixed hydrogen increases cooling loss to combustion chamber wall while achieving combustion promotion, and the combustion system is effective especially in lean mixture conditions. Analysis of flame propagation was also done with Schlieren photography in the constant volume combustion chamber.
An active-matrix LCD using thin film transistors (TFT) has been widely recognized as having potential for high-quality color flat-panel displays. Pixel-Design Array Simulation Tool (PDAST) was used to profoundly understand the gate si후미 distortion and pixel charging capability. which are the most critical limiting factors for high-quality TFT-LCDs. Since PDAST can simulate the gate, data and pixel voltages of a certain pixel on TFT array at any time and at any location on an array, the effect of the resistivity of gate line material on the pixel operations can be effectively analyzed. The gate signal delay, pixel charging ratio and level-shift of the pixel voltage were simulated with varying the parameters. The information obtained from this study could be utilized to design the larger area and finer image quality panel.
인이 높은 농도로 도핑되어진 LPCVD 다결정 실리콘 박막의 열팽창 계수를 마이크로 게이지법을 이용하여 측정하였다. 기존의 박막의 열팽창 계수 측정 법에서는 박막이 기판에 증착되어진 상태에서 측정이 이루어지므로, 기판의 탄성계수와 열팽창계수를 미리 알고 있어야 한다. 이에 비해 마이크로 게이지법에서는 박막의 열\ulcorner창 계수를 도출하기 위하여 기판의 탄성계수 값과 열팽창 계수 값을 필요로 하지 않는다는 장점이 있다. 마이크로 게이지법에서는 전류를 가할 경우 줄 발열에 의해 발생한 마이크로 게이지에의 변위를 측정하고, 그 때 계산된 마이크로 게이지의 평균 온도의 관계에서 열팽창 계수를 계산한다. 다결정 실리콘 박막의 열팽창 계수는 2.9 x $10^{-6}$$^{\circ}C$로 측정되었으며, 이 값들의 표준편차는 0.24x$10^{-6}$$^{\circ}C$였다.
The need for low cost, flexible, thin film transistor (TFT) display backplanes has focused attention on new processing techniques and materials. We report the development of TFT backplane technology based entirely on jet-printing, using a combination of additive and subtractive processing, to print active materials or etch masks. The technique eliminates the use of photolithography and has the potential to reduce the array manufacturing cost. The printing technique is demonstrated with both amorphous silicon and polymer semiconductor TFT arrays, and we show results of small prototype displays.
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[게시일 2004년 10월 1일]
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