실리콘 기판에 GaN 에피성장을 확인하기 위해, P형 Si(100) 기판 전면에 버퍼층으로 10 nm 두께의 코발트실리사이드를 형성시켰다. 형성된 코발트실리사이드 층을 HF로 크리닝하고, PA-MBE (plasma assisted-molecular beam epitaxy)를 써서 저온에서 500 nm의 GaN를 성막하였다. 완성된 GaN은 광학현미경, 주사탐침현미경, TEM, HR-XRD를 활용하여 특성을 확인하였다. HF 크리닝을 하지 않은 경우에는 GaN 에피택시 성장이 진행되지 않았다. HF 크리닝을 실시한 경우에는 실리사이드 표면의 국부적인 에칭에 의해 GaN성장이 유리하여 모두 GaN $4\;{\mu}m$ 정도의 두께를 가진 에피택시 성장이 진행되었다. XRD로 GaN의 <0002> 방향의 결정성 (crsytallinity)을 $\omega$-scan으로 판단한 결과 Si(100) 기판의 경우 2.7도를 보여 기존의 사파이어 기판 정도로 우수할 가능성이 있었다. 나노급 코발트실리사이드를 버퍼로 채용하여 GaN의 에피성장이 가능할 수 있었다.
Flash EEPROM 셀에서 기존의 ONO 구조의 IPD를 사용하면 peripheral MOSFET의 게이트 산화막을 성장할 때에 사용되는 세정 공정을 인하여 ONO 막의 상층 산화막이 식각되어 전하 보존 특성이 크게 열화되었으나 IPD 공정에 ONON 막을 사용하면 그 세정 공정시에 상층 질화막이 상층 산호막이 식각되는 것을 방지시켜 줌으로 전하보존 특성이 크게 개선되었다. ONON IPD 막을 갖고 있는 Flash EEPROM 셀의 전화 보존 특성의 모델링을 위하여 여기서는 굽는(bake) 동안의 전하 손실로 인한 문턱전압 감소의 실험식으로 ${\Delta}V_t\; = \;{\beta}t^me^{-ea/kT}$을 사용하였으며, 측정 결과 ${\beta}$=184.7, m=0.224, Ea=0.31 eV의 값을 얻었다. 이러한 0.31 eV의 활성화 에너지 값은 굽기로 인한 문턱전압의 감소가 층간 질화막 내에서의 트립된 전자들의 이동에 의한 것임을 암시하고 있다. 한편, 그 모델을 사용한 전사 모사의 결과는 굽기의 thermal budget이 낮은 경우에 실험치와 잘 일치하였으나, 반면에 높은 경우에는 측정치가 전사 모사의 결과보다 훨씬 더 크게 나타났다. 이는 thermal budge가 높은 경우에는 프로그램시에 층간 질화막 내에 트립되어 누설전류의 흐름을 차단해 주었던 전자들이 빠져나감으로 인하여 터널링에 의한 누설전류가 발생하였기 때문으로 보여졌다. 이러한 누설전류의 발생을 차단하기 위해서는 ONON 막 중에서 층간 질화막의 두께는 가능한 얇게 하고 상층 산화막의 두께는 가능한 두껍게 하는 것이 요구된다.
이 논문에서는 플래시 EEPROM 셀에서의 데이터 보존 특성을 개선하기 위해서 IPD(inter-poly-dielectrics) 층을 사용하는 새로운 제안에 관한 연구 결과들을 논의하였다. 이 연구를 위하여 약 10nm 두께의 게이트 산호막을 갖으며 또한 ONO 또는 ONON IPD 층을 갖는 적층형-게이트 플래시 EEPROM 셀들을 제작하였다. 측정 결과를 보면 ONO IPD 층을 갖는 소자들은 데이터 보존 특성이 심각하게 열화 되었으며, 그 특성의 활성화 에너지도 0.78 eV로 플래시 EEPROM 셀을 위하여 요구되는 최소 값(1.0 eV)보다 상당히 낮았다. 이는 구동 소자용 트랜지스터(peripheral MOSFET) 소자들의 게이트 산호막을 형성하기 위한 건열산화 공정 바로 직전에 실시하는 세정 공정 동안 IPD 층의 상층 산화막의 일부 또는 전부가 식각되었기 때문인 것으로 믿어진다. 반면에, ONON IPD 층을 갖는 소자들의 데이터 보존 특성은 상단히 (약 50% 이상) 개선되었으며 활성화 에너지도 1.1 eV인 것으로 나타났다. 이는 IPD 층에서 상층 산화막위에 있는 질화막이 그 세정 공정 동안 산화막이 식각되는 것을 방지해 주기 때문임에 틀림없다.
반도체 및 디스플레이 제조공정 중에 화학기상증착(CVD), 식각(etching), 세정(cleaning) 공정에서 배출되는 과불화합물(PFCs)를 포함한 폐 가스 처리를 위해서 POU (point of use) 가스 스크러버 시스템을 도입하여 사용하고 있다. 과불화합물은 지구온난화 지수(GWP, global warming potential)와 대기 중 자연분해되는 기간(lifetime)이 $CO_2$에 비해 수천 배 높은 온실가스로 분류되어 있으며, 과불화합물의 열분해를 위해서는 3,000 K 이상의 고온이 요구되는 것이 일반적이다. 이러한 특징 때문에 과불화합물을 효과적으로 제어하기 위한 방법으로 열플라즈마 기술을 도입하고자 하는 노력들이 진행되어 왔으며, POU 가스 스크러버 기술을 개발하여 산업적으로 이용하고자 하였다. 열플라즈마 기술은 플라즈마 토치 기술, 전원공급장치 기술 및 플라즈마 토치-전원공급장치 매칭 기술 최적화를 통해 안정적으로 플라즈마 발생원을 유지시키는 것이 중요하다. 또한, 과불화합물 고효율 처리를 위한 고온의 플라즈마와 폐 가스의 효과적인 혼합이 주요 기술요인으로 확인되었다. 본 논문에서는 반도체 및 디스플레이 공정 폐 가스 처리를 위한 후처리 공정에 대한 기술적 정보를 제공함과 동시에 POU 플라즈마 가스 스크러버에 대한 기술개발 동향을 파악함으로써 향후 연구개발이 요구되는 핵심사항에 대해 논의하고자 한다.
본 연구는 반도체 공정중 습식세정시 사용되는 초순수내에서의 오존의 거동과 오존이 주입된 초순수와 실리콘 웨이퍼와의 반응성에 대해 연구하였다. 초순수내 오존의 용해도는 주입되는 오존의 농도와 초순수의 온도가 낮을수록 증가하였고 주입되는 오존의 농도에 정비례하여 증가하였다. 초순수내 오존의 반감기는 초순수내 오존의 용해농도와 초순수의온도가 낮을수록 증가함을 나타내었고 반응차수는 약 1.5로 계산되었다. 초순수의산화환원전위(redox potential)값은 오존 주입시 5분 이내에 포화되어 일정한 값을 나타내었고 주입되는 오존의 농도가 증가함에 따라 약간 증가하였다. HF처리된 실리콘 웨이퍼는 오존이 2ppm 이상 용해된 초순수에서 세정하였을 때 1분 이내에 접촉각이 $10^{\circ}$미만의 친수성 표면을 형성하였고 piranha 세정액($H_2SO_4$과 $H_2O_2$의 혼합액)에 의해 형성된 자연산화막보다 오존이 주입된 초순수에 의해 형성된 산화막이 약간 더 두꺼움을 Spectroscopic Ellip-someter에 의해 관찰하였다. 오존의 농도가 1.5ppm에서 90초내에 계면활성제로 오염된 실리콘 웨이퍼를 piranha용액과 오존이 함유된 황산 그리고 오존이 함유된 초순수에서 세정시 오존이 함유된 초순수가 가장 탁월한 오염제거능력을 나타내었다.
반도체 회로를 제조하기 위해서 에칭, 세척, 증착 등의 공정들이 반복적으로 진행된다. 따라서 이러한 공정이 진행되면 진공장비 내부는 부식성이 높은 가혹한 플라즈마 환경에 노출되게 된다. 따라서 반도체 공정 장비의 내부를 플라즈마 노출에 강한 재료를 사용하여 코팅층의 에칭과 오염 입자의 생성을 최소화하여야 한다. 본 연구에서는 고상합성법에 의해 Y2O3와 YF3 분말을 원료물질로 옥시불화이트륨(YOF)를 성공적으로 합성하였다. Y2O3와 YF3 분말의 혼합비율은 1.0:1.0에서 1.0:1.6까지 조절하였으며, 혼합비율이 합성된 YOF 분말의 결정구조와 미세구조에 미치는 영향을 XRD와 FE-SEM으로 조사하였다. 합성된 YOF 분말을 이용하여 알루미늄 기판에 플라즈마 스프레이법으로 성공적으로 코팅하였다.
반도체 회로를 제조하기 위해서 에칭, 세척, 증착 등의 공정들이 반복적으로 진행된다. 따라서 이러한 공정이 진행되면 진공장비 내부는 부식성이 높은 가혹한 플라즈마 환경에 노출되게 된다. 따라서 반도체 공정 장비의 내부를 플라즈마 노출에 강한 재료를 사용하여 코팅층의 에칭과 오염 입자의 생성을 최소화하여야 한다. 본 연구에서는 고상합성법에 의해 합성된 옥시불화이트륨 (YOF)를 이용한 증착층의 플라즈마 식각 특성을 향상시키기 위하여 YOF 분말에 AlF3 분말을 혼합하여 플라즈마 스프레이 공정으로 Al 금속위에 증착시키고 그 특성을 분석하였다. AlF3 혼합비율의 증가에 따른 증착층의 결정구조, 미세구조 및 화학조성 변화를 조사하고 증착된 코팅층의 플라즈마 식각율을 측정하여 AlF3 혼합비율과의 상관관계를 분석하였다.
최근 NAND flash memory는 높은 집적성과 데이터의 비휘발성, 낮은 소비전력, 간단한 입, 출력 등의 장점들로 인해 핸드폰, MP3, USB 등의 휴대용 저장 장치 및 노트북 시장에서 많이 이용되어 왔다. 특히, 최근에는 smart watch, wearable device등과 같은 차세대 디스플레이 소자에 대한 관심이 증가함에 따라 유연하고 투명한 메모리 소자에 대한 연구가 다양하게 진행되고 있다. 대표적인 플래시 메모리 소자의 구조로 charge trapping type flash memory (CTF)가 있다. CTF 메모리 소자는 trap layer의 trap site를 이용하여 메모리 동작을 하는 소자이다. 하지만 작은 window의 크기, trap site의 열화로 인해 메모리 특성이 나빠지는 문제점 등이 있다. 따라서 최근, trap layer에 다양한 물질을 적용하여 CTF 소자의 문제점을 해결하고자 하는 연구들이 진행되고 있다. 특히, 산화물 반도체인 zinc oxide (ZnO)를 trap layer로 하는 CTF 메모리 소자가 최근 몇몇 보고 되었다. 산화물 반도체인 ZnO는 n-type 반도체이며, shallow와 deep trap site를 동시에 가지고 있는 독특한 물질이다. 이 특성으로 인해 메모리 소자의 programming 시에는 deep trap site에 charging이 일어나고, erasing 시에는 shallow trap site에 캐리어들이 쉽게 공급되면서 deep trap site에 갇혀있던 charge가 쉽게 de-trapped 된다는 장점을 가지고 있다. 따라서, 본 실험에서는 산화물 반도체인 ZnO를 trap layer로 하는 CTF 소자의 메모리 특성을 확인하기 위해 간단한 구조인 metal-oxide capacitor (MOSCAP)구조로 제작하여 메모리 특성을 평가하였다. 먼저, RCA cleaning 처리된 n-Si bulk 기판 위에 tunnel layer인 SiO2 5 nm를 rf sputter로 증착한 후 furnace 장비를 이용하여 forming gas annealing을 $450^{\circ}C$에서 실시하였다. 그 후 ZnO를 20 nm, SiO2를 30 nm rf sputter로 증착한 후, 상부전극을 E-beam evaporator 장비를 사용하여 Al 150 nm를 증착하였다. 제작된 소자의 신뢰성 및 내구성 평가를 위해 상온에서 retention과 endurance 측정을 진행하였다. 상온에서의 endurance 측정결과 1000 cycles에서 약 19.08%의 charge loss를 보였으며, Retention 측정결과, 10년 후 약 33.57%의 charge loss를 보여 좋은 메모리 특성을 가지는 것을 확인하였다. 본 실험 결과를 바탕으로, 차세대 메모리 시장에서 trap layer 물질로 산화물 반도체를 사용하는 CTF의 연구 및 계발, 활용가치가 높을 것으로 기대된다.
The LTCC (Low Temperature Co-fired Ceramic) technology meets the requirements for high quality microelectronic devices and microsystems application due to a very good electrical and mechanical properties, high reliability and stability as well as possibility of making integrated three dimensional microstructures. The wet process, which has been applied to the etching of the metallic thin film on the ceramic substrate, has multi process steps such as lithography and development and uses very toxic chemicals arising the environmental problems. The other side, Plasma technology like ion beam sputtering is clean process including surface cleaning and treatment, sputtering and etching of semiconductor devices, and environmental cleanup. In this study, metallic multilayer pattern was fabricated by the ion beam etching of Ti/Pd/Cu without the lithography. In the experiment, Alumina and LTCC were used as the substrate and Ti/Pd/Cu metallic multilayer was deposited by the DC-magnetron sputtering system. After the formation of Cu/Ni/Au multilayer pattern made by the photolithography and electroplating process, the Ti/Pd/Cu multilayer was dry-etched by using the low energy-high current ion-beam etching process. Because the electroplated Au layer was the masking barrier of the etching of Ti/Pd/Cu multilayer, the additional lithography was not necessary for the etching process. Xenon ion beam which having the high sputtering yield was irradiated and was used with various ion energy and current. The metallic pattern after the etching was optically examined and analyzed. The rate and phenomenon of the etching on each metallic layer were investigated with the diverse process condition such as ion-beam acceleration energy, current density, and etching time.
본 연구의 목적은 최근 노사 간 이슈가 되고 있는 비정규직 이슈에 주목하여 비정규직 노사분규의 사례 중 대표적인 하이닉스 사내하청 노사분규사례의 발생원인 및 해결과정 등 전 과정을 살펴봄으로써 향후 유사한 노사분규에 대한 시사점을 주고자 함에 있다. 사례분석결과 하청노조는 교섭상대방인 하청회사가 존재 할 때까지는 하청회사들과 교섭하지만, 이후 하청회사는 폐업을 하게 되고 이에 따라 하청노조원들은 직장을 잃게 되고 교섭상대방은 원청회사로 바꾸어 직접교섭과 고용을 주장한다. 원청회사의 교섭거부와 하청노조의 불법을 포함한 전 방위적 공세 속에서 지역사회 등의 노력으로 중재가 시도되고 이후 사적 조정 그리고 최종 직접교섭으로 동 분규는 해결된다. 해결에 있어서는 고용을 배제되고 위로금 등으로 해결되어 불법과 무원칙이 난무하는 한국의 노사관계에서 나름대로 법과 원칙에 입각한 해결이라는 의미 있는 결과를 나타냈다. 마지막으로, 이상의 연구결과를 토대로 시사점을 제시하였다.
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[게시일 2004년 10월 1일]
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