• 한국통신학회논문지
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• 제28권3A호
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• pp.179-184
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• 2003

본 논문에서는 ISM대역에서 수신경로의 격리도를 크게 송신경로의 삽입손실은 작게 하며 동시에 P1dB를 크게 하는 비대칭구조의 MMIC SPDT 스위치를 제안하였으며, 이를 ETRI에서 지원하는 IDEC MPW의 0.5㎛ GaAs MESFET으로 제작하였다. 이 SPDT 스위치 수신경로의 삽입손실은 3GHz에서 1.518dB, 5.75GHz에서 1.777dB이고, 격리도는 3GHz에서 38.474dB, 5.75GHz에서 29.125dB로 측정되었다. 그리고, 송신경로의 삽입손실은 3GHz에서 0.961dB, 5.75GHz에서 1.162dB이고, 격리도는 3GHz에서 23.259dB, 5.75GHz에서 16.632dB였다. 비대칭구조의 스위치는 대칭구조에 비하여 수신경로의 격리도가 3GHz에서 15.9dB, 5.75GHz에서 11.9dB 정도 개선되었으며, 삽입손실은 약 0.6dB 정도 증가하였다. 또한, SPDT 스위치 송신경로의 P1dB는 21.5dBm로 대칭구조에 비하여3.86dB 증가하였다.

• 한국통신학회논문지
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• 제22권6호
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• pp.1323-1333
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• 1997

In this paper, we propose an efficient architecture for a high-speed cell concentrator/distributor(HCCD) in an ATM(Asynchronous Transfer Mode) switch and by analyzeing the simulation results evaluate the performance of the proposed architecuture. The proposed HCCD distributes cells from a switch link to local processors, or concentrates cells from local processor s to a switch link. This design is to guarntee a high throughput for the IPC (inter-processor communication) link in a distributed ATM switching system. The HCCD is designed in a moudlar architecture to provide the extensibility and the flexibility. The main characteristics of the HCCD are 1) Adaption of a local CPU in HCCD for improving flexibility of the system, 2) A cell-baced statistical multiplexing function for efficient multiplexing, 3) A cell distribution function based on VPI(Virtual Path Identifier), 4) A bypassing capability for IPC between processor attached to the same HCCD, 5) A multicasting capability for point-to-multipoint communication, 6) A VPI table updating function for the efficient management of links, 7) A self-testing function for detecting system fault.

• 전력전자학회논문지
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• 제10권5호
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• pp.518-525
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• 2005

제안된 회로는 하나의 보조스위치를 이용하여 주 스위치와 정류용 다이오드가 턴-온/턴-오프 시 동시에 영전압과 영전류 조건을 만족시킨다. 그리고 이 회로에 사용되는 주 스위치는 다수 캐리어 소자뿐만 아니라 소수 캐리어 반도체 소자까지 사용할 수 있는 장점을 가지고 모든 PWM 컨버터에 적용 가능하다. 그리고 제안된 보조 스위치와 공진회로가 주 전력 경로에 존재하지 않으므로 주 스위치와 다이오드에 더 이상의 전압/전류 스트레스가 없게 된다. 제안된 컨버터의 유효성을 이론적 분석과 실험을 통하여 입증하였다.

• 대한전자공학회:학술대회논문집
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• 대한전자공학회 1998년도 추계종합학술대회 논문집
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• pp.799-802
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• 1998

As we know, gigabit ethernet is a new technology to be substituted for current fast ethernet used widely in local area network. The switch used in gigabit ethernet should deal with frames in giga-bps. To do such a fast switching, we need that serveral processes meet the budgets, such as MAC address table lookup, several giga speed path setup, fast scheduling, and etc. Especially MAC address table lookup has to be processed in the same speed with speed of incoming packets, thus the bottleneck in the process can cause packet loss by the overflow in the input buffer. We devise new practical hardware hashing method to perform fast table lookup by minimizing the number of external memory access and accelerating with hardware.

• Journal of Power Electronics
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• 제12권5호
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• pp.723-730
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• 2012

This paper presents a new ZVS single phase bridgeless (Power Factor Correction) PFC, using an active clamp to achieve zero-voltage-switching for all main switches and diodes. Since the presented PFC uses a bridgeless rectifier, most of the time, only two semiconductor components are in the main current path, instead of three in conventional single-switch configurations. This property significantly reduces the conduction losses,. Moreover, zero voltage switching removes switching loss of all main switches and diodes. Also, auxiliary switch turns on zero current condition. The presented converter needs just a simple non-isolated gate drive circuitry to drive all switches. The eight stages of each switching period and the design considerations and a control strategy are explained. Finally, the converter operation is verified by simulation and experimental results.

• 한국항행학회논문지
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• 제13권4호
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• pp.509-514
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• 2009

본 논문에서는 DDR-1 메모리와 PCI-e 인터페이스를 이용하는 256 GB DRAM 기반의 SSD 스토리지를 설계 분석하였다. SSD는 주 저장매체로써 DRAM 이나 NAND Flash 를 사용하는 스토리지로써 메모리칩으로부터 직접 데이터를 처리할 수 있기 때문에 종래의 HDD의 기계적인 처리속도보다 매우 고속인 장점이 있다. 설계된 DRAM 기반 SSD 시스템은 복수 개의 RAM 디스크를 데이터 저장매체로 사용하며, PCI-e 인터페이스 버스를 각 메모리디스크의 통신 경로로 사용하여 고속의 데이터 처리가 가능한 구조이다. 실험을 위하여 UNIX 및 Windows/Linux 서버, SAN Switch, Ethernet Switch를 이용한 실험시스템을 구성하고 IOmeter 를 이용하여 IOPS(Input output Per Second)와 대역폭 성능을 측정하였으며 측정결과에서 DDR-1 SSD는 470,000의 IOPS와 800MB/sec로 HDD 나 Flash-based SSD 에 비하여 높은 대역폭이 나타남을 확인하였다.

• 대한전자공학회논문지SD
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• 제37권7호
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• pp.50-57
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• 2000

본 논문에서는 고속 FPGA 설계를 위한 논리 수준의 조합회로 합성 알고리듬을 제안한다. FPGA는 현장에서 직접 제작이 가능하고 제작 시간이 짧으며 제작 비용이 저렴하므로 초기 prototype 시스템의 제작에 자주 사용되고 있으나, ASIC 칩에 비해 지연시간이 크고 집적도가 떨어지는 단점이 있다. 제안된 알고리듬은 회로의 지연시간을 줄이기 위해 critical path를 분할한 후 분할된 회로를 동시에 수행하는 구조의 회로를 생성한다. MCNC 표준 테스트 회로에 대한 실험에서 제안된 지연시간 최적화 알고리듬이 기준 알고리듬에 비해 지연시간이 평균 19.1% 감소된 회로를 생성함을 보였다.

• 한국정보과학회:학술대회논문집
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• 한국정보과학회 2004년도 가을 학술발표논문집 Vol.31 No.2 (3)
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• pp.658-660
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• 2004

모바일 멀티미디어 서비스에서는 핸드오프의 효율적인 처리를 통한 QoS를 보장하는 것이 중요하다. 본 논문에서는 기존 핸드오프 기법의 경로 최적화, 회선의 재활용률, 핸드오프 수행시간 등의 문제점을 개선을 위해 Crossover Switch(CX)탐색 기법에 적용되는 기존의 Loose select, Prior path knowledge와 제안한 Hybrid CX 탐색 알고리즘의 성능분석을 위해 C#을 사용하여 시뮬레이터를 구현하고 회선 재이용률, 경로 최적화 정도를 비교분석하였다. 실험결과 제안한 Hybrid CX 탐색 알고리즘이 우수하다는 것을 확인하였다.

• 대한전기학회:학술대회논문집
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• 대한전기학회 2008년도 제39회 하계학술대회
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• pp.245-246
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• 2008

변전소 모선에서 측정되는 전압, 전류를 기반으로 하는 CB기반 고장거리 추정기법은 배전선의 다중 분기선 때문에 다중개의 고장위치를 추론하는 것은 물론 분기 부하모델의 불확실성으로 인해 거리 계산에 오차를 포함하게 된다. 따라서 본 연구에서는 유비쿼터스 기반의 배전계통 하에서 구간 측정 전압, 전류 및 IED간 정보교환을 통해 얻어지는 전압, 전류 정보를 이용하여 고장경로를 추정하는 IED 기반 고장경로 추정기법을 제안한다.

• 대한전기학회:학술대회논문집
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• 대한전기학회 1987년도 전기.전자공학 학술대회 논문집(II)
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• pp.894-897
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• 1987

Listener echos, which arise in multiple 4-wire loop connections(MLC) during the evolving switched telephone network, impare voice-band data signal transmission performance. This paper first shows the calculation method of the total number of listener echo loops over N 4-wire physical loops and presents the additative law for listener echos. It next demonstrates that about 4 dB should be ensured to Eke the transmission loss of intraoffice call path be minimum for the voice-band data service in a digital local switch.