All parasitics such as switch conduction voltages, conduction resistances, switching times and ESR''s of capacitors are counted in the new state-space modeling based on non-ideal switching functions. An equivalent simplified model is derived from the complex circuit with parasitics. Hence the results are very simple and exact, which are very important features of modelings. The pole frequency, dc voltage gain, and efficiency of the general converter, the buck-boost converter are analyzed and verified by the experiments with good agreements with the theories. This may be a good summary for the previous works concerned with parasitics.
This paper presents the accurate deembeding method for pad and parasitics of MOSFET device. rad effects are deembedded using THRU LINE, which is much simpler method without laborious fitting procedure compared with conventional OPEN and SHORT pad modeling. Parasitic resistance extraction uses the algebraic relation between increments of inversion layer charge and oxide capacitance. It is especially adequate for insulating gate junction device. Extracted parasitics are verified through comparing modeled and measured S parameters.
본 논문에서는 로보트 매니퓰레이터의 기준모델 적응제어계 설계에 있어서 계통의 미지 파라미터에 대해 계통식이 선형화됨에 착안하고 Augmented 오차변수를 도입하여 파라미터 제이칙 및 제어입력을 제안하였고, 계통의 모델링 과정에서 불가피하게 도입되는 모델링 오차 및 미소한 시정수를 가진 기생요소(parasitics)들이 계통의 파라미터 동정 및 추종오차에 미치는 영향을 검토하였으며 개선책으로 저역 필터를 토입한 적응제어기를 구성하여 제안된 제어칙으로 별다른 가정없이 계통이 대국적으로 안정함을 밝혔다. 끝으로 컴퓨터 시뮬레이션을 통하여 제안된 제어기 구성법이 기생요소의 영향감소에 효과적이고 유용함을 밝혔다.
10 Gbps용 전계 흡수형 InGaAsP/InGaAsP 응력 완화 MQW (Multiple Quantum Well) 광변조기의 변조 성능은 패키징후 발생되는 기생 특성에 의해서 큰 영향을 받음을 확인하였다. 이 초고주파 기생 특성은 변조기의 변조 대역폭을 제한하고 처핑 변수를 증가시키는 요인이 된다. 따라서, 이러한 기생 성분중 고속·광대역 변조시 변조 성능을 크게 저하시키는 본딩와이어에 의한 유도성 기생성분을 최소화시키기 위해 유전체 몰딩된 이중 본딩와이어 구조를 제안하였다. 50 Ω 저항으로 병렬 종단된 MQW 광변조기에 제안된 본 구조를 이용할 경우, 패키징전에 비하여 변조 대역폭이 약 125 %가 확대됨을 확인하였다. 또한 이 구조를 이용할 경우 기존에 무시되었던 패키징 기생 특성에 의한 처핑 변수의 영향을 최소화시킬 수 있는 효과적인 방법이 됨을 확인하였다. 본 연구 결과는 10 Gbps 대역 이상의 초고속 외부 광변조기의 변조 성능 극대화를 위한 최적 패키지 구현 자료로서 유용하게 사용될 수 있다.
From AC analysis results utilizing a 2-dimensional device simulator, we extracted an AC-equivalent circuit of a grounded-gate NMOS (ggNMOS) electrostatic discharge (ESD) protection device. The extracted equivalent circuit is utilized to analyze the effects of the parasitics in a ggNMOS protection device on the characteristics of a low noise amplifier (LNA). We have shown that the effects of the parasitics can appear exaggerated for an impedance matching aspect and that the noise contribution of the parasitic resistances cannot be counted if the ggNMOS protection device is modeled by a single capacitor, as in prior publications. We have confirmed that the major changes in the characteristics of an LNA when connecting an NMOS protection device at the input are reduction of the power gain and degradation of the noise performance. We have also shown that the performance degradation worsens as the substrate resistance is reduced, which could not be detected if a single capacitor model is used.
The dielectric effects on the parasitics of bondwires buried in slightly-lossy dielectric materials hav been investigated over a wide frequency range using the method of moments with incorporation of ohmic and dielectric losses. The FR-4 composite is widely used as a basis material for PCB and plastic packages, because of it sinherent electricl and chemical stbility and low cost. The cole-cole model, which is representative complex permittivity model of epoxy polymers, has been applied to consider the dielectric effects in the MoM calculation. The prasitic impedance of a grounded bondwire in FR-4 composite is greatly increased due to the dielectric loading effect enhanced by the radiation at high frequencies. These calculation results will be helpful for designing and packaging of high-frequency low-cost IC's.
본 논문에서는 간단한 회로구조와 높은 효율을 갖는 스위칭 방식의 E급 주파수 체배기에 대한 연구를 수행하였다. 주파수 체배는 능동소자의 비선형성에 의해 발생하는데 본 논문에서는 FET 능동소자를 간단한 스위치 및 기생소자 성분 모델로 근사하여 특성을 해석하고자 하였다. FET를 입력에 의해 동작하는 스위치 및 기생소자로 모델링하고 E급 주파수 체배기의 정합소자 값을 유도하였다. ADS시뮬레이터를 이용하여 출력 전압과 전류 파형 및 효율을 시뮬레이션하고 기생성분에 따른 변화를 연구하였다. 기생 커패시턴스, 저항, 인덕턴스에 의한 영향을 시뮬레이션하였으며 입력주파수 2.9GHz, 바이어스전압 2V일 때, 출력주파수 5.8GHz에서 기생커패시턴스가 0pF에서 1pF으로 변화함에 따라 드레인효율은 98%에서 28%로 감소하여 기생커패시턴스 CP가 FET의 기생 성분 중 가장 큰 영향을 끼친 것을 확인했다.
In this paper, the characteristics of linealy bent wire antennas are first analyzed for shortening straight wire antennas. The results are appropriately applied to the design of the integrated zigzag dipole antenna. Since the integration give rise to discontinuities due to line width, the integrated parasitics are properly attached to both sides of substrate for improving the antenna gain and return loss. The design results are verified with experiments.
3 나노미터 아래의 미래공정에서는 작은 면적의 표준셀(Standard Cell)을 구현하는 데에 많은 기술적인 개선을 요구한다. 따라서 어떠한 기술을 통해 얼마나 작은 면적의 표준셀을 구현할 수 있는지, 그리고 그 영향이 어떠한지 알아보는 것은 매우 중요하다. 본 논문에서는 3 나노미터와 이하의 미래공정에서 표준셀 설계를 위해 묻힌 전력망(Buried Power Rail, BPR)과 상호보완 FET(Complementary FET, CFET)이 면적 감소에 얼마나 기여하는지 살펴보며 그 영향을 기생 캐패시턴스 관점에서 분석한다. 본 논문을 통해 상호보완 FET은 4T 이하의 표준셀을 구현할 수 있는 기술이지만, Z-축으로 증가하는 높이만큼 상당한(+18.0% 이상) 기생 Cap의 영향을 받는다는 점을 밝힌다.
Kyriakis-Bitzaros, Efstathios D.;Katsafouros, Stavros G.;Halkias, George
JSTS:Journal of Semiconductor Technology and Science
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제2권1호
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pp.82-86
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2002
It is demonstrated that the conventional current-pulse laser drivers are not adequate in driving VCSELs operating at multi-Gb/s speeds. Simulation results, including the bonding parasitics, show that high-performance VCSELs are more efficiently driven using voltage-pulse mode of operation. The optical output power is almost doubled in the voltage-mode of operation, while the total electrical power consumption of the transmitter decreases by 20%.
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[게시일 2004년 10월 1일]
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