단일 모드 반도체 레이저(DFB 레이저)를 5 GHz의 반복율로 이득 스위칭하여 얻은 광 펄스를 압축하여 변환 제한된 초단 광 펄스를 생성하였다. 이득 스위칭된 광 펄스의 최소 폭은 27 psec 이고 스펙트럼 폭은 1.1 nm로 펄스에 많은 선형 처핑과 비선형 처핑이 존재한다. 이를 대역폭이 펄스의 스펙트럼 폭보다 좁은 0.55 nm의 광 필터에 통과시켜 비선형 처핑을 제거하고 분산 보상 광섬유로 압축하여 7.1 psec의 광 펄스를 얻었다. 이때 펄스의 시간-대역폭 곱은 0.49로 변환 제한된 가우시안 펄스이다. 이러한 변환 제한된 광 펄스는 40 Gbit/s 광 시분할 다중화 방식 광통신용 광원으로 사용할 수 있다.
이 논문에서는 1) 넓은 잠금 범위를 위한 이중 루프 동작과 2) 차세대 패키지 스큐 개선에 대한 전압 발생기와 안티퓨즈 회로를 사용한 프로그래머블 레프리카 딜레이, 두 가지 이점을 갖는 Delay Lock Loop(DLL)을 기술하였다. 이중 루프 동작은 차동 내부 루프 중 하나를 선택하기 위해 외부 클럭과 내부 클럭 사이의 초기 시간차에 대한 정보를 사용한다. 이를 이용하여 더 낮은 주파수로 DLL의 잠금 범위를 증가시킨다. 덧붙여서, 전압발생기와 안티퓨즈 회로를 사용한 프로그래머블 레프리카 딜레이의 결합은 패키지 공정 후에 온-오프 칩 변화로부터 발생하는 외부 클럭과 내부 클럭 사이에 스큐 제거를 해준다. 제안된 DLL은 0.16um 공정으로 제조되었고, 2.3v의 전원 공급과 42㎒ - 400㎒의 넓은 범위에서 동작한다. 측정된 결과는 43psec p-p 지터와 400㎒에서 52㎽를 소비하는 4.71psec 실효치(rms)지터를 보여준다.
소둔시편 및 소둔 후 냉간가공한 하프늄시편에 대하여 양전자수명을 조사하였다. 소둔시편에서의 양전자수명은 187$\pm$3.7 psec인 반면, 소둔 후 냉간가공한 시편에서 격자결함에 포획된 양전자의 수명은 217$\pm$4.2 psec로 측정되었다. 양전자소멸측정 및 미세경도측정 방법을 이용하여 등시소둔에 의한 냉간가공시편의 회복 및 재결정 거동을 조사하였다. 재결정단계에서는 양전자소멸측정 과 미세경도측정값이 유사한 경향을 나타냈으나, 회복단계에서는 양전자소멸측정값이 매우 현저하게 변화하는 반면, 미세경도값은 거의 변화하지 않았다. 하프늄의 회복단계는 623 K부터 시작되며 재결정온도는 1023 K정도로 측정되었다.
Since many typical 2.5 Gbps optical transmitter modules use a 50$\Omega$ characteristic impedance, they require relatively high voltage and high power sources compared to the 25$\Omega$ module. However, simple replacement of the 50$\Omega$ internal matching impedance with 25$\Omega$ results in bandwidth reduction and consequent problem of data transmitter module is proposed in order to expand the modulator bandwidth. From the calculated resutls based on accurate 3-dimensional inductance analysis, we have found that the series parasitic inductance is a dominant element limiting the bandwidth and the insertion of a 2.5pF capacitor in parallel to the 20$\Omega$ matching resiter can increase the 3 dB bandwidth about 1.4GHz wider. The time-domain results show the rise time (140 psec) without the compensation is greatly improved to 63 psec with the compensation. This capacitive ocmpensation can be implemented easily and be compatible with common manufacturing process of the optical transmitter module.
JSTS:Journal of Semiconductor Technology and Science
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제7권4호
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pp.241-246
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2007
This paper presents two novel compensation circuits for leakage current and power supply noise (PSN) in phase locked loop (PLL) using a nanometer CMOS technology. The leakage compensation circuit reduces the leakage current of the charge pump circuit and the PSN compensation circuit decreases the effect of power supply variation on the output frequency of VCO. The PLL design is based on a 32nm predictive CMOS technology and uses a 0.9 V power supply voltage. The simulation results show that the proposed PLL achieves 88% jitter reduction at 440 MHz output frequency compared to the PLL without leakage compensator and its output frequency drift is little to 20% power supply voltage variations. The PLL has an output frequency range of 40 $M{\sim}725$ MHz with a multiplication range of 1-1023, and the RMS and peak-to-peak jitter are 5psec and 42.7 psec, respectively.
최근 플라스틱 광섬유(Plastic Optical Fiber, POF)가 홈 네트워크(Home Network) 및 LAN(Local Area Network)의 새로운 통신채널로 등장하였다. 특히 PMMA 계에 기반을 둔 언덕형 굴절률 분포 플라스틱 광섬유(Graded Index Plastic Optical Feiber)는 500nm와 650nm 근처에서 아주 적은 손실을 가지므로 이 파장영역에서의 광원으로서 극초단 광펄스 생성이 요구되고 있다. 본 연구에서는 650nm InGaAIP FP(fabry perot) LD와 간단한 RF(radio frequency)소자들을 이용한 회로를 구성하고 이득스위칭 기술을 사용하여 1GHz의 펄스 반복율을 가지고 33.3psec 정도의 짧은 반치선폭(FWHM)을 가지는 광펄스를 생성시키는데 성공하였다. 이득스위칭 된 광펄스는 주입되는 직류전류(DC bias current)와 변조되는 주파에 따라 반치선폭은 33.3-82.8 psec, 펄스 에너지는 0.97-9.69pJ의 값을 얻었다. 또한 CW 발진과 이득스위칭 된 광펄스의 스펙트럼 폭은 각각 0.44nm, 150nm로 됨을 측정하였다. 이러한 결과를 가지는 연속적인 광펄스는 직류전류와 VCO에 의한 변조주파수의 적절한 선택에 따라 초고속 근거리 광통신분야 뿐만 아니라 여러 가지 초고속 광소자 및 전자소자의 특성평가 등에 응용될수 있을 것으로 예상된다.
본 논문에서는 FCC 규격을 만족하는 DS-UWB 통신을 위한 고차미분 가우시안 펄스 생성기를 제안하고, 이를 실험적으로 구현하였다. 100Mbps의 구형파를 가우시안 펄스로 변환하기 위해 두개의 SRB만을 이용한 가우시안 펄스 발생기를 제작하였다. 출력된 펄스는 330 psec의 펄스폭과 920 mV의 크기를 가진다. 또한 WLAN 대역을 제거하기 위해 마이크로스트립 라인과 병렬 스터브를 이용한 고차미분의 특성을 가지는 이중 대역통과 필터를 설계 및 제작하였다. 최종적으로 WLAN 대역을 -25dB 이상 억제를 하고, 시간축 상에서 1 nsec의 펄스폭과 25 mV의 크기를 가지는 13차 가우시안 펄스를 출력하였다.
칩의 외부 클럭과 내부 클럭 사이의 스큐를 줄이기 위하여 고정밀도 동기 미러 지연 소자를 제안한다. 제안하는 동기 미러 지연 소자는 두 단계에 걸쳐서 클럭 스큐를 감소시킨다. 먼저 기존의 동기 미러 지연 소자에 의하여 동기화가 이루어진다. 그 다음, 연속 근사 레지스터에 의하여 조절되는 delay-locked loop에 의하여 세밀하게 동기화가 이루어진다. 동기화가 이루어지는데 필요한 전체 시간은 10 사이클이다. 모의 실험 결과, 제안하는 동기 미러 지연 소자는 182MHz에서 50psec의 스큐 특성을 가지며, 0.35㎛ 1-poly 4-metal CMOS 공정 하에서 3.3V의 전원 전압을 사용했을 때, 17.5mW를 소모하는 것을 알 수 있다.
본 실험에서는 RF 소자들과 650 nm InGaAIP FP LD를 사용하고 이득스위칭에 의하여 선폭이 35psec 되는 극초단 광펄스를 생성하였다. 또한 이렇게 생성된 극초단 광펄스를 이용하여 언덕형 굴절률 분포를 가지는 다중모드 광섬유의 대역폭을 빠른 푸리에 변환(Fast Fourier Transform)으로 계산하였다 따라서 본 실험에서 이용된 언덕형 굴절률 분포를 갖는 다중모드 광섬유의 대역폭은 670 MHz.km로 측정되었다.
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[게시일 2004년 10월 1일]
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