• 한국표면공학회:학술대회논문집
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• 한국표면공학회 1999년도 추계학술발표회 초록집
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• pp.49-49
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• 1999

In this study, $Cl_2/BCI_3$ magnetized inductively coupled plasmas (MICP) were used to etch GaN and the effects of magnetic confinements of inductively coupled plasmas on the GaN etch characteristics were investigated as a function of $Cl_2/BCI_3$. Also, the effects of Kr addition to the magnetized $Cl_2/BCI_3$ plasmas on the GaN etch rates were investigated. The characteristics of the plasmas were estimated using a Langmuir probe and quadrupole ma~s spectrometry (QMS). Etched GaN profiles were observed using scanning electron microscopy (SEM). The small addition of $Cl_2/BCI_3$ (10-20%) in $Cl_2$ increased GaN etch rates for both with and without the magnetic confinements. The application of magnetic confinements to the $Cl_2/BCI_3$ inductively coupled plasmas (ICP) increased GaN etch rates and changed the $Cl_2/BCI_3$ gas composition of the peak GaN etch rate from 10% $BCI_3$ to 20% $BCI_3$. It also increased the etch selectivity over photoresist, while slightly reducing the selectivity over $Si0_2$. The application of the magnetic field significantly increased positive $BCI_2{\;}^+$ measured by QMS and total ion saturation current measured by the Langmuir probe. Other species such as CI, BCI, and CI+ were increased while species such as $BCl_2$ and $BCI_3$ were decreased with the application of the magnetic field. Therefore, it appears that the increase of GaN etch rate in our experiment is related to the increased dissociative ionization of $BCI_3$ by the application of the magnetic field. The addition of 10% Kr in an optimized $Cl_2/BCI_3$ condition (80% $Cl_2/$ 20% $BCI_3$) with the magnets increased the GaN etch rate about 60%. More anisotropic GaN etch profile was obtained with the application of the magnetic field and a vertical GaN etch profile could be obtained with the addition of 10% Kr in an optimized $Cl_2/BCI_3$ condition with the magnets.

• 한국진공학회:학술대회논문집
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• 한국진공학회 2012년도 제42회 동계 정기 학술대회 초록집
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• pp.431-432
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• 2012

In the era of 20 nm scaled semiconductor volume manufacturing, Microelectronics Manufacturing Engineering Education is presented in this paper. The purpose of microelectronic engineering education is to educate engineers to work in the semiconductor industry; it is therefore should be considered even before than technology development. Three Microelectronics Manufacturing Engineering related courses are introduced, and how undergraduate students acquired hands-on experience on Microelectronics fabrication and manufacturing. Conventionally employed wire bonding was recognized as not only an additional parasitic source in high-frequency mobile applications due to the increased inductance caused from the wiring loop, but also a huddle for minimizing IC packaging footprint. To alleviate the concerns, chip bumping technologies such as flip chip bumping and pillar bumping have been suggested as promising chip assembly methods to provide high-density interconnects and lower signal propagation delay [1,2]. Aluminum as metal interconnecting material over the decades in integrated circuits (ICs) manufacturing has been rapidly replaced with copper in majority IC products. A single copper metal layer with various test patterns of lines and vias and $400{\mu}m$ by $400{\mu}m$ interconnected pads are formed. Mask M1 allows metal interconnection patterns on 4" wafers with AZ1512 positive tone photoresist, and Cu/TiN/Ti layers are wet etched in two steps. We employed WPR, a thick patternable negative photoresist, manufactured by JSR Corp., which is specifically developed as dielectric material for multi- chip packaging (MCP) and package-on-package (PoP). Spin-coating at 1,000 rpm, i-line UV exposure, and 1 hour curing at $110^{\circ}C$ allows about $25{\mu}m$ thick passivation layer before performing wafer level soldering. Conventional Si3N4 passivation between Cu and WPR layer using plasma CVD can be an optional. To practice the board level flip chip assembly, individual students draw their own fan-outs of 40 rectangle pads using Eagle CAD, a free PCB artwork EDA. Individuals then transfer the test circuitry on a blank CCFL board followed by Cu etching and solder mask processes. Negative dry film resist (DFR), Accimage$^{(R)}$, manufactured by Kolon Industries, Inc., was used for solder resist for ball grid array (BGA). We demonstrated how Microelectronics Manufacturing Engineering education has been performed by presenting brief intermediate by-product from undergraduate and graduate students. Microelectronics Manufacturing Engineering, once again, is to educating engineers to actively work in the area of semiconductor manufacturing. Through one semester senior level hands-on laboratory course, participating students will have clearer understanding on microelectronics manufacturing and realized the importance of manufacturing yield in practice.

• 공업화학
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• 제24권1호
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• pp.31-37
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• 2013

텍스쳐링에 의해 실리콘 웨이퍼의 표면반사율을 감소시키는 것은 실리콘 태양전지의 효율향상을 위해 매우 중요한 공정이다. 본 연구에서는 에칭속도 제어를 위해 촉매제를 포함한 산 용액으로 텍스쳐링 처리한 웨이퍼의 표면효과와 그 태양전지 특성을 평가 고찰하였다. 텍스쳐링 전 $HNO_3-H_2O_2-H_2O$ 용액의 전처리는 표면반사율의 초기 저감효과를 가져왔다. 이는 산화특성에 의해 유기 불순물이 제거되고 텍스쳐링을 위한 핵의 생성에 기인한다고 할 수 있다. 이후 공정에서 불산/질산 용액에 인산 및 초산과 같은 완충제를 첨가한 혼합용액을 제조하고, 적정 농도 조합과 그 처리시간의 최적화를 통해 개선된 텍스쳐링 효과를 얻을 수 있었으며 이 효과는 표면반사율 감소를 통해 확인할 수 있었다. 이렇게 제조된 실리콘 웨이퍼에 반사방지막 코팅 후 태양전지를 제작하여 그 변환효율을 측정한 결과 16.4%의 양호한 특성을 나타냈다. 이는 개선된 텍스쳐링 처리에 의해 저감된 표면특성에 의한 단락전류의 증가에 기인한 것으로 추정된다.

• 한국자기학회지
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• 제17권4호
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• pp.166-171
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• 2007

단결정 Bi단일 나노선의 정상 자기 저항(ordinary magnetoresistance) 특성을 $2{\sim}300K$에서 4 단자법으로 측정하였다. I-V 측정을 통해 전기적 오믹 형성을 확인하였고, 2 K과 300 K에서 비저항이 각각 $1.0{\times}10^{-4}$와 $8.2{\times}10^{-5}{\Omega}{\cdot}cm$으로 측정되었다. 수직(transverse) 및 수평(longitudinal) 자기저항비(MR ratio)가 110 K와 2 K에서 각각 현재까지 보고된 MR 중 가장 큰 2496%와 -38%으로 관찰되었으며, 이 결과는 자발 성장법으로 성장된 Bi 나노선의 결정성이 매우 우수한 단결정임을 증명한다. simple two band(STB) 모델을 통해 Bi 나노선의 수직 및 수평 정상 자기 저항(OMR) 거동이 온도에 따른 페르미 준위(Fermi level)와 밴드 겹침(band overlap)등의 전자 구조 변화 및 운반자 농도 변화로 잘 설명된다.

• 한국진공학회지
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• 제7권4호
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• pp.403-409
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• 1998

본 연구에서는 자장강화된 유도결합형 플라즈마를 사용하여 이 플라즈마의 특성을 조사하고 또한 산화막 식각에 미치는 영향에 대하여 조사하였다. 자장 강화를 위해 4쌍의 영구자석이 사용되었고, 산화막 식각을 위해 $C_2F_6, CHF_3, C_4F_8$ 가스 및 이들 혼합가스가 사 용되었으며 첨가가스로 $H_2$를 사용하였다. 자장강화된 유도결합형 플라즈마 특성 분석을 위 해 Langmuir probe와 optical emission spectrometer를 이용하여 산화막 식각 속도 및 photoresist에 대한 식각 선택비를 stylus profilometer를 이용하여 측정하였다. 이온 밀도에 있어서 자장 유무에 따른 큰 변화는 관찰되지 않았으나 이온전류밀도의 균일도는 자장을 가 한 경우 웨이퍼가 놓이는 기판 부분에서 상당히 증가된 것을 알 수 있었다. 또한 자장이 가 해진 경우, 자장을 가하지 않은 경우에 비해 플라즈마 전위가 감소된 반면 전자온도 및 라 디칼 밀도는 크게 증가되는 것을 알 수 있었으며 산화막 식각시에도 높은 식각 속도와 식각 균일도를 보였다. 산화막 식각을 위해 수소가스를 사용한 가스조합중에서 C4F8/H2가스조합 이 가장 우수한 식각 속도 및 photoresist에 대한 식각 선택비를 나타내었으며 공정변수를 최적화 함으로써 순수 C4F8에서 4이상의 선택비와 함께 8000$\AA$/min의 가장 높은 식각속도 를 얻을 수 있었으며, 50%C4F8/50%H2에서 4000$\AA$/min의 산화막 식각 속도와 함께 15이상 의 식각 선택비를 얻을 수 있었다.

• 한국전기전자재료학회:학술대회논문집
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• 한국전기전자재료학회 2007년도 하계학술대회 논문집 Vol.8
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• pp.116-116
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• 2007

21 세기에 접어들면서 인터넷을 통한 정보 통신의 발달과 개인 휴대용 이동 통신기기의 활발한 보급에 따라 휴대형 전자기기들의 소형화와 고성능화로 나아가고 있다. 이러한 전자기기에 사용될 IC의 내장 메모리 또한 집적화 및 고속화, 저 전력화가 이루어져야 한다. 이러한 전자기기들에 필수적인 압전 세라믹스 부품 중 압전 부저 및 기타 음향 부품등을 각종 전자기기와 무선 전화기에 채택함으로써 압전 부품에 대한 수요와 생산이 계속 증가할 것으로 전망된다. 이처럼 압전 세라믹스를 이용한 그 응용 범위는 대단히 방대하며, 현재 모든 압전 부품들은 PZT 계열 재료로 만들어지고 있고, 차후 모두 비납계열 재료로 대체될 것이 확실시된다. Pb의 환경오염은 이미 오래전부터 큰 문제점으로 인식되고 있었으며 그 일례로 미국의 캘리포니아 주에서는 1986년부터 약 800종의 유해물질, 그 중에서도 Pb 사용을 300ppm 이하로 규제하는 Proposition 65를 제정하여 실행하고 있다. 그리고 2003년 2월에 EU (European Union) 에서 발표한 전자산업에 관한 규제 사항중 하나인 위험물질 사용에 관한 지칭 (Restriction of Hazardous Substance, RoHS) 에 의하면, 2006 년 7월부터 전기 전자 제품에 있어서 위험 물질인 Pb을 포함한 중금속 물질(카드늄, 수은, 6가 크롬, 브롬계 난연재)의 사용을 금지한다고 발표하였다. 비록 전자세라믹 부품에 함유된 Pb는 예외 사항으로 두었지만 대체 가능한 물질이 개발되면 전자세라믹 부품에서도 Pb의 사용을 금지한다고 규정하였다. 더욱이 일본은 2005 년부터 Pb 사용을 금지시켰다. 이와 같이 Pb가 환경에 미치는 영향 때문에 비납계 강유전 물질 및 압전 세라믹스 재료에 대한 연구가 전 세계적으로 활발히 진행되고 있다. 본 연구에서는 비납계 강유전체의 patterning을 위해서, NKN 박막을 고밀도 플라즈마원인 ICP를 이용하여 식각 mechanism을 연구하고, 식각변수에 따른 식각 공정을 최적화에 대하여 연구하였다. 가스 혼합비에 따라 식각 할때 700 W의 RF 전력과 - 150 V의 직류 바이어스 전압을 인가하였고, 공정 압력은 2 Pa, 기판 온도는 $23^{\circ}C$로 고정하였다. 식각 속도는 Tencor사의 Alpha-step 500을 이용하여 측정되었으며 식각 시 NKN 박막 표면과 라디칼과의 화학적인 반응을 분석하고 식각 메커니즘을 규명하기 위하여 XPS(x-ray photoelectron spectroscopy)를 사용하였다.

• 한국전기전자재료학회:학술대회논문집
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• 한국전기전자재료학회 2008년도 하계학술대회 논문집 Vol.9
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• pp.239-240
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• 2008

As semiconductor devices are scaled down for better performance and more functionality, the Cu-based interconnects suffer from the increase of the resistivity of the Cu wires. The resistivity increase, which is attributed to the electron scattering from grain boundaries and interfaces, needs to be addressed in order to further scale down semiconductor devices [1]. The increase in the resistivity of the interconnect can be alleviated by increasing the grain size of electroplating (EP)-Cu or by modifying the Cu surface [1]. Another possible solution is to maximize the portion of the EP-Cu volume in the vias or damascene structures with the conformal diffusion barrier and seed layer by optimizing their deposition processes during Cu interconnect fabrication, which are currently ionized physical vapor deposition (IPVD)-based Ta/TaN bilayer and IPVD-Cu, respectively. The use of in-situ etching, during IPVD of the barrier or the seed layer, has been effective in enlarging the trench volume where the Cu is filled, resulting in improved reliability and performance of the Cu-based interconnect. However, the application of IPVD technology is expected to be limited eventually because of poor sidewall step coverage and the narrow top part of the damascene structures. Recently, Ru has been suggested as a diffusion barrier that is compatible with the direct plating of Cu [2-3]. A single-layer diffusion barrier for the direct plating of Cu is desirable to optimize the resistance of the Cu interconnects because it eliminates the Cu-seed layer. However, previous studies have shown that the Ru by itself is not a suitable diffusion barrier for Cu metallization [4-6]. Thus, the diffusion barrier performance of the Ru film should be improved in order for it to be successfully incorporated as a seed layer/barrier layer for the direct plating of Cu. The improvement of its barrier performance, by modifying the Ru microstructure from columnar to amorphous (by incorporating the N into Ru during PVD), has been previously reported [7]. Another approach for improving the barrier performance of the Ru film is to use Ru as a just seed layer and combine it with superior materials to function as a diffusion barrier against the Cu. A RulTaN bilayer prepared by PVD has recently been suggested as a seed layer/diffusion barrier for Cu. This bilayer was stable between the Cu and Si after annealing at $700^{\circ}C$ for I min [8]. Although these reports dealt with the possible applications of Ru for Cu metallization, cases where the Ru film was prepared by atomic layer deposition (ALD) have not been identified. These are important because of ALD's excellent conformality. In this study, a bilayer diffusion barrier of Ru/TaCN prepared by ALD was investigated. As the addition of the third element into the transition metal nitride disrupts the crystal lattice and leads to the formation of a stable ternary amorphous material, as indicated by Nicolet [9], ALD-TaCN is expected to improve the diffusion barrier performance of the ALD-Ru against Cu. Ru was deposited by a sequential supply of bis(ethylcyclopentadienyl)ruthenium [Ru$(EtCp)_2$] and $NH_3$plasma and TaCN by a sequential supply of $(NEt_2)_3Ta=Nbu^t$ (tert-butylimido-trisdiethylamido-tantalum, TBTDET) and $H_2$ plasma. Sheet resistance measurements, X-ray diffractometry (XRD), and Auger electron spectroscopy (AES) analysis showed that the bilayer diffusion barriers of ALD-Ru (12 nm)/ALD-TaCN (2 nm) and ALD-Ru (4nm)/ALD-TaCN (2 nm) prevented the Cu diffusion up to annealing temperatures of 600 and $550^{\circ}C$ for 30 min, respectively. This is found to be due to the excellent diffusion barrier performance of the ALD-TaCN film against the Cu, due to it having an amorphous structure. A 5-nm-thick ALD-TaCN film was even stable up to annealing at $650^{\circ}C$ between Cu and Si. Transmission electron microscopy (TEM) investigation combined with energy dispersive spectroscopy (EDS) analysis revealed that the ALD-Ru/ALD-TaCN diffusion barrier failed by the Cu diffusion through the bilayer into the Si substrate. This is due to the ALD-TaCN interlayer preventing the interfacial reaction between the Ru and Si.

• 한국결정성장학회지
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• 제22권1호
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• pp.5-10
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• 2012

일반적으로 mesa 구조의 발광다이오드 제작은 MOCVD법으로 수행되고 있다. 특히 개개의 발광다이오드 칩을 식각하고 분리하기 위해서 발광다이오드는 반응성이온식각(RIE)공정과 절단(scribing) 공정을 거치게 된다. 플라즈마를 이용한 건식식각공정인 RIE 공정은 결함, 전위, 표면의 댕글링 본드 형성과 같은 몇 가지 문제점을 유발하고, 이러한 이유로 인해 소자 특성을 저하시킨다. 선택영역성장법은 사파이어 기판 위에 고품질의 GaN 에피층을 성장시키는 방법으로써 주목받고 있다. 본 논문에서는 고품질의 막을 제작하고 공정을 간소화하기 위해서 선택영역성장법을 도입하였고, 기존의 발광다이오드 특성에 영향을 주지 않는 선택영역의 크기를 규정하고자 한다. 실험에 사용된 원형의 선택성장영역의 직경크기는 2500, 1000, 350, 200 ${\mu}m$이고, 선택성장 된 발광다이오드의 소자 특성을 얻고자 SEM, EL, I-V 측정을 시행하였다. 주된 발광파장의 위치는 직경크기 2500, 1000, 350, 200 ${\mu}m$에서 각각 485, 480, 450, 445 nm로 측정되었다. 직경 350, 200 ${\mu}m$에서는 불규칙한 표면과 기존 발광다이오드보다 높은 저항 값을 얻을 수 있었지만, 직경 2500, 1000 ${\mu}m$에서는 평탄한 표면과 앞서 말한 350, 200 ${\mu}m$의 특성보다 우수한 전류-전압 특성을 얻을 수 있었다. 이러한 결과들로 기존 발광다이오드의 특성에 영향을 주지 않는 적당한 선택성장 직경크기는 1000 ${\mu}m$ 이상임을 확인하였다.