• 제목/요약/키워드: One-chip processor

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마이크로 프로세서로 손쉽게 구현 가능한 BLDC(Burshless DC)-모터 제어 알고리즘 (BLDC(Brushless DC) Motor Control Algorithm to be easily Realized by a Micro Processor)

  • 이영주
    • 대한전자공학회:학술대회논문집
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    • 대한전자공학회 2002년도 하계종합학술대회 논문집(5)
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    • pp.59-62
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    • 2002
  • BLDC motor is widely used in automation areas for its good maintenance and controllability. In this paper it is designed for a speed control servo system of sinusoidal typo BLDC motor that can be easily adapted to automation systems with lower cost. Also, control parameters & periods are made adjustable according to the sensors of the motor, electric and mechanical time constant, and PI and PD control are used. The processor for the proposed system is a low cost 16bit One-Chip microprocessor. By experimental results from application to the industrial sewing machine, one of the application of BLDC motor, it can be verified that under the given reference, the system is enough as a speed and position servo without overshoots.

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LZSS 알고리즘과 엔트로피 부호를 이용한 사전탐색처리장치를 갖는 부호기/복호기 단일-칩의 VLSI 설계 및 구현 (A VLSI Design and Implementation of a Single-Chip Encoder/Decoder with Dictionary Search Processor(DISP) using LZSS Algorithm and Entropy Coding)

  • 김종섭;조상복
    • 대한전자공학회논문지SD
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    • 제38권2호
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    • pp.103-113
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    • 2001
  • 본 논문은 0.6㎛ CMOS 기술로 LZSS 알고리즘과 엔트로피 부호를 이용한 부호기/복호기 단일-칩의 본 논문은 0.6uul CMOS 기술로 LZSS 알고리즘과 엔트로피 부호를 이용한 부호기/복호기 단일-칩의 VLSI 설계 및 구현에 관하여 기술하였다. 처리 속도 50MHz를 갖는 사전탐색처리장치(DISP)의 메모리는 2K×Bbit 크기를 사용하였다. 이것은 매번 33개 클럭 중 한 개의 클럭은 사전의 WINDOW 배열을 갱신으로 사용하고 나머지 클럭은 주기마다 한 개의 데이터 기호를 바이트 단위로 압축을 실행한다. 결과적으로, LZSS 부호어 출력에 엔트로피 부호를 적용하여 46%의 평균 압축률을 보였다. 이것은 LZSS에 보다 7% 정도의 압축 성능이 향상된 것이다.

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Development of totally implantable total artificial heart controller

  • Choi, Won-Woo;Lee, Sang-hoon;Lee, Woo-Cheol;Min, Byoung-Gu
    • 제어로봇시스템학회:학술대회논문집
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    • 제어로봇시스템학회 1991년도 한국자동제어학술회의논문집(국내학술편); KOEX, Seoul; 22-24 Oct. 1991
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    • pp.758-761
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    • 1991
  • Using one chip microcontroller 87Cl96 (On chip EPROM type) and EPLD (Erasable & Programable Logic Device), an implantable control system to drive pendulum type electromechanical total artificial heart was developed. This control system consists of 4 parts, main management system, motor driver with power regulator, state monitoring system and communication part. The main system has the functions for speed detection, PI(proportional and integration) control, PWM generation, communication and analog data processor. Two kinds of power system were used and separated by 8 photo coupler arrays to improve the system stability. The performances of each compartments were compared with our previous z80 microprocessor based control system and good correspondences was shown. Logic power consumption was reduced to a one third of our previous controller. Using mock circulation tests, the overall performances of control system are evaluated.

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운동량 측정 신발의 개발 (Development of the shoes measuring the performance of walking or running)

  • 김유신;전창훈;김명훈;최형식
    • 대한기계학회:학술대회논문집
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    • 대한기계학회 2003년도 춘계학술대회
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    • pp.863-867
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    • 2003
  • This paper aims at the development of shoes measuring the performance of walking or running, which is equipped with electronic devices. In the in-sole of the shoes, a piezoelectric sensor is inserted for measuring the number of steps and the speed of walking. The measured signals are processed by the one-chip microprocessor and related electronic devices. Using the data, the momentum and calories of walking and running are calculated, and the results are transmitted to the displaying system composed of LCD by the RF telecommunication system.

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보조계전기의 진단 모니터링 시스템 구현 (Implementation of Diagnostic Monitoring System for Auxiliary Relay)

  • 장용훈;남재현
    • 한국정보통신학회:학술대회논문집
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    • 한국정보통신학회 2016년도 추계학술대회
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    • pp.709-711
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    • 2016
  • 산업현장에서 자동화시스템은 PLC(Program Logic Control)를 사용하여 시스템을 제어하고, 감지기에서 전달되는 정보로 시스템의 상태를 계측하고 생산성 향상을 위해 사용되고 있다. 본 연구에서 제안하는 진단 모니터링시스템은 릴레이모듈, 원칩프로세서모듈 그리고 컴퓨터 모니터링시스템으로 구성된다. 보조계전기의 고장을 실시간으로 파악하여 고장 난 시스템을 수리하고, 정상 가동에 소요되는 시간을 최소화하여 생산성을 향상시키고자 한다.

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경제적인 VPN 시스템 구축을 위한 2-Chip 기반의 암호가속기 성능분석 (Performance Analyses of Encryption Accelerator based on 2-Chip Companion Crypto ASICs for Economic VPN System)

  • 이완복;김정태
    • 한국정보통신학회논문지
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    • 제10권2호
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    • pp.338-343
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    • 2006
  • 본 논문은 저비용 고성능으로 패킷암호 처리를 할 수 있는 VPN 시스템의 구조와 그 설계에 대해서 소개한다. 제안하는 시스템 구조는 보안장비용 다기능 네트워크 프로세서와 전용 암호패킷 처리 칩의 2개의 컴페니언 칩들로 구성되어 있으며, 즉각적인 활용을 위해 필요한 운영체제의 구축 및 디바이스 드라이버, 컴파일러와 이를 기반으로 한 IPSec VPN의 핵심 엔진에 대해 구축한 방안이 언급된다. 특히, 계산력을 많이 필요로 하는 블록 암호 알고리즘인 3DES, AES, SEED는 별도의 칩으로 구현되어 범용성이 뛰어난 것이 특징이며, 이 칩의 성능 평가 결과를 소개한다.

멀티 코어 프로세서의 온도관리를 위한 방안 연구 및 열-인식 태스크 스케줄링 (Thermal Management for Multi-core Processor and Prototyping Thermal-aware Task Scheduler)

  • 최정환
    • 한국정보과학회논문지:시스템및이론
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    • 제35권7호
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    • pp.354-360
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    • 2008
  • 최신의 마이크로프로세서 설계에서는 전력 관련 문제들이 중요한 고려사항이 되었다. 온-칩(On-chip) 온도 상승은 이와 관련하여 중요한 요소로 부각되었다. 이를 적절하게 처리하지 않을 경우 냉각 비용과 칩 신뢰성에 부정적인 결과를 초래한다. 이 논문에서 우리는 시간적/공간적인 핫 스폿(Hot spot) 완화를 위한 설계들과 열 시간 상수, 작업부하 변동, 마이크로프로세서의 전력 분배 사이의 보편적인 상충관계(Trade off)들을 조사한다. 우리의 방안은 작업부하의 실행위치/순서를 변경하고 동시실행 스레드의 수를 조절하여 시스템의 공간 및 시간적인 열 틈새(Heat slack)에 영향을 줌으로써, 운영체계(OS)와 이미 시스템에 존재하는 하드웨어의 지원만으로 적절한 시간제한내에 작업부하를 조절함으로써 온-칩 온도를 낮출 수 있다.

전기로 제어를 위한 전문가 시스템 (Expert system for electrical furnace)

  • 명노직;허욱열
    • 제어로봇시스템학회:학술대회논문집
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    • 제어로봇시스템학회 1990년도 한국자동제어학술회의논문집(국내학술편); KOEX, Seoul; 26-27 Oct. 1990
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    • pp.113-116
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    • 1990
  • In this paper, An expert system for electric furnace with time delay is proposed. The expert system uses Fuzzy control theory. The conventional controller uses Auto-Tuning control theory. From experiment, we can obtain that the response of expert system is superior to the response of the conventional controller. In this experiment, the expert controller is implemented with the IBM PC. The 8751 One chip processor controling the electric furnace is used.

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DDMB 구조에서의 런타임 메모리 최적화 알고리즘 (Run-time Memory Optimization Algorithm for the DDMB Architecture)

  • 조정훈;백윤흥;권수현
    • 정보처리학회논문지A
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    • 제13A권5호
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    • pp.413-420
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    • 2006
  • 대부분의 디지털 신호 처리기 (Digital Signal Processor)는 두 개 이상의 메모리 뱅크를 가지는 하버드 아키텍처 (Harvard architecture)를 지원한다. 다중 메모리 뱅크 중에서 하나는 프로그램용으로 나머지는 데이터용으로 사용하여 프로세서가 한 명령어 사이클에 메모리의 여러 데이터에 동시 접근을 가능하게 한다. 이전 연구에서 우리는 다중 메모리 뱅크에 효율적으로 데이터를 할당하는 방법에 대하여 논하였다. 본 논문에서는 이전 연구의 확장으로 런타임 메모리의 최적화에 대한 우리의 최근 연구에 대하여 소개한다. 듀얼 데이터 메모리 뱅3(Dual Data Memory Bank)를 효율적으로 이용하기 위해 각 메모리 뱅크에 할당된 변수를 관리하기 위한 독립적인 두 개의 런타임 스택이 필요하다. 프로시저에 대한 두 메모리 뱅크의 활성화 레코드(Activation Record)의 크기는 각 메모리 뱅크에 할당된 변수의 개수가 일정하지 않기 때문에 다를 수 있다. 따라서 여러 개의 프로시저가 연속으로 호출될 때 두 개의 런타임 스택의 크기가 크게 달라질 수 있다. 이러한 두 메모리 뱅크 사이의 불균형은 하나의 메모리에 여유 공간이 있음에도 불구하고 다른 하나의 메모리 뱅크의 사용량이 온칩 메모리(on-chip memory)범위를 초과하는 원인이 될 수 있다. 본 논문에서는 온칩 메모리를 효율적으로 사용하기 위해 두 런타임 스택의 균형 맞추기를 시도했다. 본 논문에서 제안하는 알고리즘은 상대적으로 단순하지만 효율적으로 런타임 메모리를 사용할 수 있다는 것을 실험결과를 통해 보여주고 있다.

병렬 알고리즘의 가속화를 위한 GP-GPU의 Thread할당 기법 (Thread Distribution Method of GP-GPU for Accelerating Parallel Algorithms)

  • 이관호;김치용
    • 전기전자학회논문지
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    • 제21권1호
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    • pp.92-95
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    • 2017
  • 본 논문에서는 적은 면적의 GP-GPU에서 성능을 향상시키기 위한 방법을 제안한다. 본 논문에서는 superscalar와 같이 과도하게 스케줄링 복잡성을 증가시키지 않는 대신 단순한 코어의 수를 늘려 성능을 극대화 시키는 방법을 제안한다. GP-GPU를 구성하는 Stream Processor의 구조를 단순화한다. 또한, Warp Schedule에서 thread 할당을 어플리케이션에 적합한 방법을 개발하여 성능을 개선한다. 성능을 검증하는 방안으로 neural network의 한 분야인 딥러닝에 대한 스레드 할당방식을 제안한다. Neural Network 알고리즘의 경우 Intel CPU 대비 90%에서 ARM Cortex-A15 4 core 대비 98% 성능 향상을 확인할 수 있었다.