• 제목/요약/키워드: One dimensional array

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Color volumetric 3D display system based on a rotating LED Screen

  • Haifeng, Li;Jiang, Wu;Xu, Liu;Caijie, Yan;Zhenrong, Zheng
    • 한국정보디스플레이학회:학술대회논문집
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    • 한국정보디스플레이학회 2009년도 9th International Meeting on Information Display
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    • pp.510-512
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    • 2009
  • A volumetric 3D display system based on a rotating two dimensional color LED array is set up. It has a cylinder display space ${\Phi}800{\times}640mm3$ which is composed of 256 slices of pictures in one 3D image with each slice $320{\times}256$ LED pixels. The volumetric image has 4 gray scales and 64 colors. The main structure and working principle of the system is described in detail.

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전해 가공 방법을 이용한 다중 마이크로 전극 제작 (Electrochemical Fabrication of Multi Microelectrodes)

  • 권순근;임형준;김수현;곽윤근
    • 대한기계학회:학술대회논문집
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    • 대한기계학회 2004년도 춘계학술대회
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    • pp.1136-1141
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    • 2004
  • In recent years, demands on microelectrode have been greatly enhanced because of its potential applications and mass production of microelectrodes is needed. An electrochemical fabrication is used as an method for the simple and cheap fabrication of multi microelectrodes. In this paper, one dimensional microelectrode array is used for fabricating of multi electrodes. A diffusion layer which is formed near the electrode surface has an effect on the shape error of multi microelectrodes. The optimal distance between electrodes to minimize shape errors of multi electrodes is investigated. Multi microelectrodes which has several tens of and hundreds of micrometer in diameter are fabricated at a time.

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다수의 영상에 대한 스크램블 및 디스크램블 방법 (Scramble and Descramble Scheme on Multiple Images)

  • 김승열;유영갑
    • 한국콘텐츠학회논문지
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    • 제6권6호
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    • pp.50-55
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    • 2006
  • 본 논문에서는 다수의 비디오(video) 채널로부터 영상을 스크램블 및 디스크램블 하는 방법을 제안한다. 이 알고리즘은 다수의 영상 혼합과 이어 붙여진 영상의 화소 좌표의 뒤섞기를 이용한 암호화 방법이다. 조합된 프레임의 수직라인과 수평라인의 영상정보를 암호화 및 복호화 함으로서 암호화된 복합 영상을 얻는다. 이 알고리즘은 다수의 비디오 채널에서 모아진 다수의 영상을 하나의 영상으로 재구성하여 영상을 암호화함으로써 한 번에 다수의 영상 암호화하고 높은 보안성을 제공한다.

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영역-그룹화 질의 계산 알고리즘 (An Algorithm for Computing Range-Groupby Queries)

  • 이영구;문양세;황규영
    • 한국정보과학회논문지:데이타베이스
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    • 제29권4호
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    • pp.247-261
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    • 2002
  • 온라인 분석처리(On-Line Analytical Processing: OLAP)에서 집계 연산은 중요한 기본 연산이다. 본 논문에서는 OLAP에서의 집계 질의 중 영역-그룹화(range-groupby)라는 새로운 클래스의 질의를 정의하고, 이 질의의 처리 방법을 제시한다. 영역-그룹화 질의는 n-차원 데이타 큐브의 임의의 영역에 속한 셀들에 대하여 주어진 그룹화 속성들의 조합에 따라 집계 값을 구하는 질의이다. 이 질의는 관심의 대상이 되는 임의의 영역 내에서의 경향을 다각적인 측면에서 분석하기 위해서 OLAP에서 자주 사용되는 질의이다. 일반적으로, OLAP에서는 질의를 빠르게 처리하기 위하여 전방-합 배열(prefix-sum array)이라 불리는 집계 결과를 미리 계산하여 유지하는 선계산 기법이 실제적으로 널리 사용되고 있다. 그런데, 영역-그룹화 질의의 경우에는, 그룹화 속성들의 모든 조합에 대하여 집계 결과를 저장해야 하기 때문에, 저장 공간 오버헤드가 너무 크다. 본 논문에서는 가능한 적은 공간 오버헤드를 가지고 영역-그룹화 질의를 빠르게 처리할 수 있는 방법을 제안한다. 제안한 방법은 단지 하나의 전방-합 배열만을 유지하면서도, 가능한 모든 그룹화 속성의 조합에 대하여 영역-그룹화 질의를 효율적으로 처리한다. 이 방법은 가능한 모든 그룹화 속성들의 조합에 대하여, 전방-합 배열을 선계산하여 유지하는 방법과 비교할 때 액세스되는 셀의 개수는 비슷하면 서 공간 오버헤드는 (equation omitted)(n은 디멘젼의 개수)로 줄인다.

Field Programmable Stateful Logic Array 패브릭 매핑 및 배치 (Fabric Mapping and Placement of Field Programmable Stateful Logic Array)

  • 김교선
    • 전자공학회논문지
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    • 제49권12호
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    • pp.209-218
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    • 2012
  • 최근 무어의 법칙을 연장시킬 시스템 집적 기술로서 Field Programmable Stateful Logic Array (FPSLA)가 제안되었다. 본 논문은 FPSLA의 설계 자동화 절차를 확립하고 논리 합성, 동기화, 물리적 매핑, 자동 배치 등의 접근 방법을 최초로 제시한다. 특히, 동기화를 통해 배치를 1차원 문제로 축소한 후 비선형 최적화 기법을 개량한 개략 배치 모델 및 하향식 계층적 2분법을 이용한 배치 적법화 알고리즘을 제안하였다. 또한, 제안된 모델 및 알고리즘을 소프트웨어로 구현하여 ACM/SIGDA 벤치 마크 예제에 적용함으로써 그 유효성을 입증하였다. 이 소프트웨어에는 Fanout 수만큼 출력 상태를 같은 단의 멤리스터성 스위치에 복사해야 하는 FPSLA의 특성을 고려하여 최적화 단계 별로 넷을 하이퍼에지로 통합했다가 다시 에지로 분리하는 기법이 제안되었으며 약 18.4%의 추가적 최적화를 이룩했다. FPSLA의 출력 상태 복사는 논리 단 일부에 셀 밀도가 집중되는 문제를 노출했으며 단위 논리 게이트의 Fanin을 제한하는 기법으로 18.5% 감소 효과를 얻었다. FPSLA의 실용성 확보를 위해서는 우선 논리 합성 시 Fanin의 수가 일부 단에 집중되지 않도록 제약하는 방안을 개발하여야 한다. 또한, FPSLA 패브릭 구조를 이식하기 위해 대칭성이 감소된 나노와이어 크로스바가 형성하는 복잡한 그래프 상에서 수행되어야 하는 자동 배선의 효율성 연구도 필요하다. 이러한 툴 개발은 설계 자동화 자체뿐만 아니라 FPSLA의 패브릭 구조 개선에 필요한 실험에 유용한 평가 도구로서도 큰 역할을 할 것이다.

사이드 홀을 가진 케뉼라에 관한 수치해석적 연구 (Numerical Analysis on the Flow in Cannulae having Side Holes)

  • 박중열;박찬영;민병구
    • 대한의용생체공학회:의공학회지
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    • 제25권6호
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    • pp.489-496
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    • 2004
  • 혈액이 케뉼라를 통과할 때 생리적인 범위를 벋어나는 기계적인 하중이나 전단응력을 받게 되며, 그 결과로 용혈의 발생기전이 되는 ADP(Adenosine Diphospate)를 증가 시키게 된다. 저자는 수치해석적인 방법을 이용하여 사이드 홀을 가진 케뉼라의 3차원 유동을 해석하였다. 연구의 대상이 되는 케뉼라는 환자의 대퇴정맥에 삽입되어 혈액을 배출하는 배액 케뉼라이다. 이러한 배액 케뉼라는 배출 성능을 높이기 위해 일반적으로 사이드 홀을 장착한다. 4개, 12개, 20개인 사이드 홀을 가진 케뉼라에 대하여 경우에 대하여, 각각 엇갈림 배열, 직렬 배열. 변형된 직렬배열을 적용하여, 총 9가지 서로 다른 모델을 시뮬레이션 해보았으며 이것을 사이드 홀이 없는 케뉼라와 더불어 비교하였다. 유량, 벽면전단응력(Wail Shear Stress. WSS), 전단율(Shear Rate. SR) 값을 구하여 분석하므로 사이드 홀의 영향을 알아보았다. 연구를 통하여 사이드 홀의 개수와 배열이 모두 혈류 역학적인 변수들에 영향을 주는 것을 확인하였다. 유량이 사이드 홀의 개수에 비례하지 않는 것을 확인 하였고 사이드 홀의 개수가 많을 수로 평균 전단율을 줄이는 것을 확인 하였다.

데이터 전송 오류에 대한 고장 극복 암호회로 (Fault Tolerant Cryptography Circuit for Data Transmission Errors)

  • 유영갑;박래현;안영일;김한벼리
    • 한국콘텐츠학회논문지
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    • 제8권10호
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    • pp.37-44
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    • 2008
  • 논문은 암호문 송신 중 전송 오류에 의한 암복호화의 문제에 대한 해결책을 제시 한다. 블록 암호 알고리즘은 산사태(avalanche) 효과로 인해 단일 비트 오류에 대해서도 많은 비트에 오류를 발생시킨다. 이를 해결하기 위해 재배열 과정과 간단한 오류 정정 코드를 이용해서 산사태(avalanche) 효과에 강인한 방안을 제안한다. 재배열 과정은 간단한 오류 정정 코드를 사용하기 위한 것이다. 재배열 과정은 한 프레임 내에서 전송의 기본 단위인 n-비트 블록 내에 1비트의 단일 오류만이 존재 할 수 있도록 오류를 여러 단위에 분산시키는 역할을 하게 된다. 즉, n-비트 내에서 단일 오류만이 존재하게 되어 단일 오류 정정 코드로 쉽게 복원이 가능하게 된다. 이 방식은 보다 큰 데이터 단위에 확장하여 사용 될 수 있다.

강제 대류하에서 일차원 액적 배열내의 화염 퍼짐에 관한 실험적 연구 (An Experimental Study on Flame Spread in One-Dimensional Droplet Array with Forced Convection)

  • 박정;이기만;신강숭
    • 대한기계학회논문집B
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    • 제24권1호
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    • pp.68-74
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    • 2000
  • Experimental investigation on flame spread along suspended droplet arrays have been conducted with various droplet spacings and ambient air velocities. Especially, an opposed air stream is introduced to simulate fundamental flame spread behaviors in spray combustion. High-speed chemiluminescence imaging technique of OH radicals has been adopted to measure flame spread rates and to observe various flame spread behaviors. The fuel used is n-Decane and the air velocity varies from 0 to 17cm/s. The pattern of flame spread is grouped into two: a continuous mode and an intermittent one. It is found that there exists droplet spcings, above which flame spread does not occur. The increase of ambient air velocity causes the limit droplet spacing of flame spread to become small due to the increase of apparent flame stretch. As the ambient air velocity decreases, flame spread rate increases and then decreases after taking a maximum flame spread rate. This suggests that there exists a moderate air flowing to give a maximum flame spread rate due to enhanced chemical reaction by the increase of oxidizer concentration.

일차원 액적 배열의 화염 퍼짐에 있어서 연료의 혼합 효과에 관한 연구 (A Study on Blend Effect of Fuel in Flame Spread Along An One-Dimensional Droplet Array)

  • 박정;소림수소;신강숭
    • 한국연소학회지
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    • 제3권2호
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    • pp.1-11
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    • 1998
  • Experimental investigation on flame spread of blended fuel droplet arrays has been conducted for droplet diameters of 1.0mm and 0.75mm using high-speed chemiluminescence images of OH radical. The flame spread rate is measured with blended fuel composition, droplet diameter, and droplet spacing. Flame spread is categorized into two: a continuous mode and an intermittent one. There exist a limit droplet spacing, above which flame does not spread, and a droplet spacing of maximum flame spread, which is closely related to flame diameter. It is seen that flame spread rate is mainly dependent upon the relative position of flame zone within a droplet spacing. In case of large droplet, the increase of % volume of Heptane induces the shift of limit droplet spacing to a larger spacing since volatile Heptane plays a role of an enhancer of flame spread rate. In case of small droplet, the increase of % volume of Heptane leads to the shift of limit droplet spacing to a smaller droplet spacing. This is so because of the delayed chemical reaction time by the rapid increase of mass flux of fuel vapor for small droplet.

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Logic eFuse OTP 메모리 IP 설계 (Design of a Logic eFuse OTP Memory IP)

  • 임영욱;하판봉;김영희
    • 한국정보통신학회논문지
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    • 제20권2호
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    • pp.317-326
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    • 2016
  • 본 논문에서는 OTP (One-Time Programmable) IP (Intellectual Property)의 개발비용을 절감하고 개발 기간을 단축하기 위해 로직 트랜지스터만 이용한 로직 eFuse (electrical Fuse) OTP IP를 설계하였다. 웨이퍼 테스트 시 테스트 장비에서 FSOURCE 패드를 통해 VDD (=1.5V)보다 높은 2.4V의 외부 프로그램 전압을 eFuse OTP IP에만 공급하므로 eFuse OTP 이외의 다른 IP에는 소자의 신뢰성에 영향을 미치지 않으면서 eFuse OTP cell의 eFuse 링크에 높은 전압을 인가하도록 하였다. 한편 본 논문에서는 128행 ${\times}$ 8열의 2D (Dimensional) 메모리 어레이에 직접 FSOURCE 전압을 인가하여 eFuse에 인가되는 프로그램 파워를 증가시키면서 디코딩 로직 회로를 저면적으로 구현한 eFuse OTP 셀을 제안하였다. 동부하이텍 $0.11{\mu}m$ CIS 공정을 이용하여 설계된 1Kb eFuse OTP 메모리 IP의 레이아웃 면적은 $295.595{\mu}m{\times}455.873{\mu}m$ ($=0.134mm^2$)이다.