Sindhadevi, M.;Kanagasabai, Malathi;Arun, Henridass;Shrivastav, A. K.
Journal of Electrical Engineering and Technology
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제11권1호
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pp.175-183
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2016
This paper brings out a novel method for reducing Near end and Far end Crosstalk using Electromagnetic Band Gap structures (EBG) in High Speed RF transmission lines. This work becomes useful in high speed closely spaced Printed Circuit Board (PCB) traces connected to multi core processors. By using this method, reduction of −40dB in Near-End Crosstalk (NEXT) and −60 dB in Far End Crosstalk (FEXT) is achieved. The results are validated through experimental measurements. Time domain analysis is performed to validate the signal integrity property of coupled transmission lines.
본 논문에서는 100 Mb/s Unshielded Twisted Pairs (UTP) 케이블 Modular Jack의 평형 통신 시스템(Balanced Communication System)에서 시스템의 성능에 영향을 주지 않으변서, UTP 케이블의 꼬임이 풀림 으로 인해 서로 근접하게 배치된 평형통신 선로(Balanced Communication Lines)간에 존재하는 불균일한 결 합으로 인한 차등 누화 선호(Differen tial- Mode Crosstalk Signal)를 효과적으로 제거하거나 억제시킬 수 있는 접근 방법에 대하여 논하고 있으며, 실제 UTP 케이블의 Modular Jack에 이를 적용시켜 이에 대한 큰단누화 (Near-End Crosstalk (Next)를 측정함으로써 그 타당성을 입증하였다.
본 논문은 필드 상쇄 기술을 사용하여 PCB(printed circuit board) 기판으로 모듈라 잭 내부구조를 설계한 후 측정하여 이론과 실제가 일치함을 보였다. 모듈라 플러그의 경우, Maxwell 3D parameter extractor S/W를 사용하여 M.O.M(method of moment) 방식으로 예상되는 C(capacitance) 값을 추출한 후, 그 값에 맞는 PCB를 설계한 후 , 시뮬레이션하여 최적의 값을 얻었고, 이를 근거로 PCB를 제작하여 네트웍 분석기(network analyzer)로 측정항목들을 측정하였다. 측정 결과와 필드 상쇄 기술을 사용한 시뮬레이션 결과가 잘 일치함을 보였다.
UTP 케이블은 광범위하게 사용되고 있고, 최근에는 UHF 주파수 밴드를 위한 제품도 개발되고 있다. UTP 케이블의 가장 중요한 성능 중 하나는 NEXT 특성이다. NEXT 특성을 만족하는 UTP 케이블을 제조하기 위해서 적당한 피치의 길이를 선택하는 기술을 연구하였다. 전산모사는 선로 사이의 뮤추얼 인덕턴스와 커패시턴스를 포함한 전송선로 모델을 이용하였고, 주파수는 1 MHz에서 600 MHz까지의 데이터로 나타내었다. Cat. 6 케이블 NEXT의 worst margin은 전산모사와 측정 결과가 잘 일치하였다.
본 논문에서는 FTTC/VDSL (Fiber-to-the-Curb/Very High-speed Digital Subscriber Line) 전송시스템의 개발동향과 ANSI, ETSI, ITU등의 표준화 위원회에서 현재 진행중인 VDSL 시스템의 표준화 작업에 대해 기술하였다. 특히, POTS (Plain Old Telephone Service), BA-ISDA(Basic Access Integrated Services Digital Network), HDSL(High-rate Digital Subscriber Line), SDSL (Single-pair HDSL), ADSL(Asymmetric Digital Subscriber Line) 등의 다양한 xDSL (Digital Subscriber Line) 서비스들에서 발생하는 NEXT (Near-end Crosstalk)/FEXT (Far-end Crosstalk)와 같은 crosstalk를 최소화하기 위해 제안된 VDSL시스템의 주파수 대역과 PSD (Power Spectral Density) mask에 관해 설명하고, 순방향(down-stream) 채널과 역방향(upstream) 채널의 데이터 전송률이 대칭적인 VDSL전송시스템과 비대칭적인 VDSL 전송시스템 간의 주파수대역의 호환성 문제, RFI(Radio Frequency Interference) ingress/egress 문제의 해결 방안에 관해 기술하였다. 또한, 현재 VDSL Coalition과 VDSL Alliance 간에 논의 중인 VDSL 전송시스템의 변복조 방식에 관한 표준화 작업과정 및 순방향과 역방향에 할당될 band 개수에 따른 시스템 성능의 장단점 등에 관해 살펴보았다. 끝으로 현재 국내에서 개발되고 있는 FTTC/VDSL 전송시스템의 전체구조를 요약하고, 네트워크에서 가입자쪽으로 순방향 데이터 전송에 사용된 51.84 Mb/s 19-CAP (Carrierless Amplitude/Phase Modulation) 전송시스템과 가입자 댁내에서 네트워크 방향으로 역방향 데이터 전송에 사용된 1.62 Mb/s QPSK (Quadrature Phase Shift Keying) burst-mode TDMA (Time Division Multiple Access) 전송시스템 등의 동작 원리 및 구조를 기술하였다.
본 논문은 ATM LAN 시스템의 NEXT(near-end crosstalk) 억제에 관한 연구로서, cyclostationary 근단 누화신혼(NEXT)가 존재하는 경우, NEXT 억제를 수행하는 PS-FSE (phase-splitting fractionally spaced equalizer)의 수렴 동작과 성능에 대하여 분석한다. 전체 수렴 속도와 수렴 후 성능은 신호와 근단 누화 신호와의 상대적 클락 페이즈(relative clock phase)에 따라 다르게 나타나고, 이러한 현상은 PS-FSE의 eigenstructure를 통해 설명할수 있다. Cyclostationary 근단 누화 신호과 존재하는 경우 PS-FSE는 stationary 잡음의경우와 다른 eigenstructure를 가진다. PS-FSE의 전체 수렴 속도는 근단 누화 신호 전력 스펙트럼에서 신호와 근단 누화 신호간의 cross 전력 스펙트럼을 뺀 값으로 구해지는 eigenvalue 값에 의해 결정되고, 따라서 신호와 근단 누화 신호간의 correlation에 의해 전체 수렴 속도가 좌우된다.
디지털 가입자 회선(DSL)의 채널 용량에 가장 크게 영향을 미치는 내부 잡음원으로서 근단누화(NEXT) 및 원단누화(FEXT) 잡음을 들 수 있지만, 외부 잡음원인 임펄스 영향에 의해 DSL 성능 열화가 야기되므로 송수신 설계에 있어 이들 잡음원들의 복합적인 성능 분석이 절실히 요구되고 있다. 이에 본 연구에서는 테스트 신호 Cook 펄스를 Middleton의 Class A 임펄스 신호로 모델화 한 후, 가우스 잡음, NEXT 및 FEXT 잡음, 임펄스 잡음의 복합 잡음환경에서 DMT 신호의 SNR 마진을 계산하여 평가를 행하였다. 그 결과 업링크상에서는 루프전송길이에 따른 전송속도의 열화는 크지 않으며, 잡음의 특성에 의해 전송속도가 제한되지만, 다운링크상에서는 루프 전송길이 뿐만 아니라 잡음특성등에 의한 복합적인 열화가 두드러짐을 알 수 있다. 결론적으로 본 연구의 결과는 임펄스 잡음을 포함한 복합환경에서의 ADSL 성능기준을 설정하는데 주요 자료로서 활용될 수 있을 것이다.
본 논문에서는 비동기식 Zipper 방식의 VDSL(Very High Blt-rate Digital Subscriber Line) 시스템에서 cyclic extension 을 최소화 하는 기법을 제안하고, 전형적인 전화채널 환경 하에서 제안된 방식의 성능을 분석한다. Zipper 방식에서는 각 DMT(discrete-multitone) 블록에cyclic prefix(CP) 와 cyclic suffix(CS)가 추가로 사용되는데, 여기서 CP 는 심볼간 간섭과 부채널간 간섭을 방지하기 위하여 삽입되며, CS는 upstream 과 downstream 부반송파간의 직교성을 유지하기 위하여 추가되어 near-end crosstalk (NEXT)을 방지한다. 이 방식이 동기식 Zipper 방식으로 CS에 의해 NEXT를 제거하기 위해서는 한 binder 내의 모든 송신단의 동기를 맞추어야 한다. 그러나 비동기식 Zipper 방식은 다른 송신단과의 동기가 맞지 않아 CS가 NEXT에 아무런 영향을 주지 못한다 본 논문에서는 CS를 사용하지 않는 비동기식 Zipper 방식의 VDSL 시스템을 제안한다. 컴퓨터 모의실험을 통하여 제안된 방식이 전형적인 채널환경 하에서 기존 Zipper 방식의 VDSL 시스템과 비교하여 비슷한 전송능력을 갖게 됨을 보인다.
Echo and near-end crosstalk(NEXT) can be generated in two-wire duplex transmission. In this paper investigates how to cancel echoes of high speed communication. A pipeline algorithm is used to remove the echoes that high speed communication. It is least mean squared(LMS) algorithm based on the relaxed look-ahead concept, is focused on the pipelined LMS, and its performance is compared to that of the serial LMS algorithm. And we design pipelined adaptive filtering. In advanced of the hardware implementation with VHDL code the performance of pipelined LMS algorithm is verified by the computer simulation.
In this paper we propose an efficient implementation technique for cyclic extension in VDSL(Very High bit-rate Digital Subscriber Line) systems using Zipper duplexing and analyze its performances under typical telephone channel environments. In Zipper-based VDSL systems each DTM(discrete-multitone) block is appended by both cyclic prefix(CP) and cyclic suffix(CS). The CP is inserte to prevent both intersymbol interference (ISI) and iterchannel interference (ICI) while the CS is appended to ensure orthogonality between the upstream and downstream carriers thus preventing near-end crosstalk (NEXT). However in order to implement the CP in the transmitter side of the VDSL system an additional hardware is required to append the latter part of each DMT symbol to the beginning of the DMT symbol. In this paper we propose a VDSL system with Zipper duplexing using only CS to reduce hardware complexity (memory and processing delay) required for implementation of CP. It is shown by computer simulation that the proposed approach has the same capacity under typical channel environments as the previous Zipper-based VDSL system using both CP and CS. even with a significantly lower hardware complexity.
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[게시일 2004년 10월 1일]
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