• 한국컴퓨터정보학회논문지
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• 제13권2호
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• pp.1-9
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• 2008

소프트웨어가 대형화되고 기능이 복잡해짐에 따라 개발절차를 따르지 않으면 성공하기 어렵다. 개발과정의 종합적인 체계를 제시하는 소프트웨어 프로세스는 성숙되고 능력 있는 개발 조직이 일반적으로 수행하는 개발 활동과 절차라 할 수 있는데, 전반적 개발과정의 관리에 관련되어있다. 하지만 복잡하고 일반 개발자에는 생소한 개념이 많아 이를 도입하여 적용하는데 많은 어려움이 있다. 또한 프로세스에 대한 표준이나 성숙도 측정 모델 등 다양한 프레임워크가 제시되고 있으나, 이들 간의 관계를 이해하지 못하고는 제대로 사용하기가 어렵다. 본 연구에서는 개발 프로세스의 도입 및 개선 시 높은 효과를 얻기 위해, 온톨로지를 사용하여 소프트웨어 프로세스에 관련 프레임워크들의 복잡한 개념을 표현하고 이들 간을 연관시킨 모델을 제시한다.

• 한국통신학회논문지
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• 제16권1호
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• pp.46-56
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• 1991

본 논문에서는 16위도 X 8비트 Content Addressable and Reentrant Memory(CARM)를 설계하였다. CARM은 읽기, 저장, 매칭, 리엔트린트(Reentrant)의 4가지 동작 모드를 수행한다. CARM의 읽기와 저장 동작은 기존의 스태틱 RAM과 같다.CARM은 집 장에서 레영역 회수(Garbate collection)를 조건적으로 수행할 수 있는 리엔트런트 동작을 가지고 있다. 이러한 기능은 다이내믹 데이타 플로우 컴퓨터의 고속 매칭 유닛에 사용될 수 있다. CARM은 또한 매칭어드레스를 그들의 우선권에 따라 순차적으로 인코딩을 할 수 있는 기능을 가지고 있다. 이러한 CARM은 전체적으로 메모리 셀, 순차적 어드레스 인코더(Sequential Address Encoer, S.A.E), 리엔트런트 동작, 읽기/저장 제어, 데이타/마스크 레지스터, 감지 증폭기, 인코더, 디코더 등의 8개의 블럭으로 구성된다.CARM은 데이타 플로우 컴퓨터, 패턴 인식,테이블 룩업(Table look-up), 영상처리 등에 응용될 수 있을 것이다. 설계된 회로에 대해 각 동작별로 Apollo 워크스테이션의 QUICKSIM을 이용하여 논리 시물레이션을 하였고, 각 블럭별 회로의 SPICE 시뮬레이션을 하였다. 시뮬레이션결과 액세스 타임은 26ns였고, 매치 동작을 수행하는 데에는 4lns의 자연시간이 소요됐다. 결체 레이아웃은 3{\;}\mu\textrm{m} n well CMOS 공정에 따른 설계 규칙을 이용하여 수행하였다.

• JSTS:Journal of Semiconductor Technology and Science
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• 제15권6호
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• pp.685-694
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• 2015

In this paper, a new dynamic reference scheme is proposed to improve the read voltage margin better than the previous static reference scheme. The proposed dynamic reference scheme can be helpful in compensating not only the background pattern dependence but also the cell position dependence. The proposed dynamic reference is verified by simulating the CMOS-memristor hybrid circuit using the practical CMOS SPICE and memristor Verilog-A models. In the simulation, the percentage read voltage margin is compared between the previous static reference scheme and the new dynamic reference scheme. Assuming that the critical percentage of read voltage margin is 5%, the memristor array size with the dynamic scheme can be larger by 60%, compared to the array size with the static one. In addition, for the array size of $64{\times}64$, the interconnect resistance in the array with the dynamic scheme can be increased by 30% than the static reference one. For the array size of $128{\times}128$, the interconnect resistance with the proposed scheme can be improved by 38% than the previous static one, allowing more margin on the variation of interconnect resistance.

• 한국식품영양학회지
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• 제13권4호
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• pp.372-378
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• 2000

성인 남자 963명, 여자 539명, 총 1,502명에게 개고기 음식의 인식에 관한 설문조사를 한 다음 연령별, 성별로 나누고 SAS 시스템으로 통계처리하였다. 그 결과, 가장 많이 먹어본 개고기 음식은 보신탕으로 나타났고, 그 다음 전골, 수육, 무침의 순이었다. 개고기 먹는 회수는 연간 2∼6회였다. 개고기를 처음 먹어 본 나이는 남자는 21∼30세, 여자는 11∼20세가 가장 많았다. 조선시대의 개고기 요리 중 알고 있는 것은 남녀 모두 개장국이 가장 많았고, 그 다음 개소주, 옻보신탕, 편육의 순서를 보였다. 개고기를 먹어서 좋아진 점은 남녀 모두 \`건강해졌다\`가 가장 많았고 그 다음 \`활력이 생겼다\`는 순서를 나타냈다. 새로 개발하기를 바라는 요리는 남녀 모두 개구이가 가장 많았고, 그 다음 탕수육과 즉석 보신탕으로 나타났다.

• 한국정보과학회논문지:소프트웨어및응용
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• 제33권3호
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• pp.267-276
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• 2006

소프트웨어 개발 성숙도를 향상시키기 위한 프로세스 프레임워크로써 IS 15504(SPICE) 및 CMMI 등은 이미 검증된 모델이다. 하지만 이들 프로세스 성숙도 모델들이 기업의 개발능력 및 효율을 높여주는 구체적인 실천방법을 제시하지는 않는다. 기업 내에서의 실제적인 적용을 위해서는 위의 모델들을 기반으로 제품이나 기술 도메인, 사업 및 조직의 규모 등 기업환경이 고려된 기업 고유의 모델의 개발 및 적용이 필요하다. 본 논문에서는 소프트웨어 개발 프로세스에 대한 수년 간의 지속적인 적용 및 개선 경험을 바탕으로 기존의 SPI(Software Process Improvement) 모델을 확장하여 기업의 비즈니스 목적과 환경에 부합하도록 조직차원의 전반적인 소프트웨어 개발 경쟁력을 강화한 사례를 소개한다. 기존의 SPI 모델이 프로세스 각 분야에 대한 정의와 성숙도를 판단하기 위한 능력 수준을 정의한 것에 비해 본 논문에서는 그 영역을 핵심기술 및 조직구조까지 확대하고, 능력 수준을 일반적인 프로세스 능력 수준이 아닌 조직에서의 모델의 확산도로 확장하여 소프트웨어 개발 경쟁력을 강화하기 위한 통합된 모델을 정의하여 적용하였다. 본 논문은 기업에서 확장된 프로세스 성숙도 모델을 이용하여 조직의 능력을 향상시키는 구체적인 사례로 유사 영역에서 참조 모델로 활용될 수 있을 것이며, 프로세스 성숙도 모델 연구에 대한 기업의 피드백으로의 기여가 있을 것이다.

• 한국조리학회지
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• 제15권4호
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• pp.73-85
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• 2009

본 연구는 서구권 국가에서도 영양학적 우수성을 인정하고 소비가 점차 증가하는 추세이며, 기능성이 있는 천연 향신료 중 독특한 향과 항산화, 항암효과를 갖고 중국인들이 가장 선호하는 고수(Coriandrum sativum L.)를 고추장에 첨가하여 기능성이 향상된 고수 고추장 개발을 통해 중국 시장에 고추장의 활용성과 소비를 확대를 높이고자 하였다. 고수 고추장의 고수는 파우더와 원액 넣어 본 연구의 결론은 다음과 같다. CP7의 색(4.04), 고수의 향(3.72), 고수의 맛(3.92), 부드러운 정도(4.36)가 강하게 평가되었고, CJ4는 윤기(3.42), 고수의 향(3.04), 고수의 맛(4.29)이 강하게 평가되었다. 이는 고수의 첨가량이 증가할 수록 고추장의 향과 고추장의 맛은 약하게 평가되는 것을 알 수 있었다.

• 한국전자통신학회논문지
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• 제8권2호
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• pp.207-212
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• 2013

본 논문에서는 n-채널 저온 다결정 실리콘 박막 트랜지스터의 문턱전압 변동을 보상할 수 있는 전압 기입 AMOLED 화소회로를 제안하였다. 제안한 6T1C 화소회로는 5개의 스위칭 박막 트랜지스터, 1개의 OLED 구동 박막 트랜지스터 및 1개의 정전용량으로 구성되어 있다. SmartSpice 시뮬레이션 결과, 구동 트랜지스터의 문턱전압이 ${\pm}0.33$ V 변동시 최대 OLED 전류의 오차율은 7.05 %이고 Vdata = 5.75 V에서 OLED 양극 전압 오차율은 0.07 %로 제안한 6T1C 화소회로가 구동 트랜지스터의 문턱전압 변동에도 균일한 OLED 전류를 공급함을 확인하였다.

• 한국전자거래학회:학술대회논문집
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• 한국전자거래학회 2002년도 e-Biz World Conference
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• pp.135-154
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• 2002

1990년대 정보기술의 발달과 더불어 기업들의 e-비즈니스화 추세가 가속화 되고 있고, 이로부터 e-비즈니스와 깊은 연관성을 지닌 IT산업의 중요성이 커지고 있다. 이에 IT 산업이 제공하는 IT 서비스를 평가하고자 하는 움직임이 활발해지고 있다. 하지만 기존의 IT 서비스 평가 모형은 개발자 혹은 사용자 중 한쪽으로만 치우친 관점으로 이와 같은 평가 모형은 IT 서비스를 총체적으로 평가하지 못하여 평가 후 공급업체와 고객에게 주는 피드백 가치가 낮아지는 결과를 낳는다. 이에 본 논문에서는 IT 서비스에 특화된 프로세스를 기반으로 한 고객만족도 성숙체계를 제시하였다. 또한 IT 서비스 고객만족도 성숙체계를 기반으로 한 IT 서비스 평가 체계를 도출하였다. 또한. 본 논문에서는 IT 서비스 고객만족도 평가체계를 제안하면서 이를 실제 사례를 통해 모형 적용의 예를 제시하였다.

• 한국정보통신학회:학술대회논문집
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• 한국해양정보통신학회 2008년도 추계종합학술대회 B
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• pp.600-603
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• 2008

본 논문은 액정 표시 소자 (liquid crystal display, LCD)의 저소비 전력을 위한 새로운 메모리-인-픽셀 회로 설계를 제안한다. 각 픽셀 (화소)이 한 개의 메모리를 가지고 있기 때문에 이러한 회로는LCD동작을 위해 게이트와 소스 구동 회로의 동작 없이도 메모리에 저장된 데이터를 이용하여 8컬러를 표현할 수 있다. 즉 구동 회로의 동작 없이도 각 화소에 내장된 메모리를 이용하여 데이터를 표현할 수 있기 때문에 LCD패널의 소비전력을 줄일 수 있다. 각 메모리 회로는 각 화소에 내장된 수정된 S-R플립플롭(NAND형)으로 구성되어 있고, 플립플롭은 겹치지 않는 클럭 CLK_A와 CLK_B를 이용하여 교류 바이어스를 공급한다. NAND형은 인버터형 메모리에 비해 회로는 더 복잡하지만, 약 50%의 더 낮은 소비전력 특성을 가진다. $96{\times}128$의 해상도를 가진 LCD패널에 대해 인버터형 메모리가 0.037 mW의 소비전력을 보인 반면 제안된 메모리 회로는 단지 0.007mW의 우수한 소비전력을 보였다.

• 대한의용생체공학회:의공학회지
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• 제16권4호
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• pp.415-424
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• 1995

Combined models, specified by two or more modeling formalisms, can represent a wide variety of complex systems. This paper describes a methodology for the development of combined models in two model types of discrete event and continuous process. The methodology is based on transformation of continuous state space into discrete one to homomorphically represent dynamics of continuous processes in discrete events. This paper proposes a formal structure which can combine model of the DES and the CS within a framework. The structure employs the DEVS formalism for the DES models and differential or polynomial equations for the CS models. To employ the proposed structure to specify a DEVS/CS combined model, a modeler needs to take the following steps. First, a modeler should identify events in the CS and transform the states of the CS into the DES. Second, a modular employs the formalism to specify the system as the DES. Finally, a moduler developes sub-models for the CS and continguos states of the DES and establishs one-to-one correspondence between the sub-models and such states. The proposed formal structre has been applied to develop a DEVS/CS combined model for the human cardiovascular system. For this, the cardiac cycle is partitioned into a set of phases based on events identified through observation. For each phase, a CS model has been developed and associated with the phase. To validate the DEVS/CS combined model developed, then simulate the model in the DEVSIM + + environment, which is a model simulation results with the results obtained from the CS model simulation using SPICE. The comparison shows that the DEVS/CS combined model adequately represents dynamics of the human heart system at each phase of cardiac cycle.