본 연구에서는 비선형 부하에서 발생되는 기본파 무효전력 및 고조파를 보상하기 위한 종전의 전압형 및 전류형 PWM 능동전력필터를 대체 할 수 있는 Z-소스 인버터 토폴로지의 하이브리드 능동전력필터에 대하여 고찰하였다. Z-소스 토폴로지의 능동전력필터의 보상 DC전원으로는 PEMFC가 사용되며, Z-소스 인버터의 shoot-through 듀티비의 조절에 의하여 낮은 연료전지의 전압을 높은 보상 전압으로 부스트 한다. 제안된 시스템은 병렬형 Z-소스 능동전력필터와 7차 고조파 (420Hz) 동조 필터로 구성되며, 이 구성에 의하여 Z-소스 능동전력필터의 스위치 디바이스의 전압 스트레스는 감소된다. 제안된 Z-소스 하이브리드 능동전력필터의 보상 알고리즘으로는 전류 동기 검출법이 사용되었다. 3상 220V/60Hz, 25A급 비선형 다이오드 부하 조건하에서 PSIM 시뮬레이션을 수행하였으며, 정상상태 및 과도상태에서의 제안된 시스템의 보상 성능을 파악하였다.
We present a cost-effective dual polarization quadrature phase-shift coherent receiver module using a silica planar lightwave circuit (PLC) hybrid assembly. Two polarization beam splitters and two $90^{\circ}$ optical hybrids are monolithically integrated in one silica PLC chip with an index contrast of $2%-{\Delta}$. Two four-channel spot-size converter integrated waveguide-photodetector (PD) arrays are bonded on PD carriers for transverse-electric/transverse-magnetic polarization, and butt-coupled to a polished facet of the PLC using a simple chip-to-chip bonding method. Instead of a ceramic sub-mount, a low-cost printed circuit board is applied in the module. A stepped CuW block is used to dissipate the heat generated from trans-impedance amplifiers and to vertically align RF transmission lines. The fabricated coherent receiver shows a 3-dB bandwidth of 26 GHz and a common mode rejection ratio of 16 dB at 22 GHz for a local oscillator optical input. A bit error rate of $8.3{\times}10^{-11}$ is achieved at a 112-Gbps back-to-back transmission with off-line digital signal processing.
The on-line measurement of high-power IGBT collector current is important for the hierarchical control and short-circuit and overcurrent protection of its driver and the sensorless control of the converter. The conventional on-line measurement methods for IGBT collector current are not suitable for engineering measurement due to their large-size, high-cost, low-efficiency sensors, current transformers or dividers, etc. Based on the gate driver, this paper has proposed a current measuring circuit for IGBT collector current. The circuit is used to conduct non-intervention on-line measurement of IGBT collector current by detecting the voltage drop of the IGBT power emitter and the auxiliary emitter terminals. A theoretical analysis verifies the feasibility of this circuit. The circuit adopts an operational amplifier for impedance isolation to prevent the measuring circuit from affecting the dynamic performance of the IGBT. Due to using the scheme for integration first and amplification afterwards, the difficult problem of achieving high accuracy in the transient-state and on-state measurement of the voltage between the terminals of IGBT power emitter and the auxiliary emitter (uEe) has been solved. This is impossible for a conventional detector. On this basis, the adoption of a two-stage operational amplifier can better meet the requirements of high bandwidth measurement under the conditions of a small signal with a large gain. Finally, various experiments have been carried out under the conditions of several typical loads (resistance-inductance load, resistance load and inductance load), different IGBT junction temperatures, soft short-circuits and hard short-circuits for the on-line measurement of IGBT collector current. This is aided by the capacitor voltage which is the integration result of the voltage uEe. The results show that the proposed method of measuring IGBT collector current is feasible and effective.
본 논문은 근육의 기능을 조절하는 신경말단에 전기적인 자극을 가하여 신경의 반응 정도를 측정하는 플랫폼 구현에 관한 연구로써, 전기 자극에 대한 신경반응이 가해지는 전류량, 가해지는 전류지속시간, 전극위치에 따른 반응을 측정하였다. 신격자극의 전극 위치는 표면말달 운동신경이면 어느 신경이든지 가능하고, 신격자극 양식에는 단순연축자극(Single Twitch Stimulation), 사연속자극(Train-of-four, TOF), 두 집단 발사자극(Double Burst Stimulation, DBS)이 있다. 임베디드 시스템기반으로 가기위한 저전력 MCU를 선정하고, 기본적인 신경자극반응 측정 센서의 민감도를 알아보기 위해 센서 인터페이스를 구성하여 반응정도를 측정해야 한다. 그리고 측정된 Data의 정확도를 높이기 위해 고성능의 AD Convertor 선정하여 플랫폼을 구현하였다. 또한 본 논문의 플랫폼은 의료기기용으로 개발되었기 때문에 시스템 이용자의 안전을 고려하여 전원회로 구성 시 전원 Isolation를 고려하여 설계하였다.
As the demand for high-rise buildings increases, the demand for high-speed elevators is also increasing. In order to make a high-speed elevator, a method is needed to reduce the weight of the elevator's components, which is a constraint on the increase in speed. As a measure to reduce the weight, it is possible to remove the traveling cable for power and signal supply. Since the weight of the traveling cable varies depending on the position of the carriage, it is difficult to compensate the weight using the counter weight. The power supply is a structure in which a brush-rail type power input terminal is installed in the elevator hoistway to receive power in a contact-type manner while the carriage is moving. If a small-capacity ESS is installed in a passenger car, power can be supplied uninterruptedly inside the passenger car. A small-capacity ESS charging system to be applied to such an elevator system is required to perform several functions. First, the passenger Car must be able to charge as much as possible even during high-speed operation. A control algorithm with high responsiveness is required because charging starts and ends repeatedly by the partially installed input power stage. In addition, if the input-side line impedance is large due to the structure of the system and the response characteristic is increased, the stability of the system may be lowered. Accordingly, in this paper, we propose a control algorithm that has a stable steady-state output while having a fast response in a transient state. To verify the proposed control algorithm, simulation was conducted using PSIM, and the performance of the controller was verified by manufacturing a prototype buck conveter charger.
본 논문에서는 주로 소면적 구현을 위하여 세그먼트 부분 정합 기법을 적용한 10비트 100MS/s DAC를 제안한다. 제안하는 DAC는 비교적 적은 수의 소자로도 요구되는 선형성을 유지하면서 고속으로 부하저항의 구동이 가능한 세그먼트 전류 구동방식 구조를 사용하였으며, 제안하는 세그먼트 부분 정합 기법을 적용하여 정합이 필요한 전류 셀들의 숫자와 크기를 줄였다. 또한, 전류 셀에는 작은 크기의 소자를 사용하면서도 높은 출력 임피던스를 얻을 수 있도록 이중-캐스코드 구조를 채용하였다. 시제품 DAC는 0.13um CMOS 공정으로 제작되었으며, 유효 면적의 크기는 $0.13mm^2$이다. 시제품 측정 결과, 3.3V의 전원전압과 $1V_{p-p}$의 단일 출력 범위 조건에서 $50{\Omega}$의 부하저항을 구동할 때 DNL 및 INL은 각각 -0.73LSB, -0.76LSB 수준이며, SFDR은 100MS/s의 동작 속도에서 최대 58.6dB이다.
본 논문에서는 유럽형 점 대 점 마이크로파 고정 통신에 이용되는 주파수 하향 변환기 설계에 있어, 평탄도 개선 측면에서 접근한 단일 평형 주파수 혼합기의 설계 및 제작 결과에 대해 소개하도록 한다. 일반적인 주파수 하향 변환기의 구성에서 주파수 혼합기에 연결되는 RF필터 등의 여파기 임피던스 특성이 RF 대역에서만 유지되고 LO 대역에서는 그 특성이 달라져 LO 구동 전력이 혼합기 다이오드에 불규칙하게 인가됨에 따라 대역 평탄도 특성이 악화된다. 이에 대해 본 논문에서는 영상 대역 제거 필터 및 LO 고조파 필터를 혼합기 내에 집적하고 여파기와 혼합기 포트 간 전기적 길이를 이용하여, 평탄도 특성에 대한 여파기의 영향을 최소로 한 여파기 집적형 주파수 혼합기를 설계하였다. 제작된 주파수 혼합기는 RF 대역 $21.2{\sim}22.6\;GHz$, LO 대역 $19.32{\sim}20.72\;GHz$ IF 대역 1.88 GHz+/-50 MHz의 주파수 재원을 가지며, LO 구동 전력 10 dBm에서 영상 대역 제거 필터를 포함한 변환 손실이 8.5 dB, 대역평탄도 2 dB, 입력 PldB 8 dBm, 입력 IIP3 15 dBm의 특성을 보였다. RF, LO 및 IF 포트의 반사 손실은 각각 -12 dB, -10 dB, -5 dB의 특성을 보였다. LO/RF, LO/IF 격리도는 각각 20 dB, 50 dB로 측정되었다.
전자기유도(electromagnetic induction) 현상을 이용한 비파괴진단기법으로 최근까지 와전류탐상기법, 교류장측정기법, 자속누설검사기법, 그리고 원격장검사기법 등이 개발되어 활용되고 있었다. 이 기법중 와전류탐상기법은 오늘날 발전설비, 화학, 조선 및 군수설비 등의 열교환기 전열관 비파괴검사에 널리 적용되고 있다. 와전류탐상검사 시스템의 구성은 기능별로 와전류신호 합성 모듈, 아날로그 모듈, 디지털 신호처리를 위한 아날로그-디지털 변환 모듈, 전원공급장치 및 신호취득 평가 프로그램 등으로 구성되며, 본 연구에서는 다중채널방식의 와전류탐상검사 장치(하드웨어) 개발에 필요한 구성 요소중 1차적으로 와전류신호 합성 모듈, 아날로그 모듈을 설계 개발하였다. 본 연구에서 개발한 와전류탐상검사 장치의 특정은 주파수영역 및 시간영역 다중화 방식에 의한 최대 4개 주파수의 동시 적용이 가능한 다중채널장치이다. 와전류신호 합성 모듈, 아날로그 모듈을 구성하는 각 회로에서 와전류신호 발생, 변조, 전처리, 변조 및 신호 디스플레이를 위한 신호가 적절하게 처리되어 최종적으로 와전류신호 평가에 필수적인 리사쥬신호가 임피던스 평면 내에 디스플레이 되는 것을 확인하였다.
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[게시일 2004년 10월 1일]
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