The increasing computational capability of processors is driving the need for high bandwidth links to communicate and store the information that is processed. Such links are often an important part of multi processor interconnection, processor-to-memory interfaces and Serial-network interfaces. This paper describes a 0.11-${\mu}{\textrm}{m}$ CMOS 4 Gbp s/pin 3-Level transceiver using RSL/(Rambus Signaling Logic) for high bandwidth. This system which uses a high-gain windowed integrating receiver with wide common-mode range which was designed in order to improve SNR when operating with the smaller input overdrive of 3-Level. For multi-gigabit/second application, the data rate is limited by Inter-Symbol Interference (ISI) caused by low pass effects of channel, process-limited on-chip clock frequency, and serial link distance. In order to detect the transmited 4Gbps/pin with 3-Level data sucessfully ,the receiver is designed using 3-stage sense amplifier. The proposed transceiver employes multi-level signaling (3-Level Pulse Amplitude Modulation) using clock multi phase, double data rate and Prbs patten generator. The transceiver shows data rate of 3.2 ~ 4.0 Gbps/pin with a 1GHz internal clock.
To minimize construction of nuclear facility, it is required to reduce reinforcing bar amount and solve reinforcing bar concentration and for this, it is necessary to develop appication design technology and modular of high strength reinforcing bar. Hence, KHNP reduces excessive reinforcing bar amount which can cause possibility of poor construction of concrete through design standard development and modular of nuclear facility structure using high strength reinforcing bar to raise economics and has its purpose to maintain high-level safety and durability as they are. This study is to introduce application method for the Rebar Modulation of High-Strength Reinforcing Bars to the Nuclear Power Plant Structures.
Nguyen, Tuyen D.;Phan, Dzung Quoc;Dao, Dat Ngoc;Lee, Hong-Hee
Journal of Power Electronics
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제14권6호
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pp.1197-1207
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2014
Common-mode voltage (CMV) causes overvoltage stress to winding insulation and damages AC motors. CMV with high dv/dt causes leakage currents, which create noise problems for equipment installed near the converter. This study proposes a new pulse-width modulation (PWM) strategy for three-level T-type NPC inverters. This strategy substantially eliminates CMV. The principle for selecting suitable triangle carrier signals for the three-level T-type NPC is described. The proposed method can mitigate the peak value of CMV by 50% compared with the phase disposition pulse-width modulation method. Furthermore, the proposed method exhibits better harmonic spectrum and lower root mean square value for the CMV than those of the reduced-CMV method on the basis of the phase opposition disposition PWM scheme with modulation index higher than 0.5. The proposed modulation can easily be implemented using software without any additional hardware modifications. Both simulation and experimental results demonstrate that the proposed carrier phase-shift PWM method has good output waveform performance and reduces CMV.
Central 60° synchronous modulation is an easy pulse-width modulation (PWM) method to implement for the traction inverters of urban rail trains at a very low switching frequency. Unfortunately, its switching patterns are determined by a Fourier analysis of assumed steady-state voltages. As a result, its transient responses are not very good with over-currents and high instantaneous torque pulses. In the proposed solution, the switching patterns of the conventional central 60° modulation are modified according to the dynamic error between the target and actual stator flux. Then, the specific trajectory of the stator flux and current vector can be guaranteed, which leads to better system transients. In addition, stator flux control is introduced to get smooth mode switching between the central 60° modulation and the other PWMs in this paper. A detailed flow chart of the control signal transmission is given. The target flux is obtained by an integral of the target voltage. The actual PMSM flux is estimated by a minimum order flux state observer based on the extended flux model. Based on a two-level inverter model, improved rules in the α-β stationary coordinate system and equations of the switching patterns amendment are proposed. The proposed method is verified by simulation and experimental results.
In this paper, a hybrid modular multilevel converter (MMC) topology with an improved nearest level modulation method is proposed for medium-voltage high-power applications. The arm of the proposed topology contains N series connected half-bridge submodules (HBSMs), one full-bridge submodule (FBSM) and an inductor. By exploiting the FBSM, half-level voltages are obtained in the arm voltages. Therefore, an output voltage with a 2N+1 level number can be generated. Moreover, the total level number of the inserted submodules (SMs) is a constant. Thus, there is no pulse voltage across the arm inductors, and the SM capacitor voltage is rated. With the proposed voltage balancing method, the capacitor voltage of the HBSM is twice the voltage of the FBSM, and each IGBT of the FBSM has a relatively low switching frequency and an equalized conduction loss. The capacitor voltage balancing methods of the two kinds of SMs are implemented independently. As a result, the switching frequency of the HBSM is not increased compared to the conventional MMC. In addition, according to a theoretical calculation of the total harmonic distortion of the electromotive force (EMF), the voltage quality with the presented method can be significantly enhanced when the SM number is relatively small. Simulation and experimental results obtained with a MMC-based inverter verify the validity of the developed method.
홀로그래픽 데이터 저장장치에서 데이터는 줄 단위가 아닌 페이지 단위처리하기 때문에, 짧은 접근 시간, 고용량, 빠른 전송 능력을 갖는다. 또한 멀티레벨 홀로그래픽 데이터 저장장치에서는 하나의 픽셀은 1bit이상 저장이 가능하다. 하지만 인접한 심볼간의 레벨의 차이가 클수록 인접 심볼간 간섭 문제가 발생한다. 그러므로 가장 큰 심볼과 가장 작은 심볼이 인접하는 것을 방지해야 한다. 본 논문에서는 인접 심볼간 간섭을 줄이기 위해 4-레벨 홀로그래픽 데이터 저장장치를 위한 12/16 변조부호를 제안한다.
With the development of multilevel converters, cascaded single-phase H-bridge rectifiers (CHBRs) has become widely adopted in high-voltage high-power applications. In this study, sequence pulse modulation (SPM) is proposed for CHBRs. SPM is designed to balance the dc-link voltage and maintain the smooth changes of switch states. In contrast to phase disposition modulation, SPM balances the dc-link voltage even after removing the load of one submodule. The operation principle of SPM is deduced, and the unbalance degree of SPM is analyzed. All the proposed approaches are experimentally verified through a prototype of a four-module (nine-level) CHBR. Conclusions are drawn in accordance with the results of SPM and its imbalance degree analysis.
This paper proposes a new THD reduction algorithm for modular multilevel converters (MMCs) with offset voltage injection operated in nearest level modulation (NLM). High voltage direct current (HVDC) is actively introduced to the grid connection of offshore wind powers, and this paper deals with a voltage generation technique with an MMC for wind power generation. In the proposed method, third harmonic voltage is added for reducing the THD. The third harmonic voltage is adjusted so that each of the pole voltage magnitudes maintains a constant value with a maximum number of (N+1) levels, where N is the number of sub-modules per arm. By using the proposed method, the THD of the output voltage is mitigated without increasing the switching frequency. In addition, the proposed method has advantageous characteristics such as simple implementation. As a part of this study, this paper compares the THD results of the conventional method and the proposed method with offset voltage injection to reduce the THD. In this paper, simulations have been carried out to verify the effectiveness of the proposed scheme, and the proposed method is implemented by a HILS (Hardware in the Loop Simulation) system. The obtained results show agreement with the simulation results. It is confirmed that the new scheme achieved the maximum level output voltage and improved the THD quality.
본 논문은 OLED 패널 소스 구동회로에서 구동 전류의 크기와 폭을 조절하는 새로운 amplitude width modulation(AWM) 방식을 제안하였다. 기존의 소스 구동회로에서 pulse amplitude modulation(PAM) 방식은 DAC 회로 추가로 인해 크기가 커진다는 단점이 있고, pulse width modulation(PWM) 방식은 낮은 그레이 신호 레벨에서 발광 효율이 나쁜 단점이 있다. 이와 같은 단점을 개선하기 위해 본 논문에는 색상 데이터 비트의 MSB를 이용하여 구동 전류의 레벨을 제어하고, 데이터 비트의 LSB를 이용하여 구동 전류의 폭을 조정하는 구동방식을 제안하였다. 제안된 구동 방식은 $0.35-{\mu}m$ 3-poly 4-metal CMOS high voltage 공정을 사용하여 구현하였다. 시뮬레이션 결과는 제안된 AWM 구동 회로가 PAM 방식에 비해 회로 크기를 줄였고 신호 레벨이 낮은 영역에서 PAM과 거의 동일한 발광 효율을 얻었다.
A new modulation scheme called multicoded-pulse position modulation (MC-PPM) is proposed for an ultrawideband (UWB) impulse radio communication system. The multicoded signal is generated by using several orthogonal codes for transmitting data simultaneously. Then, each multi-level value of the multicoded signal is converted to pulse position which results in not only an improved data rate, but also a processing gain in reception, delivering the power-efficient benefit of PPM and guaranteeing the low pulse energy for UWB systems. We notice that the modulation of multi-level values of the multicoded signal to pulse position is more efficient in terms of achievable data rate than the modulation of transmitting data based on other PPM schemes within given bandwidth and pulse energy. Therefore, as a performance measure, we focus on the achievable data rate (link capacity) of the proposed scheme and analyze it theoretically. Through simulation, we compare the link capacity of the MC-PPM scheme and other PPM schemes, such as M -ary PPM and multiple PPM. With the fixed bandwidth and same pulse energy condition, the UWB system based on the proposed MC-PPM scheme shows good link capacity and an increased data rate as L increases, which is contrary to other PPM schemes.
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[게시일 2004년 10월 1일]
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