• 인지과학
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• 제24권2호
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• pp.95-109
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• 2013

본 논문에서는 제한된 자원을 사용하는 기기에 적합한 경량화된 한국어 형태소 분석 및 품사 부착 방법을 제안한다. 관련된 초기 연구로는 규칙에 기반을 둔 방법들이 적용되었으나 최근에는 통계에 기반을 둔 방법들을 중심으로 연구되고 있다. 계산 처리 능력과 사용 가능한 메모리가 제한되는 환경에서는 규칙에 기반을 둔 방법보다 상대적으로 많은 자원을 사용하는 통계에 기반을 둔 방법을 사용하여 형태소 분석 및 품사 부착을 수행하기에는 한계가 있다. 본 논문에서는 기존의 규칙에 기반을 둔 형태소 분석 방법인 좌최장일치법을 개선하여 형태소 분석을 수행하고, 통계적인 방법인 hidden Markov model을 축소하여 형태소 품사 부착을 수행한다. 제안하는 방법은 기존의 hidden Markov model을 사용한 시스템과 유사한 성능을 보여주며 소량의 메모리 사용과 월등히 빠른 속도로 형태소 분석 및 품사 부착을 수행할 수 있다.

• 한국지역사회생활과학회지
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• 제16권1호
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• pp.37-47
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• 2005

Education has been emphasized as one of tools of realizing social equality, which has its base on the ideology of equal education opportunity. The Opportunity level of adult education is important in the meaning of social equality. but these days It is being inequality. so The objectives of this study were 1) measuring the opportunity level of adult education in Korea, 2) analysing the difference adult education level by gender, regions, 3) making out the gap of the its level by social educational agencies, 4) to suggest the way to improve the opportunity level of adults educations between adults by gender, regions. The followings are the results from the study: Adult education participation level were lower. Adult education participation level per adult education type showed higher participation at private institutes, lower at cultural center of community and school's human and material resources are not properly utilized in adult educational activities. By adult education participation level per gender and location, women have a higher participation level then men, and urban areas have a higher participation level then rural areas. In case of location, environment variables is most explanatory in adult education participation level. To strive for methods to activate school-oriented adult education activities and to develop political solution to ease the resources gaps for adult education investment among regions in order not to deepen environment gaps of adult education between urban and rural areas. For adult education activation, institution and bodies in charge of adult education should expand and discover hardware and develop and distribute software. Also, adult education specialists who operate and manage these hardware and sofeware efficiently should be recruited.

• 한국통신학회논문지
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• 제26권12C호
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• pp.233-239
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• 2001

ADSL G.LITE 모뎀이 수행하는 주파수 영역의 연산과정에서 하향링크에 대한 FET 과정과 FEQ 과정은 가장 많은 연산량을 차지하는 부분이며, 이를 효율적으로 구현하기 위한 연구들이 수행되었다. 기존의 연구는 ADSL G.DMT 방식에 적합한 시스템으로서 G.LITE에 그대로 적용하기에는 부적합하다. 본 논문에서는 주파수 영역의 연산과정을 분석하고, 하드웨어 자원 할당에 따른 시스템의 효율성을 분석하여 G.LITE 방식에 적합한 프로세서의 구조를 제안하였다. 제안된 프로세서는 1개의 실수 곱셈기와 2개의 실수 덧셈기를 병렬로 연결한 구조를 가지며, 파이프라인 형태 및 병렬연산 형태의 작업 스케쥴링을 통해 효율적으로 연산을 수행할 수 있도록 설계되었다. 제안된 프로세서는 Kiss가 제안한 ALU 구조나 Wang이 제안한 FFT/IFFT 프로세서 구조에 비해 적은 하드웨어 자원을 이용하여 연산과정을 효율적으로 수행함으로서 G.LITE 시스템에 적합한 구조를 갖는다.

• KNOM Review
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• 제21권2호
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• pp.26-34
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• 2018

클라우드 컴퓨팅 및 서비스의 확산으로 인터넷 트래픽과 서비스 품질 향상에 대한 요구가 증가하면서 데이터 센터 내부 서버의 리소스를 보다 효율적으로 사용하는 서버 가상화와 네트워크 가상화 기술에 대한 관심이 증가하고 있다. 트래픽 모니터링을 위해 패킷을 복제하는 기존의 하드웨어 TAP (Test Access Port) 장비는 서버 가상화 환경에서 구성된 가상 데이터 경로 (datapath)에 적합하지 않기 때문에 하드웨어 TAP 장비를 소프트웨어로 구현한 Virtual TAP (vTAP)을 통해 가상 스위치에서 패킷을 복제한다. 그러나 가상 스위치에서 vTAP을 구현하면 호스트 머신의 컴퓨팅 리소스를 가상 스위치 및 가상 머신과 공유하기 때문에 성능 저하 문제가 발생한다. 이 문제를 극복하기 위해 고속 패킷 처리 기술인 eBPF (Extended Berkeley Packet Filter) 기반의 vTAP 구현 기술을 제안하고 기존 방법과 성능을 비교한다.

• 한국정보통신학회논문지
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• 제21권12호
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• pp.2213-2220
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• 2017

EGML (Effective Gaussian Mixture Learning) 기반의 배경차분 기법을 이용한 이동객체 검출 (Moving Object Detection; MOD) 프로세서의 효율적인 하드웨어 구현 방식을 제안한다. 하드웨어 복잡도를 감소시키기 위해 배경 생성에 사용되는 일부 연산을 근사화하여 구현하였으며, 배경차분과 가우시안 계산의 나눗셈 연산에 사용되는 하드웨어 자원이 공유되도록 설계하였다. 설계한 MOD 프로세서는 MATLAB/Simulink를 이용한 HDL-netlist 시뮬레이션과 FPGA-in-the-loop 방식을 통해 기능을 검증하였다. IEEE CDW-2014 데이터 세트의 6가지 영상을 입력으로 사용하여 MOD 성능을 평가한 결과, 평균 재현율(recall)은 0.7700, 평균 정밀도(precision)는 0.7170, F-measure가 0.7293으로 평가되었다. Xilinx ISE를 이용하여 FPGA 합성한 결과, Virtex5 XC5VSX95T 디바이스에서 총 882 슬라이스와 $146{\times}36kbit$의 블록 램으로 구현되었으며, 동일한 알고리듬을 적용한 기존의 구현 사례에 비해 약 60%의 하드웨어를 감소시켰다. MOD 프로세서는 최대 75 MHz의 클록 주파수로 동작하여 $800{\times}600$ 해상도의 영상에 대해 39 fps의 성능으로 실시간 처리가 가능한 것으로 평가되었다.

• 한국정보통신학회논문지
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• 제16권4호
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• pp.713-720
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• 2012

최근 차세대 영상 기술로 홀로그래피가 많은 주목을 받고 있다. 홀로그램은 광학적인 촬영을 통해서 획득할 수도 있지만 최근에는 컴퓨터를 이용한 홀로그램 생성 방법을 많이 사용하고 있다. 이를 컴퓨터 생성 홀로그램(computer generated hologram, CGH)이라 하는데 CGH는 많은 연산량이 요구되어 S/W를 이용하면 실시간으로 생성하는 것이 불가능하다. 따라서 실시간의 CGH를 위해서 FPGA나 GPU를 이용한 연산 방법이 주로 사용되고 있다. 하드웨어를 기반으로 하여 구현할 경우에 내부 시스템의 비트 제한으로 인하여 S/W와 같은 품질을 얻을 수 없다. 따라서 본 논문에서는 품질의 저하를 최소화하면서 하드웨어의 자원을 최대한 감소시킬 수 있는 하드웨어 비트 너비를 분석하여 가이드라인을 제시하고자 한다. 이를 위해서 1비트 단위의 고정소수점 시뮬레이션을 모든 내부 변수 및 연산과정에 대해 수행하고, 수치적인 결과와 시각적인 결과를 종합적으로 분석하여 최적의 비트 너비와 응용분야에 따른 비트 너비를 제시한다.

• 한국가구학회지
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• 제18권2호
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• pp.91-99
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• 2007

Modernity which is superficial phenomenon set off the mass scale for mass consumption and provide uniformly artificial environment. But natural destruction, environment pollution, resources exhaustion and so on has been caused by this and now ecology is threatened by destruction and damage beyond the limitation and human beings survival is even threatened. Accordingly furniture development for environment preservation considered environment problem is the urgent real situation. Recent paradigm is the concept of Eco-design which is the green design possible to live together in symbiosis, and new types of alternative furniture are needed in Korea as well. 'Furniture for disassembly' is presented as new method for alternative furniture. Furniture for disassembly can be presented by mainly two directions. The first main characteristic is what is assembled by the use of woodworking joints technique as an assembly structure system without any hardware. The second is what is presented as the structure possible to be assembled by simple manual tools with hardware without any glue. The advantages of furniture for disassembly are environment preservation, space application, transportation efficiency and shapeliness. In manufacture method which is different from present furniture, the application of traditional truss technique which uses various types of custom-made and connection technique in case of assemble structure system without hardware is the typical differences. This assembly method expects not only interest induction about assembly and disassembly of diagram per sub materials but also the development of emotion, the improvement of collaboration, space perception ability and shape sense, the improvement of solid body structure insight and so on, when it use in the furniture for children with the application to many kinds of structure with BANGDOOSANJ (Wedged), JUMUGJANGBU (Dovetail) or NABIEUNJANG (Dovetail Keys) and so on.

• Spatial Information Research
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• 제23권4호
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• pp.1-11
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• 2015

2012년 1월부터 공간정보 오픈플랫폼의 서비스가 시작된 이래로, 서비스가 늘어남에 따라 서비스 이용자 수와 시스템의 규모가 크게 증가하게 되었다. 그러나 이러한 오픈플랫폼 시스템이 가지고 있는 하드웨어 자원들이 어느 수준의 서비스를 처리할 수 있는지에 대한 자세한 분석 결과는 전혀 알 수 없었다. 이러한 이유로 특정 이슈와 더불어 서비스 이용자가 급증할 때마다 서비스를 처리하기 위하여 단순히 하드웨어 증설을 통해 일시적으로 서비스 지연 문제를 해결하여 왔다. 이에 본 연구에서는 현재 오픈플랫폼이 보유하고 있는 시스템 성능을 정확히 파악하여 향후 동일한 문제가 발생하지 않도록 근본적인 해결책을 제시하고자 한다. 구체적으로 본 연구에서는 NMON을 이용한 하드웨어 성능 분석과 nGrinder를 이용한 웹서비스 부하 테스트를 통해 오픈플랫폼이 현재 가지고 있는 정확한 시스템 성능을 파악하고, 이후 보다 나은 서비스를 제공할 수 있는 시스템으로 개선하기 위한 자원 재조정 방안을 제시하고자 한다.

• 대한전자공학회논문지SD
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• 제39권6호
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• pp.59-68
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• 2002

본 논문에서는 블록 효과(blocking effect)가 없고, 압축성능 또한 높아 영상압축을 포함한 여러 응용 분야에서 널리 사용되고 있는 2차원 이산 웨이블렛 변환(DWT, Discrete Wavelet Transform) 필터를 설계하였다. 필터로는 4개의 필터 탭을 갖는 Two-channel QMF(Quadrature Mirror Filter) PR(Perfect Reconstruction) Lattice 필터를 사용하였다. 제안된 DWT 아키텍쳐는 단순하지만 효과적인 스케줄링 기법을 이용하여 설계되어 최소의 하드웨어(곱셈기, 덧셈기, 레지스터 등)로 구성되었고, 이 아키텍쳐에 두 개의 연속적인 입력이 동시에 제공되면 효율적으로 2차원 DWT를 수행함을 보였다. 제안된 아키텍쳐는 RTL 레벨 시뮬레이션을 통해 검증되었고, 100% 하드웨어 이용도(utilization)를 나타낸다. 다른 연구 결과들과 비교하였을 때 최소의 하드웨어를 사용하여 상대적으로 높은 수행능력을 보였다. 효과적인 메모리 매핑 방법과 그를 위한 주소 발생 방법이 제안되었으며, 고정 소수점 연산 시에 발생하는 에러를 분석하여 적절한 양자화 비트를 결정하기 위한 다양한 시뮬레이션과 성능이 분석되었다.

• 전기전자학회논문지
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• 제19권1호
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• pp.45-51
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• 2015

최근 IoT(Internet of Things) 기기를 위한 근거리 무선 네트워크 시스템이 널리 활용되면서 점차 보안의 필요성이 증가하고 있다. 본 논문에서는 IEEE 802.15.4 호환 WPAN 기기를 위한 낮은 복잡도를 갖는 128-bit AES-$CCM^*$ 하드웨어를 효율적으로 구현하였다. WPAN 기기에서는 하드웨어 자원과 전력 소모가 매우 제한되기 때문에, 다양한 최적화 기법을 적용하여 낮은 복잡도를 갖는 AES-$CCM^*$ 하드웨어를 구현해야 한다. 본 논문은 하드웨어의 복잡도를 줄이기 위해 composite field 연산을 채택하면서 8-bit 데이터 패스를 갖는 folded AES processing core를 제안한다. 또한 IEEE 802.15.4 표준에서 정의된 $CCM^*$ 모드를 지원하기 위해 적은 하드웨어 자원을 사용하며 응답시간이 빠른 토글 구조의 AES-$CCM^*$ 제안한다. 본 논문에서 제안된 AES-$CCM^*$ 하드웨어는 기존의 하드웨어의 57%에 해당하는 게이트 수로 구현가능하다.