• 제목/요약/키워드: Fundamental Circuit

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최근접 벡터 제어기법을 이용한 Cascade 3상 IHCML 인버터 (Cascade 3-Phase IHCML Inverter using maximal distension vector control)

  • 송성근;박성준;남해곤
    • 대한전기학회:학술대회논문집
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    • 대한전기학회 2007년도 제38회 하계학술대회
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    • pp.187-189
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    • 2007
  • In this paper, the cascade 3-phase IHMCL inverter using two low frequency transformers is proposed. The proposed inverter is constructed by connecting a 3-phase IHCML inverter. the cascade 3-phase IHCML inverter has several advantages. One advantage is that only one input power source is required because of using transformers to isolate. Another advantage is that the switching frequency of the high power switches is almost fundamental frequency of reference and the other the switching frequency of the low power switches is higher. It can be known that cascade 3 phase IHCML inverter has the excellent efficiency and the outstanding electric quality. lastly, we tested the 5kW cascade 3-phase IHCML inverter to clarify the proposed electric circuit and reasonableness of control signal for the proposed inverter.

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고 변환이득 및 격리 특성의 V-band용 4체배 Sub-harmonic Mixer (High Conversion Gain and Isolation Characteristic V-band Quadruple Sub-harmonic Mixer)

  • 엄원영;설우석;한효종;김성찬;이한신;안단;김삼동;박형무;이진구
    • 대한전자공학회논문지TC
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    • 제40권7호
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    • pp.293-299
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    • 2003
  • 본 논문에서는 0.1 ㎛ GaAs PHEMTs MIMIC 공정을 이용하여 V-band에서 사용 가능한 고 성능의 sub-harmonic mixer를 제안하였다. LO신호의 n차 하모닉 성분을 이용하기 위해서는 LO신호 전력의 필연적인 감쇠가 있다. 이러한 단점을 극복하기 위하여 본 논문에서는 주파수를 혼합하기 위한 APDP(anti-parallel diode pair) 구조에 0.1 ㎛ PHEMT (pseudomorphic high electron mobility transistors)를 각 단에 연결시켜 LO 신호의 4차 성분을 이용하는데 있어 주요한 성능 향상을 이루었다. PHEMT 다이오드 와 PHEMT를 0.1 ㎛의 게이트 길이를 갖는 동일 공정을 통하여 구현하였고 CPW (Coplanar Waveguide) 라이브러리를 개발하여 제안된 회로를 설계하였다. 또한 상대적으로 낮은 주파수의 출력 IF 단에는 출력 주파수의 선택성을 좋게 하기 위하여 Lumped 소자를 이용하여 정합회로를 구성하여 RF 입력 신호와 LO 신호의 출력단 유입을 억제하였다. 제작된 sub-harmonic mixer의 특성을 측정한 결과 입력 RF 주파수가 60.4 ㎓, LO 주파수가 14.5 ㎓일 때, 0.8 ㏈의 변환이득 특성을 얻었으며, LO-to-IF, LO-to-RF 격리 특성을 측정한 결과 동작영역에 걸쳐 50 ㏈ 이상의 높은 격리 특성을 나타내었다.

Analysis of a Harmonics Neutralized 48-Pulse STATCOM with GTO Based Voltage Source Converters

  • Singh, Bhim;Saha, Radheshyam
    • Journal of Electrical Engineering and Technology
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    • 제3권3호
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    • pp.391-400
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    • 2008
  • Multi-pulse topology of converters using elementary six-pulse GTO - VSC (gate turn off based voltage source converter) operated under fundamental frequency switching (FFS) control is widely adopted in high power rating static synchronous compensators (STATCOM). Practically, a 48-pulse ($6{\times}8$ pulse) configuration is used with the phase angle control algorithm employing proportional and integral (PI) control methodology. These kinds of controllers, for example the ${\pm}80MVAR$ compensator at Inuyama switching station, KEPCO, Japan, employs two stages of magnetics viz. intermediate transformers (as many as VSCs) and a main coupling transformer to minimize harmonics distortion in the line and to achieve a desired operational efficiency. The magnetic circuit needs altogether nine transformers of which eight are phase shifting transformers (PST) used in the intermediate stage, each rating equal to or more than one eighth of the compensator rating, and the other one is the main coupling transformer having a power rating equal to that of the compensator. In this paper, a two-level 48-pulse ${\pm}100MVAR$ STATCOM is proposed where eight, six-pulse GTO-VSC are employed and magnetics is simplified to single-stage using four transformers of which three are PSTs and the other is a normal transformer. Thus, it reduces the magnetics to half of the value needed in the commercially available compensator. By adopting the simple PI-controllers, the model is simulated in a MATLAB environment by SimPowerSystems toolbox for voltage regulation in the transmission system. The simulation results show that the THD levels in line voltage and current are well below the limiting values specified in the IEEE Std 519-1992 for harmonic control in electrical power systems. The controller performance is observed reasonably well during capacitive and inductive modes of operation.

모바일 기반의 HRV 알고리즘 분석 인터페이스에 대한 실증적 시뮬레이션의 재활치료용 생체계측 시스템 모델링의 구현 (Embodiment of living body measure system modeling for Rehalibitation treatment of positive simulation for HRV algorithm analysis interface of Mobile base)

  • 김휘영
    • 한국컴퓨터산업학회논문지
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    • 제7권4호
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    • pp.437-446
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    • 2006
  • 모바일 컴퓨터는 현대기술의 보조적 역할보다는 중추적인 역할을 제공하고 새로운기술을 생리학적 개념의 정확성을 재고하고, 창조적으로 재건할 수 있다. 병적징후들이 질병으로 발전되기 휠씬 이전에 재활전, 후 변화를 유도하는 과정에 개입할 수 있는 가능성을 제공해 준다. 그러나 많은 파라미터가 분석대상, 수학적 처리 및 얻어진 데이터의 평준화 시스템의 거대함, 모든 데이터의 동시수집이 어려움 등을 들 수 있다. 이러한 주점은 시스템을 구성하는 요소들간의 구조적인 연관성에 두고 있다. 따라서 본 연구에서는 시스템적 조절의 시간적 요소가 지니는 역학연구가 분석핵심이 되는 접근법의 모색이 타당하고 재활용 생체전기 신호를 바탕으로 하는 신경역학적 코드화 방법을 채택했다. 연구결과, 생체신호 디지털 분석장치의 바탕모델이 개발할 수가 있었고 학문적인 모색을 목적으로 재활치료용HSS(Hardware-software system)를 적용시킬 수가 있었다. 나아가 모바일기반의 생체전기 신호형성의 비전형화된 특성이 연구되었고 그 결과, 생체계측 신호의 기본적인 과정을 아날로그-디지털 송수신장치의 구조회로 형태로 모델링 할 수 있었다.

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PDA기반의 HRV분석 인터페이스에 대한 시뮬레이션의 재활치료용 생체계측 시스템 모델링의 구현 (Embodiment of living body measure system modelling for rehalititation treatment of simulation for HRV analysis interface of PDA base)

  • 김휘영;최진영;박성준;김진영;박성준;김희제
    • 대한전기학회:학술대회논문집
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    • 대한전기학회 2006년도 제37회 하계학술대회 논문집 D
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    • pp.2167-2168
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    • 2006
  • Mobilecomputer of offers more fundamental role than role assistance enemy of modem technology equipment and new Information Technology can reconsider, and reconstruct creatively accuracy of physiological concept. That military register symptoms are developed of disease, before far before rehalibitation, of for possibility that can intervene in process that motive change of military register symptoms after rehalibitation. But, that many parameters become analysis target and mathematical settlement and equalization system of noted data of that is huge, same time collection of all datas can lift difficulty etc.. These main weakness puts in structural relation between elements that compose system. Therefore, dynamics research that time urea of systematic adjustment has selected method code Tuesday nerve dynamics enemy who groping of approach that become analysis point is proper and do with recycling bioelectricity signal. Nature model of do living body signal digital analysis chapter as research result could be developed and scientific foundation groping could apply HSS (Hardware-software system) by rehalibitation purpose. Special quality that isdone radish form Tuesday of bioelectricity signal formation furthermore studied, and by the result, fundamental process of bodysignal in do structure circuit form of analog - digital water supply height modelling do can.

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ISM 대역용 접힌 다이폴 능동 집적 안테나의 설계 (Design of ISM-band Folded Dipole Active Integrated Antenna)

  • 이재홍;서종수
    • 한국통신학회논문지
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    • 제26권11B호
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    • pp.1612-1619
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    • 2001
  • 본 논문에서는 ISM 대역의 전력 증폭기와 안테나를 직접 결합함으로써 회로 크기와 삽입손실을 최소화하고 고조파 동조를 용이하게 하기 위하여 접힌 다이폴 능동 집적 안테나(Folded Dipole Active Integrated Antenna)를 설계하고 그 성능을 실험, 분석하였다. 전력 증폭기의 시뮬레이션 정확성을 높이기 위하여 비선형 모델을 사용하였으며, Load pull 방식을 적용하여 최대 전력점을 구한 후 임피던스를 정합하였다. 실험 결과 구동증폭기를 포할한 전체 전력첨가효율(PAE)은 31.5%로 계산되었고, 송신 전력은 13.7dBm의 출력을 확인할 수 있었다. 그리고 2.44 GHz 대역용으로 제안한 안테나는 기존 다이폴 안테나보다 크기가 작으며, 안테나 이득을 포함한 전체 이득은 23.7 dB를 얻을 수 있었고, 기본파 대비 제 2 고조파 억압은 30dBc 이상의 양호한 특성을 나타내었다.

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Modified Modular Multilevel Converter with Submodule Voltage Fluctuation Suppression

  • Huang, Xin;Zhang, Kai;Kan, Jingbo;Xiong, Jian
    • Journal of Power Electronics
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    • 제17권4호
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    • pp.942-952
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    • 2017
  • Modular multilevel converters (MMCs) have been receiving extensive research interest in high/medium-voltage applications due to its modularity, scalability, reliability, high-voltage capability, and excellent harmonic performance. Submodule capacitors are usually rather bulky because they have to withstand fundamental frequency voltage fluctuations. To reduce the capacitance of these capacitors, this study proposes a modified MMC with an active power decoupling circuit within each submodule. The modified submodule contains an auxiliary half bridge, with its capacitor split in two. Also, the midpoints of the half bridge and the split capacitors are connected by an inductor. With this modified submodule, the fundamental frequency voltage fluctuation can be suppressed to a great extent. The second-order voltage fluctuation, which is the second most significant component in submodule voltage fluctuations, is removed by the proper control of the second-order circulating current. Consequently, the submodule capacitance is significantly reduced. The viability and effectiveness of the proposed new MMC are confirmed by the simulation and experimental results. The proposed MMC is best suited for medium-voltage applications where power density is given a high priority.

고출력 LED 모듈 역률 개선 방법 연구 (A Study on Methodology to Improve the Power Factor of the High Power LED Module)

  • 노영환
    • 전기전자학회논문지
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    • 제18권3호
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    • pp.335-340
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    • 2014
  • 친환경 및 에너지 효율에 대한 관심이 증대되고 있는 가운데 LED(Light Emitting Diode)는 제어방식이 정 전류구동과 SMPS(Switching Mode Power Supply)방식으로 구동하므로 소형화 및 경량화를 이룰 수 있고 전력 소모가 적으며 효율이 높아 광원 및 조명장치에 활용하는데 유용하다. LED 생산업체는 고출력 LED 모듈의 칩 설계 원천기술의 확보가 필요하고, LED 를 조명으로 적용시키기 위해 전력손실을 줄일 수 있는 고출력 LED 모듈 개발을 위한 구동회로 설계와 역률 개선의 방안 연구가 필요하다. 산업현장에서 교류(AC) 직결 LED 구동소자인 HV9910를 일반적으로 사용하고 있다. 본 논문에서 HV9910에 PFC와 Noise Filter를 추가한 구동회로의 역률 및 효율에 대한 개선방법을 시뮬레이션을 통해 검증하는데 있다.

차동 이차 고조파 출력을 갖는 CMOS LC 전압조정발진기 (A CMOS LC VCO with Differential Second Harmonic Output)

  • 김현;신현철
    • 대한전자공학회논문지SD
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    • 제44권6호
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    • pp.60-68
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    • 2007
  • 발진기를 구성하는 교차결합된 P형 및 N형 트랜지스터의 공통 소스 단자로부터 기본 발진주파수의 이차 고조파 신호를 차동으로 출력하는 전압조정발진기를 제안하였다. 공통소스단자의 임피던스를 최적화하고 발진기를 전압제한영역에서 동작시키면 차동 이차 고조파 신호가 모든 공정/온도/공급전압의 코너에서 진폭차와 위상차가 $0{\sim}1.6dB$ 이고 $+2.2^{\circ}{\sim}-5.6^{\circ}$ 범위 안에서 유지됨을 확인할 수 있었다. 또한 진폭/위상 오차를 보정할 수 있는 임피던스 튜닝 회로도 사용하였다. 제안된 구조를 검증하기 위해 5 GHz 차동 이차고조파를 발생하는 전압조정발진기를 $0.18-{\mu}m$ CMOS 공정을 통해 설계 제작하였다. 이차고조파의 차동출력의 차이인 에러 신호는 임피던스 튜닝 회로를 통하여 -70 dBm이라는 낮은 수준으로 측정되었다. 따라서 CMOS LC 전압조정발진기가 진폭차가 0.34 dB 이고 위상차가 $1^{\circ}$ 인 만족할만한 차동의 이차고조파 신호를 출력하고 있음을 확인하였다.

Fuzzy Logic PID controller based on FPGA

  • Tipsuwanporn, V.;Runghimmawan, T.;Krongratana, V.;Suesut, T.;Jitnaknan, P.
    • 제어로봇시스템학회:학술대회논문집
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    • 제어로봇시스템학회 2003년도 ICCAS
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    • pp.1066-1070
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    • 2003
  • Recently technologies have created new principle and theory but the PID control system remains its popularity as the PID controller contains simple structure, including maintenance and parameter adjustment being so simple. Thus, this paper proposes auto tune PID by fuzzy logic controller based on FPGA which to achieve real time and small size circuit board. The digital PID controller design to consist of analog to digital converter which use chip TDA8763AM/3 (10 bit high-speed low power ADC), digital to analog converter which use two chip DAC08 (8 bit digital to analog converters) and fuzzy logic tune digital PID processor embedded on chip FPGA XC2S50-5tq-144. The digital PID processor was designed by fundamental PID equation which architectures including multiplier, adder, subtracter and some other logic gate. The fuzzy logic tune digital PID was designed by look up table (LUT) method which data storage into ROM refer from trial and error process. The digital PID processor verified behavior by the application program ModelSimXE. The result of simulation when input is units step and vary controller gain ($K_p$, $K_i$ and $K_d$) are similarity with theory of PID and maximum execution time is 150 ns/action at frequency are 30 MHz. The fuzzy logic tune digital PID controller based on FPGA was verified by control model of level control system which can control level into model are correctly and rapidly. Finally, this design use small size circuit board and very faster than computer and microcontroller.

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