본 논문에서는 국내의 지진자료를 이용하여 지진특성을 추정하기 전에 적용할 수 있는 사전자료처리기법을 종합적으로 검토하였다. 사전처리 기법으로는 계기보정, 센서검교정상태 확인, 윈도우에 의한 스펙트럼 왜곡 최소화, non-causal ringing에 의한 초동 왜곡 보정 기법을 분석하였으며, 자료 선택시 주파수 영역의 S/N비 확인 및 포화된 자료의 사용가능성 여부를 제시하였다.
In this paper, an efficient and fast algorithm to reduce calculation amount of FIR(Finite Impulse Responses) filtering is proposed. Proposed algorithm enables arbitrary size of parallel processing, and their structures are also easily derived. Furthermore, it is shown that the number of multiplication/sample is reduced, and number of instructions using MAC(Multiplication and Accumulation) processor are also reduced. For theoretical improvement, numbers of sub filters are compared with those of conventional algorithm. In addition to the theoretical improvement, it is shown that number of element for hardwired implementation are reduced comparison to those of the conventional algorithm.
In this study, improvements for error correction, speed, position, and rotation calculation algorithms have been proposed to be used in resolver to digital conversion (RDC) systems. The proposed open-loop system drives the resolver and uses the output signals of the resolver signal to estimate the real time position, the instant speed, and the rotation count with high resolution and accuracy even at high speeds and noise. The proposed solution implements strong features of both closed and open loop based systems while eliminating their weak points. The improvements proposed is resistant to noise owing to digital FIR filter and data averaging techniques. The implementation used for proof of concept is implemented on a hardware using an FPGA and configurable to be used by any resolver.
현대에 있어서 영상정보는 아주 큰 비중을 차지하고 있다. 따라서 이러한 영상정보를 얼마나 빨리 그리고 많이 압축 시킬 수 있는가가 핵심적인 관건이다. 본 논문에서는 공간적 압축 방식의 핵심인 DCT와 비교하여 블록킹 효과(Blocking Effect)과 없고, 우수한 압축 성능을 갖는 DWT(Discrete Wavelet Transform)알고리즘을 적용한 2차원 이산 웨이브렛 변환 필터를 설계하였다. 본 논문에서 구현한 DWT 필터는 FIR필터 방법으로 설계하였으며, Daubenchies-4 Tap을 이용하였고, 파이프라인 연산으로 승산기, 가산기를 병렬로 처리하여 고속연산을 수행하였다. 뿐만 아니라 메모리 맵핑 과정과 메모리 컨트롤 어드레스 발생기를 사용하여 메모리와 연산량을 최소화 하여 칩사이즈를 줄여 설계하였다.
Journal of Electrical Engineering and information Science
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제1권2호
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pp.67-76
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1996
In the present paper we propose two new improved iterative restoration algorithms. One is to accelerate convergence of the steepest descent method using the improved search directions, while the other accelerates convergence by using preconditioners. It is also shown that the proposed preconditioned algorithm can accelerate iteration-adaptive iterative image restoration algorithm. The preconditioner in the proposed algorithm can be implemented by using the FIR filter structure, so it can be applied to practical application with manageable amount of computation. Experimental results of the proposed methods show good perfomance improvement in the sense of both convergence speed and quality of the restored image. Although the proposed methods cannot be directly included in spatially-adaptive restoration, they can be used as pre-processing for iteration-adaptive algorithms.
본 논문에서는 많은 연산을 필요로 하는 디지털 필터의 저전력화를 위한 새로운 저전력 기법을 제안한다. 제안된 저전력 기법에서는 CSD (canonic signed digit)숫자의 유효 표현 범위를 결정하는 nonzero digit 와 ternary digit의 값에 따른 필터의 차단대역 특성 변화를 이용하여, 다단계의 필터 차단 대역 특성을 가지는 가변 CSD 계수를 얻고 이를 approximate processing 기법에 적용하였다. 제안된 저전력 필터 설계기법의 성능을 확인하기 위하여 4개의 필터 차단대역 특성을 사용하는 AC '97 과표본화 ADC용 decimation 필터의 설계에 적용하였다. Decimation필터 중 제안된 저전력 기법을 적용한 두 half-band 필터의 연산량은 제안된 기법을 적용하지 않은 경우에 비해 각각의 근사화 수준에서 단위 출력 샘플 당 63.5, 35.7, 13.9 %의 덧셈 연산만을 수행하여 필터의 출력을 얻을 수 있었다. Decimation 필터는 0.6㎛ CMOS SOG 라이브러리를 사용하여 제작·실험하였으며, 실험결과 입력 신호의 attenuation에 따라 전체 소모전력의 약 3.8 %에서 9 %의 소모전력이 감소되었음을 확인하였다. 제안된 가변 CSD 계수를 이용한 approximate processing 방식은 특히 음성 대역 및 오디오 대역의 신호처리와 과표본화 ADC/DAC의 decimation/interpolation과 같은 multirate 시스템에 적합하다.
본 논문에서는 감음신경성 난청자의 비선형적으로 변하는 가청 한계값을 보상하는 청력보정회로를 제안한다. 제안된 청력 보정 회로는 주파수 대역에서 직접 보상하기 위해 FFT와 IFFT 프로세서를 사용하고, 회로크기를 줄이기 위해 입력신호 크기 제어 방식을 사용한다. 제안된 청력보정 회로는 기존의 FIR필터 구조가 적용된 청력보정 회로보다 다중밴드 이득 보정이 가능하기 때문에 주파수 보정능력이 감음신경성 난청자에 대해 약 $15\%$이상 향상된 결과를 나타낸다. 입력신호 제어방식 적용으로 입출력 비트가 제한되지 않은 프로세서보다 하드웨어 크기는 $65\%$ 감소된다.
ROM은 디지털 시스템에서 전력 소모가 크고 속도의 병목현상을 갖는 블록이다. 점증적인 시스템의 고속화에 따라 ROM 설계시 전력소모 감소와 동작 속도 향상이 요구 된다 FFT 및 FIR 필터에 적용되는 ROM은 주소를 순차적으로 접근하는 방식의 ROM이 필요하며, 본 논문에서는 순차적으로 주소를 접근하는 ROM을 설계할 때 기존의 ROM과 같은 값을 출력 하면서 저장되는 셀을 줄일 수 있는 방법을 제안하였다 이러한 방법을 이용하면 비트라인에 연결된 저장 셀 개수가 감소되며 따라서 비트라인의 커패시턴스 값이 감소된다 비트라인의 커패시턴스 값이 감소하면서 지연시간 및 파워가 감소한다. 논문에서 예제로 사용한 Fill 계수 저장용 ROM의 경우 제안한 알고리즘을 적용하였을 때 저장 셀 '1'이 최대 86.3% 감소함을 알 수 있다.
구조물에서 발생하는 동적변위를 정확하게 취득하는 것은 토목구조물의 안전성을 평가하기 위한 필수적인 사항이다. 본 연구에서는 구조물에 발생하는 변위를 가장 정확하게 측정할 수 있는 RTK-GPS/가속도계 통합방법에 대한 비교와 분석을 수행하였다. 이를 위하여 가속도 자료로부터 동적 변위를 계산할 때에 사용할 수 있는 주요한 2가지 방법을 비교하였고, RTK-GPS로 측정한 변위와 가속도계로 측정한 변위를 통합하여 동적 변위와 정적, 준정적 변위를 모두 측정할 때에 사용할 수 있는 통합계산 방법들을 비교하였다. 엄밀한 비교를 위하여 캔틸레버 보를 제작하고 다양한 종류의 변위를 발생시킨 후 비교 대상 방법별로 이에 대한 측정 정확도를 평가하되 평가의 기준으로 LVDT 측정값을 사용함으로써 정확한 평가가 이루어지도록 하였다. 연구의 결과, 가속도 자료를 FIR 대역필터로 필터링 하고 이중적분하여 변위를 계산하는 방법이 가속도계를 이용한 동적변위 측정에 가장 적합한 것으로 나타났다. 또한, 동적변위와 정적변위, 준정적 변위를 종합적으로 측정하기 위한 RTK-GPS/가속도계 통합계산 방법으로는 대역별 변위 추출에 의한 통합 방법이 적합한 것으로 나타났다.
본 논문에서는 음성 및 데이터 트래픽에 대한 비트오율 성능이 CDMA 방식의 IMT-2000 시스댐에서 역방향 링크의 시뮬레이션 결과에 의해서 평가되었다. 역방향링크에서 시률래이션은 ITU-R에서 제시한 욕내, 도보, 그리고 차량 환경에 대하여 수행되었다. 또한 시뮬레이션에서 BER 성능을 향상시키기 위한 기술로 1.6념-Iz 전력 제어, 5-tap FIR 필터를 이용한 페이딩신호의 진폭과 위상 추정, 그리고 연판정 Viterbi 및 Reed-Solomon 복호 등이 적용되었다. 시뮬레이션 결과로는 최적의 파일롯전력 대비 트래픽전력의 비, 핑거수에 따른 BER 성능, 그리고 $10^{-6}$ BER에서 길쌍부호와 Concatenated 부호와의 성능비교를 제시하고 있다.
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[게시일 2004년 10월 1일]
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