정해진 대역폭 내에서 시청자의 대기시간과 요구되는 버퍼의 량을 줄이는 것은 주문형 비디오(VoD) 서비스 시스템 설계에서 중요한 요소였다. 하지만 기존의 제안된 많은 주문형 비디오 방법들의 높은 복잡도가 구현을 어렵게 하기 때문에, 최근에는 이와 더불어 주문형 비디오 방법의 복잡도를 줄이는 것도 중요한 요소로 간주되고 있다. 본 논문에서는 대역폭의 효율성도 높이면서 기존의 주문형 비디오 방법들의 복잡성을 크게 줄인 Fast Staggered 방식을 제안한다. 논문에서 제안하는 Fast Staggered 방식은 Fast Broadcasting의 높은 대역폭 효율과 Staggered Broadcasting 방식의 간단한 구조적 특징을 한꺼번에 가지고 있는 매우 실용적인 주문형 비디오 방법이다. 모의실험 결과 제안된 방식은 시청자 최대 대기시간이 Fast Broadcasting 방식과 거의 일치하고, 시청자 최대 버퍼 요구량은 매우 낮게 나타났다. 그리고 제안된 방식은 비디오 분할에 따라서 시청자의 대기시간과 필요한 버퍼량을 조절 할 수 있기 때문에 주문형 비디오 방식이 적용되는 환경에 따라서 조절해서 적용이 가능하다. 또한 주문형 비디오 방식의 복잡성도 함께 줄일 수 있는데, 제안된 방식은 비디오 데이터 세그먼트 수를 크게 줄이고, 복잡한 채널 관리를 줄였으며, 사용하는 채널의 수도 크게 감소시켰다. 본 논문은 Fast Staggered 방식의 서버 동작과정, 클라이언트 동작과정, 성능 모델, 모의실험을 통해 제안된 방식의 높은 효율성과 실용성을 제시한다.
플래시 메모리가 개인 정보 도구, 유비쿼터스 컴퓨팅 환경, 모바일 제품, 가전 제품 등에 급속한 속도로 활용되고 있다. 플래시 메모리는, 이러한 환경에 저장매체로서 사용되기에 적합한 성질들 - 즉 저전력, 비휘발성, 고성능, 물리적인 안정성, 그리고 휴대성 등 - 을 갖고 있다. 그런데 하드디스크와 달리, 이미 데이터가 기록된 블록에 대해 덮어쓰기가 되지 않는다는 약점을 갖고 있다. 덮어쓰기를 위해서는 해당 블록을 지우고 쓰기 작업을 수행해야 한다. 이와 같은 성질은 플래시 메모리의 쓰기 성능을 매우 저하시킬 수 있다. 이와 같은 문제점을 해결하기 위해 플래시 메모리에는 FTL(Flash Translation Layer)라는 시스템 소프트웨어 모듈을 갖고 있다. 현재까지 많은 FTL 기법들이 제안되었는데, 그 중에서 대표적인 기법으로 로그블록 기법이 있다. 이 기법은 한정된 수의 로그블록을 쓰기 버퍼로 이용함으로써 쓰기에 따른 소거 연산을 줄임으로써 성능을 높인다. 그런데 이 기법은 로그블록의 활용률이 낮다는 것이 단점이다. 이러한 단점은 각 로그블록에 쓰여질 수 있는 섹터들이 블록 단위로 연관(Block Associative Sector Translation - BAST)되기 때문이다. 본 논문에서는 한정된 수의 로그블록들의 활용률을 높이기 위해 임의쓰기(random overwrite) 패턴을 보이는 섹터들을 전체 로그블록들에 완전 연관(Fully Associative Sector Translation - FAST)시킴으로써 활용률을 높이는 FAST 기법을 제안한다. 본 논문의 기여사항을 다음과 같다. 1) BAST 기법의 단점과 그 이유를 밝히고, 2) FAST 기법의 동기, 기본 개념, 그리고 동작원리를 설명하고, 3) 성능평가를 통해 FAST 기법의 우수성을 보인다.
KSII Transactions on Internet and Information Systems (TIIS)
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제9권8호
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pp.3068-3078
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2015
Although the massive MIMO system supports a high throughput, it requires a lot of channel information for channel compensation. For the reduction of overhead, the massive MIMO system generally uses TDD as duplexing scheme. Therefore, the massive MIMO system is sensitive to rapidly changing fast fading in according to time. For the improvement of reduced SINR by fast fading, the adaptive power control is proposed. Unlike the conventional scheme, the proposed scheme considers mobility of device for adaptive power control. The simulation of the proposed scheme is performed with consideration for mobility of device. The result of the simulation shows that the proposed scheme improves SINR. Since SINR is decreased in according to the number of device in the network by unit of cell, each base station can accommodate more devices by the proposed scheme. Also, because the massive MIMO system with high SINR can use high order modulation scheme, it can support higher throughput.
CCFH(Candidatecasting Fast Handoff) 알고리듬은 기존의 Mobile IP에 멀티캐스팅을 결합한 고속 핸드오프의 성능을 능가하며, B/W 효율성 측면에서 역시 뛰어난 성능을 보이는 새로운 핸드오프 방법이다. 이 알고리듬은 L2 정보를 이용, L2 핸드오프가 발생하기 전 미리 멀티캐스팅하여 L3 핸드오프 지연을 타 방법에 비해 획기적으로 줄인다. 본 논문에서는 제안된 핸드오프 방법을 소개하고, 기존 MIP(Mobile IP)의 기본적인 핸드오프 방법뿐만 아니라 다른 핸드오프 방법들과의 비교 분석을 통하여 제안된 방법의 성능이 우수함을 확인한다.
제한된 네트워크 자원을 효율적으로 활용하기 위해서는 네트워크의 대역폭 측정이 선행되어야 한다. 대역폭의 측정을 위해서 다양한 방법이 제시되었으며 Yoo Han-seoung이 제안한 Fast Convergence Scheme[1] 방식은 적은 계산량으로 빠르고 정확하게 대역폭을 찾을 수 있었으나 네트워크의 변동에 민감하게 반응하는 문제점이 있었다. 따라서 본 연구에서는 Fast Convergence Scheme 방식에서의 오류 측정값에 대한 안정성을 높이는 알고리즘을 제안하였다.
This Letter proposes a scheme that supports a fast handover effectively in hierarchical mobile IPv6 networks (F-HMIPv6) by optimizing the associated data and control flows during the handover. By NS-2 simulation, we show that the proposed scheme can give better handover performance than a simple combination of existing schemes.
본 논문에서는 고정밀 차량위치 추적 기반의 교통신호등 제어를 위한 저전송율 초광대역 무선통신 시스템에서의 Ultra Fast Acquisition 알고리즘을 연구하였다. 현재 CDMA에서 사용되는 acquisition방식으로는 저전송율 UWB시스템에서 회로가 복잡해지고 빠른 acquisition을 기대할 수 없기 때문에 새로운 Ultra Fast Acquisition방식이 필요하다. 기본적으로 Sequential Estimation방식을 사용하며 trinomial m-시퀀스를 사용하여 유비쿼터스 센서 네트워크용 U시스템에서 long PN code를 사용하는 경우에도 회로의 복잡도를 줄이고 FCC Emission limit을 만족시키면서, $1\~3{\mu}sec$이내의 acquisition을 가능하도록 설계하였다.
IEEE 802.16e는 여러 가지 면에서 개선의 여지를 남기고 있으며 그중 특히 고속 핸드오버는 사용자가 고속으로 이동하는 환경에서는 필수적인 요소이다. 이 논문에서는 핸드오버 후보 기지국을 활용하는 고속 핸드오버 방식을 제안하였다. 제안된 방식은 IEEE 802.16e에 기반을 두고 있지 만 모의실험을 통한 성능 분석 결과에 의하면 핸드오버 지연을 기존 방식 대비 30%이상 감소시키며 핸드오버 탈락 확률 또한 5% 이상 향상시키는 성능개선 결과를 나타내었다.
Rapid and accurate phase synchronization is critical for the reliable control of grid-tied inverters. However, the commonly used software phase-locked loop methods do not always satisfy the need for high-speed and accurate phase synchronization under severe grid imbalance conditions. To address this problem, this study develops a novel open-loop phase locking scheme based on a synchronous reference frame. The proposed scheme is characterized by remarkable response speed, high accuracy, and easy implementation. It comprises three functional cascaded blocks: fast orthogonal signal generation block, fast fundamental-frequency positive sequence component construction block, and fast phase calculation block. The developed virtual orthogonal signal generation method in the first block, which is characterized by noise immunity and high accuracy, can effectively avoid approximation errors and noise amplification in a wide range of sampling frequencies. In the second block, which is the foundation for achieving fast phase synchronization within 3 ms, the fundamental-frequency positive sequence components of unsymmetrical grid voltages can be achieved with the developed orthogonal signal construction strategy and the symmetrical component method. The real-time grid phase can be consequently obtained in the third block, which is free from self-tuning closed-loop control and thus improves the dynamic performance of the proposed scheme. The proposed scheme is adaptive to severe unsymmetrical grid voltages with sudden changes in magnitude, phase, and/or frequency. Moreover, this scheme is able to eliminate phase errors induced by harmonics and random noise. The validity and utility of the proposed scheme are verified by the experimental results.
This paper described a replica-delay adaptive lock-acquisition scheme for high-speed DLLs. The proposed scheme provides the fast and correct locking cycle that is variable according to the magnitude of the arbitrary replica delay (fixed delay). The scheme guarantees the wide operation range and the fast lock-aquisition time. It has been confirmed by HSPICE simulations in a 0.35${\mu}{\textrm}{m}$ CMOS process.
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[게시일 2004년 10월 1일]
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