In this paper, A Feedforward Linear Power Amplifier for IMT-2000 which IMD characteristics was improved was designed and fabricated. To improve the main power amplifier IMD characteristics, the Feedback loop was added to basic Feedforward Power Amplifier structure. Therefore, the output power of error amplifier can be reduced, and it is easy to control the linearization circuit to cancel total IMD. The designed power amplifier represented the 40㏈m(l0W) output power and -55㏈C 3rd IMD at Center frequency 2.14㎓ (@5㎒).
IEIE Transactions on Smart Processing and Computing
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제3권4호
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pp.161-166
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2014
An accurate gain-of-two amplifier, which successfully reduces the capacitor mismatch error is proposed. This amplifier has similar circuit complexity and linearity improvement to the capacitor error-averaging technique, but operates with two clock phases just like the conventional pipeline stage. This makes it suitable for high-speed, high-resolution analog-to-digital converters (ADCs). Two ADC architectures employing the proposed accurate gain-of-two amplifier are also presented. The simulation results show that the proposed ADCs can achieve 15-bit linearity with 8-bit capacitor matching.
A new controller for switching audio power amplifier with digital PWM input is proposed- Bi-directional Saw-tooth Error Correction (BSEC). This control method for high quality switching amplifier is based on a pulsed edge correction approach using PWM audio signal input as a reference of power switching digital to analog converter. The proposed controller has excellent features such as wide error correction range and no limitation on the modulation index. The controller is implemented in the half-bridge class D amplifier and the performance is verified through hardware experiments. It delivers 100W into 4${\Omega}$ load with less than 0.2% of total harmonic distortion (THD) all over operating range and an maximum efficiency of 82%.
This letter proposes a novel calibration method for a multiport amplifier (MPA) to achieve optimum port-to-port isolation by correcting both the amplitude and phase of the calibration signals. The proposed architecture allows for the detection of the phase error and amplitude error in each RF signal path simultaneously and can enhance the calibrated resolution by controlling the analog phase shifters and attenuators. The designed $2{\times}2$ and $4{\times}4$ MPAs show isolation characteristics of 30 dB and 27 dB over a frequency range of 19.5 GHz to 22.5 GHz, respectively.
In this paper we present an LDO based on an error amplifier. The designed error amplifier has a gain of 89.93dB at low frequencies. This amplifier's Bandwidth is 50.8MHz and its phase margin is $59.2^{\circ}C$. Also we proposed a BGR. This BGR has a low output variation with temperature and its PSRR at 1 KHz is -71.5dB. For a temperature variation from $-40^{\circ}C$ to $125^{\circ}C$ we have just 9.4mV variation in 3.3V LDO output. Also it is stable for a wide range of output load currents [0-200mA] and a $1{\mu}F$ output capacitor and its line regulation and especially load regulation is very small comparing other papers. The PSRR of proposed LDO is -61.16dB at 1 KHz. Also we designed it for several output voltages by using a ladder of resistors, transmission gates and a decoder. Low power consumption is the other superiority of this LDO which is just 1.55mW in full load. The circuit was designed in $0.35{\mu}m$ CMOS process.
본 논문에서는 GaAsFET 전력증폭기를 다중반송 통신시스템에서 적용시키고자 설계한 PA증폭기의 측정된 전달함수를 비선형 모델링 한 결과를 제시하였으며 모델링 한 결과를 가지고 설계한 RF 증폭기의 AMAM 및 AMPM 비선형 특성을 추정하였다. 추정된 비선형특성 의하여 다중반송전송시스템에서의 증폭기의 근접채널간섭특성(ACPR), QPSK 및 64QAM과 같은 디지털 변조 신호에 대하여 성상도에서의 데이터 오차벡터의 크기(EVM) 및 BER 관계를 분석하였다. 본 연구에서 제시한 RF GaAs FET의 비선형 모델링은 OFDM을 이용하는 무선 다중반송전송시스템 설계에 적용할 수 있으며 전력증폭기와 디지털 변조 신호에 따른 비선형 관계를 정확하게 추정할 수 있다.
본 논문은 피드포워드 전력 증폭기의 효율 개선을 위한 도허티 증폭기의 적용에 관한 연구이다. 성능 분석을 위하여 중심 주파수 2.14 GHz의 WCDMA 4FA신호를 인가하여 평균 출력 전력 15 W에서 측정하였다. 적용한 도허티 증폭기는 동급 class AB 증폭기와 비교하여 고효율 저선형성의 특성을 나타내며 효율 개선을 위하여 피드포워드 전력 증폭기(FPA)의 주 증폭기로 사용되었다. 특성 변화를 분석하기 위해 선형성과 효율 특성이 다른 2가지 종류의 도허티 증폭기를 적용하였으며 각각의 FPA들은 평균 출력 15 W에서 효율은 $2\%$ 이상의 개선을 보였지만 선형성은 1.5 dBc 이상 저하되는 특성을 나타냈다. 저하된 선형성을 개선하기 위하여 부가적으로 오차 루프의 결합 계수(CF)와 오차 증폭기의 용량을 변화시켰다. CF와 오차 증폭기의 용량 변화로 효율 개선과 높은 선형성을 얻을 수 있었고 도허티 증폭기가 35 dBc 이상의 선형성을 유지하면 부가적인 변화 없이 평균 출력 전력 15 W에서 $2\%$ 이상의 효율 개선과 충분한 선형성을 얻을 수 있다.
본 논문에서는 MSSI 보상 기법을 채택한 1,200 km의 WDM 전송 시스템에서의 비트 에러율, 수신 감도, 입사 전력 최소 허용치를 증폭기 간격에 따라 수치적으로 살펴보았다. 변조 파형 형식에 관계없이 수신 감도와 입사 전력 최소 허용치 모두 증폭기 간격이 증가할수록 나빠지는 것을 알 수 있었다. 수신 감도 측면에서는 NRZ 전송보다 RZ 전송을 하는 경우 감도를 개선할 수 있었지만 실제 입사 전력 허용치 면에서는 NRZ가 RZ 전송보다 유리한 것을 확인하였다. 아울러 증폭기 간격을 50 km 이하로 해야만 수신 감도와 입사 전력 최소 허용치 모두 분산 계수, 채널 파장, 펌프광 전력에 비교적 영향을 적게 받는 것을 확인할 수 있었다.
본 논문에서는 전력증폭기의 선형성을 광대역으로 개선시키기 위하여 delay 특성의영향에 대하여 고려하였다. 사용된 전력 증폭기의 이득은 37dB이고, 3단의 1W급으로 설계되었다. Error 증폭기는 4단으로 설계되었으며 이득은 55dB이다. 그리고 방향성 결합기 및 전력 분배기를 설계하였으며, 또한 크기와 위상을 조절하기 위한 장치로 vector modulator를 사용하였다. 각 모듈을 통합하여 주파수 2.11GHz에서 2.2GHz까지 delay 특성을 고려한 광대역 선형 전력 증폭기를 설계하였으며, 30MHz의 대역폭에 걸쳐 C/I$_3$비가 25dB 이상의 개선 효과를 얻었다.
본 논문은 Doherty 증폭기의 높은 효율을 유지하면서 선형성을 개선하기 위해 아날로그 전치왜곡기를 가진 Doherty 증폭기를 보여준다. 3차 전치왜곡기는 전치왜곡기와 Doherty 증폭기에서 3차와 5차 혼변조 성분이 이루는 위상차를 같게 만들어 3차뿐만 아니라 5차 혼변조 왜곡신호를 동시에 상쇄시킨다. 이것은 전치왜곡기에서 위상조절 왜곡발생기를 이용하여 3차와 5차의 위상차를 독립적으로 조절함으로서 이루어진다. 또한, 간단하고 정확한 위상 측정 장치를 이용하여 왜곡발생기의 위상조절 능력을 실험적으로 확인한다. 실험적인 검증을 위해, 3차 전치왜곡기는 2.11-2.17 GHz의 WCDMA 대역에서 180-W Doherty 증폭기와 구현된다. 투톤 실험결과는 3차와 5차 혼변조 왜곡성분이 크게 상쇄될 수 있음을 보여준다. 또한, 4-carrier WCDMA 응용에서도 넓은 출력 범위에서 상당한 ACLR이 개선된다. 이 기법은 간단한 구조, 작은 크기, 세 가지의 조절 파라미터 때문에 가격 효율적이며 편리하다.
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[게시일 2004년 10월 1일]
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