The modeling of accurate timing in storage elements of ASIC cell library was studied. The propagation delay time of clock signal affects the critical time and this can cause malfunction in the chip designed in synchronous. In this paper, an analysis on the effect of input slope of clock signal in timing modeling were carried out. For the first time, in ASIC design, the design guides that can be used in both $0.6{\mu}M$ and $0.8{\mu}m$ design rule were offered, reducing the run time of SPICE and the time of cell library development.
Journal of the Institute of Electronics Engineers of Korea SD
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제48권3호
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pp.42-47
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2011
The partial product matrix (PPM) of a parallel squarer is symmetric. To reduce the depth of PPM, it can be folded, shifted and rearranged. In this paper, we present an area-efficient squarer design method using new partial product rearrangement. Also, a fixed-width squarer design method of the proposed squarer is presented. By simulations, it is shown that the proposed squarers lead to up to 17% reduction in area, 10% reduction in propagation delay and 10% reduction in power consumption compared with previous squarers. By using the proposed fixed-width squarers, the area, propagation delay and power consumption can be further reduced up to 30%, 16% and 28%, respectively.
The cautious blasting works had been used with emulsion explosion electric M/S delay caps. Drill depth was from 3m to 6m with Crawler Drill $\varphi{70mm}$ on the calcalious sand stone(sort-moderate-semi hard Rock). The total numbers of feet blast were 88. Scale distance were induces 15.52-60.32. It was applied to propagation Law in blasting vibration as follows. Propagtion Law in Blasting Vibration $V=K(\frac{D}{W^b})^n$ where V : Peak partical velocity(cm/sec) D : Distance between explosion and recording sites (m) W : Maximum Charge per delay-period of eighit milliseconds or more(Kg) K : Ground transmission constant, empirically determind on th Rocks, Explosive and drilling pattern ets. b : Charge exponents n : Reduced exponents Where the quantity $D/W^b$ is known as the Scale distance. Above equation is worked by the U.S Bureau of Mines to determine peak particle velocity. The propagation Law can be catagrorized in three graups. Cabic root Scaling charge per delay Square root Scaling of charge per delay Site-specific Scaling of charge per delay Charge and reduction exponents carried out by multiple regressional analysis. It's divided into under loom and over loom distance because the frequency is verified by the distance from blast site. Empirical equation of cautious blasting vibration is as follows. Over 30m----under l00m----- $V=41(D/3\sqrt{W})^{-1.41}$ -----A Over l00m-----$V= 121(D/3\sqrt{W})^{-1.66}$-----B K value on the above equation has to be more specified for furthur understang about the effect of explosives, Rock strength. And Drilling pattern on the vibration levels, it is necessary to carry out more tests.
The cautious blasting works had been used with emulsion explosion electric M /S delay caps. Drill depth was from 3m to 6m with Crawler Drill 70mm on the calcalious sand stone (soft-moderate-semi hard Rock) . The total numbers of feet blast were 88. Scale distance were induces 15.52-60.32. It was applied to Propagation Law in blasting vibration as follows .Propagtion Law in Blasting Vibration V=k(D/W/sup b/)/sup n/ where V : Peak partical velocity(cm/sec) D : Distance between explosion and recording sites(m) W ; Maximum Charge per delay -period of eight milliseconds or more(Kg) K : Ground transmission constant, empirically determind on the Rocks, Explosive and drilling pattern ets. b : Charge exponents n : Reduced exponents Where the quantity D/W/sup b/ is known as the Scale distance. Above equation is worked by the U.S Bureau of Mines to determine peak particle velocity. The propagation Law can be catagrorized in three groups. Cabic root Scaling charge per delay Square root Scaling of charge per delay Site-specific Scaling of charge delay Charge and reduction exponents carried out by multiple regressional analysis. It's divided into under loom and over loom distance because the frequency is varified by the distance from blast site. Empirical equation of cautious blasting vibration is as follows. Over 30m--under 100m----V=41(D/ W)/sup -1.41/-----A Over l00m---------V=121(D/ W)/sup -1.56/-----B K value on the above equation has to be more specified for furthur understand about the effect of explosives. Rock strength, And Drilling pattern on the vibration levels, it is necessary to carry out more tests.
Transactions of the Korean Society for Noise and Vibration Engineering
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제14권12호
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pp.1338-1346
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2004
The positions of rotating sound sources have been localized by experiments with the Doppler effects removed. In order to de-Dopplerize the sound signals emitted from moving sources, two kinds of signal reconstruction methods were applied. One is the forward propagation method and the other is the backward propagation method. Forward propagation method analyze the source emission time based on the instantaneous distance between sensors and the assumed source position, then the signals are reconstructed with respect to the emission time. On the other hand, the backward method uses time delay to do-Dopplerize the acquired data for the received time of reference. In both techniques. the reconstructed signal data were processed using beamforming algorithm to produce power distributions at the frequencies of interest. Experiments have been carried out for varying frequencies, rotating speeds and the object distances. It is shown that the forward propagation method gives better performance in locating source position than the backward propagation method.
Journal of the Korea Institute of Military Science and Technology
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제14권5호
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pp.842-849
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2011
The transponder simulator designed to simulate the transponder of military satellite communication systems in the geostationary orbit is required to have time delay function, because of 250 ms delay time, when a radio wave transmits the distance of 36,000 km in free space. But, it is very difficult to develop 250 ms time delay device in the transponder simulator of 100 MHz bandwidth, due to unstable operation of FPGA, loss of memory data for the high speed rate signal processing. Up to date, bandwidth of the time delay device is limited to 45 MHz bandwidth. To solve this problem, we propose the new time delay techniques up to 100 MHz bandwidth without data loss. Proposed techniques are the low speed down scaling and high speed up scaling methods to read and write the external memory, and the matrix structure design of FPGA memory to treat data as high speed rate. We developed the satellite link simulator in 100 MHz bandwidth using the proposed new time delay techniques, implemented to the transponder simulator and verified the function of 265 ms time delay device in 100 MHz bandwidth.
Journal of the Institute of Electronics Engineers of Korea TE
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제37권3호
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pp.6-15
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2000
In this paper, we propose a high speed parallel multiplier with a hierarchical architecture using a fast 4-2 compressor and 6-2 compressor. Generally, the performance of parallel multiplier depends on the processing speed of partial products summation tree with CSA adder. In this paper we propose a new circuit of 4-2 compressor and 6-2 compressor which reduces the propagation delay time, compared with conventional one. We Propose a hierarchical multiplier architecture in order to improve the execution speed of 16$\times$16 parallel multiplier using proposed compressors in this paper and make layout design easily by regular structure. The propagation delay time of the proposed 4-2 compressor circuit was 14% reduced as a result of SPICE simulation, compared with the conventional 4-2 compressor. The total propagation delay time of proposed 16$\times$16 parallel multiplier was 12% reduced using proposed 4-2 compressor and 6-2 compressor.
This paper describes the design of new method of propagation delay measurement in micro and nanostructures during characterization of ASIC standard library cell. Providing more accuracy timing information about library cell (NOR, AND, XOR, etc.) to the design team we can improve a quality of timing analysis inside of ASIC design flow process. Also, this information could be very useful for semiconductor foundry team to make correction in technology process. By comparison of the propagation delay in the CMOS element and result of analog SPICE simulation, we can make assumptions about accuracy and quality of the transistor's parameters. Physical implementation of phase error accumulation method(PHEAM) can be easy integrated at the same chip as close as possible to the device under test(DUT). It was implemented as digital IP core for semiconductor manufacturing process($0.11{\mu}m$, GL130SB). Specialized method helps to observe the propagation time delay in one element of the standard-cell library with up-to picoseconds accuracy and less. Thus, the special useful solutions for VLSI schematic-to-parameters extraction (STPE), basic cell layout verification, design simulation and verification are announced.
Ship ad-hoc network (SANET) extends the coverage of the maritime communication among ships with the reduced cost. To fulfill the growing demands of real-time services, the SANET requires an efficient clock time synchronization algorithm which has not been carefully investigated under the ad-hoc maritime environment. This is mainly because the conventional algorithms only suggest to decrease the beacon collision probability that diminishes the clock drift among the units. However, the SANET is a very large-scale network in terms of geographic scope, e.g., with 100 km coverage. The key factor to affect the synchronization performance is the signal propagation delay, which has not being carefully considered in the existing algorithms. Therefore, it requires a robust multi-hop synchronization algorithm to support the communication among hundreds of the ships under the maritime environment. The proposed algorithm has to face and overcome several challenges, i.e., physical clock, e.g., coordinated universal time (UTC)/global positioning system (GPS) unavailable due to the atrocious weather, network link stability, and large propagation delay in the SANET. In this paper, we propose a logical clock synchronization algorithm with multi-hop function for the SANET, namely multi-hop clock synchronization for SANET (MCSS). It works in an ad-hoc manner in case of no UTC/GPS being available, and the multi-hop function makes sure the link stability of the network. For the proposed MCSS, the synchronization time reference nodes (STRNs) are efficiently selected by considering the propagation delay, and the beacon collision can be decreased by the combination of adaptive timing synchronization procedure (ATSP) with the proposed STRN selection procedure. Based on the simulation results, we finalize the multi-hop frame structure of the SANET by considering the clock synchronization, where the physical layer parameters are contrived to meet the requirements of target applications.
Journal of the Institute of Convergence Signal Processing
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제12권2호
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pp.107-112
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2011
Several developed countries have been developing their own satellite navigation systems, such as Europe's Galileo, China's BEIDOU, and Japan's QZSS, to cope with clock errors and signal vulnerabilities of GPS. In addition, modernization of Loran, eLoran, for GPS backup has been conducted. In Korea, a dependent navigation system has been required and for GPS backup, the need for utilization of time synchronization infrastructure through the modernization of Loran has been raised. Loran signal uses 100Khz groundwave. A significant factor limiting the ranging accuracy of the Loran signal is the ASF arising from the fact that the groundwave signal is likely to propagate over paths of varying conductivity and topography. Thus, an ASF compensation method is very important for Loran and eLoran navigation. This paper introduces the propagation delay model and then compares and analyzes the estimations from the propagation delay model and measured ASFs.
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[게시일 2004년 10월 1일]
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