Lock mechanism is essential for synchronization on the multiprocessor systems. Lock mechanism needs to reduce the time for lock operation in low lock contention. Lock mechanism must consider the case of the high lock contention. The conventional lock control scheme in memory results in the increase of bus traffic and memory utilization in lock operation. This paper suggests a lock scheme which stores the lock data in cache and manages it efficiently to reduce the time spent in lock operation when the lock contention is low on a multiprocessor system built on HiPi-bus(Highly Pipelined bus). This paper also presents the design of the HIPi-CLOCK (Highly Pipelined bus Cache LOCK mechanism) which transfere the data from on cache to another when the lock contention is high. The designed simulator compares the conventional lock scheme which controls the lock in memory with the suggested HiPi-CLOCK scheme in terms of the RMW(Read-Modify-Write) operation time using simulated trace. It is shown that the suggested lock control scheme performance is over twice than that of the conventional method in low lock contention. When the lock contention is high, the performance of the suggested scheme increases as the number of the shared lock data increases.
In this paper, we deal with implementing design for a correlator access code generator module which they are used for setting up a connection between units, a packet decision, a clock syncronization, by FPGA. The orrelator module which is composed of the Wallace Tree's CSA and threshold value decision device decides useful a packet and syncronizes a clock, after it correlates an input signal of 1 Mbps transmission rate by a sliding window. An access code generator module which is composed of a BCH (Bose-Chadhuri-Hocquenghem) cyclic encoder and control device was designed according as a four steps' generation process proposed in the bluetooth standard. The pseudo random sequence which solves syncronization problem saved a voluntary device Proposed the module was designed by VHDL. An simulation and test are inspected by Xilinx FPGA.
미국의 GPS, 러시아의 GLONASS, 유럽의 Galileo, 중국의 Beidou 등과 같은 GNSS(Global Navigation Satellite System)의 핵심요소인 정밀 시각은 전 세계에서 다양한 경제적 활동의 중요한 근간이 되어 있다. 통신시스템, 전력 그리드, 금융 네트워크 등은 기본적인 작동 원리의 근간뿐만 아니라 작업들 간의 동기와 운영적 효율을 위해 정밀 시각을 기반으로 동작한다. 본 논문에서는 GNSS 신호 관측을 통해 클럭의 오류(클럭 솔루션)를 계산하는 방법인 정밀 절대측위 기법을 구현한 벨기에의 아토미움을 국내에서 처음으로 소개하고 한국표준과학연구원 관측 데이터를 적용하여 클럭 솔루션을 추출한 결과를 제시한다.
B-ISDN에 쓰이는 ATM 교환기 스위치 링크 및 망동기용 아날로그 / 디지털 혼합형 주파수 체배 분배 ASIC을 설계하였다. 이 ASIC은 46.94 MHz의 외부 입력 클럭을 이용하여 234.7 MHz의 시스템 클럭 및 77.76 MHz, 19.44 MHz의 가입자 클럭을 발생시키는 역학을 하며, 여러 개의 외부 입력 클럭에 대한 체크 및 선택 기능도 동시에 포함한다. 효율적인 ASIC 구성을 위하여 고속의 클럭 발생을 위한 아날로그 PLL 회로는 전주문 방식을, 외부 입력 클럭 체크 및 선택을 위한 디지털 회로는 표준셀 방식을 사용하여 아날로그 / 디지털 혼합 방식으로 설계하였으며, 0.8 $\mu\textrm{m}$ 디지털 CMOS 공정으로 제작 가능하도록 저항 및 커패시터를 특별한 방법으로 레이아웃 하였다.
제한된 스펙트럼 자원의 효율적 사용을 위한 하나의 해법으로 GPS 시각 기반의 이동선형주파수변조(SLFM)를 갖는 동일채널 다중국소 레이더 운용을 위한 방법을 제시한다. 제안된 알고리즘은 선택된 SLFM 신호 중에 상호상관 특성으로부터 허용할 수 있는 최소상관 수준을 갖는 SLFM 후보군을 찾는다. 제안 방법의 검증을 위해 단일 톱니 또는 삼각 LFM 신호를 갖는 동일채널에 운용되는 수 개의 레이더에 대해 수치해석을 하였다. 간섭 및 잡음, 알고리즘 한계, 그리고 SLFM 신호의 시각 동기 오류에 대해 탐지 거리 및 거리 윤곽의 계산 결과를 고찰하였다.
본 논문에서는 동기식 광 네트워크 SDH(Synchronous Digital Hierarchy)망의 장거리 무선 전송을 위해 필요한 연동 장치를 연구하였다. SDH 방식의 기본 전송단위인 STM-1 신호와 155Mbps급 Synchronous Etherenet의 무선 전송 구현 및 측정 방법을 제안한다. STM-1 전송과 Synchronous Ethernet 전송을 위해 클럭 동기 회복 기능을 제공하며, 안정적인 동기 확보를 위해 예비 클럭 전환 기능을 설계 하였다.
현재 SoC 설계에 사용되는 많은 IP들은 대부분 이들이 연결되는 버스 클럭과 주파수가 서로 다른 클럭을 사용하며 이를 위해서는 비동기 FIFO가 필수적이다. 그러나 아직 많은 수의 비동기 FIFO가 잘못 설계되고 있으며 이에 따른 비용이 심각하다. 이에 본 논문에서는 레지스터 기반의 비동기 FIFO를 유효비트를 사용하여 설계함으로써 비동기 회로에서 발생하는 metastability를 없애고 비동기 카운터의 오류를 수정함으로써 비동기 클럭들 사이에서 안전하게 데이터를 전송할 수 있는 FIFO 구조를 제안한다. 또한 이 FIFO 구조의 HDL 기술을 바탕으로 합성하여 다른 방식의 FIFO 설계 방식과 비교 평가한다.
Merino, M.M. Romay;Medel, C. Hernandez;Piedelobo, J.R. Martin
한국항해항만학회:학술대회논문집
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한국항해항만학회 2006년도 International Symposium on GPS/GNSS Vol.2
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pp.9-14
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2006
Galileo is the European Global Navigation Satellite System, under civilian control, and consists on a constellation of medium Earth orbit satellites and its associated ground infrastructure. Galileo will provide to their users highly accurate global positioning services and their associated integrity information. The elements in charge of the computation of Galileo navigation and integrity information are the OSPF (Orbit Synchronization Processing Facility) and IPF (Integrity Processing Facility), within the Galileo Ground Mission Segment (GMS). Navigation algorithms play a key role in the provision of the Galileo Mission, since they are responsible for computing the essential information the users need to calculate their position: the satellite ephemeris and clock offsets. Such information is generated in the Galileo Ground Mission Segment and broadcast by the satellites within the navigation signal, together with the expected a-priori accuracy (SISA: Signal-In-Space Accuracy), which is the parameter that in fault-free conditions makes the overbounding the predicted ephemeris and clock model errors for the Worst User Location. In parallel, the integrity algorithms of the GMS are responsible of providing a real-time monitoring of the satellite status with timely alarm messages in case of failures. The accuracy of the integrity monitoring system is characterized by the SISMA (Signal In Space Monitoring Accuracy), which is also broadcast to the users through the integrity message.
본 연구에서는 내륙에서 수신한 로란 9930M 포항 송신국의 로란신호를 이용하여 Loran differential ASF를 측정하였고, 이를 통해 로란 신호의 시각동기 정확도를 향상시켰다. Differential ASF는 한국표준과학연구원(KRISS)의 UTC(KRIS) 기준 TOA 데이터에서 충남대학교와 국립해양측위정보원에 설치된 원자시계를 기준으로 동시에 측정된 TOA 데이터를 각각 차분함으로써 구하였다. 자기장 안테나를 이용한 충남대학교에서의 60분 평균 TOA 측정결과는 $0.1{\mu}s$ 이내의 변동성을 보였고 국립해양측위정보원에서의 TOA 측정결과는 $0.05{\mu}s$ 이내의 변동성을 보였다. 또한 충남대학교와 국립해양측위정보원에서의 60분 평균 differential ASF 측정결과는 수신국의 주변 환경 영향에 의해 최대 $0.1{\mu}s$ 정도까지 시각 변동성을 나타냈다. 따라서 UTC(KRIS)를 기준으로 측정한 TOA 데이터로 충남대학교와 국립해양측위정보원 측정 데이터를 각각 보상하면 differential ASF 변화가 상쇄되어 로란 신호를 이용한 시각동기 정확도를 10 ns 정도 이내로 향상시킬 수 있다. 그리고 세슘원자시계를 기준으로 포항 송신국 로란 신호의 기준위상과 KRISS에서의 로란 수신기의 출력 기준위상을 측정하여 두 지점 사이의 ASF는 약 $3.5{\mu}s$로 나타났다.
본 논문은 DS/SS의 동기 복조를 위한 동기발진기의 특성에 대하여 연구하였다. 동기발진기는 외부신호가 인가되지 않을 때에는 고유 주파수를 발진하고. 고조파 및 저조파의 외부 신호가 인가되면 동기발진기는 인가 신호를 추적하여 동조한다 따라서 출력은 광대역의 외부 주파수에 동기 하므로서 주파수 분주와 주파수 증배에 이용 할 수 있으며, 디지탈 통신에 있어서 동기 문제점을 해결 할 수 있는 방안을 제시하였으며, 이와 같은 특성을 이용하여 DS/SS 동기 적용을 위한 실험에서 양호한 동기 특성을 얻을 수 있었다. 본 연구논문은 1998년 부산정보대학의 학술 연구조성비로 이루어졌으며, 지원해주신 부산정보대학에 감사드립니다.
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[게시일 2004년 10월 1일]
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