The Potential Induced Degradation(PID) in PV module mainly affected by various performance conditions such as a potential difference between solar cell and frame, ambient temperature and relative humidity. The positive charges as sodium ions in front glass reach solar cell in module by a potential difference and are accumulated in the solar cell. The ions accelerate the recombination of generation electrons within solar cell under illumination, which reduces the entire output of module. Recently, it was generally known that PID generation is suppressed by controlling the thickness of SiNx AR coating layer on solar cell or using Sodium-free glass and high resistivity encapsulant. However, recovery effects for module with PID are required, because those methods permanently prevent generating PID of module. PID recovery method that voltage reversely applies between solar cell and frame contract to PID generation begins to receive attention. In this paper, PID recovery tests by using voltage under various outdoor conditions as humidity, temperature, voltage are conducted to effectively mitigate PID in module. We confirm that this recovery method perfectly eliminates PID of solar cell according to repeative PID generation and recovery as well as the applied voltage of three factors mainly affect PID recovery.
본 논문에서는 MPEG-2 비디오 부호화기에서의 프레임 메모리 하드웨어 구현을 위한 DRAM의 효율적인 메모리 맵과 이에 따른 하드웨어 구조를 제안한다. 논문에서 제시된 메모리 맵은 DRAM 사용 시간과 대역폭을 줄임으로써 시스템의 성능을 개선할 수 있도록 설정되었고, 개발된 하드웨어는 MPEG-2 비디오 부호화기에 구성된 타모듈과 인터페이스를 위해 하드웨어는 VHDL을 이용하여 구현하였으며, $0.5\mu\textrm{m}$, VTI, ASIC 라이브러리인 camn5a3을 이용하여 합성하였다. 개발된 하드웨어에 대한 RT (register transfer) 수준 및 게이트 수준의 검증을 위해 VHDL 시뮬레이터와 로직 합성 툴을 사용하였고, 추후 성능 개선과 기능 검증을 위해서 하드웨어 에뮬레이터를 개발하였다. 구현된 하드웨어 MPEG-2의 MP@ML에서 요구하는 전송률로 데이터를 채널에 전송할 수 있도록 하였다.
In order to achieve high capacity and reliable link quality in user communication, this paper proposes a new concept of virtual cell: the Dual Virtual Cell(DVC), and DVC employment strategy based on DWCS. The proposed system uses two kinds of virtual cell. One is the AVC(Active Virtual Cell) which exists for actual traffic and the other is the CVC(Candidate Virtual Cell) which contains a set of candidate antennas to protect user's link quality from performance degradation or interruption. And also this system aims to reduce MT's overloads and acheive a prompt link change successfuly by introducing DVC structure which makes it possible for network to monitor real-time channel and to conrol communication links. The proposed system constructs DVC by using antenna selection method and improves frame error performance with employing Space-Time Trellis Code(STTC).
IEEE 802.11 무선 네트워크에서는 프레임 충돌현상을 방지하기 위해 RTS/CTS와 같은 제어프레임을 지원한다. 하지만 제어프레임은 프레임 충돌 현상을 막지만 전송률을 떨어뜨린다. 또한, 이웃하는 셀이나 같은 셀에 있는 다른 노드들의 동작을 막아버리는 현상인 False Node Problem을 발생시키기도 한다. 비효율적인 전송률과 False Node Problem을 해결하기 위해 새로운 제어프레임을 제안한다. 새로운 제어 프레임은 기존의 프레임에서 채널 감지기능을 갖는 4바이트를 추가한 것이며, 채널 감지 기능은 데이터를 수신할 때 일정한 시간에 채널을 다시 감지한다. 이 기능으로 채널의 접속 빈도를 높이게 되어 False Node Problem을 방지할 것이라고 기대한다. False Node Problem 방지와 효율적인 전송률을 증명하기 위해 새로운 제어프레임과 기존의 제어프레임을 지연시간과 load을 비교 분석을 하였다.
ATM 망에서 ABR(Available Bit Rate) 서비스 이상으로 단순한 구현을 통해 대역폭 보장을 만족할 수 있는 다양한 GFR(Guaranteed Frame Rate) 구현의 성능에 대한 연구가 이루어지고 있다. GFR 서비스에 있어서 서비스 품질보장을 만족시키기 위한 중요한 요소 중의 하나는 버퍼관리이다. 즉 ATM 스위치에서 untagged된 셀에 대해 MCR(Minimum Cell Rate)을 보장하기 위해서는 효율적인 버퍼관리가 필요하다. 본 논문에서는 GFR 서비스 보장을 위한 버퍼관리 기법을 제안하고 시뮬레이션을 통해 성능을 평가하였다. 제안된 기법은 각 VC간의 공평성을 보장하기 위해 버퍼에서 셀 폐기를 제어 할 수 있도록 하였으며, 기존의 방식인 Double-EPD(Early Packet Discsrding) 및 DFBA(Differential Fair Buffer Allocation) 기법과 비교하였다. 시뮬레이션 결과 제안된 기법이 기존의 기법에 비해 goodput 및 공평성지표면에서 향상되었음을 확인하였다.
본 논문에서는 ATM 계층에서 TCP/IP 트래픽 공평성 향상을 위한 GFR 서비스의 버퍼관리 및 스케줄링 기법을 제안하였다. 제안된 알고리즘은 프레임의 폐기정책 뿐만 아니라 여러 VC중에서 어떠한 VC의 셀을 서비스 할 것인가를 결정하기 위해 ATM 스위치에 도착하는 untagged 셀을 이용하였다. 시뮬레이션을 통한 성능 분석 결과 기존의 WRR 방식에서 만족하지 못하는 공평성 기준 2(MCR plus equal share)를 만족시킬 수 있었다. 또한 수율면에서도 제안된 알고리즘이 기존의 WRR보다 약 30% 향상되었고 공평성 지표에서는 WRR보다 제안된 알고리즘이 더 우수함을 확인할 수 있었다.
We have studied how liquid crystal's rubbing direction and voltage driving method affect generation of disclination line. At first, generation of disclination line in vertical alignment(VA) cell and VA-twisted nematic(TN) cell has been examined. When liquid crystal's rubbing direction of bottom substrate was 0$^{\circ}$, the degree of generated disclination line was the smallest value. Further, the generation of disclination line above the electrode is less in the frame inversion than in the line inversion. Secondly, we have examined a generation of disclination line in reflective fringe-field switching cell. When the distance between common electrodes is over 3 ${\mu}{\textrm}{m}$ with on-state of one pixel and off-state of neighboring pixels, the reflectance appears only on-state pixel without generating reflectance in adjacent pixels.
Background: Missense and frame-shift mutations within the dimer forming domain of the caspase 8 gene have been identified in several cancers. However, the genetic status of this region in precancerous lesions, like oral submucous fibrosis (OSMF), and well differentiated oral squamous cell carcinomas (OSCCs) in patients from southern region of India is not known, and hence the present study was designed to address this issue. Materials and Methods: Genomic DNA isolated from biopsy tissues of thirty one oral submucous fibrosis and twenty five OSCC samples were subjected to PCR amplification with intronic primers flanking exon 7 of the caspase 8 gene. The PCR amplicons were subsequently subjected to direct sequencing to elucidate the status of mutation. Results: Sequence analysis identified a frame-shift and a novel missense mutation in two out of twenty five OSCC samples. The frame-shift mutation was due to a two base pair deletion (c.1225_1226delTG), while the missense mutation was due to substitution of wild type cysteine residue with phenylalanine at codon 426 (C426F). The missense mutation, however, was found to be heterozygous as the wild type C426C codon was also present. None of the OSMF samples carried mutations. Conclusions: The identification of mutations in OSCC lesions but not OSMF suggests that dimer forming domain mutations in caspase 8 may be limited to malignant lesions. The absence of mutations in OSMF also suggests that the samples analyzed in the present study may not have acquired transforming potential. To the best of our knowledge this is the first study to have explored and identified frame-shift and novel missense mutations in OSCC tissue samples.
In grid-interconnection system, a fast, robust and precise phase angle detector is most important to grid synchronization and the active power control. The phase angle can be easily estimated by synchronous dq PLL system. On the other hand under unbalanced voltage condition, synchronous dq PLL system has problem that harmonics occur to phase angle or magnitude of grid voltage because of the effect of the negative sequence components. So, To eliminate the negative sequence components, the PLL method using APF (All Pass Filter) in a stationery reference frame to extract positive sequence components under unbalanced voltage condition is researched. In this paper, we propose a new PLL method with decoupling network using APF in a synchronous reference frame to extract the positive sequence components of the grid voltage under unbalanced grid. The cut-off frequency of APF in a synchronous reference frame can be set to twice of the fundamental frequency comparing with that of APF in a stationery reference frame which is the fundamental frequency. The proposed PLL strategy can detect the phase angle quickly and accurately under unbalanced gird voltages. Simulation and experimental results are presented to verify the proposed strategy under different kind of voltage dips.
최근 LCD가 TV 시장에서 높은 점유율을 보이고 DMB, PMP 그리고 휴대폰과 같이 LCD를 디스플레이로 사용하는 휴대용 기기에서의 동영상 이용이 급격히 늘어나고 있다. LCD의 응답시간을 향상시킬 수 있는 방법의 하나로 Overdrive 기법이 있으나 프레임 메모리의 사용이 필수이기 때문에 메모리의 사용량이 많아진다. 본 논문에서는 Overdrive 기법에 사용되는 프레임 메모리 사용량을 줄이기 위하여 Color Conversion과 수정한 DWT-IDWT를 제안하였다. 이를 통해 화질의 큰 열화가 생기지 않으면서도 프레임 메모리의 사용량을 50%로 줄일 수 있었고, 기존의 방법과 비교하여 메모리 사용량의 약 15%를 더 줄일 수 있었다. 제안한 방법은 Xilinx FPGA로 구현하였고 메모리를 제외하고 2172개의 Slice가 사용되었다.
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[게시일 2004년 10월 1일]
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