Sharma, Pradip Kumar;Moon, Seo Yeon;Park, Jong Hyuk
Journal of Information Processing Systems
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제13권1호
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pp.184-195
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2017
In recent decades, the ad hoc network for vehicles has been a core network technology to provide comfort and security to drivers in vehicle environments. However, emerging applications and services require major changes in underlying network models and computing that require new road network planning. Meanwhile, blockchain widely known as one of the disruptive technologies has emerged in recent years, is experiencing rapid development and has the potential to revolutionize intelligent transport systems. Blockchain can be used to build an intelligent, secure, distributed and autonomous transport system. It allows better utilization of the infrastructure and resources of intelligent transport systems, particularly effective for crowdsourcing technology. In this paper, we proposes a vehicle network architecture based on blockchain in the smart city (Block-VN). Block-VN is a reliable and secure architecture that operates in a distributed way to build the new distributed transport management system. We are considering a new network system of vehicles, Block-VN, above them. In addition, we examine how the network of vehicles evolves with paradigms focused on networking and vehicular information. Finally, we discuss service scenarios and design principles for Block-VN.
항공기, 철도, 선박과 같은 대형 시스템들은 전기, 기계적으로 매우 복잡한 구조를 가졌으며 부품의 수명만을 고려한 기존의 유지보수에서 탈피하여, 고장분석의 시스템화를 통해 장치의 고유수명과는 관계없이 발생 가능한 우발고장도 대처할 수 있는 신뢰성 기반의 유지보수체계를 연구하여야 한다. 본 연구에서는 선행연구로 필요한 복합 시스템의 신뢰도 계산방법에 관한 연구이다. 복합 시스템의 신뢰도를 효과적으로 계산하기 위해 시스템의 RBD(Reliability Block Diagram)를 구성하고 인접행렬을 사용하여 RBD(Reliability Block Diagram)를 행렬로 표현한다. 또한 RBD(Reliability Block Diagram)행렬을 통하여 신뢰도 경로행렬과 고장열거 행렬을 구성하여 시스템의 신뢰도를 계산한다. 본 연구에서 제안한 알고리즘은 자동화, 시스템화가 가능하며 현재 개발하고 있는 신뢰도 정보관리 시스템 및 신뢰성 기반 유지보수 시스템에서 활용될 것이다.
The Purpose of this study was to utilize of CAD System in pattern making process for women's apparel. The automation by the use of CAD System provides the higher accuracy and efficiency in pattern making process. AccuMark 300 System was used. for .this study. The results from this study were as follows . 1. New size spec chart and grading pitch chart were developed based on the data analysis and fitting tests for female college students. 2. New jacket block was developed based on the torso length sloper 3. Automatic grading of jacket block have been developed by creation and modification of grading rules of block pattern. 4. Pattern Design Systyem(P/D/S) were enabled to be constructed directly form a block pattern by modifications to existing styled pattern. 5. Original master pattern was generated by P/D/S menu option. 6. Production pattem added seam allowance, notchs was generated by P/D/S menu option. 7 Interative maker making process have enabled to save a wide range of time and space. 8. Measurement of garment by P/D/S measuring tools is to utilize in garment costing, quality control.
치과 재료분야는 그 동안 많은 발전을 해왔음에도 불구하고 자연치아의 색조 재현 및, 인접 치와의 조화에 따른 심미성과 지대치와의 적합성 등에 많은 문제가 야기되어왔다. 기존 all ceramic 은 단관 제작 시 심미적인 요구가 다소 해결되었으나 bridge work 에 있어서는 그 강도 및, 작업의 효율성은 여전히 문제시되어 오고 있다. 최근 기존 Inceram의 단점을 보안한 Celay Inceram system은 spinell, alumina, zirconia Blanks를 이용하여 더욱더 기능적인 자연스러움으로 접근되어진다. 이에 그 system의 alumina blank를 이용한 bridge work 의 임상 증례를 살펴보기로 한다.
JSTS:Journal of Semiconductor Technology and Science
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제5권4호
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pp.276-281
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2005
This paper presents a low voltage operating IF QPSK receiver block which is consisted of programmable gain amplifier (PGA) and analog to digital converter. This PGA has 6 bit control and 250MHz bandwidth, $0{\sim}20\;dB$ gain range. Using the proposed PGA architecture (low distortion gain control switch block), we can process the continuous fully differential $0.2{\sim}2.5Vpp$ input/output range and 44MHz carrier with 2 MHz bandwidth signal at 1.8V supply voltage. Using the sub-sampling technique (input freq. is $44{\sim}46MHz$, sampling freq. is 25MHz), we can process the IF QPSK signal ($44{\sim}46MHz$) which is the output of the 6 bit PGA. We can get the SNDR 35dB, which is the result of PGA and ADC at full gain mode. We fabricated the PGA and ADC and the digital signal processing block of the IF QPSK with the 0.18um CMOS MIM process 1.8V Supply.
In this paper the linear elastic coupling between a 2 degree of freedom shear-type frame system and a rigid block is analytically and experimentally investigated. As demonstrated by some of the authors in previous papers, it is possible to choose a coupling system able to guarantee advantages, whatever the mechanical characteristics of the frame. The main purpose of the investigation is to validate the analytical model. The nonlinear equations of motion of the coupled system are obtained by a Lagrangian approach and successively numerically integrated under harmonic and seismic excitation. The results, in terms of gain graphs, maps and spectra, represent the ratio between the maximum displacements or drifts of the coupled and uncoupled systems as a function of the system's parameters. Numerical investigations show the effectiveness of the nonlinear coupling for a large set of parameters. Thus experimental tests are carried out to verify the analytical results. An electro-dynamic long-stroke shaker sinusoidally and seismically forces a shear-type 2 d.o.f frame coupled with a rigid aluminium block. The experimental investigations confirm the effectiveness of the coupling as predicted by the analytical model.
This research heightens use efficiency of existent train railroad equipment by maximum through communication based train control system, and because system that take advantage of new skill compares with safety of old signal system same or it that show that is high be. Examined MBS Embodiment method of most suitable by presenting calculation that find out location of train that this treatise runs free curved line department to embody MBS(Moving Block System) through communication
본 논문에서는 FPGA를 이용하여 산업용 구동장치로 널리 사용되고 있는 유도 전동기의 디지털 전류 제어시스템을 구현하였다. 이를 위해 VHDL을 이용하여 FPGA를 설계하였으며 이 FPGA는 PWM 발생부, PWM 보호부, 회전속도 검출부, 프로그램 폭주 방지부, 인터럽트 발생부, 디코더 로직부, 신호 지연 발생부 및 디지털 입·출력부로 각각 구성되어있다. 본 FPGA의 설계시 고속처리의 문제점을 해결하기 위해 클럭전용핀을 활용하였으며 또한 40 MHz에서도 동작할 수 있는 삼각파를 만들기 위해 업다운 카운터와 래치부를 병렬 처리함으로써 고속화하였다. 특히 삼각파와 각종 레지스터를 비교 연산할 때 많은 팬아웃 문제에 따른 게이트 지연(gate delay) 요소를 줄이기 위해 병렬 카운터를 두어 고속화를 실현하였다. 아울러 삼각파의 진폭과 주파수 및 PWM 파형의 데드 타임 등을 소프트웨어적으로 가변 하도록 하였다. 이와 같은 기능들을 FPGA로 구현하기 위하여 퀵로직(Quick Logic)사의 pASIC 2 SpDE와 Synplify-Lite 합성툴을 이용하여 로직을 합성하였다. 또한 Verilog HDL 환경에서 최악의 상황들(worst cases)에 대한 최종 시뮬레이션이 성공적으로 수행되었다. 아울러 구현된 FPGA를 84핀 PLCC 형태의 FPGA로 프로그래밍 한 후 3상 유도전동기의 디지털 전류 제어 시스템에 적용하였다. 이를 위해 DSP(TMS320C31-40 MHz)와 FPGA, A/D 변환기 및 전류 변환기(Hall CT) 등을 이용하여 3상 유도 전동기의 디지털 전류 제어 시스템을 구성하였으며, 디지털 전류 제어의 효용성을 실험을 통해 확인하였다.
This paper describes the development tool for applications of automotive electronic control unit based on OSEK/VDX. This development tool has a plug-in structure and is written in Java language, because of being based on Eclipse CDT. And also this development tool has another functionality of expansion, which means a special function block can be easily adopted in this development tool. Currently, this development tool consists of five blocks, which are integrated development environment block, fusing program block, system generation block, debugger block, and cross-compiler toolchain block. They have relationship between each other and work for developing OSEK/VDX-based applications. In this paper, we show the functionality of each block of this development tool and its implementation.
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[게시일 2004년 10월 1일]
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