Inter-processor communication is required to manage resources in ATM switching system where processors are distributed. ATM switching system, which was developed in our institute, does't have dedicated communication path for inter-processor communication, but use the ordinary switching network same as user data. Therefore, we should test communication paths and equipments before running various application software programs. In this paper, we propose a method to test communication paths between processors in ATM switching system and describe an implemented program using this method.
ATM 통신망의 성공 및 확산을 위해서는 신규서비스의 창출과 함께 기존 서비스의 가격 경쟁력 있는 수용이 요구되는데, 인터넷 (IP)은 그 사용자 및 서비스의 수요를 고려할 때 ATM 망에서 가장 먼저 수용해야 할 서비스로서 현재 ATM 통신망에서의 인터넷 수용방안이 다양하게 논의되고 있다. 본 논문에서는 전력정보통신망을 전제로 하여 ATM WAN 통신망에서의 IP 서비스 수용에 관심을 두고 이를 위한 두 가지 방안으로 LAN Emulation 모델과 간단한 형태의 IP Internetworking 모델을 설정하고, LAN 과 WAN 접속구간의 서비스 카테고리가 ABR(Available Bit Rate)과 UBR(Unspecified Bit Rate)인 경우에 대해서 각 모델별로 적용하여 시뮬레이션을 수행하였다. 성능 비교를 위해 TCP 계층과 ATM 계층에서의 end-to-end delay를 분석한 결과, LAN-Emulation 모델을 적용하는 경우 간단한 형태의 IP Internetworking 모델에서 보다 성능효율이 우수하고, LAN과 WAN 접속구간의 서비스 카테고리는 백본 ATM 교환기와 Edge 단말에서의 버퍼크기가 동일한 경우 ABR이 UBR보다 성능효율이 우수함을 알 수 있었다.
본 논문에서는 이득-투명 SOA 스위치를 이용한 새로운 구조의 광 셀 역압축기를 제안하였다. 제안된 구조는 하드웨어 및 제어의 단순화와 이득-투명 SOA를 이용함으로써 처리용량을 극대화하기 위한 요구조건을 만족시킨다. 제안된 구조의 동작을 실험으로 보이기 위해 4-비트의 소규모 광 압축셀을 역압축시키는 실험을 수행하였으며, 제안구조의 동작원리와 일치하는 결과를 얻을 수 있었다. 이는 시간분할 방식을 포함하는 광 ATM 교환기와 광 패킷망 등에 주요 요소로서 적용될 수 있다.
본 논문에서는 ATM 망에서의 ADSL 정합장치 기능 구현에 대하여 기술한다. ADSL 정합장치 기능은 ADSL 모뎀에 연결되어 비대칭으로 송수신 되는 데이터의 ATM 물리 계층을 처리하는 ATM 교환기 표준 보드로 구현되었다. 기능 구현을 위해 기존 연구 결과로부터 최악의 선로 조건에서 가입자 선로의 누화, 임펄스 잡음 및 기타 가입자 선로에 가해지는 중요 전송 손실을 모델링하고, 시험 환경을 구성하여 성능 평가 시험을 하였다. 선로 시뮬레이터를 이용한 다양한 루프 및 최악의 선로 조건 시험에서 표준 규격을 만족한 것으로 나타났으며, ATM 교환기 및 ADSL 가입자 선로를 통한 고속 멀티미디어 서비스가 양호하게 수행됨을 확인하였고, 따라서 개발된 ADSL 정합장치는 ATM 망에서 기존 동선 가입자 선로를 통하여 양호한 ADSL 서비스를 제공할 수 있는 것으로 평가되었다.
데이터 감시(AUDIT) 기능이란 분산 실장 되어 있는 데이터들을 대상으로 데이터 이상을 진단하고 불일치 데이터를 검출하여 이를 일치시키는 일련의 작업을 말하는 것으로 데이터 불일치로 인해 유발되는 시스템 문제를 최소화시키는데 목적을 둔다. 본 논문에서는 ATM 교환기의 연결 데이터의 대부분을 차지하고 있는 PVC(Permanent Virtual Circuit) 데이터에 대한 감사 기능 지원 방안을 제안하였다. 즉 고속/저속 가입자 링크에 대해 일정 시간마다 감사 기능의 주기적 수행과 운용자 명령어에 의한 즉각적인 감사 기능을 제안하여 PVC 정보의 불일치로 인한 데이터의 손실 및 시스템 장애를 최소화 할 수 있게 하였다. 또한 감사 기능으로 인해 연결 제어 프로세서와 DC(Device Controller) 사이에 송수신하는 많은 IPC(Inter Processor Communication) 메시지가 연결 제어 프로세서의 부하에 어떠한 영향을 미치는지 분석하였는데, 시스템 부하와 거의 무관하게 연결 제어 프로세서의 부하가 일정함을 확인하였다.
ACE 2000 ATM 교환기를 이용하여 MPLS 교환기를 구현 시, ATM 가입자 및 중계선을 수용하여 스위치와 정합 기능을 수행하는 AIM(ATM interface module)에 IP 패킷에 대한 룩업을 수행하여 ATM 스위치로 패킷을 포워딩하는 HFEA(High performance Forwarding Engine board Assembly)를 연동하기 위해서는 UTOPIA Level2 연결이 요구된다. 그러나 HFEA 에서 622Mbps 급 성능의 MXT4400(SAR) 칩은 TSAR(Transmit SAR)로 운용 시 Master모드로 동작하게 되고, AIM 모듈 또한 Rx에서 Master모드로 동작하기 때문에 이들을 연결하기 위해서는 양 모듈간에서 Slave 모드로 동작할 수 있는 UTOPIA Controller가 필요하게 된다. 이에 따라 ALMA(AW Layer Module Assembly)칩과 HFEA TSAR 사이에서 데이터를 전달하는 UTOPIA Controller를 Xilinx를 이용해 FPGA로 구현하였다.
멀티미디어 서비스를 비롯한 다양한 서비스를 제공하여 줄 광대역 종합 통신망의 성능은 망을 구성하는 핵심적인 요소인 교환기의 성능에 크게 좌우된다. ATM교환용 스위치의 구조로 다단 상호 접속망인 Banyan 망을 설정하였으며 , Banyan망은 블록킹 현상으로 인한 성능의 한계가 있다. 블록킹 현상의 완화를 위해 입력단에 선입선출 방식의 버펄르 둔 입력 Buffered Banyan망과 셀우회이론을 사용한 입력 buffered banyan 망 각각에 단조버퍼링 방식을 적용, 성능을 비교하였다. 시뮬레이션 결과 셀 우회이론을 사용한 Buffered Banyan 망이 선입선출 방식의 Buffered Banyan 망보다 성능이 우수하며 단조 증가 버퍼링 방식이 단조 감소 버퍼링 방식보다 성능이 우수하였다.
A simulation model for the estimation of cutoff connection rate in the asynchronous transfer mode (ATM) switching system under multimedia traffic environments is presented. The simulator is developed by the integration of the AweSim tool with user-written C++ routines that model the internal structures of operational details of the switching system. For the case study, the simulator is applied to the ATM switching system developed by Electronics and Telecommunications Research Institute (ETRI) to compare design alternatives according to the cutoff connection rates.
초고속 정보통신망에서 ATM 사용자와 ATM 망간의 접속을 위한 ATM 정합장치는 ATM 통신 방식으로 ATM 교환기와 정합하는 각종 정합장치로 구성된다. ATM 정합장치는 155.520 Mbps의 선로 속도를 갖는 기본속도(STM-1 : Synchronous Transport Module-1) 정합장치와 44.736 Mbps의 선로 속도를 갖는 중속(DS-3 : Digital Signal-level 3) 정합장치, 그리고 2.048 Mbps 혹은 1.544 Mbps의 선로 속도를 갖는 저속(DS-l/E) 정합장치, 622.08 Ups의 선로 속도를 갖는 고속(STM4) 정합 장치로 구성된다. 본 논문에서는 ATM 저속, 중속, 기본속도 및 고속 정합장치의 기능 및 구현에 대하여 기술하였다.
본 논문에서는 시분할 다중화와 파장분할 다중화방식이 혼합된 광 ATM 스위치의 구조를 제안하였다. 제안된 구조의 광 ATM 스위치는 파장분할 다중화를 위한 도파로일 격자와 시분할 다중화를 위한 광압축기와 광파이버 지연선의 기본적인 모듈로 구성되어 있다. 다른 교환기 구조와 비교해 볼 때 제안된 스위치 구조는 하드웨어적으로 간단하고, 비용면에서도 매우 유리할 뿐더러 대 용량의 정보교환도 가능하기 때문에 광대역 종합정보통신망에 적합한 스위칭 시스템이다.
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[게시일 2004년 10월 1일]
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