• 전자통신동향분석
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• 제28권5호
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• pp.156-163
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• 2013

최근 건강에 대한 관심이 늘면서 의료 환경도 진료 중심 의료에서 예방 중심 의료로, 질병관리 중심에서 건강관리 중심으로 패러다임이 바뀌고 있다. 또한 국민 경제에서 의료비 비중은 점차 증가하고 있는 추세이다. 이러한 이유로 자신의 라이프 스타일 및 건강을 직접 관리하려는 인구가 증가하고 있다. 이를 IT 기술에 접목하여 가정 내에서 질병관리뿐만 아니라 병원 간의 연결을 통한 원격진료 서비스 제공 등을 목표로 하는 웨어러블 헬스케어 분야 동향을 살펴보고 이에 대응하기 위한 DSP 설계 동향에 대해서 살펴보겠다.

• 전자공학회논문지A
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• 제32A권10호
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• pp.93-101
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• 1995

The evaluation of the logic capability and the library generation method of the multiplexor-based logic module is described. Optimizing logic module for silicon area and logic capability is essential to build a efficient FPGAs(Field-Programmable Gate Arrays). Because the multiplexor-based logic module can implement a large number of functions, it presents difficulties for library-based approaches. However, the logic functions of the logic module can be significantly reduced by lmiting the number of variables and sum-of-products and by removing same functions with different variable ordering using algorithm presented in this paper.

• 대한전자공학회:학술대회논문집
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• 대한전자공학회 2002년도 하계종합학술대회 논문집(2)
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• pp.349-352
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• 2002

In this Paper, we introduced 32 bit SOC implementation for multi-application Smart Card and described the methodology for reducing power consumption. It consists of ARMTTDMI micro-processor, 192 KBytes EEPROM, 16 KB SRAM, crypto processors and card reader interface based on AMBA bus system. We used Synopsys Power Compiler to estimate and optimize power consumption. Experimental results show that we can reduce Power consumption up to 62 % without increasing the chip area.

• 대한전자공학회:학술대회논문집
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• 대한전자공학회 2002년도 하계종합학술대회 논문집(2)
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• pp.93-96
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• 2002

It is said that the verification effort occupies about 50-70 percent of the total effort of a System-On-A-Chip. This paper aims to develop a test bench automation tool based on the abstraction of the interface protocols. This tool will allow designers to describe their test benches in a high level language such as C rather than VHDL or Verilog. It helps designers to save their verification time and effort.

• 대한전자공학회:학술대회논문집
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• 대한전자공학회 2000년도 추계종합학술대회 논문집(2)
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• pp.172-175
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• 2000

In this paper, we address the requirement of VHDL parser for design rule checker, and the structure and implementing method of design rule checker which checks if IP design is valuable to reuse. This checker builds the grammar trees from the design rules, and the internal graphs representation from IP design data. It maps the nodes of the grammar trees and the internal graphs to check if it violates the design rules. The design rule checker can do the cross reference between source codes and error messages to find error position easy.

• 대한전자공학회:학술대회논문집
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• 대한전자공학회 2001년도 하계종합학술대회 논문집(2)
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• pp.325-328
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• 2001

This paper describes a VHDL code coverage checker for If design and verification. Applying the verification coverage to IP design is a methodology rapidly gaining popularity. This enables the designers to improve the IP design quality and reduces the time-to-market by providing the Quantitative measure of simulation completeness and test benches. To support this methodology, a VHDL code coverage model was defined and the measurement tool was developed.

• 전자통신동향분석
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• 제14권5호통권59호
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• pp.28-33
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• 1999

최근 정보사회에 따른 전파수요가 높아지고 있으며 이에 따른 주파수의 요구가 점차 고주파화되고 있고 미개척분야인 밀리미터파의 개발이 중요한 과제로 대두되고 있다. 본 고에서는 밀리미터파 대역 수동부품용 세라믹 유전체 소재에 관한 동향을 서술하였으며, 이 대역에서 세라믹 소재의 유전특성을 측정, 평가하는 여러 방법 중에서 자유공간법을 이용한 기술에 관하여 소개하고자 한다.

• 전자통신동향분석
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• 제34권1호
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• pp.123-131
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• 2019

Automotive electronics are complex and require high performance with an advanced driver assistant system (ADAS) and a functioning autonomous system. Thus, considering their complexity, the processor of the electronic control unit (ECU) requires a design that ensures high performance and reliability to ensure functional safety. This study discusses the technology used for developing a processor that can ensure functional safety of current automotive electronic systems.

• IT SoC Magazine
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• 통권2호
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• pp.34-38
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• 2004

실리콘 처리 기술의 고속화 요구와 유무선 환경에서 동영상 통신이 가능한 비디오 폰, 영상 회의 시스템, 이동 통신용 단말기 등의 전자 제품 사용자의 급증은 시스템을 하나의 칩에 집적화하는 SoC(System-On-a-Chip) 설계 기술을 요구하고 있다. 칩의 복잡도와 SoC 제품의 생산성 차이가 계속적으로 증가함에 따라 현재의 IC 설계 방법으로는 SoC 제품의 성능과 요구의 변화를 만족시킬 수 없다. 칩의 면적을 최소화하고 성능을 최대화하며 게이트 수준의 최적화를 통한 기존의 셀 기반 설계 방법으로는 설계의 생산성 문제를 해결할 수 없다. 이러한 문제를 해결 위한 새로운 설계 방법인 IP 재사용을 기반으로 한 플랫폼 기반 설계가 제시되었다. 플랫폼 기반 설계는 SoC 제품을 빠르게 개발하기 위한 응용 기반 통합 플랫폼과 재사용이 가능한 IP(Intellectual Property) 이용한 플랫폼 기반 설계(Platform-Based Design) 방법이다. 새로운 설계 방법은 90% 이상의 IP 재사용을 통해서 설계 시간을 단축하며, 시스템 수준에서의 최적화를 통해서 제품의 시장 경쟁력(Time-to-Market)의 문제를 해결하기 위한 방법이다.

• 한국정밀공학회:학술대회논문집
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• 한국정밀공학회 1995년도 춘계학술대회 논문집
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• pp.58-63
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• 1995

절삭가공 중에서도 높은 비중을 차지하는 구멍가공은 전자제품, 공작기계 뿐만 아니라 산업 전반에 걸쳐 소형 화, 다양화, 대량생산화 함에 따라 미세화, 고속화하게 되었다. 본 연구에서는 미세드릴 가공시에 발생하는 스러스트를 측정하여 이송, 절삭속도, 피삭재 두께 변화 등 각 절삭조건이 공구수면과 가공확대오차에 미치는 문제점을 해결하기 위한 방안으로 스텝이송 방식을 채택하여 그 효과에 대한 평가를 목적으로 한다.