A new position correction method using four fiducials as reference points was developed and examined. It was aimed to calibrate nonlinear deformation by numerous error sources. A correlation for correction was derived from the geometric relationship between four fiducials and chip position. Compared with three points method, it exhibited more accurate correction, especially for inner area of a quadrilateral composed of four fiducial points. Its accuracy was found to be increased as fiducials moves outwardly within a printed circuit board (PCB) and/or as they form more rectangle-like shape As for arbitrarily nonlinear deformation, this method can be applied using more than five fiducials. In this case, local-area calibration is carried out by sectioning a board area into several rectangular are as.
최근의 전자기기는 반도체 기술의 급속한 발전에 따라 소형화, 고기능화 및 다양화 뿐만 아니라 경박단소화되는 추세에 있다. 이러한 시장의 요구에 대응하여 표면실장용 전자부품이 등장하여 그 사용이 점차증가하고 있고 여기에 발맞춰 국내 . 외 전자기기 제조업체가 제품내의 PCB를 SMD화하는 추세에 있다. 따라서 표면실장 부품의 조립을 위한 고밀도, 고정도의 실장기술의 개발이 요구되고 있다. 또한 부품 자동삽입 등 기존의 방법들로 조립된, 전자기기 내부에 사용 되는 PCB의 조립상태 및 각 부품의 특성들을 검사하기 위한 In-circuit Tester의 기술도 빠른 속도로 발전하여 자동화되어가고 있는 추세에 있다. 이에 따라 본 연구소에서는 '90년에 능 Mounter GCA-M2000 모델을 개발 완료하였고 현재 관련 사업부에서 양산중에 있으며, 아날로그 방식 및 디지털 방식의 In-circuit Tester 모델도 개발 완료하여 현재 양산 중에 있다. 이 지면을 빌어 소개할 기회를 갖고자 한다.
표면실장장비(SMD)의 겐트리는 부품을 피더에서 기판으로 옮기는 역할을 한다. 이 때 겐트리의 이동 시간은 생산량에 영향을 미친다. 따라서 본 논문에서는 겐트리의 이동 시간을 단축시키기 위해 부품의 흡착에서 실장까지 가장 빠른 경로를 제시한다. 이 경로는 겐트리의 특성상 카메라 앞에서의 속도가 2인 경우이다. 따라서 이때의 궤적 그래프를 시뮬레이션을 통해 작성하고 이동 시간을 계산하였다. 그 결과 현재 사용 중인 stop-motion방법보다 본 논문에서 제시한 moving-motion방법의 이동 시간이 20%단축된 것을 알 수 있다.
SMT는 전자 부품을 흡착하여 PCB상에 정확히 실장 하는 장비이다. 이를 위해서는 중간 위치에 설치된 카메라 앞에서 정지하여 비전 검사를 한 후 실장 위치로 이동한다. 그 이동 경로의 타입은 16가지가 되며, 본 논문에서는 (sLa-Camera-pLa)타입에 대한 3가지 경로의 구동 시간을 비교하였다. 첫 번째는 비전 검사를 위해 카메라 앞에서 정지한 후 실장 하는 방법(stop-motion), 두 번째는 카메라 앞에서 정지하지 않고 움직이면서 비전 검사를 한 후 실장하는 방법(fly1-motion), 세 번째는 X축과 Y축이 최고의 높은 속도를 갖도록 한 후 비전 검사를 하고 실장하는 방법(fly2-motion)이다. 3가지 방법에 대한 구동 시간을 계산하여 비교한 결과 모두 동일한 시간이 걸리는 것을 알 수 있었다. 따라서(sLa-Camera-pLa)타입은 장비 구조의 변경 없이 stop-motion방법으로도 가장 빠른 시간에 실장할 수 있음을 확인하였다.
본 연구에서는 쏠더를 이용한 새로운 웨이퍼 레벨 실장 기술을 제안하였고 순수 주석도금이 쏠더로서 이용되었다. 제안된 실장 기술의 가장 큰 차별성은 레고 조립처럼 어셈블리 한 후에 쏠더 리프로우를 통해 측면 접합한다는 것이다. 이런 측면 접합 기술은 기본적으로 표면 상태에 매우 둔감하다는 장점과 비아를 통한 전기적 연결 시 끝 단의 노칭(notching)에 의한 전기적 연결 끊김 문제를 해결할 수 있다. 접합강도는 전단 응력을 측정하여 평가하였고, 실장의 기밀성(Hermeticity)는 가압 헬륨 측정법을 통해서 평가되었다. 실험결과로부터 본 실장 기술은 고 수율 웨이퍼 레벨 실장 기술의 대안이며 실행 가능함을 확인할 수 있었다.
본 연구는 솔더의 리프로우 현상으로부터 제안되었다. 솔더는 원형 흡착 층 위에서 녹게 되면 단위 면적당 표면 에너지를 최소화 하려는 특성 때문에 구형이 되는데, 이는 자기정렬 기구의 핵심이기도 하다. 본 연구에서 제안되는 새로운 설계가 기존의 설계와 가장 큰 차이점은 그림 1에서 처럼 솔더의 리프로우에 의해 측면 접합을 한다는 것이다. 대부분의 기존 실장 기술은 접합 면과 피 접합 면이 서로 마주보고 있으며 서로 맞닿아야만 접합이 이루어 지는 "intimate contact" 원리인 반면, 본 연구에서 제안된 개념은 접합 면과 피 접합 면이 쏠더에 의해 끼워진 상태에서 측면 접합되는 원리이 기 때문에 접합 면끼리 서로 인접하지 않아도 접 합은 자연적으로 완성되어 접합면의 표면상태에 충분히 둔감하다는 장점을 가질 수 있다. 그림 1의 (b)는 개념도 (a)를 구현하기 위한 제작 공정을 보여준다. 버섯 모양의 구조물을 형성하는 공정과 측벽에 UBM을 선택적으로 형성하는 공정이 핵심 공정이며 이외의 접합 공정은 기존의 방법과 달리 매우 간단하게 완성시킬 수 있다. 본 논문에서는 기본적으로 제안된 방법으로 구현되는 실장결과와 그 기본적인 기계적 강도, 기밀 특성을 살펴 보았다. 그리고 RF 소자의 실장에 있어서 제안된 방법에 의한 전기적 연결의 기초 결과에 대해서 논의한다.
표면실장기술(SMT: Surface Mount Technology)에 있어서 휴대폰 및 평판 디스플레이가 점점 가볍고 얇아지면서 이 제품에 사용되는 전자부품이 작아지고 있어, 0402, 0603 Chip등과 같은 SMD(Surface Mount Device) 부품을 실장하는 기술이 대두되고 있다. 따라서 Chip Mounter 제조회사들은 미삽이나 오삽을 방지하기 위한 실장기술에 대해 지속적인 연구를 해오고 있다. 본 연구는 이러한 미삽 오삽 방지를 실현하기 위하여 Fiber sensor를 이용하여 기계적 구조를 마련하고, 이를 활용한 시스템 알고리즘을 개선하는 기술을 제시한다.
SMT장비는 전자 부품을 흡착하여 PCB상에 정확히 실장 하는 장비이다. 이를 위해서는 중간 위치에 설치된 카메라 앞에서 정지하여 비전 검사를 한 후 실장 위치로 이동한다. 그 이동 경로의 타입은 16가지가 되며, 그 중에서 (sLa-Camera-pLb)경로에 대해 가장 빠른 시간에 실장 할 수 있는 알고리즘을 본 논문에서는 제시한다. 이를 위해서는 카메라 위치에서 정지하지 않고 이동하면서 비전 검사할 때 수많은 궤적 중 어떤 궤적이 가장 빠른 시간에 검사 후 실장 할 수 있는 경로인지를 찾는 알고리즘을 제시한다. 그 결과 카메라 앞에서 정지하여 검사 후 이동하는 방식보다 16%의 시간 단축 효과가 있음을 시뮬레이션을 통해 입증하였다.
초 박형 실리콘 칩을 이용하여 실리콘 칩들을 포함한 모듈 전체가 굽힘이 자유로운 유연 패키징 기술을 구현하였으며 bending test와 FEA를 통해 초 박형 실리콘 칩의 기계적 특성을 살펴보았다. 초 박형 실리콘칩$(t<30{\mu}m)$은 표면손상의 가능성을 배제하기 위해 화학적 thinning 방법을 이용하여 제작되었으며 열압착 방식에 의해 $Kapton^{(R)}$에 바로 실장 되었다. 실리콘칩과 $Kapton^{(R)}$ 기판간의 단차가 적기 때문에 전기도금 방식으로 전기적 결선을 이룰 수 있었다. 이러한 방식의 패키징은 이러한 공정은 flip chip 공정에 비해 공정 간단하고 wire 본딩과 달리 표면 단차 적다. 따라서 연성회로 기관을 비롯한 인쇄회로기판의 표면뿐만 아니라 기판 자체에 삽임이 가능하여 패키징 밀도 증가를 기대할 수 있으며 실질적인 실장 가능면적을 극대화 할 수 있다.
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[게시일 2004년 10월 1일]
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