반사기 형태에 따른 경사진 빗살무늬 변환기 SAW 필터 특성을 비교하기 위해 모의실험을 통해 Langasite 기판위에 전극을 형성시켰으며, 전극재료로는 Al-Cu를 사용하였다. 모의실험을 바탕으로 입력단에는 IDT를 직렬형태로 연결시킨 block 형태로 하중을 가하는 전극 방법을 쓰고 출력단은 withdrawal 형태로 하중을 가하는 방법을 써서 제작하였다. 이를 바탕으로 광대역의 SAW 필터 전극 설계 방식에 대한 적절한 위상조건도 얻고자 시도하였다. Langasite 기판위에 형성시킨 입 출력빗살무늬 변환기 전극수는 50쌍, 두께는$5000{\AA}$으로 하였으며, 반사기 폭과 간격은 각각 $3.6{\mu}m$ 및 $2.0{\mu}m$으로 하였다. 제작한필터의 주파수 특성은 중심주파수가 대략 190MHz정도, 대역폭은 8.0MHz 정도로 측정되었으며, matching 후 return-loss는 -16dB 이하이고, 리플 특성은 4dB 정도이며, 반사에 의한 잔향은 -20dB 이하로 측정되었다.
본 논문에서는 소형 모바일 기기에 적용이 가능하도록 코일형 및 루프형 공진기의 평면화를 통해 소형화하여 자기공진형 무선전력전송 시스템을 구축하였다. 제안된 디스크형 이중코일공진기(disk type double coil resonator)는 아크릴 기판(acrylic substrate)의 양면에 얇은 구리 재질을 2 mm의 넓이(width)와 1 mm의 간격(pitch)으로 8번 감은 수의 나선코일패턴을 설계하여 최외각단을 연결한 구조이다. 이 공진기는 구리 재질의 패턴 길이에 의한 유도용량과 각 양쪽 나선코일패턴간의 아크릴 사이에 발생하는 정전용량을 이용하여 6.78 MHz에서 공진한다. 공진기에 설계된 나선코일패턴의 크기는 최외각 지름이 9 cm로 소형화 되었다. 급전 및 부하공진기로 사용되는 루프는 5 mm 굵기의 동선을 이용하여 지름 10 cm의 단일 루프로 구현하였다. 또한, 6.78 MHz에서 공진할 수 있도록 3,300 pF 커패시터(capacitor)를 직렬로 연결하였다. 디스크형 이중코일공진기의 특성을 알아보기 위해 다양한 공진기 재배열을 통해 시스템을 구성 및 측정하였으며, 소형 무선전력전송 시스템의 최대 전송효율은 35.67 %를 보였다. 제안된 공진기의 구조를 통해 더 작은 소형화 구조 설계가 가능할 것으로 기대된다.
두 개 이상의 동축선을 사용하여 한 쪽은 동축선을 직렬로 연결하고, 반대 쪽은 동축선을 병렬로 연결하면 광대역에서 동작하는 임피던스 변환회로가 된다. 동축선을 이용한 광대역 임피던스 변환회로는 동축선의 외곽 도체를 임피던스 변환에 이용하기 때문에 수식 또는 시뮬레이션 프로그램을 통한 예측이 매우 어렵다. 본 논문에서는 ${\lambda}/4$-마이크로스트립 선로 임피던스 변환회로의 선로 신호 감쇄에 대한 전달 특성(S21) 해석을 바탕으로 $25{\Omega}$ 동축선 두 개를 이용한 광대역 4:1($50{\Omega}:12.5{\Omega}$) 전송선로 임피던스 변환회로를 제작하여 동작 특성을 살펴보았다. 두 개의 동축선을 이용한 광대역 임피던스 변환기는 동축선의 길이를 90도(${\lambda}/4$)로 인식하는 주파수에서 신호 전달 특성(S21)이 급격히 감소하는 노치 특성이 발생하였다. 또한, 동축선 길이의 $0.06{\sim}0.2{\lambda}$에 해당하는 주파수 범위에서 신호 전달특성(S21) -0.2dB 이내의 값을 가졌다. 이러한 신호 전달특성(S21)은 출력 단에 연결된 마이크로스트립 선로의 길이 변화를 통해 약간의 동작 주파수 범위 변화와 원하는 주파수에서 최적의 신호 전달특성(S21)을 설정할 수 있음을 확인하였다.
본 논문은 CMOS RFIC 단일 칩을 위한 Bandgap Voltage Reference와 이를 포함한 저 잡음 Low Dropout (LDO) Regulator 회로에 관한 것이다. 저 잡음을 위해 Bandgap Voltage Reference에 사용된 BJT 다이오드의 유효면적을 증가시켜야 함을 LDO의 잡음해석을 통해 나타내었다. 이를 위해 다이오드를 직렬 연결하여 실리콘의 실제면적은 최소화 하면서 다이오드의 유효면적을 증가시키는 방법을 적용하였고, 이를 통해 LDO의 출력잡음을 줄일 수 있음을 확인하였다. $0.18{\mu}m$ CMOS 공정으로 제작된 LDO는 입력전압이 2.2 V 에서 5 V 일때 1.8 V의 출력전압에서 최대 90 mA의 전류를 내보낼 수 있다. 측정 결과 Line regulation은 0.04%/V 이고 Load regulation은 0.45%를 얻었으며 출력 잡음 레벨은 100 Hz와 1 kHz offset에서 각각 479 nV/$^\surd{Hz}$와 186 nV/$^\surd{Hz}$의 우수한 성능을 얻었다.
본 논문에서는 2가지 DGS 공진기를 제안하고 이를 이용한 저역통과 필터를 설계한다. 제안된 구조는 전송선로부분에 스터브가 존재하고 그 아래의 접지면에 구형 슬롯과 II자형 슬롯을 갖는 DGS셀 형태로써, 통과대역에서의 반사손실을 자유자재로 변화시킬 수 있으며, 저지대역에서의 감쇠극의 조정이 용이한 특징을 갖는다. 단일 스터브 II자형 DGS셀의 단점인 차단주파수에서의 스커트 특성을 개선하기 위하여 구형 슬롯을 양옆에 직렬 연결함으로써 매우 급격한 차단 특성을 얻을 수 있었다. 따라서 이 구조를 사용한 저역통과 필터는 기존 필터에 비해 초소형화가 가능하며, 부품 실장에서 유리하고, WLL 및 2.4㎓ ISM 대역의 하모닉 성분 및 불요파 제거 등 다양한 응용을 기대할 수 있다.
높은 중량에너지밀도로 배터리 무게를 줄일 수 있는 장점을 갖는 리튬이온 배터리는 중량이 중요한 관심사인 많은 항공우주 응용분야에서 빠른 속도로 Ni-Cd, Ni-H2 등의 기존 배터리를 대체하고 있다. 또한 리튬이온 배터리는 낮은 열 손실 특성과 높은 에너지 효율 그리고 저렴한 셀 단가를 갖는다. 80개의 소니 US18650 리튬이온 셀을 사용한 KSLV-I 탑재배터리 모듈은 셀을 8개씩 직렬로 구성한 후 각 열을 병렬로 10개 연결하여 요구되는 전압과 용량을 공급한다. 본 논문에서는 우주발사체용 리튬이온 배터리의 설계 및 그 특성에 대해 소개하며, 예상되는 우주환경에서 배터리가 신뢰성 있게 동작하는지를 검증하는 환경시험 프로그램 절차를 보였다. 배터리 성능은 전자부하기를 이용한 시뮬레이션 시험을 통해 확인하였고 발사체 2단에 장착하여 각 전장품들과의 연계시험을 통해 검증하였다.
120∼180 GHz 대역의 고정 튜닝방식을 사용한 SIS(Superconductor-Insulator-Superconductor) 접합 믹서를 개발 하였다. 이 믹서는 노베야마 전파천문대에서 제작된 6개 직렬 연결 Nb/Al-A1$_2$O$_3$/Nb SIS 접합 소자를 사용하였으며 석영유리 기판에 제작된 이 SIS 칩은 전 주파수 대역에서 입력신호 결합을 향상시키기 위해 half-height 도파관의 중심에 놓여 있다. 본 논문에서 개발된 SIS 믹서는 기계적인 튜닝 장치를 사용하지 않으며 RF 신호와 LO 전력은 냉각된 십자형 방향성 결합기를 통해서 믹서에 공급된다. 또한 IF 신호 손실을 줄이기 위해 SIS 믹서의 IF 출력 임피던스를 IF 증폭단의 50 $\Omega$ 입력 임피던스에 정합 시켰다. SIS 수신기의 측정된 DSB 잡음온도는 120∼180 GHz 대역에서 32∼131 K이며 본 논문에서 개발된 SIS 믹서는 대덕전파천문대의 14 m 전파망원경에 설치되어 전파천문 관측에 사용되고 있다.
본 논문에서는 직렬 연결된 N-단 증폭기의 1dB 이득 억압점을 예측하기 위한 새로운 방법을 제안한다. 제안된 방법은 각 증폭기 제작사로부터 제공된 스칼라 데이터를 사용하여 각 증폭기의 입출력 전력 전달함수를 산출하고 이것을 각 증폭기의 입출력이 정합되었다는 가정하에 스칼라 형태로 곱함으로써 서브 시스템의 입출력 전력 전달 함수를 산출한다. 이렇게 구해진 전달 함수를 이용하여 역으로 서브 시스템의 1dB 이득 억압점을 예측할 수 있다. 제안된 방법은 스칼라 데이타의 수에 관계없이 사용할 수 있는 일반적인 방법이지만 본 논문에서는 2개의 스칼라 데이타(선형 전력 이득, 1dB 이득 억압점)와 3개의 스칼라 데이타(선형 전력 이득, 1dB와 0.5dB 이득 억압점)만을 사용할 경우에 대해서만 각각 분석된다. 제안된 방법의 유용성을 확인하기 위해 Ku-band에서 동작하는 두개의 표본 증폭기를 사용하여 기존의 방법과 제안된 방법에 의한 예측 결과와 실험에 의해 측정된 결과를 서로 비교하기 위해 함께 제시한다.
SCALDO(Supercapacitor Assisted LDO) 레귤레이터는 기존 LDO(Low Drop-out) 레귤레이터(이하 LDO)의 낮은 효율을 개선하기 위해 연구되고 있는 회로로서, 회로의 입력단과 LDO사이에 슈퍼커패시터를 부착하여 입력과 출력 전압의 차이에 의해 발생하는 불필요한 전력손실을 재사용함으로써 LDO의 효율을 향상시킬 수 있다. 하지만 SCALDO 레귤레이터는 현재 연구 중에 있는 회로로 몇 가지 개선되어야 할 사항들이 남아있다. 그 중 한 가지는 회로의 최초동작 시 LDO에 인가되는 과전압문제이다. 회로의 최초동작 시 슈퍼커패시터가 완전히 방전되어 있어 충전모드 시 입력과 슈퍼커패시터, LDO가 직렬로 연결되는 SCALDO 레귤레이터 특성 상 입력전압이 LDO에 짧은 시간동안 그대로 인가되는데, 입력전압이 출력전압보다 최소 2배 이상 크기 때문에 이는 LDO에 상당히 큰 부담이 될 수 있다. 본 논문에서는 이러한 과전압 문제를 해소하기 위해 회로 동작 전 슈퍼커패시터를 충전시킬 수 있는 사전충전부가 포함된 새로운 SCALDO 레귤레이터를 제안하였으며, 실험을 통해 동작 초기 LDO에 인가되는 과전압이 상당부분 감소됨을 확인하였다.
가산기는 기본적인 산술 연간 장치로써, 산술 연산 시스템 전체의 속도 및 전력소모에 결정적인 역할을 한다. 단일 비트 전가산기의 성능을 향상시키는 문제는 시스템 성능 향상의 기본적인 요소이다. 주 논문에서는 기존의 모듈 I과 모듈III를 거쳐 출력 Cout을 갖는 XOR-XNOR 구조와는 달리 모듈 I을 거치지 않고 입력 A, B, Cin에 의해 모듈III를 거쳐 출력 Cout을 갖는 새로운 구조를 이용한다. 최대 5단계의 지연단계를 2단계로 줄인 전가산기를 제안한다. 따라서 Cout 출력속도가 향상되어 리플캐리 가산기와 같은 직렬연결의 경우 더욱 좋은 성능을 나타내고 있다. 제안한 1Bit 전가산기는 static CMOS, CPL, TFA, HPSC, TSAC 전가산기에 비해 좋은 성능을 가지고 있다. 가장 좋은 성능을 나타내는 기존의 전가산기에 비해 4.3% 향상된 지연시간을 가지며 9.8%의 향상된 PDP 비율을 갖는다. 제안한 전가산기 회로는 HSPICE 툴을 이용하여 $0.18{\mu}m$ CMOS 공정에서 전력소모 및 동작속도를 측정하였으며 공급전압에 따른 특성을 비교하였다.
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[게시일 2004년 10월 1일]
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