Journal of the Institute of Electronics Engineers of Korea SD
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v.47
no.2
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pp.32-39
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2010
Conventional cell characterization does not consider Multiple Input Switching(MIS). Since the impact of MIS on gate delay variation is large, it is not possible to predict the accurate gate delay with the conventional cell characterization. We observed the maximum 46% difference in gate delay due tn MIS. In this paper, we propose a gate delay model considering the delay variation caused by the temporal proximity of MIS. The proposed model calculates the delay variation using the Radial Basis Function. The experimental results show that the proposed method can more accurately predict the gate delay when MIS occurs.
For popularization of virtual reality hardwares, VR sickness come from latency is huge problem. To reduce latency, most of the HMDs use cable for video transmission. However, cable causes spatial limitation that disturb user experience. For maximize user's immersion, wireless video transmission system is necessary. Unfortunately, wireless video transmission's latency is much longer than cable's latency. Prediction algorithms may reduce latency but cause jittering effect as a side effect. This paper experiment how jittering effect affects VR sickness. The result of experiment shows jittering effect make vr sickness worse. Future research about prediction algorithm should consider both prediction error and jittering effect.
Journal of Advanced Marine Engineering and Technology
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v.41
no.1
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pp.56-61
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2017
This paper presents a data prediction method and its application to haptic-based teleoperation systems. In general, time delays inevitably occur during data transmission in a network environment, which degrades the overall performance of haptic-based teleoperation systems. To address this situation, this paper proposes an autoregressive moving average (ARMA) model-based data prediction algorithm for estimating model parameters and predicting future data recursively in real time. The proposed method was applied to haptic data captured every 5 ms while bilateral haptic interaction was carried out by two users with an object in a virtual space. The results showed that the prediction performance of the proposed method had an error of less than 1 ms when predicting position-level data 100 ms ahead.
Journal of the Korean Institute of Intelligent Systems
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v.22
no.2
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pp.174-180
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2012
This paper proposes a decentralized adaptive output-feedback controller design for nonlinear interconnected systems with unknown time delays. The interaction terms with unknown delays are related to all states of subsystems. The time-delayed functions are compensated by using appropriate Lyapunov-Krasovskii functionals and function approximation technique. The observer dynamic surface design technique is employed to design the proposed memoryless local controller for each subsystem. In addition, we prove that all signals in the closed-loop system are semiglobally uniformly bounded and control errors converge to an adjustable neighborhood of the origin.
Journal of the Institute of Electronics Engineers of Korea SD
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v.42
no.11
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pp.41-48
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2005
The crosstalk effects that can be observed in the very dee submicron semiconductor chips are due to the coupling capacitances between interconnect lines. The accuracy of the full-chip timing analysis is determined by the accuracy of the estimated propagation delays of cells and interconnects within the chip. This paper presents a CMOS cell driver model and delay calculation algerian capturing the crosstalk effects due to the coupling capacitances. The proposed model and algorithm were implemented in a delay calculation program and used to estimate the propagation delays of the benchmark circuits extracted from a chip layout. We observed that the average discrepancy from HSPICE simulation results is within $1\%$ for the circuits with a victim affected by $0\~10$ aggressors.
본 논문은 정적 CMOS 회로의 단락 전류로 인한 전력소모와 게이트의 전달 지연시간을 구하기 위한 간단한 방법을 제시한다. 단락전류식은 게이트와 드레인 사이에 존재하는 커플링 커패시턴스의 영사한 후 모형화한 전류 수식을 기반으로 CMOS 회로의 지연 시간을 예측하기 위한 거시모형과 수식들을 제안하였다. 제안된 방법은 시뮬레이션을 통하여 현재의 기술 동향 특성인 신호 천이시간과 부하 커패시턴스가 감소하는 경우에 대해 이전의 연구보다 더욱 정확하고 신속히 예측할 수 있음을 보였다. 또한 제안된 거시 모형은 전류식이 변할지라도 전력소모와 타이밍 수준에서의 지연시간을 계산하는데 쉽게 적용이 가능하다.
In this study, present the most useful delay scan time by statistical analysis of SUVm data for 30 suspected pancreatic cancer patients. Two statistical analysis and a mathematical model was applied to the theoretical formula by glucose and insulin mechanics, and a mathematical model was created. Statistical analysis was performed via Metlab p/g. Optimal delay scan time was suggested by Metlab p/g for the change of SUV value over time.In this study, for diagnosis pancreatic cancer by dual time point PET/CT, propose optimal delay scan time 131.5 minuts. The proposed delay scan time showed statistical reliability applicable to the diagnosis of pancreatic cancer (p<0.05). Delayed scanning with the suggested delay scan time of 131.5 minutes is considered to be useful for the diagnosis of pancreatic cancer compared to general PET / CT scan.hen the delayed test is performed with the proposed delay scan time 131.5 minuts, Compared with general PET/CT scans.
Proceedings of the Korean Information Science Society Conference
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2000.04a
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pp.83-85
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2000
멀티미디어 서버는 시간 제약성을 가지는 멀티미디어 데이터를 정해진 시간 이내에 디스크로부터 검색해야 하므로 디스크 검색 요청 이전에 디스크 서비스 시간을 예측하여 제한된 시간 이내에 종료된다는 것을 보장해야 한다. 리눅스는 자원의 이용률 및 시스템 성능을 향상시키기 위해서 선행 읽기와 페이지 캐쉬 등의 기법들을 사용하고 있는데 이러한 기법들의 사용으로 디스크 서비스 시간은 매우 가변적이게 된다. 본 논문에서는 리눅스 파일 시스템을 개선하여 디스크 서비스 시간의 가변성이 최소화되도록 하고 이를 기반으로 정밀한 회전 지연 시간 모델에 의한 디스크 서비스 시간의 예측 기법을 제안한다.
제어대상 시스템에 시간지연과 외란이 동시에 존재하는 경우, 스미스 예측기와 외란 관측기를 함께 사용하면 시간지연과 외란으로 인한 시스템의 성능저하를 완화할 수 있다. 또한 유동적인 시간지연에 대비하여 시간지연을 갖는 2차 시스템 모델링 기법으로 설계된 PID 제어기를 이용하면 시간지연에 대해 강인한 제어 시스템을 얻을 수 있다. 한편, 이전에 사용된 2차 시스템 모델링 기법의 적용범위가 한정되어 있어 이 방법은 적분 공정을 포함하는 시스템의 제어 문제에는 적용되지 못하였다. 본 논문에서는 적분공정을 포함하는 시스템에 적용될 수 있는 새로운 2차 시스템 모델링 기법의 PID 제어기를 통해 외란과 시간지연에 강인한 제어기 설계 기법을 제안한다. 모의실험을 통해 이전의 방법과 그 성능을 비교한다.
Proceedings of the Korean Information Science Society Conference
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2001.04a
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pp.19-21
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2001
저전력 설계에 관한 프로세서 구조의 연구 중, CPU와 L1캐쉬 사이에 크기가 작은 LO 캐쉬를 사용하는 방법이 제시 된 바 있다. LO 캐쉬의 사용은 괄목할 만한 에너지 절약 효과를 거두었지만, 커다란 지연시간의 증가를 초래하였다. 따라서 LO 캐쉬는 필요에 따라서 선택적으로 사용이 되지 않으면 심각한 지연 시간의 증가로 인하여 실제 시스템에 적용하기 어려운 면을 가지고 있다. 선택적인 제어를 위한 방법으로서 몇몇 연구에서 예측기를 이용하는 방법을 제시하였으나, LO 캐쉬에 적합하지 않았다. 우리는 이 논문에서 새로운 가상적인 캐쉬 예측기를 제시하고 이에 대한 시뮬레이션 결과를 제시하였다.
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[게시일 2004년 10월 1일]
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