본 연구에서는 사각형태 화장품 케이스 사출성형 시 발생되었던 수지 미성형 불량을 해결하기 위하여 사출성형해석 기술을 통해 성형품 형상변경 및 사출금형 내 유동 시스템 수정방안 도출을 수행하였다. 대상제품인 사각형태 화장품 케이스는 상측부 케이스로서 케이스 외관에 게이트 및 취출흔적이 남지 않아야 함에 따라 측면부 게이트 적용으로 유동거리가 길어져 미성형 불량이 다수 발생하는 제품이다. 따라서, 수지 유동성 향상과 더불어 효율적인 보압전달을 통하여 수지 충전 및 변형발생 저감을 위하여 성형품 형상변화 및 유동시스템 변화에 따른 사출성형해석을 수행하고 결과를 고찰하였다. 이로써 최종적으로 수지 미충전으로 인한 미성형 불량을 제거하고 성형품 변형을 줄일 수 있는 수지유동시스템 수정방안을 제시하였다.
The design of gate and runner(delivery system) is one of the most important subject in injection molding. Delivery system is a channel to flow the polymer melt from the injection molding machine to the mold cavities. Also, delivery system affect quality and productivity of the part. The synthesis of delivery system of injection molding has been done empirically, since it requires profound knowledge about the moldability and causal effects on the properties of the part, which are not available to designers through the current CAD systems. GATEWAY is a knowledge module which contains knowledge to permit non-experts as well as mold design experts to generate the acceptable geometries of gate and runner far injection molded parts. A knowledge-based CAD system is constructed by adding the knowledge module, GATEWAY, to an existing geometric modeler. A knowledge-based CAD system is a new tool which enables the concurrent design and CIM with integrated and balanced design decisions at the initial design of injection molding.
본 연구는 IoT기반의 의료정보 처리를 위한 시스템 및 네트워크 기술 구현에 관련한 것이다. 본 연구의 구성환경은 IoT의 기본구성으로 센서노드, 게이트웨이, 서버노드의 구성이다. 센서노드로서의 의료단말이 게이트웨이에 연결요청을 하면 서버에 미리 등록된 의료장치일 경우 서버는 등록을 허가한다. 착용형 의료장치는 주기적으로 센싱정보를 수집하여 서버에 전달하고 서버는 이를 시각화하거나 미래사용을 위해 저장한다. 본 논문에서는 이에 필요한 전체 절차와 알고리즘을 기술하였고 소프트웨어 구조를 제안하였다.
한국천문연구원에서 개발 중인 KHz급 Satellite Laser Ranging(SLR) 시스템인 ARGO-M 의 운영시스템 중의 하나인 Interface Control System 은 현재 시각에서의 위성의 위치를 개산하여 추적마운트부에 Tracking 정보를 제공하고, 주기적으로 발사되는 레이저의 귀환 시간을 계산하여 수신광검출기 게이트를 열어야 하는 시간을 FPGA 보드에 전달하는 기능 등을 수행하게 된다. 이러한 일련의 작업은 각각 필요한 시점에 정확하게 실행되어야 하며 이를 위해 실시간 운영체계가 사용될 예정이다. 실시간 운영체계 하에서 Ranging 에 관련한 프로세스를 수행할 경우에 발생될 수 있는 문제점을 검토하기 위해서 기존에 Austria Graz SLR 관측소에서 사용하고 있는 DOS용 테스트 프로그램을 실시간 운영체계로 검토되고 있는 INtime 환경으로 이식하여 성능을 기존의 DOS 프로그램과 비교하여 보았다. Controller 역할을 담당하고 있는 FPGA 보드와의 데이터 통신의 주기성을 확인하는 시험 결과 실시간 운영체계를 사용하는 경우가 USB 사용 등 외적인 교란에 의한 영향을 적게 받는 것을 확인 할 수 있었다. 또한 500피코초 단위의 해상도를 갖는 내부 이벤트 타이머와의 연계, 레이저 발사 명령, 광검출기의 게이트 여닫기 등의 프로세스가 실시간 환경에서 문제점 없이 구현 가능함을 확인하였다.
인코딩은 정보의 형태나 형식을 표준화, 보안, 처리 속도 향상, 저장 공간 절약 등을 위해 다른 형태나 형식으로 변환 또는 처리 하는 것을 말한다. 정보 통신에서 송신자의 정보가 다른 형태로 수신자에게 전달할 수 있도록 정보를 변환하는 것도 인코딩이다. 이 처리를 수행 하는 장치를 인코더라 부른다. 본 논문에서는 양자 컴퓨터에서 요구되는 인코더 중 가장 기본적인 4-to-2 인코더를 제안한다. 제안한 인코더는 2개의 OR 게이트를 사용하여 구성된다. 제안한 구조는 셀의 간격을 최적화 하고 배선간의 잡음을 최소화하는 것을 목적으로 설계한다. 제안된 인코더를 QCADesigner를 통해 시뮬레이션을 수행하고, 그 결과를 분석하여 효율성을 확인한다.
사물인터넷 기술을 활용하기 위해서는 디바이스 간 연결을 위한 플랫폼이 필요하다. 이런 이유로 여러 기업이나 단체에서 각자의 플랫폼 개발에 힘을 쓰고 있다. 이 중 퀄컴 주도의 IoT 연합단체인 AllSeen Alliance에서 표준화한 IoT 오픈소스 플랫폼인 AllJoyn을 이용하여 WiFi나 Zigbee, Bluetooth 등 다양한 통신 기술들을 통해 들어오는 정보를 AllJoyn 플랫폼 방식으로 변환시키고 이를 다른 AllJoyn 디바이스에 전달하는 것을 연구한다. 궁극적으로 비 AllJoyn 디바이스들과 AllJoyn 디바이스 사이의 통신을 가능하게 하는 게이트웨이 시스템을 연구한다.
OSI 망과 TCP/OP 인터네트를 통합 관리하기 위해서 강력하고 융통성이 있는 패러 다임인 응용 게이트웨어가 사용되고 있지만 게이트웨어의 미시 관리 (micro management) 로 응급 상황에서 통신 지연과 시용이 증가하여 성능이 저하된다. 또한 서로 다른 방안 정책을 사용하는두 영역간에 접근 제어 정책을 사상하는 메카니즘이 필요하다. 이러한 문제는 서로 다른 표준으로 구성된 두 영역을 통합하는 데서 야기된다. 본 논문에서는 CMIP의 강력하고 융통성이 있는 서비스뿐만 아니라 관리 기능을 위임할 수 있는 응용 게이트웨어를 설계하였다. Diffie-Hellman의 키 분배 방식을 기반으로 하여 관리 서비스와 기능을 안전하게 전달하는 알고리즘을 정의하고 서로 다른 보안 정책을 사용하는 두 영역간에 안전한 통신이 보장될 수 있도록 보안 정책을 조정하는 메카니즘을 제시하였다.
본 논문에서는 게이트 레벌 소자와 스위치 레벨 소자가 함께 사용한 혼합형 조합 회로에서의 고착 고장(stuck-at fault) 검출을 위한 고장 시뮬레이션에 대하여 기술 한다. 실용적인 혼합형 회로의 고장 검출용으로 사용하기 위하여 게이트 레벨 및 정 적 스위치 레벨 회로는 물론 동적 스위치 레벨의 회로들도 처리할 수 있도록 한다. 또한, wired 논리 소자에서의 다중 신호 충돌 현상을 해결하기 위하여 새로운 6치 논 리값과 연산 규칙을 정의하여 신호 세기의 정보와 함께 사용한다. 고장 시뮬레이션의 기본 알고리즘으로는 게이트 레벨 조합 회로에서 주로 사용되는 병렬 패턴 단일 고장 전달(PPSFP:parallel pattern single fault propagation) 기법을 스위치 레벨 소자에 확장 적용한다. 마지막으로 스위치 레벨 소자로 구현된 ISCAS85 벤치 마크 회로와 실 제 혼합형 설계 회로에 대한 실험 결과를 통하여 본 연구에서 개발된 시스템의 효율 성을 입증한다.
본 논문은 H.264 움직임 예측을 위해 휘도 성분과 색차 성분의 부화소를 생성하는 효율적인 부화소 보간기 회로 설계에 대해 기술한다. 제안된 구조를 기반으로 한 회로는 보간 연산을 위해 입력 데이터를 버퍼링하지 않고 수평, 수직, 대각선의 부화소 보간을 병렬로 처리한다. 휘도성분에 대한 1/2 화소, 1/4 화소 보간과 색차 성분에 대한 1/8 화소 보간을 동시에 처리하여 회로 성능을 더욱 개선하였다. 회로 크기를 줄이기 위해 본 논문에서는 병렬로 보간 연산을 처리하는데 필요한 모든 중간 데이터를 레지스터 대신 내부 SRAM에 저장하였다. 제안된 구조를 레지스터 전달 수준의 회로로 기술하였고, FPGA 보드에서 동작을 검증하였다. 또한 구현된 회로를 130nm CMOS 표준 셀 라이브러리를 이용하여 게이트 수준의 회로로 합성하였다. 합성된 회로의 크기는 20,674 게이트이고 최대 동작 주파수는 244MHz이다. 회로에 사용된 SPSRAM의 전체 크기는 3,232 비트이다. 구현된 회로는 논리 게이트와 SRAM을 포함하여 다른 논문에서 제안한 회로에 비해 크기가 작고 성능도 우수하다.
본 논문은 밀리미터파 대역에서 사용될 PHEMT의 특성향상을 위한 연구의 일원으로 게이트 식각에 따른 소자의 특성 변화를 연구하였다. PHEMT는 ohmic 금속을 리세스 패턴으로 사용한 wide 리세스와 게이트 패턴을 리세스 패턴으로 사용한 narrow 리세스의 두가지를 이용하여 제작하였다. 제작된 PHEMT의 최대 전달컨덕턴스(g/sub m/)는 wide 리세스를 이용한 경우 332.7 mS/mm, narrow 리세스를 이용한 경우 504.6 mS/mm의 값을 각각 얻었다. 소신호 주파수 특성으로, wide 리세스를 이용하여 제작한 PHEMT는 전류 이득 차단주파수(f/sub T/) 113 GHz, 최대 공진 주파수(f/sub max/) 172 GHz를 각각 얻었다. Narrow 리세스를 이용하여 제작한 PHEMT의 전류 이득 차단주파수(f/sub T/)와 최대 공진 주파수(f/sub max/)는 101 GHz, 142 GHz를 각각 얻었다. 측정된 결과는 소신호 모델에서 각 파라미터의 변화와 비교, 분석하였다.
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[게시일 2004년 10월 1일]
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