• 한국멀티미디어학회:학술대회논문집
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• 한국멀티미디어학회 2003년도 춘계학술발표대회논문집
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• pp.5-9
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• 2003

장주기 격자 필터를 이용한 EDFA용 이득평탄화 필터 설계에는 대역폭에 따라 한 개에서 세 개까지의 평탄화가 가능하다 이러한 필터 설계는 EDFA의 고유의 중심 파장, 크기, 대역폭에 대한 각 장주기 광섬유 격자의 중심 파장, 크기, 대역폭을 설정하여 이득평탄화를 최적화시킨다. 이득평탄화 필터의 설계를 위한 방법으로써 수동 설계통한 이득평탄화를 했으나, 신속하고 편리함을 위해 반자동 설계, 자동 설계 프로그램을 구현하였다. 이를 통한 이득평탄화 정도는, 수동이 0.38dB, 반자동 0.57dB, 자동 0.62dB 정도로 정밀한 이득평탄화를 얻을 수 있는 설계가 가능하였다.

• 한국산학기술학회:학술대회논문집
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• 한국산학기술학회 2010년도 춘계학술발표논문집 1부
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• pp.119-123
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• 2010

본 논문에서는 2단계 잡음제거 방법의 이득함수를 이용한 고조파 복원 잡음제거 방법의 이득함수를 조정하여 기존의 방법보다 음성개선을 향상시켰고, 제안한 방법으로 개선된 음성을 음성인식 기술에 적용하였다. 본 논문에서는 기존 방법으로 음성개선 결과 묵음구간에서 음성구간으로 변화는 구간에서 이전 프레임의 추정된 음성신호로 스펙트럼의 이득함수가 구해져서 음성이 발생하는 구간에서 왜곡이 발생한다. 따라서 본 논문에서는 이러한 현상을 개선시키기 위해 2단계 잡음제거 방법의 이득함수를 추정된 a priori SNR과 비교하여 이득함수를 조정하고, 2단계 잡음제거 방법의 이득함수를 고조파 복원 방법의 이득함수와 비교하여 이득함수를 조정하여 음성을 개선하는 방법을 제안하였다. 그리고 음성인식을 위한 특징벡터 추출을 위해 제안한 방법으로 개선된 음성의 대수 에너지를 정규화 하는 대수 에너지 정규화 방법(Log Energy Normalization)을 음성인식 방법에 적용하였다.

• 한국광학회지
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• 제11권2호
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• pp.108-113
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• 2000

본 논문에서는 새롭게 제안한 ASE 차동 감시 방법을 이용하여 EDFA의 이득 과도 현상 및 정상상태의 이득 오차를 제어하는 방법에 대해 기술한다. 현재까지 EDFA의 과도현상을 해결하기 위해 제안된 방법들은 대부분 제어에 있어서 특정한 기준점을 필요로 하기 때문에 다양한 규격을 갖는 증폭기들에 적용하고자 할 때에는 증폴기 각각의 특성을 측정하여 제어 파라미터를 변경하거나 제어 회로를 수정해야 하는 불편이 있어Te. 본 논문에서는 이를 해결하기 위한 방법으로서 이득 대력양단의 ASE 파워를 서로 비교하여 얻은 이득 평탄도의 변화를 이득의 변화로 간주하는 이득 오차 검출기를 제안하였다. 제안한 방법은 이득과 이득 평탄도의 1:1 대응관계를 이용하는 것으로서, 밀도 반전의 변화를 직접적으로 반영할 뿐만 아니라, 그 동작에 있어서 제어 회로의 기준점을 필요로 하지 않기 때문에 하나의 회로를 서로 다른 이득 특성을 갖는 증폭기에 회로의 변경 없이 적용할 수 있다는 장점을 가지고 있다. 이를 검증하기 위해 실제 제작된 EDFA 및 여러 개의 EDFA로 연결된 링크를 대상으로 완전한 이득 고정 시스템을 구현하였는데 제작된 증폭기의 정상상태 이득 및 이득 고정 시스템의 설계 파라미터에 무관하게 정확한 이득 고정 성능을 얻을 수 있었다.

• 융합신호처리학회 학술대회논문집
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• 한국신호처리시스템학회 2001년도 하계 학술대회 논문집(KISPS SUMMER CONFERENCE 2001
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• pp.101-104
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• 2001

본 논문에서는 5GHz 대역을 사용하는 무선 LAN의 표준안인 IEEE 802.11a-1999를 위한 디지털 자동 이득 제어기를 제안한다. 송수신간의 동기화를 위한 신호인 Training symbol을 이용하여 수신기에 입력되는 신호의 이득을 측정한다. 측정된 이득을 이상적인 이득과 비교하여 갱신할 이득을 구한다. 갱신 이득은 신호를 증폭하는GCA(Gain Controlled Amplifier)의 입력 전압으로 변환되어 신호의 증폭도를 제어하게 된다. 본 논문에서는 하드웨어 부담을 줄이기 위해 부분 선형 근사방법을 이용하여, 갱신 이득을 GCA의 입력 전압으로 변환한다. 보다 정확한 제어를 위하여 이득 측정 및 제어 값의 갱신을 7회 반복하여 수행한다. 본 논문에서 제안한 디지털 자동 이득 제어기는 VHDL을 이용하여 설계하였으며, Xilinx CAD Tool을 이용하여 Timing Verification을 수행하였다.

• 한국광학회지
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• 제8권3호
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• pp.209-212
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• 1997

실리카가 주 매질인 에르븀 첨가 광증폭기의 1545-1557 nm의 파장 영역에서 이득 스펙트럼 특성과 EDFA를 여러 번 통과하면서 누적되는 특성을 측정, 분석하였다. 파장에 따른 이득 차이가 최소인 이득은 에르븀 첨가 광섬유의 길이가 정해지면 단일하게 결정되고(G$_{0}$), 이득 불균일의 정도는 동작 이득이 G일 때 G$_{0}$-G에 거의 비례하며 비례상수는 0.1~0.2 dB/dB의 값을 갖는다. 에르븀 첨가 광증폭기를 여러 번 지날 때 파장에 따른 이득불균일 및 신호대 잡음비 불균일은 계속 누적되며, 그 양은 통과한 EDFA의 수에 비례한다. 입력 신호광 세기 -20 dBm/ch., 이득 21 dB에서 최적화된 EDFA를 제작하여 파장에 따른 이득 및 잡음지수 특성을 측정한 결과, EDFA 12회 통과 후 파장에 따른 이득차는 5 dB, 잡음지수는 3 dB의 값을 나타냈다.

• 한국전자파학회:학술대회논문집
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• 한국전자파학회 2000년도 종합학술발표회 논문집 Vol.10 No.1
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• pp.146-149
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• 2000

SiGe HUT뜰 이용하여 Cellular 주파수 대역(824-849 MHz)에서 MMIC 상향 주파수 혼합기와 가변이득 증폭기를 설계하였다. 동작 전압은 2.7 V 이며, 이중평형 구조의 상향 주파수 혼합기는 12 dB의 변환이득, -0.6 dBm의 1dB 이득압축 출력전력, 30 dB 이상의 LO-RF 단자 격리도 특성, 1.25의 LO-VSWR. 1.34의 RF-VSWR을 가지며, 상호컨덕턴스형 가변이득 증폭기는 35 dB의 최대 선형이득, 13 dBm의 1dB 이득압축 출력전력, 42dB의 가변이득, 23dB의 3차 상호변조 교점 출력전력(OIP$_3$), 1.27의 입력 VSWR, 1.1의 출력 VSWR 특성을 보인다.

• 융합신호처리학회논문지
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• 제2권4호
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• pp.71-76
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• 2001

본 논문에서는 5GHz 대역을 사용하는 고속 무선 LAN의 표준안의 IEEE 802.11a-1999 를 위한 디지털 자동 이득 제어기를 제언한다. 송수신간의 동기화를 위한 신호인 training symbol을 이용하여 수신기에 입력되는 신호의 이득을 측정한다. 측정된 이득을 이상적인 이득과 비교하여 갱신할 이득을 구한다. 갱신 이득은 신호를 증폭하는 GCA(Gain Controlled Amplifer)의 입력 전압으로 변환되어 신호의 증폭도를 제어하게 된다. 본 논문에서는 하드웨어 부담을 줄이기 위해 부분 선형 근사방법을 이용하여 갱신 이득을 본 논문에서 제안한 디지털 자동 이득 제어기는 VHDL을 이용하여 설계하였으며, Xilinx cAD tool을 이용하여 timing verification을 수행하였다.

• 한국정보통신학회:학술대회논문집
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• 한국정보통신학회 2013년도 추계학술대회
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• pp.354-356
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• 2013

본 논문에서는 CMOS 스위치를 이용한 디지털 이득 제어 구조를 가진 이득 조절 증폭기 (PGA, Programmable Gain Amplifier)를 제안한다. 기존의 아날로그 이득 제어 방식에서는 가변적인 트랜스 컨덕턴스를 활용하는 과정에서 바이어스 전류나 전압에 의해 이득이 변하게 되어 순간적으로 구성회로의 바이어스 포인트가 변하기 때문에 왜곡이 발생하게 되는 문제점이 있다. 본 논문에서는 이러한 문제점을 해결하기 위해 기존의 gm-boosting 증폭기를 변형한 디지털 이득 제어 방식으로 설계되어 있기 때문에 우수한 선형성을 가지며 특수 목적에 맞도록 그 이득을 6dB에서 60dB까지 7가지 단계로 조절 가능하다. 제안한 PGA는 기존 회로에 비해 0.2dB 보다 작은 이득오차와 0.47mW의 낮은 소비전력 특성을 보였다.

• 한국통신학회논문지
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• 제17권8호
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• pp.867-880
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• 1992

본 논문에서는 갈륨비소 연산 증폭기의 입력단 설계에 있어서 기초가 되는 차동 증폭기에 사용될 이득 증가 기법을 적용한 단일 증폭기와 새로운 구성의 전류 미러를 설계하였다.차동 전압 이득을 높이기 위하여 단일 증폭기의 bootstrap 이득 증가 기법을 이용하여 차증 증폭기를 구성하였다. 차동 증폭기에 사용되는 정전류원으로서 주파수 특성이 우수한 선형 역상 전류 미러를 사용하여 회로의 안정화를 꾀하였다. 또한, 동상 전압 이득을 감소시키기 위하여 common mode feedback을 사용함으로써 차동 증폭기의 성능 평가에 있어서중요한 CMRR을 높였다.PSPICE를 통한 시뮬레이션 결과, 기본 단일 증폭기의 이득은 29.dB인데 비하여 새로 설계된 new bootstrapped 이득 증가 기법을 사용한 경우에는 57.67db로써 이득이 28.26dB 개선되었음을 알 수 있었다. 또한, 본 논문에서 설계한 차동 증폭기는 차동 이득이 57.66dB, CMRR이 83.98dB로써 기존의 논문보다 향상되었고 주파수 특성면에서도 차단 주파수가 23.26GHz로써 우수함을 입증하였다.

• 전자공학회논문지SC
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• 제40권6호
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• pp.68-77
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• 2003

생체 임피던스 측정에 사용되는 프론트 엔드의 입력 커패시턴스를 상쇄시키며, 편하고, 작은 이득 여유로도 안정하게 동작하는 제안된 네가티브 커패시턴스 회로를 제안하였다. 기존의 회로를 사용하기 위해서는 적절한 이득-대역폭 적을 갖는 연산 증폭기를 선택해야 하는데 비하여 제안하는 회로는 광대역 연산 증폭기를 사용하므로 연산 증폭기의 선택이 쉽다. 또한 이득 여유가 귀환 커패시터에 직렬로 연결된 귀환 저항에 의하여 조절되므로 이득 여유를 가변 저항기로 튜닝할 수 있다. 제안된 회로의 입력 임피던스는 기존회로의 임피던스보다 2배 크며 네가티브 커패시턴스 회로를 채용하지 않았을 때에 비하여 40배 크다. 나아가서 제안된 회로의 폐루프 위상 응답은 기존의 회로와 네가티브 커패시턴스 회로를 채용하지 않았을 때에 비하여 좋다. 무엇보다도 이득 피킹이 발생하더라도 제안된 회로에서 이득 피킹의 주파수는 루프 이득이 최대로 되는 주파수 보다 높으므로, 이득 여유가 이득 피킹의 영향을 거의 받지 않는다. 따라서 제안된 회로는 매우 작은 이득 여유로도 안정하게 동작할 수 있다.