• Title/Summary/Keyword: 유기메모리

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유기물에서 내부의 트랩 분포 변화에 따른 전자 이동도 현상

  • Yu, Ju-Hyeong;Kim, Dong-Hun;Kim, Tae-Hwan
    • Proceedings of the Korean Vacuum Society Conference
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    • 2012.02a
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    • pp.416-416
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    • 2012
  • 유기물을 기반으로 하는 유기발광소자, 유기메모리 및 유기 태양전지 등과 같은 차세대 전자소자는 기존의 무기물 기반의 소자에 비해 가격이 싸고 제작방법이 간단하며 휘어지게 만들 수 있다는 장점을 갖기 때문에 많은 관심을 받고 있다. 유기물을 기반으로 한 전자 소자의 효율을 향상시키기 위해서는 유기물질이 갖는 고유의 물리적 특성에 관한 연구가 중요하다. 특히, 유기물 내에서의 전하 전송 메카니즘을 이해하기 위해 유기물의 전자 이동도에 대한 연구가 중요하나, 아직까지 유기물질을 기반으로 한 전자 소자의 전자 이동도에 대한 이론적인 연구가 비교적 적다. 본 연구에서는 유기물 내에서의 트랩 분포 변화에 따른 전자 이동도를 몬테카를로 방법을 이용하여 계산하였다. 시뮬레이션을 위한 기본 구조로 소자의 길이는 30-300 사이트로 하였으며, 이웃한 사이트간 거리는 $3{\acute{\AA}}$로 결정하였다. 유기물 내에 존재하는 트랩의 분포는 가우시안 분포로 가정하였고, 트랩의 분산도와 트랩 총량을 변화시켜 계산하였다. 이웃한 트랩간의 천이 확률을 Miller and Abrahams 식을 이용하여 계산하고, 트랩간의 천이시간을 랜덤 변수로 결정하였고, 이들을 통계적으로 처리하여 유기물 내에서의 전자 이동도를 계산하였다. 시뮬레이션 결과는 유기물의 트랩분포가 일정할 경우 전자 이동도는 전계가 증가함에 따라 일정하게 증가하다가 일정 전계에서 포화된 후 다시 감소한다. 초기의 전계 영역에서는 전계의 증가에 따라 유기물 내 트랩간의 천이 확률이 증가하기 때문에 전자 이동도가 증가한다. 하지만, 일정 전계 이상에서는 전자의 이동 속도가 거의 변하지 않기 때문에, 전계의 증가에 따라 전자 이동도는 오히려 줄어들게 된다. 트랩의 분산도가 증가함에 따라 낮은 전계 영역에서는 전자 이동도가 작고, 전계가 증가할수록 분산도와 상관없이 전자 이동도가 비슷한 값으로 수렴한다. 트랩의 분산도가 30 meV로 작을 경우에 일정 온도 이상에서의 전자 이동도는 포화되어 일정한 값으로 유지한다. 유기물 내에 존재하는 트랩 분포에 따라 온도의 변화가 전자 이동도에 미치는 영향이 달라짐을 알 수 있다. 이러한 결과는 유기물질을 기반으로 한 전자소자에서의 전하 전송 메카니즘을 이해하고 소자의 제작 및 특성 향상에 도움이 된다고 생각한다.

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SiC/SiNx 복합층을 열처리에 의하여 형성된 SiC 나노입자의 광학적 성질

  • Park, Hun-Min;O, Do-Hyeon;Kim, Tae-Hwan
    • Proceedings of the Korean Vacuum Society Conference
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    • 2013.02a
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    • pp.393-393
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    • 2013
  • 나노입자를 포함하는 합성물은 전자소자와 광전소자의 응용 가능성 때문에 많은 연구가 진행되고 있다. 복합층을 사용한 소자의 전기적 성질에 대한 연구는 많이 진행되었으나, SiC/SiNx 다층 복합층 소자에 대한 광학적 특성에 대한 연구는 상대적으로 미흡하다. 본 연구는 SiC/SiNx 다층 복합층을 사용하여 스퍼터링 방법으로 형성하고 열처리를 사용하여 복합층의 미세구조와 광학적 특성을 조사하였다. SiNx층을 p-형 Si 기판 위에 성장한 후 SiC층을 형성하였다. 3번의 주기적인 성장으로 다층구조를 형성하고, 30분 동안 열처리 하였다. 투과전자현미경상은 SiC/SiNx 복합층에 SiC 나노입자가 형성한 것을 확인하였다. 광류미네센스 스펙트럼 결과는 형성한 SiC/SiNx 복합층을 열처리할 때 SiC층에서 나타나는 주된 피크 위치가 변위되는 것을 보였다. 광류 미네센스 스펙트럼 결과에서 나타난 주된 피크가 열치리에 따라 변화하는 원인을 규명하였다.

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Design and Implementation of Smart Card Payment System on the Web (웹 상에서 스마트카드 지불 시스템 설계 및 구현)

  • 김소희;김증섭;유기영
    • Proceedings of the Korean Information Science Society Conference
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    • 1999.10c
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    • pp.549-551
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    • 1999
  • 웹 상에서의 전자 상거래는 고객과 상인간의 정보 보호와 대금 결제의 신뢰성이 보장되어야 한다. 스마트카드는 자체내의 메모리기능과 연산기능을 가진 IC 카드로써 사용자 인증과 개인정보 보호 기능이 탁월하다. 따라서, 신용 카드 기반의 전자 지불 프로토콜의 표준인 SET을 사용하여, 보안 기능이 뛰어난 스마트카드를 지불 수단으로 하는 안전하고 효율적인 스마트카드 전자 지불 시스템을 설계하고 자바로 구현하였다. 본 논문에서 구현한 지불 시스템은 지불 정보와 주문 정보의 기밀성을 제공하고, 공개키 기반의 암호 체계로 데이터의 무결성을 보장한다.

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Scheduling of loop with carried dependence using thread (쓰레드를 이용한 루프 캐리 종속성을 가진 루프의 스케쥴링)

  • 김현철;이종국;유기영
    • Proceedings of the Korean Information Science Society Conference
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    • 2000.04a
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    • pp.627-629
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    • 2000
  • 루프를 병렬 처리하기 위해 공유 메모리 다중처리기에 루프를 할당하는 네 가지 기법들을 루프 캐리 종속성(loop-carried dependence)을 가진 루프의 할당에 적용하기 위해 하여 변형 후 그들의 성능을 비교 분석한다. 구현은 자바 쓰레드 환경에서 하였다. 또한, 반복들간에 종속 관계가 생기는 루프의 효율적 수행을 위해 CDSS(Carried-Dependence Self-Scheduling)할당 기법을 제안한다. 종속 거리, 쓰레드 수, 반복 수등을 다양하게 하여 시뮬레이션 해 본 결과 제안한 CDSS는 양호한 부하 균형을 유지하였으며 다른 기법들에 비해 루프 수행 시간을 줄여 효율적임을 알 수 있었다.

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Exploration of Functional Parallelism using threads (스레드를 이용한 함수 병렬성 추출)

  • 김현철;이성우;류시룡;유기영
    • Proceedings of the Korean Information Science Society Conference
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    • 2000.10c
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    • pp.633-635
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    • 2000
  • 본 논문에서는 프로그램을 루프 구조에 근거하여 계층적으로 표현한 HTG (Hierarchical Task Graph)의 복합 노드 태스크들을 공유 메모리 다중처리기 환경에서의 효율적 수행을 위한 새로운 스케쥴링 기법을 제안한다. 단일처리기의 멀티스레드 구조를 비롯한 여러 플랫폼에 적용하기 위해 자바의 스레드를 사용하여 구현하였으며, 기존의 HTG의 함수 병렬성을 위한 비티 벡터 알고리즘과 성능을 비교 분석하였다. 실험 결과에서 보듯이, 제안된 기법이 비트 벡트 방법에 비해 수행 시간 측면에서 효율적임을 알 수 있으며 또한, 좋은 부하 균형을 유지하였다.

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Effects of structure of Organic Bi-stable Device on the memory characteristics (유기쌍안정소자의 구조가 메모리특성에 미치는 영향)

  • Lee, Jae-June;Kong, Sang-Bok;Hwang, Sung-Beom;Song, Chung-Kun
    • Proceedings of the IEEK Conference
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    • 2006.06a
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    • pp.483-484
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    • 2006
  • In this paper, we fabricated the organic bi-stable devices under the different condition from the other groups and analyzed the electrical characteristics. Then we investigated the effects of the device structure such as organic layer thickness, middle metal layer thickness and middle metal layer deposition rate on the memory characteristics.

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Stress Induced Leakage Currents in the Silicon Oxide Insulator with the Nano Structures (나노 구조에서 실리콘 산화 절연막의 스트레스 유기 누설전류)

  • 강창수
    • Journal of the Institute of Electronics Engineers of Korea TE
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    • v.39 no.4
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    • pp.335-340
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    • 2002
  • In this paper, the stress induced leakage currents of thin silicon oxides is investigated in the ULSI implementation with nano structure transistors. The stress and transient currents associated with the on and off time of applied voltage were used to measure the distribution of high voltage stress induced traps in thin silicon oxide films. The stress and transient currents were due to the charging and discharging of traps generated by high stress voltage in the silicon oxides. The transient current was caused by the tunnel charging and discharging of the stress generated traps nearby two interfaces. The stress induced leakage current will affect data retention in electrically erasable programmable read only memories. The oxide current for the thickness dependence of stress current, transient current, and stress induced leakage currents has been measured in oxides with thicknesses between 113.4${\AA}$ and 814${\AA}$, which have the gate area $10^3cm^2$. The stress induced leakage currents will affect data retention and the stress current, transient current is used to estimate to fundamental limitations on oxide thicknesses.

Plasma Polymerized Styrene for Gate Insulator Application to Pentacene-capacitor (유기박막트랜지스터 응용을 위해 플라즈마 중합된 Styrene 게이트 절연박막)

  • Hwang, M.H.;Son, Y.D.;Woo, I.S.;Basana, B.;Lim, J.S.;Shin, P.K.
    • Journal of the Korean Vacuum Society
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    • v.20 no.5
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    • pp.327-332
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    • 2011
  • Plasma polymerized styrene (ppS) thin films were prepared on ITO coated glass substrates for a MIM (metal-insulator-metal) structure with thermally evaporated Au thin film as metal contact. Also the ppS thin films were applied as organic insulator to a MIS (metal-insulatorsemiconductor) device with thermally evaporated pentacene thin film as organic semiconductor layer. After the I-V and C-V measurements with MIM and MIS structures, the ppS revealed relatively higher dielectric constant of k=3.7 than those of the conventional poly styrene and very low leakage current density of $1{\times}10^{-8}Acm^{-2}$ at electric field strength of $1MVcm^{-1}$. The MIS structure with the ppS dielectric layer showed negligible hysteresis in C-V characteristics. It would be therefore expected that the proposed ppS could be applied as a promising dielectric/insulator to organic thin film transistors, organic memory devices, and flexible organic electronic devices.

Organo-Compatible Gate Dielectrics for High-performance Organic Field-effect Transistors (고성능 유기 전계효과 트랜지스터를 위한 유기친화 게이트 절연층)

  • Lee, Minjung;Lee, Seulyi;Yoo, Jaeseok;Jang, Mi;Yang, Hoichang
    • Applied Chemistry for Engineering
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    • v.24 no.3
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    • pp.219-226
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    • 2013
  • Organic semiconductor-based soft electronics has potential advantages for next-generation electronics and displays, which request mobile convenience, flexibility, light-weight, large area, etc. Organic field-effect transistors (OFET) are core elements for soft electronic applications, such as e-paper, e-book, smart card, RFID tag, photovoltaics, portable computer, sensor, memory, etc. An optimal multi-layered structure of organic semiconductor, insulator, and electrodes is required to achieve high-performance OFET. Since most organic semiconductors are self-assembled structures with weak van der Waals forces during film formation, their crystalline structures and orientation are significantly affected by environmental conditions, specifically, substrate properties of surface energy and roughness, changing the corresponding OFET. Organo-compatible insulators and surface treatments can induce the crystal structure and orientation of solution- or vacuum-processable organic semiconductors preferential to the charge-carrier transport in OFET.

Efficient On-the-fly Detection of First Races in Shared-Memory Programs with Nested Parallelism (내포병렬성을 가진 공유메모리 프로그램의 수행중 최초경합 탐지를 위한 효율적 기법)

  • 하금숙;전용기;유기영
    • Journal of KIISE:Computer Systems and Theory
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    • v.30 no.7_8
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    • pp.341-351
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    • 2003
  • For debugging effectively the shared-memory programs with nested parallelism, it is important to detect efficiently the first races which incur non-deterministic executions of the programs. Previous on-the-fly technique detects the first races in two passes, and shows inefficiencies both in execution time and memory space because the size of an access history for each shared variable depends on the maximum parallelism of program. This paper proposes a new on-the-fly technique to detect the first races in two passes, which is constant in both the number of event comparisons and the space complexity on each access to shared variable because the size of an access history for each shared variable is a small constant. This technique therefore makes on-the-fly race detection more efficient and practical for debugging shared-memory programs with nested parallelism.