본 논문은 철근 콘크리트에 대한 전자기적 모델링을 하고, 전파에 대한 차폐 효과를 분석하였다. 철근 콘크리트는 대부분의 건축물에 쓰이고 있으며, 내부에 격자 구조의 철근을 설치하기 때문에 특정 주파수 대역에서 전파의 차폐 효과가 있다. 철근 콘크리트의 해석은 3D EM(3-dimensional electromagnetic) 시뮬레이션 툴을 이용하여 철근과 콘크리트를 각각 해석한 뒤 그 영향을 고려하여 전체 철근 콘크리트의 해석을 하였다. 콘크리트의 경우 주파수가 높아짐에 따라 손실 특성 역시 높아져 차폐 효과가 커진다. 단층 철근의 경우 철근의 두께가 두꺼워질수록 차폐 효과가 커지며 주파수가 낮을수록 철근에 의한 차폐 효과가 커지는 것을 분석하였다. 또한, 철근과 철근 사이의 간격이 넓어질수록 차폐 효과가 낮아진다. 철근 구조를 2층으로 확장한 경우에 대해서도 철근과 철근 층 사이의 거리에 따른 차폐 효과에 대한 분석을 하였다. 철근 콘크리트 단층 철근을 사용한 경우, 철근두께 가 10, 20, 30 mm일 때 500 MHz에서 각각 철근 콘크리트 두께 10 cm당 -1.89, -2.73, -4.76 dB/10 cm의 투과 특성 값을 가지며, 두 층 철근을 이용한 경우에도 철근 두께에 대하여 -2.46, -6.16, -9.55 dB/10 cm의 투과 특성을 나타낸다.
태양전지를 실제적인 건물의 한 구성요소로 이용하는 건물일체형 태양광발전(BIPV : Building Integrated Photovoltaic) 시스템은 기존의 건물재료를 대체하여 재료비용 및 건설비용의 절감효과를 가져다주며 건물의 미적인 가치를 높여주는 장점을 가지고 있다. BIPV에 대한 연구가 유럽 및 미국, 일본 등의 나라에서 오래전부터 활발히 수행되고 있으며, 시장성 또한 무한 확대되고 있다. 아치형 PV 시스템은 PV 어레이의 직병렬 연결 상태 및 아치각에 따라 효율 특성이 상이하지만 이에 관한 분석은 미흡하며, 아치형 PV 시스템을 설계함에 있어서 미적인 요소만 고려하고 이러한 발전효율에 관한 요소는 전혀 고려되지 않은 채 설계되고 있다. 본 논문에서는 아치형 PV 시스템의 효율에 관한 파라미터인 위도와 경도, 온도 및 일사량, 아치각, 시스템 구성에 따른 각종 손실 등 이에 대한 세부적인 기술검토와 각 장비들의 특성을 정합시켜 아치형 PV 시스템의 최적화를 이루어 효율을 개선시키고자 한다. 아치형 PV 시스템의 효율개선을 위하여 다중제어 인버터 방식을 제안하고 시뮬레이션 툴인 Solar Pro를 이용하여 평판형 및 다양한 아치형 PV 시스템을 구성하여 운전특성을 비교 분석하였다.
본 논문에서는 유전체가 삽입된 공진기를 이용하여 C-band용 대역통과 여파기를 설계, 제작하였다. 공진기의 높이는 인접 유전체 공진기의 도파관 차단 주파수로부터 결정된다. 공진기의 지름은 도체 손실을 고려하여 유전체의 두 배로 결정하였다. 유전체 공진기의 공진주파수는 비소멸(non-decaying) 모드 해석법으로 계산하였다. 일반적으로 원통형 유전체 공진기의 공진주파수는 Cohn 모델로 해석하였는데, 이것은 공진기의 벽과 유전체벽 사이에서 전자파가 소멸(decaying)된다는 가정 하에 해석한 방법이다. 그러나, 이 방법은 근사적인 해석방법이다. 외부양호도(external quality factor)인 $Q_{ex}$는 Ansoft의 Maxwell 시뮬레이션 툴을 사용하여 결정하였다. 유전율 45인 유전체를 사용하여 설계한 대역통과 여파기는 5.065GHz의 중심주파수를 가졌다. 삽입손실은 1dB, 밴드 폭은 20MHz, 감쇠 특성은 30dB$(f_0{\pm}15MHz)$)로 설계목표에 만족함을 알 수 있다.
페이스북, 싸이월드 등의 소셜 네트워크 서비스(Social Network Service: SNS)가 발전하면서, 이를 기반으로 하는 소셜 네트워크 게임, 소셜 커머스 등의 서비스도 활성화되고 있다. 특히, 소셜 네트워크 게임(Social Network Game: NG)은 기존 온라인 게임보다는 규모가 가볍고, 친구들끼리 쉽게 즐길 수 있다는 점에서 사람들에게 많은 호응을 얻고 있다. 이러한 소셜 네트워크 게임 시장 규모는 해가 지날수록 점점 커지고 있지만 게임 개발 측면에서는 아직 미흡한 부분이 많다. 특히, 현재 나온 대부분의 개발엔진들이 온라인 게임이나 콘솔 게임에 초점이 맞춰져 있고, 소셜 네트워크 게임의 특징에 적합한 전용 엔진이 거의 없는 상황이어서 소셜 네트워크 게임을 개발하는데 많은 시간이 소요된다. 본 논문에서 제시한 엔진은 기존의 게임 엔진이 가지는 요소 및 특징뿐만 아니라 소셜 네트워크 게임의 특징을 고려하여 소셜 네트워크 게임 개발에 최적화하여 설계하였다. 또한 소셜 게임 장르 중 가장 많은 비율을 차지하는 시뮬레이션 게임을 구현하기 위해 필요한 맵과 캐릭터 애니메이션을 쉽게 구현할 수 있는 모듈과 툴을 제공한다. 본 논문에서 구현된 엔진은 이미지, 텍스트 및 캐릭터 출력 속도를 기준으로 성능을 평가하였고, 실험 결과 이미지, 텍스트 및 캐릭터 모두 게임을 구현하기에 충분히 빠른 출력 속도를 보여주었다.
본 논문은 테스트 프로브의 플런저 접점 위치와 구조에 따른 신호 전달 특성 변화를 분석하였다. 플런저 접점 위치는 실제 동작 상황을 고려하였으며, 플런저 내부 접점과 바렐 입구 접점으로 나누어 테스트 프로브의 고주파 성능 변화를 조사하였다. 또한 테스트 프로브는 더블, 싱글, 아웃스프링의 3 가지 구조로 나누고 구조 차이에 따른 신호 전달 특성 변화를 분석하였다. 고주파 전자기 해석 툴 HFSS를 사용하여 삽입손실과 반사손실을 계산하고, Q3D 시뮬레이션을 이용하여 테스트 프로브의 임피던스를 분석한다. 접점 위치에 따른 계산 결과, 바렐 입구 접점의 삽입손실이 플런저 내부 접점보다 감소하였다. 이를 통해 테스트 프로브의 접점 위치에 따라 테스트 프로브의 고주파 성능이 달라질 수 있음을 확인하였다. 구조에 따른 신호 전달 특성의 비교 분석에서는 아웃스프링 프로브가 보다 우수한 삽입손실과 반사손실 주파수 특성을 보여주었다. 테스트 프로브 구조별로 특성 임피던스를 계산하였으며 더블 프로브와 싱글 프로브는 $30.8{\Omega}$으로 동일한 결과를 보여주었다. 반면에 아웃스프링 프로브는 $47.1{\Omega}$의 결과가 나타났다. 아웃스프링 프로브의 특성 임피던스가 $50{\Omega}$에 보다 근접하여 높은 신호 전달 특성을 보인 것으로 분석된다. 아웃스프링 프로브가 높은 삽입손실과 반사손실 특성을 보여 고속 동작 제품의 성능 검사에 적합한 것으로 예상한다.
IT 시스템 기반의 네트워크 환경의 급속한 발전은 지속적인 연구방향의 중요한 이슈의 결과이다. 침입시도 탐지는 관심분야의 하나인 것이다. 최근에 다양한 기술을 기반으로 하는 침입시도탐지들이 제안되고 있으나 이러한 기술은 여러 형태의 침입시도의 패턴 중에 한가지 형태 및 시스템에 적용이 가능한 것이다. 또한 새로운 형태 침입시도를 탐지하지 못하고 있다. 그러므로 새로운 형태를 인식하는 침입탐지 관련 기술이 요구되어 지고 있다. 본 연구에서는 퍼지인식도와 비정상 트래픽 분석을 이용한 네트워크 기반의 침입탐지기법(NePID)을 제안한다. 이 제안은 패킷 분석을 통하여 서비스거부공격과 유사한 침입시도를 탐지하는 것이다. 서비스거부공격은 침입시도의 형태를 나타내며 대표적인 공격으로는 syn flooding 공격이 있다 제안한 기법은 syn flooding을 탐지하기 위하여 패킷정보를 수집 및 분석한다. 또한 피지인식도와 비정상 트래픽 분석을 적용하여 판단모듈의 분석 결과를 토대로 기존의 서비스 거부 공격의 탐지 툴과의 비교분석을 하였으며 실험데이터로는 MIT Lincoln 연구실의 IDS 평가데이터 (KDD'99)를 이용하였다. 시뮬레이션 결과 최대평균 positive rate는 97.094% 탐지율과 negative rate는 2.936%을 얻었으며 이 결과치는 KDD'99의 우승자인 Bernard의 결과치와 유사한 수준의 값을 나타내었다.
IETF CoRE WG은 IoT (Internet of Things) 환경에서 웹기반 응용 서비스를 지원하기 위해 CoAP (Constrained Application Protocol)를 표준화하고 있다. 하지만, CoAP 표준에서는 CoAP 센서 노드의 이동성에 대해서는 고려하지 않았다. 본 논문에서는 IoT 환경에서의 제한된 네트워크의 특징을 고려한 CoAP 센서 노드의 이동성 관리를 제공 할 수 있는 이동성 관리 프로토콜을 제안한다. 제안된 CoAP 센서를 위한 이동성 관리 프로토콜은 CoAP 센서 노드가 서로 다른 네트워크로 움직이는 동안에 웹 클라이언트가 CoAP 센서 노드로부터 신뢰성 있는 센싱 정보를 전송 받을 수 있게 된다. 이를 위해, 본 논문에서는 CoAP 센서 노드의 IP 주소를 별도로 관리하는 이동성 관리 구조를 설계하였고, 신뢰성 있는 센싱 정보 전달을 위해, 홀딩 (Holding Mode) 및 바인딩 모드 (Binding Mode)을 사용한 이동성 관리 프로토콜을 제시했다. 마지막으로, 핸드오버 지연과 패킷 손실 성능에 대해 제안된 CoAP 센서 노드의 이동성 관리 프로토콜과 기존의 이동성 관리 프로토콜간 수학적 분석과 네트워크 시뮬레이션 툴을 활용한 성능 분석을 수행하였다. 성능결과는 제안된 이동성 관리 프로토콜이 기존의 이동성 관리 프로토콜에 비해 패킷손실 없이 센싱 데이터를 신뢰성있게 전송 할 수 있다는 것을 보여준다.
본 연구에서는 한국형 달 탐사 시험용 궤도선을 위한 심우주 추적망 (Deep Space Network)의 관측값을 구현하는 알고리즘을 개발하였다. 이 알고리즘을 활용하여 탐사선의 신호 지연 효과를 관측 모델을 통해 보정해서 계산된 관측값을 생성할 수 있다. 계산된 관측값으로 거리, 도플러, 방위각, 고도각을 생성하였다. 기하학적 데이터 값을 General Mission Analysis Tool (GMAT)의 시나리오를 통해 구하였으며, 계산된 관측값을 구하기 위해서 시간 지연 효과, 대류층 지연 효과, 대류권 내 하전 입자에 의한 지연 효과, 대류권 밖 하전 입자에 의한 지연 효과, 대류층에 의한 굴절 효과, 안테나에 의한 지연 효과를 고려하였다. 관측 모델들을 통해 구한 계산된 관측값은 시험용 궤도선의 정밀 궤도 결정을 위해 사용된다. 본 논문에서 개발한 데이터 시뮬레이션 모듈은 미 항공우주국의 궤도 결정 툴 박스 (Orbit Determination ToolBoX, ODTBX)를 이용해 검증되었다.
반도체 기술과 멀티미디어 통신기술이 발달하면서 고품위 영상과 다중 채널의 오디오에 관심을 갖게 되었다. MPEG 오디오 계층 3 디코더는 표준안에 기반을 둔 프로세서로써 기존에 많이 구현되어 있다. MPBG-1오디오 계층3 디코더의 합성필터는 디코더 전체에서 가장 많은 연산을 필요로 하기 때문에 고속 프로세서를 설계하기 위해서는 연산량을 줄일 수 있는 새로운 방식의 합성필터를 필요로 한다. 따라서 본 논문에서는 MPEG-1 오디오 계층 3의 핵심부분인 합성필터 부분을 DALUT (distributed arithmetic look-up table)방식을 이용하여 FPGA (Field Programmable Gate Array)에 구현하였다. 고속 필터를 설계하기 위해서 승산기 대신에 DALUT방식을 사용하였고, 파이프라인 구조를 사용하였으며, 데이터를 코사인 함수와 곱셈한 결과를 테이블로 만듦으로써 곱셈기를 제거하여 30%의 성능향상을 얻었다. 본 논문에서의 하드웨어 설계는 모두 VHDL (VHSIC Hardware Description Language)로 기술하였다. VHDL 시뮬레이션은 ALDEC사의 Active-HDL 6.1과 Model-sim 및 합성은 Synplify Pro 7.2v을 사용하였다. 대상 라이브러리는 XILINX사의 XC4010E, XC4020BX, XC4052 XL, P&R 툴은 XACT Ml.4를 사용하여 구현하였다. 구현된 프로세서는 20MHz∼70MHz사이에서 동작한다.
본 논문에서는 FPGA를 이용하여 산업용 구동장치로 널리 사용되고 있는 유도 전동기의 디지털 전류 제어시스템을 구현하였다. 이를 위해 VHDL을 이용하여 FPGA를 설계하였으며 이 FPGA는 PWM 발생부, PWM 보호부, 회전속도 검출부, 프로그램 폭주 방지부, 인터럽트 발생부, 디코더 로직부, 신호 지연 발생부 및 디지털 입·출력부로 각각 구성되어있다. 본 FPGA의 설계시 고속처리의 문제점을 해결하기 위해 클럭전용핀을 활용하였으며 또한 40 MHz에서도 동작할 수 있는 삼각파를 만들기 위해 업다운 카운터와 래치부를 병렬 처리함으로써 고속화하였다. 특히 삼각파와 각종 레지스터를 비교 연산할 때 많은 팬아웃 문제에 따른 게이트 지연(gate delay) 요소를 줄이기 위해 병렬 카운터를 두어 고속화를 실현하였다. 아울러 삼각파의 진폭과 주파수 및 PWM 파형의 데드 타임 등을 소프트웨어적으로 가변 하도록 하였다. 이와 같은 기능들을 FPGA로 구현하기 위하여 퀵로직(Quick Logic)사의 pASIC 2 SpDE와 Synplify-Lite 합성툴을 이용하여 로직을 합성하였다. 또한 Verilog HDL 환경에서 최악의 상황들(worst cases)에 대한 최종 시뮬레이션이 성공적으로 수행되었다. 아울러 구현된 FPGA를 84핀 PLCC 형태의 FPGA로 프로그래밍 한 후 3상 유도전동기의 디지털 전류 제어 시스템에 적용하였다. 이를 위해 DSP(TMS320C31-40 MHz)와 FPGA, A/D 변환기 및 전류 변환기(Hall CT) 등을 이용하여 3상 유도 전동기의 디지털 전류 제어 시스템을 구성하였으며, 디지털 전류 제어의 효용성을 실험을 통해 확인하였다.
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[게시일 2004년 10월 1일]
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