• 소음진동
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• 제3권1호
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• pp.22-27
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• 1993

이제까지 저진동 차체 설계에 관한 해석 및 설계기술에 대한 동향을 간략히 살펴보았다. 앞에서도 밝혔듯이 최근들어 차동차의 차체를 최적화 설계기법을 이용 하여 수많은 경우의 수에 대한 설계개선을 시도하는 것이 현실적으로 가능해졌다. 이와같은 최적화기법을 사용하여 설계과정이 전산화된다면 시험을 통해서만 가능하던 일련의 설계과정을 컴퓨터 시뮬레이션을 통하여 해결함으로써 설계에 소요되는 시간 을 파격적으로 단축시키고 아울러 더 좋은 설계를 만들어 낼 기회를 그만큼 더 증대 시킬 것이다. 요즈음 선진국의 자동차업계에서는 초기 차체 설계과정의 속도가 더 빨라지고 설계에 소요되는 시간은 줄어드는 경향이 있다. 그러나 자동차 설계가 점점 더 복잡하여져서 엔지니어가 설계를 최적화하기 위헤서는 어떤 단계가 필요한지를 알기가 점점 더 어려워지고 있다. 이제는 설계를 평가하는데 걸리는 시간보다는 설계 과정을 통제 및 관리하여 그 설계를 어떻게 잘 개선할 수 있는가 하는 것이 엔지니어 의 능력을 평가하는 데 더 중요한 기준이 될 것이다. 여기에서는 언급되지 않았지만 최근 들어와서 플라스틱, 알루미늄, 복합재 등 여러가지의 신소재들을 차체의 재료 로 사용하기 위한 연구가 활발히 검토되고 있거나 이미 실용화 단계에 와 있는 것도 있다. 이러한 신소재를 사용하여 저진동 차체를 설계하기 위해서는 새로운 제작 및 가공기술의 개발이 선행되어야 함은 물론이고 앞에서 서술한 해석 및 설계기술이 뒷받침 되어야 한다는 것은 두 말할 나위가 없겠다.

• 한국정보처리학회:학술대회논문집
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• 한국정보처리학회 2005년도 춘계학술발표대회
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• pp.1275-1278
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• 2005

Ad-hoc 네트워크에서 AODV 라우팅 프로토콜의 경로 설정에 대한 성능 분석과 개선 방식은 이미 많은 논문에서 다루고 있다. 하지만 기존 방식들은 대부분 네트워크 부하가 적은 경우만을 고려하고 있다. 본 논문에서는 그와 같은 상황 제약에 따른 단편적인 성능 검증을 극복하기 위해 많은 노드가 참여하고 트래픽 양이 많은 Ad-hoc 네트워크에서 트래픽양의 변화에 따른 성능을 시뮬레이션을 통해 분석하였다. 트래픽 양이 많을 경우, 기존의 AODV 라우팅 프로토콜의 성능이 훨씬 떨어지는 것을 알 수 있었다. 본 논문에서는 분석결과를 토대로 노드의 라우팅 테이블 Entry 수를 확인하여 혼잡도를 고려한 후 경로 탐색 여부를 결정하는 기법을 제안하고 성능을 분석하였다. 분석 결과 제안된 방식이 기존의 AODV specification[5]을 크게 수정하지 않으면서도 패킷 수신율 및 Drop율 등의 성능을 개선하는 효과가 있었으나 패킷 전달 속도에서는 경로가 분산 또는 우회되어 약간 길어진다는 것을 확인하였다.

• 한국정보통신학회:학술대회논문집
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• 한국해양정보통신학회 2005년도 춘계종합학술대회
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• pp.217-220
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• 2005

무선 다중경로 채널에서 데이터를 고속으로 전송할 경우, 신호는 페이딩, ISI(inter-symbol interfrence) 등의 영향으로 높은 에러율을 가지게 된다. 현재의 DSRC 시스템은 1Mbps 이상의 데이터 서비스가 어려울 것으로 예상되므로 개선된 변복조방식이 요구된다. OFDM(orthogonal frequency division multiplexing) 방식은 보호기간의 삽입을 통하여 ISI를 방지할 수 있으므로 고속 데이터 전송에 적합하다. 따라서 본 논문에서는 다중경로 페이딩 환경에서 시뮬레이션을 통하여 12 Mbps 전송 속도를 갖는 OFDM/QPSK 통신 시스템의 BER 성능을 비교${\cdot}$분석하고 다중경로 페이딩 환경에서 채널 상태를 추정 보상하기 위하여 판정 궤환경 등화기(Decision Feedback Equalizer)를 적용하여 시스템 성능을 개선하였다.

• 한국정보통신학회:학술대회논문집
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• 한국해양정보통신학회 2010년도 춘계학술대회
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• pp.180-183
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• 2010

본 연구에서는 개선된 영역기반의 패턴매칭 기법을 사용하여 이동물체의 탐색과 검출을 수행하였다. 시간에 따라 변화하는 이동물체의 안정된 추적을 위해 매 영상 프레임마다 이동물체의 윤곽선을 탐지하여 다음 영상에서의 템플릿으로 사용하기 위해 갱신하였으며, 패턴매칭의 연산속도 향상을 위해 패턴 정합률에 따라 영상을 다른 비율로 압축하여 추적하는 방법을 제안하였다. 기존의 영상파일을 사용하여 시뮬레이션 한 결과 이동물체의 검출과 추적에 양호한 동작을 보여주었으며 제안된 방법의 실시간 동작 가능성을 조사하였다.

• 전력전자학회:학술대회논문집
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• 전력전자학회 2008년도 추계학술대회 논문집
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• pp.71-73
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• 2008

급변하는 전압 변동 상황에서 전력 제어를 수행하기 위해서 기존의 동기좌표 위상각 검출 제어기의 특성을 보완할 수 있는 방법을 제시하였다. 실질적인 SRF (Synchronous Reference Frame) - PLL(Phase Locked Loop) 시스템에서 계통 전압은 이상적이지 않고 센서 노이즈 등의 저감을 위하여 측정된 전압에 LPF(Low Pass Filter)를 사용하고 있는데 이러한 LPF의 특성을 고려하여 위상각 제어기의 PI게인을 설정하는 방법을 제시하였으며 가변 게인과 LPF 차단주파수 변동방식을 이용하여 전원 전압 사고의 종류에 따라 위상과 전압이 급변하는 경우에 대하여 시뮬레이션과 실험을 통해 제한된 방법으로 동특성이 개선되고 원하는 응답속도로 설계가 가능함을 보였다.

• 전력전자학회:학술대회논문집
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• 전력전자학회 2015년도 전력전자학술대회 논문집
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• pp.341-342
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• 2015

본 논문에서는 파라미터 오차 보상을 통한 3상 BLDC 전동기의 DC 전류 모델 기반의 센서리스 제어 방식을 제안한다. 기존의 DC 전류 모델 기반의 센서리스 제어 방식은 상 전환 구간마다 발생하는 실제 전류와 모델 전류의 오차로 인해 추정한 역기전력과 속도, 위치에 오차가 그대로 나타난다. 이 오차 성분을 줄이기 위해 본 논문에서는 기계 방정식을 이용하여 개선된 역기전력 추정 식을 제안하였다. 또한 개선된 역기전력 추정 식에 파라미터에 오차가 없다면 센서리스 제어가 가능하지만, 오차가 존재한다면 센서리스 제어가 불안정해진다. 이를 극복하기 위한 파라미터 오차 보상 알고리즘도 제안하였다. 제안한 방법은 시뮬레이션을 통해 검증하였다.

• 한국정보처리학회:학술대회논문집
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• 한국정보처리학회 2021년도 추계학술발표대회
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• pp.43-46
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• 2021

다양한 응용에서 저장 매체로 사용되는 NAND 플래시 메모리는 저비용과 대용량을 위해 셀 당 비트 수 증가, 제조 공정의 미세화, 그리고 적층 기술 등 다양한 기술을 사용한다. 그렇지만 이러한 기술들은 플래시 메모리 셀의 안정성과 성능에 악영향을 준다. 특히 QLC 3D 플래시 메모리인 경우, 셀 상태가 많고 상태 간 임계 전압 간격이 좁기 때문에 프로그램과 읽기에 필요한 시간이 길다. 본 논문에서는 프로그램 수행 시간을 줄이고 셀 안정성에 긍정적인 영향을 줄 수 있도록 데이터 코드를 변환하는 비균일 스크램블 기법을 소개하고, 실제 시스템 데이터를 이용하여 스크램블 기법의 성능을 평가한다. 시뮬레이션을 통해 얻은 결과에 따르면 데이터 코드를 변환하여 저장하는 스크램블 기법은 최대 204%의 프로그램 성능 개선 효과를 보인다.

• 한국항공우주학회지
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• 제41권3호
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• pp.217-225
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• 2013

통상적인 쿼드로터 항공기는 네 개 로터의 회전 속도에 의한 추력 벡터의 크기를 조절하여 자세를 제어한다. 본 연구에서는 기존에 개발된 쿼드로터 항공기의 단점을 개선하기 위해서 사이클릭 피치 제어가 가능한 쿼드로터 항공기를 설계하였다. 콜렉티브와 사이클릭 제어를 사용하는 쿼드로터 항공기는 각 로터의 회전속도를 모두 동일하게 유지함으로써 진동에 의한 구조적인 문제를 해소할 수 있으며, 12개의 자유도를 가지므로 다양한 자세에서의 비행이 가능하기 때문에 자동 비행과 실용적 임무가 가능한 고성능 항공기로서 적합하다. 본 연구에서 개발하는 쿼드로터 항공기의 모델링은 FLIGHTLAB을 이용하여 비선형 모델을 구성하였으며, 각 비행 조건에서의 선형 모델을 이용하여 LQR 제어기 설계 및 비선형 시뮬레이션을 통해 제어기의 성능을 검증하였다. 본 논문은 사이클릭 피치 제어가 가능한 쿼드로터의 모델링 및 시뮬레이션 결과를 보여준다.

• 한국정보과학회:학술대회논문집
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• 한국정보과학회 2011년도 한국컴퓨터종합학술대회논문집 Vol.38 No.1(B)
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• pp.450-453
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• 2011

반도체 공정 기술의 발달에 따라 프로세서의 성능은 비약적으로 증가하였다. 특히 최근에는 하나의 프로세서에 여러 개의 코어를 집적한 멀티코어 프로세서 기술이 급속도로 발달하고 있는 추세이다. 멀티코어 프로세서는 동작주파수를 높여 성능을 개선하는 싱글코어 프로세서의 한계를 극복하기 위해 코어 개수를 늘림으로써 각각의 코어가 더 낮은 동작주파수에서 실행할 수 있도록 하여 소모 전력을 줄일 수 있다. 또한 다수의 코어가 동시에 연산을 수행하기 때문에 싱글코어 프로세서보다 더 많은 연산을 효율적으로 수행하여 사용률이 크게 높아지고 있지만 멀티코어 프로세서에서는 다수의 코어를 단일 칩에 집적하였기 때문에 전력밀도의 증가와 높은 발열이 문제가 되고 있다. 이와 같은 상황에서 본 논문에서는 듀얼코어 프로세서를 탑재한 시스템과 쿼드코어 프로세서를 탑재한 시스템의 소모 전력과 온도를 실제 측정하고 시뮬레이션을 통해 얻은 가상 시스템의 결과를 비교, 분석함으로써 실제 측정 결과와 시뮬레이션 결과가 얼마나 유사한지를 살펴보고, 차이가 발생하는 원인에 대한 분석을 수행하고자 한다. 실험결과, 실제 시스템을 측정한 결과와 시뮬레이션을 통한 가상 시스템의 결과는 매우 유사한 추이를 보이는 것으로 나타났다. 하지만 실제 시스템의 소모 전력과 온도의 증가비율은 가상 시스템의 소모 전력과 온도의 증가비율과는 다른 경향을 보이는 것을 확인하였다.

• 한국정보과학회:학술대회논문집
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• 한국정보과학회 2007년도 가을 학술발표논문집 Vol.34 No.2 (B)
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• pp.330-334
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• 2007

내장형 시스템이 점점 복잡해지면서 하드웨어/소프트웨어 통합설계의 중요성은 더욱 부각되고 있다. 이 하드웨어/소프트웨어 통합설계의 핵심 요소는 하드웨어/소프트웨어 통합시뮬레이션이다. 내장형 시스템을 구성하는 여러 컴포넌트들을 통합시뮬레이션 할 때 이종의 여러 시뮬레이터들을 동시에 사용하는 경우가 많은데 이 때 가장 문제가 되는 점은 시뮬레이터 간의 동기화에 따른 성능 저하이다. 이를 개선하기 위해 가상 동기화 기법이 제안된 바 있다. 그러나 가상 동기화 기법도 느린 시뮬레이터의 속도에 종속 될 수밖에 없다. 보통 가장 느린 시뮬레이터는 하드웨어 RTL 시뮬레이터이다. 본 논문은 하드웨어 RTL 시뮬레이터를 FPGA 에뮬레이터로 대체하면서 가상 동기화 기법을 사용한 통합에뮬레이션 환경을 구축해 보았다. 가상 동기화 기법을 적용하는 것은, 가상 동기화 기법의 장점대로 가상 동기화 기법의 통합시뮬레이션 커널과 FPGA 에뮬레이터 사이에 통신을 할 수 있게 해주는 인터페이스 프로그램을 제작하는 것만으로 가능했고 이렇게 구축한 환경에서 H.263 디코더로 실험을 한 결과 약 2.5배의 성능 향상을 얻을 수 있었다.