호주는 2009년 연방정부에 의해 설립된 호주교육과정평가원(ACARA)의 주도 아래 국가교육과정 개발이 추진되었으며, 새로운 교과교육과정 시행 공지(2013.01.29)를 통해 2014년부터 새로운 교육과정을 점차적으로 확대 시행되고 있다. 호주의 교육과정과 교과서를 분석한 결과, 나선형 교육과정 하에 같은 내용을 학년이 올라감에 따라 반복, 심화하면서 다루고 있으며 공학도구를 적극적으로 활용하고 있고 돈과 금융 수학 등 실생활 맥락이 강조되고 있다. 또한 난이도나 분량 측면에서는 '수와 연산'이나 '문자와 식' 영역에서는 우리나라가 비교적 심화된 내용을 다루고 있는 반면 '통계' 영역에서는 호주가 실생활 통계에 초점이 맞추어져있으면서 배우는 내용도 많다. 또한 호주에서는 형식적인 '함수'는 다루지 않지만 다양한 그래프를 통해 폭 넓은 함수의 개념을 배우고 있는 등 영역에 따라 내용의 양이나 심화 정도에서 차이가 나타난다.
수학과에서 학습자는 학습을 하기 전에 선수학습을 제대로 이수하지 못했을 경우 다음 학습에 곤란을 겪는다. 학습 부진아에 대한 개별적인 지도는 교육현장에서 반드시 해결해야 할 필연적인 과제이나 일선 학급 담임에게만 그 책임을 지우는 문제를 해결하기 위해 본 연구를 실시하였다. 본 연구에서는 웹기반 진단평가 시스템을 개발 및 적용하여 학습 부진아들의 학습 결손을 여부를 진단 평가 시스템을 통해 진단하고 누적된 학습 결손을 처치하여 본 학습에 도움을 주고자 하였다. 연구대상은 연구자가 근무하는 학교의 수학 기초학습 부진아 10명을 선정하였으며 수와 연산 영역을 중심으로 진단평가 시스템을 적용하였다. 그 결과 학습 부진아의 학력 향상 및 흥미를 높이는데 효과적임을 알 수 있었으며 통계처리는 F-검증(일원분산 분석)을 통해 검증한 결과 유의한 차이가 있음을 통계적으로 검증되었다.
기존의 영상 스케일러(scaler)들은 연산량과 하드웨어 복잡도를 줄이기 위해 선형 보간과 같은 간단한 보간을 적용함으로써 화질을 희생시키거나, 고품질 영상을 얻기 위하여 복잡한 보간 기법을 적용함으로써 전력소모와 크기가 큰 하드웨어 구조를 적용하여 왔다. 그러나 영상기기들의 소형화와 고화질 영상에 대한 사용자들의 욕구 증대로 소형, 저전력이면서 결과 영상의 화질 또한 우수한 스케일러의 개발이 중요시되고 있다. 따라서 본 논문은 실시간, 고화질, 소형, 저전력의 목표를 모두 달성할 수 있는 래스터 스캔(raster scan) 방식의 스케일러 하드웨어 구조를 제안한다. 본 논문에서 제안하는 스케일러는 기존의 3차 보간(cubic interpolation) 기법과 룩업테이블(look-up table) 구조를 개선하여 저전력화와 소형화를 달성하였다. 제안하는 스케일러 구조의 특징은 기존의 실시간 스케일러가 포함하던 버퍼를 라인메모리로 대체하여 메모리 접근 횟수를 줄임으로써 저전력을 달성할 수 있도록 했다는 것이며, 또한 기존의 룩업테이블 구조에서 사용하던 3차 보간 수식을 재정리하여 곱셈기 수와 룩업테이블의 크기를 줄임으로써 하드웨어를 소형화하는 방법을 제안하였다. 마지막으로 사용되는 계수의 크기에 따른 결과를 분석하여 영상의 화질과 하드웨어 크기 간의 최적의 타협점을 제시하였다.
구성주의를 반영한 대표적인 교수 학습 이론인 학습자 중심 수학 수업이 이상적으로 실천되기 위해서는 구성주의 관점에 따른 교육과 관련된 유무형의 제 요소들(지식관, 학습자관, 교사의 역할, 평가, 수업 형식, 학습, 수업 자료 등)이 융합되어야 한다. 그 중 수업 자료는 학습자들이 스스로 지식을 구성할 수 있는 지적 능력이 있음을 전제로 개발되어야 하고, 지식의 통합성, 다양성 등이 반영되어야 할 것이며 개방형 속성을 지닌 자료이어야 한다. 이외에도 객관적 인식론을 적용할 때 갖던 특징과는 다른 특징들을 지녀야 하므로, 수업 자료가 그러한 특징들을 가지고 있는지 분석해 볼 필요가 있다. 이를 위해 2009 개정 교육과정 1-2 학년군 수학(3) 교과서의 스토리텔링이 처음 도입된 단원 중 수와 연산 영역에 해당되는 <1. 세 자리수>와 미국에서 사용되고 있는 구성주의 수학교실 2학년의 <3. 자릿값의 이해>를 비교하여 분석하였다.
국제사회는 세계 모든 아동이 달성해야 할 학습성과를 설정하고 이를 측정하려는 일련의 노력을 기울이고 있다. 연구진은 이러한 국제사회의 관점에 초점을 맞추어, 초등교육단계에서 세계 모든 아동이 달성해야 할 수학 학습성과란 무엇인가를 구체화하려고 하였다. 이러한 측면에서 본 연구는 범세계적으로 초등교육 단계에서 아동이 성취하기를 기대하는 수학 내용 요소를 추출하는 것을 목적으로 하였다. 이를 위하여 지리적, 경제적 특성을 고려하여 세계 12개국의 수학과 교육과정 문서를 분석하였다. 본 연구의 결과, 초등교육의 범위를 초등학교 6학년까지라고 가정할 수 있었고, 공통 내용 요소를 추출할 수 있었다. 특히 수와 연산 영역의 내용 요소들은 범세계적으로 동일한 수준인 것으로 밝혀졌다. 기하, 측정, 대수 영역에서도 유사한 수준으로 내용 요소들이 나타났다. 반면, 비례와 대수는 초등 교육 마지막 단계에서 다루어지는 내용이지만 공통 내용 영역 혹은 내용 요소로 보기에 한계가 있었다. 이 연구 결과는 범세계적으로 초등 교육을 논의하는데 중요한 기초 자료 역할을 할 것으로 기대된다.
본 논문에서는 제산기가 제거된 싱글톤 퍼지제어기에 대한 새로운 귀속도 함수 발생기 및 계수 선택기회로를 제안함으로써 회로 구성소자를 줄일 수 있는 기법을 제안하였다. 입력 값의 범위에 따라 추론에 사용될 언어변수를 미리 결정하여 필요한 귀속도 함수만을 발생시킴으로서 보다 간략화 된 회로를 구성할 수 있으며 또한 추론의 결과에 영향을 줄 계수들을 미리 선택해 주는 계수 선택회로를 통해 전건부의 적합도가 0이 되는 모든 규칙들에 대한 연산 회로를 제거하였다. 그리고 귀속도 함수 발생기에서 발생하는 전류모드 CMOS 회로의 문제점인 팬-아웃(fan-out)수의 제한을 해결하기 위해 전압입력-전류출력의 귀속도 함수발생기를 OTA방식으로 구성하였다. 기존의 방법에 비해 블록 수와 소자수가 큰 폭으로 감소하였음을 확인하였고, 또한 전건부와 언어변수의 수가 증가할수록 더욱 효과적임을 확인하였다.
학생들은 학교 수학교육을 통해 획득한 방법으로 여러 수학 문제를 풀고 있지만 문제 해결에 부족한 부분이 많으며, 제 7차 교육과정에서도 문제 만들기 활동을 통한 학습이 강조되고 있지만 수와 연산 영역에 치우쳐 있다. 따라서 본 연구에서는 초등학교 수학 5-가 단계에 적합한 수학 문제 만들기 프로그램을 구안하여 적용한 후, 수학 학업 성취도와 태도 및 흥미도에 미치는 효과를 분석함으로써 학생들의 전반적인 수학 학습에 대한 학업 성취도와 태도 및 흥미도를 향상시킬 수 있는 방안을 모색하였다.
이 연구는 2004년부터 2013년까지 일본수학교육학회 발행의 학술지 '산수교육'에 게재된 논문 196편을 분석 대상으로 하여 일본의 초등수학교육의 연구 동향을 제시하고, 이러한 분석결과를 토대로 우리나라 초등수학교육의 다양하고 균형 있는 연구를 위한 자료를 제공하는데 목적을 두고 수행하였다. 일본의 초등수학교육의 연구 동향을 분석한 결과는 다음과 같다. 논문의 분석 기준에 따라 연구주제로는 '수업설계 및 방법' (36.7%)이, 내용영역별로는 '수와 연산' (47.4%)이, 학년을 기준으로 하면 5, 6학년인 고학년 (21.4%)이 각 조사 영역에서 활발하게 연구되고 있었다. 특징적인 것으로 학술지 '산수교육'에서는 영재아와 부진아에 대한 연구는 찾을 수 없었고 장애아에 대한 연구 (1.0%)는 극소수 이루어지고 있었다.
본 논문에서는 다중 사용자 다중 안테나 하향링크 채널에서 에너지 효율을 향상시키기 위하여 zero-forcing beamforming (ZFBF) 전처리 필터 기반의 기지국 활성 안테나 수 최적화 기법을 제안한다. 제안하는 기법에서는 최적의 안테나 수를 찾는 연산과정의 복잡도를 줄이기 위하여 사용자의 순시 채널 이득 대신 ZFBF의 평균 채널 이득을 사용한다. 그리고 분수함수 형태의 목적함수를 차를 이용한 목적함수로 변환하여 최적의 안테나 수와 최대 에너지 효율을 찾는 과정을 반복 수행하여 문제를 해결한다. 모의실험을 통해 제안하는 기법의 에너지 효율은 exhaustive search 방법으로 찾은 최대 에너지 효율과 거의 동일함을 확인한다.
본 논문에서는 IEEE 802.16e mobile WiMax 시스템을 위한 효율적인 FFT 프로세서 구조를 제안한다. 제안된 scalable FFT/IFFT 프로세서는 128/512/1024/2048-point FFT 연산을 가변적으로 수행할 수 있다. 또한 mixed radix (MR) 기법과 multi- path delay commutator (MDC) 구조를 사용하여 비단순 승산을 줄임으로써 기존의 설계 구조에 비해 시스템 수율 변화 없이 하드웨어 복잡도를 크게 감소시켰다. 제안된 scalable FFT/IFFT 프로세서는 하드웨어 설계 언어 (HDL)를 이용하여 설계 되었고, 0.18um CMOS 스탠다드 셀 라이브러리를 이용하여 논리 합성되었다. 논리 합성 결과 4채널 radix-2 MDC (R2MDC) FFT 프로세서와 비교시 16% 감소된 게이트 수와 27% 감소된 메모리로 구현 가능함이 확인되었다.
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[게시일 2004년 10월 1일]
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