본 논문에서는 파이프라인드 구조의 빠른 변환 속도와 축차비교 구조의 저전력 구조를 이용하여 고속, 저전력 아날로그 디지털 변환기를 제안하였다. 제안된 구조의 변환 방법은 축차비교 구조의 변환에서 비교기를 파이프라인드 구조로 연결하여 홀드된 주기에 비교기의 기준 전위를 전 비교기의 출력 값에 의해 변환하도록 하여 고속 동작이 가능하도록 하였다. 제안된 구조에 의해 8비트 아날로그 디지털 변환기를 0.8㎛ CMOS공정으로 HSPICE를 이용하여 시뮬레이션한 결과, INL/DNL(Integral Non-Linearity/Differential Non-Linearity)은 각각 ±0.5/±1이었으며, 100㎑ 사인 입력 신호를 10MS/s로 샘플링 하여 DFT(Discrete Fourier Transform)측정 결과 SNR(Signal to Noise Ratio)은 41㏈를 얻을 수 있었다. 10MS/s의 변환 속도에서 전력 소모는 4.14㎽로 측정되었다.
이 논문에서는 이산여현변환 공간에서 영상의 크기를 줄이는 변환부호화 과정에서의 움직임 벡터 (motion vector) 재추정을 위한 방법을 제안하였다. 제안된 방법에서는 영상 사이의 SAD (Sum of Absolute Difference)와 매크로 블록의 에지 정보를 이용하여 커널 함수를 정의하고, 그것을 이용해서 축소된 영상에서의 새로운 움직임 벡터를 재추정하였다. 변환부호화기에서는 속도의 효율성을 위해서 변환부호화기의 입력의 화면 간 (inter-frame) 정보에서 얻을 수 있는 기존의 움직임 벡터를 이용하는 방법을 택하고 있는데 본 논문에서도 속도의 효율성을 위해서 기존의 움직임 벡터들을 이용하는 방법을 선택하였다. 제안한 방법을 이용해서 실영상에 대해서 실험을 해 본 결과 연산량을 고려한 PSNR (Peak Signal to Noise Ratio)의 측면에서 우수한 성능을 보여주는 것을 확인할 수 있었다.
주파수 영역에서의 적응 신호처리는 입력의 자기 상관 행렬에 이산 퓨리에 변환(DFT Discrete Fourier Transform)을 이용할 때 거의 대각선화 되는 특성으로 인해 시간영역 적응필터보다 주파수 영역 적응 필터가 빠르게 적응한다. 본 논문에서는 변형된 이산 퓨리에 변환(MDFT: modified DFT)을 이용하여 주파수 영역 적응 필터를 설계함으로써 안정한 수렴 속도를 갖는 잡음 제거 시스템을 제안한다. 제안한 구조는 MDFT를 이용하여 연산수를 최소화하며, 안정한 수렴을 유지하면서 블록 없는 처리를 할 수 있고, 최적의 수렴 속도를 위해 입력 자기 상관 행렬에 MDFT를 사용해 근사적으로 대각화 시키고 시간적으로 변하는 스텝 크기를 정규화 하는 고속 적응 잡음 제거(HANR: high speed adaptive noise reduction) 알고리즘이다. HANR 알고리즘을 적용한 필터는 DFT변환법을 사용한 LMS방법(non-proposed)보다 30%정도의 속도 개선이 있다.
본 논문에서는 직접 변환 방식의 수신기에서 발생하는 I 채널 및 Q 채널 간의 이득 및 위상 불일치를 보상하는 방법에 대해서 기술한다. 직접 변환 방식의 복조기에서의 이득 및 위상 불일치를 가변 스텝(Variable Step-size) 적응적 루프를 이용하여 블라인드(blind) 등화 방식으로 보상하는 알고리즘을 된 논문에서 제안한다. 이득 및 위상 불일치를 보상하기 위해 일반적인 블라인더 등화 기법을 이용할 경우 루프 이득에 따라 수렴속도와 지터(jitter) 영향이 trade-off 관계에 있다. 본 논문에서는 이들 문제를 극복하기 위하여 적응적 루프의 이득을 오차에 따라 가변 하는 방법을 제시한다. 본 논문에서는 가변 스텝 적응적 루프를 이용하여 빠른 수렴속도와 지터의 영향을 줄이도록 하는 방법을 제시하였고, 모의실험을 통하여 신호 손실 보상과 수렴 속도의 향상을 확인한다.
기계시스템을 제어한다든지 그 부재를 설계하기 위하여 그리고 구동기의 용량을 결정하는데 있어서 구동력이나 조인트반력을 해석하는 것이 필요하다. 본 논문은 주어진 시스템의 운동을 구현하는 다양한 형태의 구동조건에 따른 구동력(또는 토크)을 조인트좌표 공간에서 계산하는 알고리즘을 제시한다. 조인트좌표를 기구학적 시스템의 일반좌표로 사용하며 운동방정식과 구속조건의 가속도식은 속도변환법을 이용하여 직교좌표공간으로부터 조인트좌표공간으로 변환한다. 수치예제를 통하여 제시된 알고리즘의 유용성을 확인한다.
최근 인터넷상에서 DTD 기반의 XML 문서가 문서 교환의 표준 수단으로 등장하면서 B2B 상에서 XML 문서의 사용이 빠른 속도로 증가하고 있다. 그러나 B2B 환경에서 문서교환시스템은 각기 다른 형태의 문서구조의 사용으로 인하여 시스템의 통합 및 상호운용에 있어 많은 어려움이 있다. 이에 논리적으로는 유사한 문서 교환 시스템의 통합 및 상호운용에 있어서 XML 문서의 교환을 위해서는 상호 변환 모듈이 필요하다. 그러나 상호 변환 모듈 개발을 위한 표준화된 방법과 툴의 미비로 인하여 변환 모듈 개발과 유지 보수에 많은 비용이 소요된다. 본 연구에서는 논리적으로 비슷하지만 서로 다른 DTD 기반의 XML 문서를 상호 변환하는 변환기를 자동 생성하는 시스템(XTGen)을 설계하고 구현한다. 시스템은 XML 문서를 검증하고 DTD를 추출하는 컴포넌트(XDA), 검증된 DTD를 문서 구조 정보 형식으로 변경하는 컴포넌트(DDA), 문서 구조 정보를 보여주고 상호 변환을 위해 매핑 할 수 있도록 하는 컴포넌트(DIV), 두 문서간의 매핑 정보를 추출하는 컴포넌트(MDO), 추출된 매핑 정보를 바탕으로 2개의 XML 문서를 상호 변환하는 변환기를 생성하는 컴포넌트(TCG)로 구성된다. 본 연구에서는 제안한 XML 변환기 생성 시스템(XTGen)은 XML 문서들의 상호 변환을 위한 변환 모듈을 자동 생성함으로써 변환기 생성의 비용을 감소시킬 수 있고 변환 모듈의 표준화를 통해 유지 보수성을 높일 수 있다.
이 논문은 매트랩/시뮬링크에서 도입한 TI 2000 DSP 라이브러리를 위한 임베디드 타켓을 사용하여 직류 모터 시스템에 대한 속도 제어기를 설계하고 구현하였다. 속도 제이기는 매트랩/시뮬링크 프로그램을 사용하여 쉽게 설계하고 구현할 수 있다. 모터 속도의 궤환은 속도 감지기로 엔코드와 펄스미터를 사용하여 eZdsp F2812 의 A/D 변환기를 통하여 처리하였다. 제어기의 실시간 프로그램은 시뮬링크를 사용하여 그렸고, P 제어기, PID 제어기 그리고 매개변수 추정 을 기반 적응제어기의 변환된 프로그램 코드는 Realsys eZdsp 2812 보드로 다운로드하였다. 그리고 실험을 통하여 구현된 제어기들의 속도응답을 확인하였다. 제어대상이 변경되었을 때에도 제어기를 쉽게 설계 및 구현하는 방법을 연구했다.
고체내의 열에너지의 전달을 분석하기 위하여 고전적인 Fourier 열전도 법칙과 에너지 보존식에서 유도되는 열전도 방정식을 사용해 왔다. 이러한 열전도 방정식은 열전도가 무한한 속도로 진행된다는 것을 의미하고 있다. 그러나 극저온상태에서나 매우 급속한 열전도과정 중 매우 짧은 시간의 상태에서 non-Fourier 모델에 기초를 둔 쌍곡선형 열전도 방정식이 도입되었다. 최근의 이에 관한 연구에서 열전도가 파장의 형태로 유한한 전파속도를 갖는다는 것이 실험적으로 증명되었고 이로부터 여러 가지 실험적인 해석과 이론 해석이 전개되었다. 본 논문에서는 열전파 속도의 유한한 성질을 나타내는 수정된 열전도 법칙을 이용하여 1차원 평판에 대하여 공간에 대한 finite Fourier 변환 방법과 Green 함수 방법으로 해석하여 열전도파의 파동 성질, 공진 현상 및 위상차를 고찰하고자 한다. 열전도파가 갖는 모달 주파수에 대해 임계값을 갖으며 이 임계값을 초과할 때 공진 현상과 위상차를 고찰할 수 있었다.
본 논문에서는 시분할 구조와 1.5bit 디지털 에러보상을 사용하여 작은 면적을 갖는 저 전압, 저전력 10bit 1㎒ 사이클릭 A/D 변환기를 제안하였다. 제안된 사이클릭 A/D 변환기는 시분할 구조를 사용함으로서 변환속도의 향상과 저 전력 특성을 가질 수 있었으며 1.5bit 디지털 에러 보상을 사용함으로서 10bit의 고해상도와 저 전력 특성을 구현할 수 있었다. 제안된 사이클릭 A/D 변환기는 0.6㎛ CMOS Nwell 공정 parameter로 simulation 하였으며 layout 결과 칩면적은 1.1㎜×0.8㎜ 이며 이는 비슷한 성능을 갖는 다른 A/D 변환기에 비하여 매우 작은 크기이다. 제안된 사이클릭 A/D 변환기는 3V의 전원전압에 1.6㎽의 전력소모를 갖는다. Matlab simulation 결과 INL, DNL은 각각 0.6LSB, 0.7LSB 이하의 값을 보였다.
한글 워드프로세서의 한자 사용이 필수적인 요소이다. 일상 생황에서 의사를 전달하기 위해서는 한국어로 사용하지만, 글이나 작문을 이용하여 의사를 전달할 때는 한글이 주를 이루고 문맥 안에 함축된 의미로 한자를 사용하면 정확하게 의사가 전달된다. 현재의 한글 워드프로세서에서는 한자 순위 변환 시스템의 키의 검색 횟수가 많고 또한 복합한자 변환 시스템에서는 실행 횟수가 많은 단점을 가지고 있다. 본 논문에서는 보다 효율적인 키의 검색 횟수를 줄이기 위해 효율적인 한자 순위 변환 알고리즘과 실행횟수를 줄이기 위해 개선된 복합한자 변환 알고리즘을 사용한다. 이러한 알고리즘은 검색과 실행 속도를 빠르게 함은 물론 한글 한자 변환시스템 처리에 도움을 줄 수 있다.
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[게시일 2004년 10월 1일]
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