The reaction mechanisms of dry cleaning with UV-excited chlorine radical for Zn, Fe and Ti trace contaminants on the Si wafer have been studied by SEM, AFM and XPS analyses in this work. The patterned Zn, Fe and Ti films were deposited on the Si wafer surface by thermal evaporation and changes in the surface morphology after dry cleaning with $Cl_2$and UV/$Cl_2$at $200^{\circ}C$ were studied by optical microscopy and SEM. In addition, changes in the surface roughness of Si wafer with the cleaning was observed by AFM. The chemical bonding states of the Zn, Fe and Ti deposited silicon surface were observed with in-line XPS analysis. Zn and Fe were easily cleaned in the form of volatile zinc-chloride and iron-chloride as verified by the surface morphology changes. Ti which forms involatile oxides was not easily removed at room temperature but was slightly removed by UV/$Cl_2$at elevated temperature of $200^{\circ}C$. It was also found that the surface roughness of the Si wafer increased after $Cl_2$and UV/$Cl_2$cleaning. Therefore, the metallic contaminants on the Si wafer can be easily removed at lower temperature without surface damage by a continuous process using wet cleaning followed by UV/$Cl_2$dry cleaning.
We synthesized the self-organized nanoporous oxide with potentiostatic anodization of iron foil. The iron oxide nanocomposite (INCs) were fabricated in 1M $Na_2SO_4$ containing 0.5wt% NaF electrolyte holding the potential at 20, 40 and 60 V for 20min, respectively. Field Emmision Scanning Electron Microscopy (FESEM) and X-ray Diffractometer (XRD) were used to evaluate the micromorphology and crystalline structure of INC film. Also, this study was performed to evaluate the fenton reaction using INC film with hydroperoxide for degradation of cyanide dissolved in water. In case of INC-40V in the presence of $H_2O_2$ 3%, the first-order rate constant was found to be $1.7{\times}10^{-2}min^{-1}$, and indicated to be $1.2{\times}10^{-2}min^{-1}$ on commercial hematite powder. This result is shown to be good performance enough to replace the powder type for treatment of wastewater.
The standard map for polyerystalline $YBa_2Cu_3O_7$-X was construeted and indexed from pressed tape sintered bulk and compressed bulk samples were drawn by the [001-110-110] stereographie quadrant map and by the ECPs from individual grains of the speeimens. The relationship between the (001) texture development and critical current density (Jc) for various samples was discussed. An (001) orintation was preferred in the pressed tape thickness was decreased. and in the compressed bulk as the compression strain was increaesed.The (001) orientation made a signifieant in crease on Jc. We conclded that an ECP technique was very useful for the analysis of the orientation distribution in small-sized $YBa_2Cu_3O_7$-X specimens such as superonducting tapes or thin films.
Journal of the Microelectronics and Packaging Society
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v.13
no.3
s.40
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pp.13-17
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2006
Dense and periodic arrays of holes and tungsten none dots were fabricated on silicon oxide and silicon. The holes were approximately 25 nm wide, 40 nm deep, and 60 nm apart. To obtain nano-size patterns, self-assembling resists were used to produce layer of hexagonally ordered parallel cylinders of polymethylmethacrylate(PMMA) in polystyrene(PS) matrix. The PMMA cylinders were degraded and removed with acetic acid rinse to produce a PS mask for pattern transfer. The silicon oxide was removed by fluorine-based reactive ion etching(RIE). Selectively deposited tungsten nano dots were formed inside nano-sized trench by using a low pressure chemical vapor deposition(LPCVD) method. Tungsten nano dot and trenched silicon sizes were 26 nm and 30 nm, respectively.
Proceedings of the Korean Vacuum Society Conference
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2013.08a
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pp.241.2-241.2
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2013
최근, 비정질 산화물 반도체 thin film transistor (TFT)는 수소화된 비정질 실리콘 TFT와 비교하여 높은 이동도와 큰 on/off 전류비, 낮은 구동 전압을 가짐으로써 빠른 속도가 요구되는 차세대 투명 디스플레이의 TFT로 많은 연구가 진행되고 있다. 한편, 기존의 MOSFET 제작 시 우수한 박막을 얻기 위해서는 $500^{\circ}C$ 이상의 높은 열처리 온도가 필수적이며 이는 유리 기판과 플라스틱 기판에 적용하는 것이 적합하지 않고 높은 온도에서 수 시간 동안 열처리를 수행해야 하므로 공정 시간 및 비용이 증가하게 된다는 단점이 있다. 따라서, 본 연구에서는 RF sputter를 이용하여 증착된 비정질 InGaZnO pesudo MOSFET 소자를 제작하였으며, thermal 열처리와 microwave 열처리 방식에 따른 전기적 특성을 비교 및 분석하고 각 열처리 방식의 열처리 온도 및 조건을 최적화하였다. P-type bulk silicon 위에 산화막이 100 nm 형성된 기판에 RF 스퍼터링을 이용하여 InGaZnO 분말을 각각 1:1:2mol% 조성비로 혼합하여 소결한 타겟을 사용하여 70 nm 두께의 InGaZnO를 증착하였다. 연속해서 Photolithography 공정과 BOE(30:1) 습식 식각 과정을 이용해 활성화 영역을 형성하여 소자를 제작하였다. 제작 된 소자는 pseudo MOSFET 구조이며, 프로브 탐침을 증착 된 채널층 표면에 직접 접촉시켜 소스와 드레인 역할을 대체하여 동작시킬 수 있어 전기적 특성을 간단하고 간략화된 공정과정으로 분석할 수 있는 장점이 있다. 열처리 조건으로는 thermal 열처리의 경우, furnace를 이용하여 각각 $300^{\circ}C$, $400^{\circ}C$, $500^{\circ}C$, $600^{\circ}C$에서 30분 동안 N2 가스 분위기에서 열처리를 실시하였고, microwave 열처리는 microwave를 이용하여 각각 400 W, 600 W, 800 W, 1000 W로 20분 동안 실시하였다. 그 결과, furnace를 이용하여 열처리한 소자와 비교하여 microwave 를 통해 열처리한 소자에서 subthreshold swing (SS), threshold voltage (Vth), mobility 등이 개선되는 것을 확인하였다. 따라서, microwave 열처리 공정은 향후 저온 공정을 요구하는 MOSFET 제작 시의 훌륭한 대안으로 사용 될 것으로 기대된다.
We report on the fabrication and characterization of an oxide photoanode with a zinc oxide (ZnO) nanorod array embedded in cuprous oxide ($Cu_2O$) thin film, namely a $ZnO/Cu_2O$ oxide p-n heterostructure photoanode, for enhanced efficiency of visible light driven photoelectrochemical (PEC) water splitting. A vertically oriented n-type ZnO nanorod array is first prepared on an indium-tin-oxide-coated glass substrate via a seed-mediated hydrothermal synthesis method and then a p-type $Cu_2O$ thin film is directly electrodeposited onto the vertically oriented ZnO nanorod array to form an oxide p-n heterostructure. The introduction of $Cu_2O$ layer produces a noticeable enhancement in the visible light absorption. From the observed PEC current density versus voltage (J-V) behavior under visible light illumination, the photoconversion efficiency of this $ZnO/Cu_2O$ p-n heterostructure photoanode is found to reach 0.39 %, which is seven times that of a pristine ZnO nanorod photoanode. In particular, a significant PEC performance is observed even at an applied bias of 0 V vs $Hg/Hg_2Cl_2$, which makes the device self-powered. The observed improvement in the PEC performance is attributed to some synergistic effect of the p-n bilayer heterostructure on the formation of a built-in potential including the light absorption and separation processes of photoinduced charge carriers, which provides a new avenue for preparing efficient photoanodes for PEC water splitting.
Proceedings of the Korean Vacuum Society Conference
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2010.02a
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pp.456-456
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2010
CMOS 소자가 서브마이크론($0.1\;{\mu}m$) 이하로 스케일다운 되면서 단채널 효과(short channel effect), 게이트 산화막(gate oxide)의 누설전류(leakage current)의 증가와 높은 직렬저항(series resistance) 등의 문제가 발생한다. CMOS 소자의 구동전류(drive current)를 높이고, 단채널 효과를 줄이기 위한 가장 효율적인 방법은 소스 및 드레인의 얕은 접합(shallow junction) 형성과 직렬 저항을 줄이는 것이다. 플라즈마 도핑 방법은 플라즈마 밀도 컨트롤, 주입 바이어스 전압 조절 등을 통해 저 에너지 이온주입법보다 기판 손상 및 표면 결함의 생성을 억제하면서 고농도로 얕은 접합을 형성할 수 있다. 그리고 얕은 접합을 형성하기 위해 주입된 불순물의 활성화와 확산을 위해 후속 열처리 공정은 높은 온도에서 짧은 시간 열처리하여 불순물 물질의 활성화를 높여주면서 열처리로 인한 접합 깊이를 얕게 해야 한다. 그러나 접합의 깊이가 줄어듦에 따라서 소스 및 드레인의 표면 저항(sheet resistance)과 접촉저항(contact resistance)이 급격하게 증가하는 문제점이 있다. 이러한 표면저항과 접촉저항을 줄이기 위한 방안으로 실리사이드 박막(silicide thin film)을 형성하는 방법이 사용되고 있다. 본 논문에서는 (100) p-type 웨이퍼 He(90 %) 가스로 희석된 $PH_3$(10 %) 가스를 사용하여 플라즈마 도핑을 실시하였다. 10 mTorr의 압력에서 200 W RF 파워를 인가하여 플라즈마를 생성하였고 도핑은 바이어스 전압 -1 kV에서 60 초 동안 실시하였다. 얕은 접합을 형성하기 위한 불순물의 활성화는 ArF(193 nm) excimer laser를 통해 $460\;mJ/cm^2$의 에니지로 열처리를 실시하였다. 그리고 낮은 접촉비저항과 표면저항을 얻기 위해 metal sputter를 통해 TiN/Ti를 $800/400\;{\AA}$ 증착하고 metal RTP를 사용하여 실리사이드 형성 온도를 $650{\sim}800^{\circ}C$까지 60 초 동안 열처리를 실시하여 $TiSi_2$ 박막을 형성하였다. 그리고 $TiSi_2$의 두께를 측정하기 위해 TEM(Transmission Electron Microscopy)을 측정하였다. 화학적 결합상태를 분석하기 위해 XPS(X-ray photoelectronic)와 XRD(X-ray diffraction)를 측정하였다. 접촉비저항, 접촉저항과 표면저항을 분석하기 위해 TLM(Transfer Length Method) 패턴을 제작하여 I-V 특성을 측정하였다. TEM 측정결과 $TiSi_2$의 두께는 약 $580{\AA}$ 정도이고 morphology는 안정적이고 실리사이드 집괴 현상은 발견되지 않았다. XPS와 XRD 분석결과 실리사이드 형성 온도가 $700^{\circ}C$에서 C54 형태의 $TiSi_2$ 박막이 형성되었고 가장 낮은 접촉비저항과 접촉저항 값을 가진다.
The electrode for a supercapacitor was prepared using an amorphous ruthenium oxide, which was synthesized from ruthenium trichloride hydrate$(RuO_2{\cdot}nH_2O)$. A supercapacitor was assembled with an electrode of ruthenium oxide material on a current collector of tantalum, and an electrolyte of 4.8 M sulfuric acid. The result of the AC impedance analyses on $Ta/H_2SO_4(4.8 M)/Pt$ cell showed that tantalum was stable at the potential range of $0.0\~1.1V(vs. SCE)$. Therefore, Ta film could be used the supercapacitor as a current collector. The irreversible hydrolysis in the supercapacitor occurred over ca. 1.0V(vs.SCE) when the supercapacitor was protonated to 0.5V(vs. SCE). The supercapacitor protonated to 0.5V(vs.SCE) showed good electrochemical properties when it was tested at the potential range of 1.0V in the charge-discharge test. The potential range of the electrodes including the positive and the negative electrode was varied between -0.004 and 0.995V(vs. SCE). The potential ranges of the positive and the negative electrode were $-0.004\~0.515V(vs.\;SCE)\;and\; 0.515\~0.995V(vs.\;SCE)$, respectively.
Indium tin oxide(ITO) substrate is one of the key components of the touch panel and its sputtering process is dependent on the characteristics of various touch panel, such as driving type, size of panel, and the intended use. In this study, we optimized the sputtering condition of ITO film on polycarbonate(PC) by using in-line sputtering method for the application to resistive type touch panel. We varied the $O_2$/Ar gas ratio, sputtering power, pressure and moving speed of substrate to deposit ITO films at room temperature with the base vacuum of $1{\times}10^{-6}\;torr$. The sheet resistance and its uniformity, the transmittance, the thickness of the ITO film on PC substrate are investigated and analyzed. The optimized process parameters are as follows : the sheet resistance is $500{\pm}50\;{\Omega}$/□, the uniformity of sheet resistance is lower than 10%, the transmittance is higher than 87 % at 550nm, and the thickness is about 120~250. The optimized deposition conditions by in-line sputtering method can be applied to the actual mass production for the ITO film manufacturing technology.
Proceedings of the Korean Vacuum Society Conference
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2012.02a
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pp.202-202
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2012
유연성 투명 전도막은 현대 전자산업의 발전에 있어 필수적인 부품소재로서, 가시광선의 투과율이 80% 이상이고 면저항이 $100{\Omega}/sq.$ 전후이며 휘거나 접히고 나아가 두루마리의 형태로도 응용이 가능한 소재를 일컫는다. 이러한 유연성 투명 전도막은 차세대 정보디스플레이 산업 및 유비쿼터스 사회의 중심이 되는 유연성 디스플레이, 터치패널, 발광다이오드, 태양전지 등 매우 다양한 분야에 응용이 기대된다. 이러한 이유로 고 신뢰성 유연성 투명 전도막 개발기술은 차세대 산업에 있어서의 핵심기술로 인식되고 있다. 현재로서는 인듐 주석 산화물(indium tin oxide; ITO) 및 전도성 유기고분자를 사용하여 투명 전도막을 제조하고 있으나, ITO 박막의 경우 인듐 자원의 고갈로 인한 가격상승 및 기판과의 낮은 접착력, 열팽창계수의 차이로 인한 공정상의 문제, 산화물 특유의 취성으로 인한 유연소자로서의 내구성 저하 등의 문제가 제기되고 있다. 전도성 유기고분자의 경우는 낮은 전기전도도와 기계적강도, 유기용매 처리 등의 문제점이 지적되고 있다. 따라서 높은 전기전도도와 투광도 뿐만 아니라 유연성을 지니는 재료의 개발이 요구되고 있는 실정이다. 최근 이러한 재료로서 그래핀(graphene)과 탄소나노튜브(carbon nanotube; CNT)를 중심으로 하는 탄소나노재료가 주목받고 있으며 많은 연구가 활발히 진행되고 있다. 본 연구에서는 열화학기상증착법(thermal vapor deposition; TCVD)으로 합성된 그래핀 및 CNT를 이용하여 탄소나노재료 복합체 기반의 유연성 투명 전도막을 제작하고 그 특성을 평가하였다. 그래핀과 CNT합성을 위한 기판으로는 각각 300 nm 두께의 니켈과 1 nm 철이 증착된 실리콘 웨이퍼를 이용하였으며, 원료가스로는 메탄(CH4)과 아세틸렌(C2H2)등의 탄화수소가스를 이용하였다. 그래핀의 경우 원료가스의 유량, 합성온도, 냉각속도를 변경하여 대면적으로 두께균일도가 높은 그래핀을 합성하였으며, CNT의 경우 합성시간을 변수로 길이 제어합성을 도모하였다. 합성된 그래핀은 식각공정을, CNT는 스프레이 증착공정을 통해 고분자 기판(polyethylene terephthalate; PET) 위에 순차적으로 전사 및 증착하여 탄소나노재료 복합체 기반의 유연성 투명 전도막을 제작하였다. 제작된 탄소나노재료 복합체 기반의 유연성 투명 전도막은 물리적 과부하를 받았을 때 발생할 수 있는 유연성 투명 전도막의 구조적결함에 기인하는 전도성 저하를 보상하는 특징이 있어, 그래핀과 탄소나노튜브 각각으로 제조된 유연성 투명 전도막보다 물리적인 하중이 반복적으로 인가되었을 때 내구성이 향상되는 효과가 있다. 40% 스트레인을 반복적으로 인가하였을 때 그래핀 투명 전도막은 20 사이클 이후에 면저항이 $1-2{\Omega}/sq.$에서 $15{\Omega}/sq.$ 이상으로 급증한 반면 그래핀-CNT 복합체 투명 전도막은 30사이클까지 $1-2{\Omega}/sq.$ 정도의 면저항을 유지하였다.
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[게시일 2004년 10월 1일]
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