선진사회의 지표는 모든 사회 구성원들의 보편적 삶의 질의 수준과 그 만족도라 할 수 있다. 이러한 보편적 삶의 질은 사회적 약자들의 측면에서는 도시공간으로의 접근성과 밀접한 관련이 있다. 시각장애인과 같은 교통약자들은 도시공간에서의 관심 시설물에의 접근과 이동권의 확보가 매우 중요한 관심사이다. 특히 여객시설과 같은 시설물간의 매개역할을 수행하는 환승시설과 그 내부의 장애인 편의시설은 매우 중요한 의미를 지니고 있다. 장애인 편의시설은 각 시설물에 접근할 수 있는 유일한 방법으로 시각장애인에게 제공되므로, 이에 대한 공간적 분포를 분석하여 제공하는 것은 매우 중요한 의미를 지닌다. 그러나 기존의 관련연구들은 이용자의 의식조사나 관련 통계 분석에 머물러 있는 상황이다. 그러므로 이 연구에서는 공간(Spatial) 데이터를 기반으로 공간분석이 가능한 GIS를 이용하여 시각장애인의 여객시설의 내부편의시설 이용증진과 이동권 확보를 위한 무장애 공간을 분석하고자 하였다. 연구결과 일부 장애공간이 존재하여 신속한 보완이 필요하였으며, 다양한 내부편의시설의 이용증진을 위해서는 점자블록과 같은 장애인 편의시설의 확충이 필요함을 알 수 있었다.
본 연구는 지난 30년간(1975년${\sim}$2004년) 한국의 경제성장과정에서 교육부문별(초등 ${\cdot}$ 중등 ${\cdot}$ 고등교육) 역할을 추정하는 데 주목적이 있다. 본 연구방법은 첫째, 신고전학파 Solow의 외생적 경제성장이론을 접목한 Cobb-Douglas 모형을 확장하여 1인당 경제성장 추정을 위한 내생성장모형을 제시하였다. 둘째, 자료 한계를 극복하기 위하여 동 아시아 7개국 자료를 바탕으로 시계열 및 횡단면 자료를 블록으로 구축하여 앞의 내생성장모형을 이용하여 pooling방법으로 1인당 경제성장에 물적자본, 단순노동력, 인적자본, 지적자본(R&D), 초기년도의 기술수준 등의 기여분을 추정하였다. 이러한 각 생산요소의 직접적인 추정결과로부터 각 요소간(고등교육, 중등교육, 지적자본) 상호작용으로 인한 간접적인 기여분을 재 추정하여 보정된 결과를 제시하였다. 1975년${\sim}$2004년간 한국의 경제성장 과정에서 인적자본요소 중 중등교육의 역할이 가장 큰 87.0%, 물적자본이 39.6%, 초등교육이 6.6%, R&D자본이 24.1%를 보였으며 중등교육과 R&D자본에 간접적으로 기여한 대학교육이 -53.9%, 지식 ${\cdot}$ 정보기반사회의 의미가 감소한 단순노동력은 -1.4%, 기술추격을 가능케 하는 1975년도 초기기술수준이 -3.0%의 추정결과를 보여주고 있다.
본 연구는 의과대학에서 학습자 주도의 학습경험중심의 전문직업성 프로그램을 개발하여 운영한 후 효과성과 사용성 평가를 통해 대학수준에서 학습경험 중심의 교육과정의 실제적 함의를 밝히고자 한다. 의과대학 1학년 74명의 학생들이 학생경험개발 모형에 기반하여 설계된 PDS1(Patient-Doctor-Society1): 전문직업성, 1주일 블록수업(총 30시간), 1학점 과목에 참여하였다. 학생들은 모두 6가지의 학습주제와 학습자원 및 지원도구를 제공받아 경험의 준비, 조직, 공유, 성찰, 평가로 구성된 학습활동 단계를 수행하였다. 교육의 효과성 평가는 24개 설문항목을 사전-사후 비교하였고, 사용성 평가는 학생대상의 만족도 설문 및 교수자 학생대상의 면담이 시행되었다. 전문직업성에 대한 학습자 자기평가 결과, 리더십과 자기 주도적 학습, 전문성에 대한 태도, 사회적 책무성 모두 학습 이전과 이후의 결과에 유의미한 차이가 확인되었다. 학생을 대상으로 하는 프로그램의 만족도는 항목별 3.58~3.78에 분포하였다. 교수자와 학습자 면담에서는 교육과정설계, 운영, 평가의 전 과정에서 실질적인 사용성을 확인하였다. 연구결과는 학습경험중심의 교육과정설계와 평가의 현장 적용 가능성에 대하여 실증적 타당성을 제시해주었다. 본 연구는 의과대학에서 학습자 주도의 학습경험 방식으로 전문직업성 교육프로그램을 개발하여 운영한 실증적 사례로써 함의가 있다.
본 논문에서는 130nm 이하의 초미세 공정을 위한 저전력 32비트$\times$32비트 곱셈기를 제안한다. 공정이 미세화 되어감에 따라 누설 전류에 의한 정적 전력이 급격하게 증가하여 동적 전력에 비해 무시하지 못할 수준에까지 이르게 된다. 최근 들어 동적 전력과 정적 전력을 동시에 줄일 수 있는 방법으로 MTCMOS에 기반하는 전원 차단 방법이 널리 쓰이고 있지만, 대규모 블록의 전원이 복귀될 때 심각한 전원 잡음이 발생하는 단점이 있다. 따라서 제안하는 곱셈기는 파이프라인 스테이지를 따라 순차적으로 전원을 차단하고 복귀함으로 전원 잡음을 완화시킨다. $0.35{\mu}m$ 공정에서 칩 제작 후 측정하고 130nm 및 90m 공정에서 게이트-트랜지션 수준 모의실험을 실시한 결과 유휴 상태에서의 전력 소모는 $0.35{\mu}m$, 130nm 및 90nm 공정에서 각각 $66{\mu}W,\;13{\mu}W,\;6{\mu}W$이었으며 동작 시 전력 소모의 $0.04\sim0.08%$에 불과하였다. 기존의 클록 게이팅 기법은 공정이 미세화되어감에 따라 전력 감소 효율이 떨어지지만 제안하는 곱셈기에서는 이러한 문제점이 발생하지 않았다.
본 논문에서는 JPEG2000 표준에서 주파수 변환기법으로 채택된 이산 웨이블릿 변환을 기반으로 영상의 부분 데이터만을 암호화하여 계산량을 줄이는 방법을 제안하였다. 또한 계산량이 많은 암호화 알고리즘 대신 비교적 계산량이 적은 캣맵(cat mad)과 카오스 시스템을 이용함으로써 계산량을 더욱 감소시켰다. 이 방법은 영상의 압축비를 유지하기 위해서 양자화와 엔트로피 코딩 사이에서 암호화를 수행하며, 부대역의 선택과 카오스 시스템을 이용한 무작위 변환방법을 사용한다. 영상에 대한 실험방법은 우선 암호화할 부대역을 선택하여 영상데이터를 3차원 블록으로 만든 후 캣맵에 의해 3차원으로 영상의 픽셀값을 교환 하는 방법과 캣맵에 의해 암호화된 부대역을 카오스 시스템을 이용하여 모듈러 연산에 의해 암호화하였다. 또한, JPEG2000의 점진적 전송(Progressive transmission)에 적합하게 암호화하기 위해서 비트 평면을 선택하여 암호화하였다. 제안한 방법을 소프트웨어로 구현하여 500개의 영상을 대상으로 실험한 결과 원 영상 데이터를 부분적으로 암호화함으로써 원 영상을 인식할 수 없을 정도의 암호화효과를 얻을 수 있었다. 본 논문에서는 여러 방식을 제안하였으며, 이들의 암호화 수행시간과 암호화 효율 사이에는 상보적인 관계가 있음을 보여, 적용분야에 따라 선택적으로 사용할 수 있음을 보였다.
2015년 말 신기후변화협약인 파리협정(Paris Agreement)이 체결됨에 따라 우리나라의 환경정책에도 많은 영향을 미칠 것으로 보인다. 우리나라의 전체 이산화탄소 배출량의 42%를 차지하고 있는 건설업은 그동안 환경문제를 개선하기 위하여 다양한 정책을 펼쳐 왔지만, 친환경건축물 인증에 해당하는 프로젝트 외에는 소극적 적용에 그치고 있다. 이는 대부분의 친환경 관련제도가 건축시설물을 위주로 하기 때문인 것으로 판단된다. 따라서 건축 뿐 아니라 토목시설물에도 광범위하게 적용될 수 있는 새로운 친환경 설계평가모델이 필요하다. 본 연구에서는 기존의 VE모델을 기반으로 시설물의 친환경성, 잠재적인 환경오염 개념과 환경위험성을 평가 할 수 있는 새로운 요소를 추가하여 의사결정자가 설계단계에서 친환경에 효과적인 대안을 선정할 수 있도록 친환경 설계평가 모델을 제시 하였다. 원안인 블록식 옹벽과 대안인 현장타설 옹벽을 대상으로 사례분석을 실시한 결과 대안의 친환경가치값이 원안보다 1.026배 높게 산출되었다. 본 모델이 설계단계에서 활용된다면 환경친화적인 시설물의 건설뿐 아니라 탄소배출량의 감축에도 기여할 것으로 기대된다.
512/1,024/2,048/3,072 비트의 4가지 키 길이를 지원하는 scalable RSA 공개키 암호 프로세서를 설계하였다. RSA 암호의 핵심 연산블록인 모듈러 곱셈기를 CIOS (Coarsely Integrated Operand Scanning) 몽고메리 모듈러 곱셈 알고리듬을 이용하여 32 비트 데이터 패스로 설계하였으며, 모듈러 지수승 연산은 Left-to-Right (L-R) 이진 멱승 알고리듬을 적용하여 구현하였다. 설계된 RSA 암호 프로세서를 Virtex-5 FPGA로 구현하여 하드웨어 동작을 검증하였으며, 512/1,024/2,048/3,072 비트의 키 길이에 대해 각각 456,051/3,496,347/26,011,947/88,112,770 클록 사이클이 소요된다. $0.18{\mu}m$ CMOS 표준셀 라이브러리를 사용하여 100 MHz 동작 주파수로 합성한 결과, 10,672 GE와 $6{\times}3,072$ 비트의 메모리로 구현되었다. 설계된 RSA 공개키 암호 프로세서는 최대 동작 주파수는 147 MHz로 예측되었으며, 키 길이에 따라 RSA 복호 연산에 3.1/23.8/177/599.4 ms 가 소요되는 것으로 평가되었다.
본 논문에서는 다중 릴레이와 다중 사용자가 존재하고, 모든 노드에 다중 안테나가 탑재된 시스템에서 기지국, 릴레이 전처리기 공동 설계 기법을 제안한다. 설계 기준은 릴레이가 각자의 지역 채널 정보만 취할 수 있고, 전체 릴레이 합 전력 제약 환경일 때, 사용자 평균 자승 오류의 합(sum mean square error, SMSE)을 최소화하는 것이다. 한 릴레이의 지역 채널 정보는, 시스템의 모든 첫 번째 홉 및 두 번째 홉 채널 중에서, 그 릴레이 자신이 접속된 채널의 정보로 정의된다. 블록 대각화 전처리기가 연결된 기지국 전처리기 구조를 사용하면, 각 릴레이가 지역 채널 정보만을 활용하여 자신의 전처리기 구조를 결정할 수 있다. 제안 하는 기법은 SMSE 쌍대성을 사용하여 기지국 전처리기와 릴레이 전처리기를 결정하는 1단계 및 사용자 수신 필터를 결정하는 2단계의 순차적 반복을 기반으로 한다. 제안한 기법은 반드시 수렴하며, 이론적으로 이를 검증할 수 있다. 제안하는 기법이 Simple amplify-and-forward(SAF), MMSE 릴레이 및 [1]에서 제안한 방식에 비해서 SMSE 성능, 합 전송률 성능 모두 우월한 것을 확인한다.
자동차부품 세척장비는 엔진과 변속기 블록 등의 가공과정에서 잔류하는 기름때를 제거하며, 잦은 수류방향 전환과 고압수의 분사를 위해 한 쌍의 2 방향 밸브를 사용한다. 그러나 정교한 밸브제어장치 없이 2 방향 밸브를 사용하는 경우 급격한 수류방향 전환에 따른 맥동현상이 발생하여 사용에 어려움이 따른다. 대안으로 하나의 3 방향 절환밸브를 사용하는 방법은 정교한 제어장치 없이도 정확한 수류방향 절환이 원활히 이루어져 이러한 문제점을 해결할 수 있다. 그러나 복잡한 유로 및 바텀플러그 형상으로 인해 유속변화가 심하게 발생하여 공동현상이 나타날 수 있다. 본 연구에서는 3 방향 절환밸브 내의 유동특성을 해석적으로 평가하였으며, 바텀플러그 하부에서 나타나는 공동현상을 공동화지표와 POC(Percent of cavitation)를 도입하여 정량화하였다. 공동현상의 저감을 위해 바텀플러그 형상을 매개변수화하고, 해석의 수렴성 개선과 해석시간을 단축시킬 수 있는 단순 유한요소모델을 이용하여 유동해석을 통한 형상최적설계를 실시하였다. 완전요인배치법을 통한 실험계획법과 인공신경망 기반 반응표면모델을 적용하여 공동현상이 발생하지 않는 POC 가 30% 미만인 바텀플러그의 형상을 제시하였다. 얻어진 최적해는 POC 27%에 대하여 바텀플러그의 허리길이와 꼬리길이가 각각 6.42mm 및 6.96mm 이다.
Shaprio가 발표한 EZW에서는 한 대역의 부(父)계수가 유사방향의 인접 고주파대역에 4개의 자(子)계수들과 부자관계를 구성하는 고정트리를 기반으로 한다. 이러한 고정트리는 대역간의 계층적 상관관계를 고찰하는데는 적합할 수 있으나, 4개의 계수가 하나의 $2{\times}2$의 블록단위로 처리되기 때문에 대역내 인접계수들간에 존재하는 공간적 상관관계를 고찰하기에는 부적합하다. 이러한 대역간의 계층적 상관관계와 대역내의 공간적 상관관계의 동시에 고찰하기 위하여 가변트리가 제안되었다. 그러나 가변트리는 웨이블렛 계수들을 표현하는데 있어, 고정트리에 비해 많은 심볼들을 필요로 한다. 반면 심볼당 정보량(entropy)이 낮아지는 결과를 가져오기 때문에 고정트리에 비해 압축성능을 향상시킨다. 본 논문에서는 가변트리로 인한 심볼 수의 증가를 억제하는 두 가지 기법ㅂ을 제안한다. 첫째, 무효계수에 대한 불필요한 스캔을 억제하기 위하여 각각의 유효 부계수에 대하여 유효 자계수의 소유여부를 미리 알려주는 1비트의 탐사비트(probing bit)를 발생시킨다. 둘째, 대역에 따라 필요로 하는 심볼 알파벳이 다르다는데 근거하여 대역별 특성을 고려한 심볼세트를 새로이 정의한다. 이러한 두 가지의 기법에 의하여 발생하는 심볼의 수는 상당히 줄어들게 되고, 출력된 심볼들은 추가 엔트로피코딩을 하지 않고 그대로 전송되더라도 비교적 좋은 압축결과를 가져올 수 있다. 가변트리와 심볼수의 억제기법에 의하여 변형된 EZW 부호화 방식은 적응산술부호화기를 포함한 모드와 포함하지 않은 모드의 두 가지 형태에서 제안된다. 본 논문에서 제안하는 부호화방식은 가변트리와 심볼발생억제 방식을 EZW에 적용시켜 성능향상을 꾀하며, 적용되어진 EZW와의 성능비교를 통하여 이러한 제안방식의 유효성을 점검해 본다.
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[게시일 2004년 10월 1일]
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