• 제목/요약/키워드: 버퍼크기

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디지털 컨트롤러 공유 및 Pseudo Relaxation Oscillating 기법을 이용한 원-칩 다중출력 SMPS (One-Chip Multi-Output SMPS using a Shared Digital Controller and Pseudo Relaxation Oscillating Technique)

  • 박영균;임지훈;위재경;이용근;송인채
    • 전자공학회논문지
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    • 제50권1호
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    • pp.148-156
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    • 2013
  • 본 논문에서는 디지털 제어부를 공유하며, 회로 동작시간의 분배 방식을 통해 다중 출력을 지원하는 SMPS를 제안한다. 제안된 회로는 Pseudo Relaxation Oscillating 기법의 DPWM 발생기를 사용한다. 제안된 SMPS는 회로의 동작시간 분배 방식을 사용하여 기존의 DPWM 발생기에서 문제가 되는 큰 면적의 디지털 로직 컨트롤러를 공유하는 형태이기 때문에 칩 면적과 효율 측면에서 큰 이점을 가지지만, 각 DPWM 발생기의 실시간 제어가 어려우며 불안정한 출력 전압을 공급할 수 있다는 단점을 가진다. 이를 해결하기 위해 본 논문에서는 동작시간 분배 방식으로 인해 동작클록이 인가되지 않은 DPWM 발생기들의 출력전압을 실시간으로 피드백 받아 안정된 출력 전압을 공급할 수 있는 실시간 전류 보정 기법을 제안한다. 제안된 SMPS를 100MHz의 내부 제어 동작 주파수와 10MHz 스위칭 주파수로 동작시킬 시, 소모되는 내부 코어 회로의 최대 전류는 4.9mA이며, 출력 버퍼를 포함한 전체 시스템의 전력 소모는 30mA이다. 또한 800mA, 100KHz의 load current regulation 조건으로 시뮬레이션 시, 3.3V 출력전압에 대한 최대 리플 전압은 11mV, Over/Undershoot voltage는 각각 10mV, 19.6mV 이다. 코어 회로의 크기는 $700{\mu}m{\times}800{\mu}m$의 작은 면적으로 구현가능하다. 제안된 회로는 Dong-bu Hitek BCD $0.35{\mu}m$ 공정을 이용한 시뮬레이션을 통해 검증되었다.

System-On-Glass를 위한 Poly-Si TFT 소 면적 DC-DC 변환회로 (An Area-Efficient DC-DC Converter with Poly-Si TFT for System-On-Glass)

  • 이균렬;김대준;유창식
    • 대한전자공학회논문지SD
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    • 제42권2호
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    • pp.1-8
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    • 2005
  • System-on-glass를 위해 poly-Si TFT로 면적이 작으면서도 리플전압을 최소화한 DC-DC 전압 변환회로를 개발하였다. 전압 변환회로는 전하 펌핑 회로, 문턱전압 변화를 보상한 비교기, 오실레이터, 버퍼, 다중 위상 클럭을 만들기 위한 지연 회로로 구성된다. 제안한 다중 위상 클럭킹을 적용함으로써 클럭 주파수 또는 필터링 캐패시터의 증가 없이도 낮은 출력 리플전압을 얻음으로써 DC-DC 변환기의 면적을 최소화 하였다. 제안한 DC-DC 변환회로를 제작하여 측정한 결과 $R_{out}=100k\Omega,\;C_{out}=100pF$, 그리고 $f_{clk}=1MHz$에서 Dickson 구조와 기존의 cross-coupled 구조에서의 리플전압은 각각 590mv와 215mv인 반면 4-위상 클럭킹을 적용한 구조에서는 123mV이다. 그리고 50mV의 리플전압을 가지기 위해 필요한 필터링 캐패시터의 크기는 $I_{out}=100uA$$f_{clk}=1MHz$에서 Dickson 구조와 기존의 cross-coupled 구조에서는 각각 1029pF와 575pF인 반면 4-위상과 6-위상 클럭킹을 적용한 구조에서는 단지 290pF와 157pF만이 각각 요구된다. 구조별 효율로는 Dickson 구조의 전하 펌프에서는 $59\%$, 기존의 cross-coupled 구조와 본 논문에서 제안한 4-위상을 적용한 cross-coupled 구조의 전하 펌프에서는 $65.7\%$$65.3\%$의 효율을 각각 가진다.

파이프라인 최적화를 통한 고성능 H.264 CAVLC 복호기의 VLSI 설계 (A VLSI Design of High Performance H.264 CAVLC Decoder Using Pipeline Stage Optimization)

  • 이병엽;류광기
    • 대한전자공학회논문지SD
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    • 제46권12호
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    • pp.50-57
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    • 2009
  • 본 논문에서는 H.264/AVC 영상 압축 기술에서 영상데이터의 통계적 중복성을 제거하기 위한 CAVLC의 하드웨어 복호기 구조를 제안한다. 기존의 CAVLC 하드웨어 복호기는 4단계에 걸쳐 5가지 코드를 복호한다. 복호과정에서 각 단계 전환시 불필요한 유휴 사이클이 포함되어 복호기의 성능을 저하시키고 또한 가변길이의 코드 복호과정 중 유효비트길이 계산 과정에서도 불필요한 유휴 사이클을 포함한다. 본 논문에서는 이러한 유휴 사이클을 효과적으로 제거하기 위한 하드웨어 구조를 제안한다. 첫 번째로 복호된 코드를 저장하는 불필요한 버퍼를 제거하여 파이프라인 구조를 효율적으로 개선하고 두 번째로 유효비트길이를 계산하는 과정에서 연산 및 제어를 단순화하는 쉬프터 구조를 제안한다. 제안된 방법을 적용한 결과 하나의 매크로 블록을 처리하는데 평균적으로 89사이클만을 소모한다. 기존 방식에 비하여 29% 가량 성능이 향상됨을 확인하였다. 제안된 구조를 0.18um CMOS 공정을 적용하여 합성하였을 경우 최대 동작 주파수는 140Mhz이며 게이트 크기는 11.5K이다. 기존 방식에 비해 사이클 수는 적게 소모하면서도 적은 회로 사이즈를 구현하여 저전력 동작이 가능하다.

미생물 기원 맥키나와이트의 산화 및 용해 특성 연구 (Study on the Oxidation and Dissolution Characteristics of Biogenic Mackinawite)

  • 이승엽;백민훈;정종태
    • 한국광물학회지
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    • 제25권3호
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    • pp.155-162
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    • 2012
  • 토양 및 지하수 등의 혐기성환경에 서식하는 황산염환원박테리아의 활동으로 생성되는 맥키나와이트가 용존산소에 의해 산화 및 용해되는 특성을 관찰하였다. 오염지역에 산화지하수 유입에 의한 용존산소량 증가로 인해 안정화된 핵종들(예: 환원우라늄)이 산화 및 용해되는 상황에서 일반적으로 같이 공존하는 황화광물의 역할을 알아보고자 하였다. '디설퍼비브리오 디설프리칸스(Desulfovibrio desulfuricans)'라는 황산염환원박테리아가 만든 맥키나와이트를 '과산화수소수'와 '아질산나트륨'으로 산화시키면서 발생되는 광물 용해 현상을 약 2주 동안 관찰하였다. 산화제의 종류에 따라 시료의 광물학적 산화 및 용해 반응 특성은 달랐으나, ${\mu}m$ 크기의 황화광물 입자들에 의한 용존산소의 소모와 그에 따른 황산염 농도의 증가로 인해 산화수가 초기에 안정화되었다. 이와 같은 결과로부터 알 수 있는 사실은, 황산염환원미생물에 의해 다량 만들어지는 황화광물이 지하수의 산소를 소모시켜 환원 환경의 교란을 예방할 뿐만 아니라 버퍼물질로써 환원/침전된 핵종들의 장기 안정화에 상당한 기여를 할 것으로 예상된다.

IEEE 802.11 무선랜 환경에서의 이동성 지원 IPv6프로토콜의 성능분석 (Performance Analysis of Mobility Support Protocols for IPv6 over Wireless LAN)

  • 황승희;한연희;황종선
    • 한국정보과학회논문지:정보통신
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    • 제32권3호
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    • pp.391-403
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    • 2005
  • IPv6 기반 이동성 지원 프로토콜인 Mobile IPv6, Hierarchical Mobile IPv6, Fast Handovers over Mobile IPv6가 IETF를 통해서 제안되었다. 한편, 이동 인터넷 서비스를 위해서 IEEE 802.11 네트워크가 최근에 널리 이용되고 있다. 그래서 가까운 장래에 IEEE 802.11 네트워크에서 IPv6 이동성 지원기술은 All If 기반 이동성 지원 서비스를 실현하는 핵심 기술이 될 것이다. IPv6 이동성 지원 프로토콜들의 적절한 응용 개발을 위해서는 먼저 이들의 성능을 분석할 필요가 있다. 이런 분석에는 프로토콜에 의해 요구되는 시그널링 비용, 핸드오버시 지연 시간, 핸드오버시 손실되는 패킷의 수 및 이 손실을 줄이기 위해서 필요한 버퍼의 크기 등이 포함되어야 하며, 또한 IEEE 802.11 과 같은 하위 계층 프로토콜이미치는 영향을 분석해 볼 필요가 있다. 따라서 본 논문에서는 IEEE 802.11 네트워크에서 IPv6 이동성 지원 프로토콜들을 분석하기 위한 프레임워크를 개발하고 각각의 프로토콜들에 대한 성능 비용 함수를 제시한다. 프레임워크 제안을 위해서 본 논문에서는 패킷 트래픽 모델, 네트워크 시스템 모델 및 단말의 이동성 모델 둥을 정의한다. 또한, 다양한 파라미터를 사용하여 그들이 각 프로토콜의 성능에 미치는 영향을 분석하고 비교한다. 분석결과로서 각 프로토콜들이 각기 상호보완적인 혹은 대조적인 성능을 보이기 때문에, 임의의 프로토콜이 다른 프로토콜들 보다 비교 우위를 차지하는 일이 없음을 알 수 있다

Subharmonic Injection Locking 방법을 이용한 X-Band 주파수 합성기 설계 (The Design of a X-Band Frequency Synthesizer using the Subharmonic Injection Locking Method)

  • 김지혜;윤상원
    • 한국전자파학회논문지
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    • 제15권2호
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    • pp.152-158
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    • 2004
  • Subharmonic injection locking 방식을 이용하여 디지털 위성방송 시스템의 신호원으로 사용될 수 있는 낮은 위상 잡음과 우수한 전력 효율을 갖는 X-band 주파수 합성기를 설계, 제작하였다. 주파수 합성기는 위상 고정 발진기의 역할과 동시에 고조파 발생기로 동작하는 1.75 GHz의 주 발진기(master발진기)와 10.5 GHz 부 발진기(slave 발진기)로 구성되어 있다. PLL 방법을 적용하여 구성된 1.75 GHz 주 발진기는 능동부를 형성하는 트랜지스터와 버퍼 증폭기의 역할을 하는 BJT 트랜지스터를 직렬 연결하여 사용하였는데 첫 단은 위상고정 발진기의 역할을 하고 둘째 단은 45 GHz의 차단 주파수(cutoff frequency)를 갖는BJT를 사용함으로써 고조파 발생기로 동작하게 하여 안정적으로 Injection Locking 될 수 있도록 인가될 신호인 6차 고조파의 크기를 충분히 크게 발생시키도록 하였다. 고조파 발생기로부터 발생한 6차 고조파는 뒤에 위치한 약 45 dB 이득을 갖는 증폭기로 동작하는 부 발진기에 인가되어 Injection Locking 된다. 이러한 특성을 갖는 회로 구조를 이용하여, ILO 방식을 이용함으로 얻는 간단한 회로 구조와 낮은 위상 잡음 특성은 물론 보다 우수한 전력 효율을 갖는 10.5 GHz 주파수 합성기를 설계 제작하였다. 제작된 10.5 GHz 주파수 합성기는 7.4 V/49 mA,-0.5 V/4 mA의 전력 소모와 4.53 dBm의 출력 전력, 그리고 10 kHz와 100 kHz 이격 주파수에서 각각 -95.09 dBc/Hz와-108.90 dBc/Hz의 위상 잡음 특성을 얻었다.

3G 통신 시스템 응용을 위한 0.31pJ/conv-step의 13비트 100MS/s 0.13um CMOS A/D 변환기 (A 0.31pJ/conv-step 13b 100MS/s 0.13um CMOS ADC for 3G Communication Systems)

  • 이동석;이명환;권이기;이승훈
    • 대한전자공학회논문지SD
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    • 제46권3호
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    • pp.75-85
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    • 2009
  • 본 논문에서는 two-carrier W-CDMA 응용과 같이 고해상도, 저전력 및 소면적을 동시에 요구하는 3G 통신 시스템 응용을 위한 13비트 100MS/s 0.13um CMOS ADC를 제안한다. 제안하는 ADC는 4단 파이프라인 구조를 사용하여 고해상도와 높은 신호처리속도와 함께 전력 소로 및 면적을 최적화하였다. 입력 단 SHA 회로에는 면적 효율성을 가지멸서 고속 고해상도로 동작하는 게이트-부트스트래핑 회로를 적용하여 1.0V의 낮은 전원 전압동작에서도 신호의 왜곡없이 Nyquist 대역 이상의 입력 신호를 샘플링할 수 있도록 하였다. 입력 단 SHA 및 MDAC에는 낮은 임피던스 기반의 캐스코드 주파수 보상 기법을 적용한 2단 증폭기 회로를 사용하여 Miller 주파수 보상 기법에 비해 더욱 적은 전력을 소모하면서도 요구되는 동작 속도 및 안정적인 출력 조건을 만족시키도록 하였으며, flash ADC에 사용된 래치의 경우 비교기의 입력 단으로 전달되는 킥-백 잡음을 줄이기 위해 입력 단과 출력 노드를 클록 버퍼로 분리한 래치 회로를 사용하였다. 한편, 제안하는 시제품 ADC에는 기존의 회로와는 달리 음의 론도 계수를 갖는 3개의 전류만을 사용하는 기준 전류 및 전압 발생기를 온-칩으로 집적하여 잡음을 최소화하면서 시스템 응용에 따라 선택적으로 다른 크기의 기준 전압 값을 외부에서 인가할 수 있도록 하였다. 제안하는 시제품 ADC는 0.13um 1P8M CMOS 공정으로 제작되었으며, 측정된 DNL 및 INL은 13비트 해상도에서 각각 최대 0.70LSB, 1.79LSB의 수준을 보이며, 동적 성능으로는 100MS/s의 동작 속도에서 각각 최대 64.5dB의 SNDR과 78.0dB의 SFDR을 보여준다. 시제품 ADC의 칩 면적은 $1.22mm^2$이며, 1.2V 전원 전압과 100MS/s의 동작 속도에서 42.0mW의 전력을 소모하여 0.31pJ/conv-step의 FOM을 갖는다.

고속액체크로마토그래피 텐덤질량분석기법을 이용한 사람 혈장 내 소라페닙 농도분석법의 개발 및 검정 (Development and Validation of the Determination of Sorafenib in Human Plasma using Tandem Mass Spectrometry Coupled with Liquid Chromatography)

  • 박대진;이성곤;김우미
    • 생명과학회지
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    • 제22권11호
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    • pp.1456-1462
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    • 2012
  • 소라페닙은 멀티카이네즈 억제제로서 신세포암, 전이성 간세포암 환자의 치료에 효과가 입증된 경구용 항암제이다. 이 연구의 목적은 고속액체크로마토그래피 텐덤질량분석기법(LC/MS/MS)을 이용하여 사람 혈장 내 소라페닙의 농도를 측정하는 효율적인 방법을 개발하고 한국식품의약품안전청(KFDA) 기준에 따라 분석법을 검정하는 것이다. 혈장시료($100{\mu}l$)에 내부표준물질인 chlorantraniliprole을 첨가한 후 이소프로필알콜과 에틸아세테이트로 구성(1:4, v/v)된 0.1% 포름산 함유 추출용액을 혼합하였다. 원심분리 후 상층액을 취하여 원심감압농축하였다. 잔사를 이동상에 재용해하고 Waters사의 역상 XTerra$^{TM}$ C18 칼럼(입자크기 $3.5{\mu}m$)을 장착한 고속액체크로마토그래피 장치에 주입하였다. 액체크로마토그래피는 0.1% 포름산과 10 mM 암모늄 포메이트를 함유한 버퍼용액과 메탄올, 아세토나이트릴을 각각 1:6:3으로 혼합한 용액을 이동상으로 사용하였으며 5분 내에 측정을 완료하였다. 분석대상 물질들은 텐덤질량분석기에서 electrospray 양이온 이온화($ES^+$) 검출방식으로 확인하였으며 소라페닙은 'm/z 465.2 ${\rightarrow}$ 252.5', chlorantraniliprole은 'm/z 484.4 ${\rightarrow}$ 286.2'으로 구성한 multiple reaction monitoring 방법을 사용하였다. 검정 결과, 2-5,000 ng/ml의 농도 구간에서 양호한 직선성($r^2$ > 0.99)과 정확도(90.7-103.9%), 정밀도(10% 이하)를 나타내었다. 새롭게 개발된 LC/MS/MS을 이용한 사람 혈장 내 소라페닙의 농도 측정법은 KFDA 기준을 만족하였으며, 기존의 방법에 비해 민감도가 높은 방법이었다.

Rijndael 알고리즘을 이용한 물리 계층 ATM 셀 보안 기법 (ATM Cell Encipherment Method using Rijndael Algorithm in Physical Layer)

  • 임성렬;정기동
    • 정보처리학회논문지C
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    • 제13C권1호
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    • pp.83-94
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    • 2006
  • 본 논문에서는 미국 NIST에서 차세대 암호화 알고리즘으로 채택한 Rijndeal 알고리즘을 적용한 물리 계층 ATM 셀 보안 기법에 관한 것이다. ATM 셀 보안 기법을 기술하기 위해 물리 계층에서의 데이터 암호화 시의 표준 ISO 9160을 만족하는 데이터 보안 장치를 하드웨어로 구현하여 STM-1급(155.52Mbps) 의 ATM 망에서 암호화/복호화 과정을 검증하였다. 기존의 DES 알고리즘이 블럭 및 키 길이가 64 비트이므로 대용량 데이터 처리가 어렵고 암호화 강도가 취약함에 비해, Rijneal 알고리즘은 블럭 크기가 128 비트이며 키 길이는 128, 192, 256 비트 중 선택 가능해 시스템에 적용 시 유연성을 높일 수 있고 고속 데이터 처리 시에 유리하다. 물리 계층 ATM 셀 데이터의 실시간 처리를 위해 Rijndael 알고리즘을 FPGA로 구현한 소자를 사용하여 직렬로 입력되는 UNI(User Network Interface) 셀을 순환 여유 검사 방법을 이용하여 셀의 경계를 판별하고 셀이 사용자 셀인 경우, 목적지의 주소값 등 제어 데이터를 지니고 있는 헤더 부분을 분리한 48 옥텟의 페이로드를 병렬로 변환, 16 옥텟(128 비트) 단위로 3 개의 암호화 모듈에 각각 전달하여 암호화 과정을 마친 후 버퍼에 저장해 둔 헤더를 첨가하여 셀로 재구성하여 전송하여 준다. 수신단에서 복호화 시에는 페이로드 종류를 판별하여, 사용자 셀인 경우에는 셀의 경계를 판별한 다음 페이로드를 128 비트 단위로 3 개의 암호화 모듈에 각각 전달하여 복호화하며, 유지 보수 셀인 경우에는 복호화 과정을 거치지 않는다. 본 논문에 적용한 Rijndael 암호화 소자는 변형된 암복호화 과정을 적용하여 제작된 소자로 기존에 발표된 소자에 비해 비슷한 성능을 지니면서 면적 대 성능비가 우수한 소자를 사용하였다.ochlorococcus의 수층별 평균 풍도의 수직분포는 표면 혼합층에서 유사한 수준을 보이다 이심에서 급격한 감소를 나타냈다. 그러나 TSWP에선 풍도의 급격한 감소가 나타나지 많고 100 m 수심까지 높은 풍도를 나타냈다. Picoeukaryotes는 C-ECS에서 100 m까지 유사한 수준의 풍도를 보였으며, 동해의 $20\sim30\;m$ 수심에선 최대 풍도층이 나타났다.특별한 영향을 미치지 않는 것으로 나타났다. 동일 환자들의 골상태의 변화관찰과 신질환 관련 골감소의 요인을 밝혀내기 위한 추가적인 연구가 필요할 것으로 사료된다. 정확한 진단 및 동반된 질환을 감별하기 위한 노력이 필요하다.심되나 X-ray VCUG로 발견되지 않은 경우에는 RI VCUG를 꼭 시행하는 것이 방광요관역류의 정확한 진단을 하는데 도움이 된다..25% sodium 식이 enalapril군에서 사구체여과율이 증가됨을 관찰할 수 있었다. 4) 신절제술후 남아 있는 신조직무게를 비교하여 보면 24주째 0.25% sodium 식이군, 0.25% sodium 식이 enalapril군, 0.25% sodium 식이 nicardipine군에서 16주째 0.49% sodium 식이군, 0.49% sodium 식이 enalapril군, 0.49% sodium 식이 nicardipine 군보다 의의있게 신조직무게가 증가됨을 관찰할 수 없었다. 5) 0.25% sodium 식이군은 0.49% sodium 식이군과 비교하여 MES의 현저한 감소를 보였고 (0.25% sodium식이군: 12주; $1.97{\pm}0.02$, 24주; $2.06{\pm}0.03$ vs. 0.49% sodium 식이군: 12주; $2.29{\pm}0.09$, 16주; $2.55{\pm}0.