• Proceedings of the Korean Information Science Society Conference
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• 1999.10c
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• pp.36-38
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• 1999

하드웨어의 제품 사양에는 제품의 특징, FBD(Functional Block Diagram), 핀의 기능 및 배열, 프로그래밍 모드 및 각 블록의 기능 등이 함께 제시된다. 이 때 다른 사양과는 달리 설계 초기 단계부터 설정되는 가장 개념적인 FBD는 마이크로프로세서의 경우 메모리 인터페이스, 레지스터 파일, 데이터패스, 예외처리기, 각종 제어기, 타이머 등으로 구성된다. FBD의 각 블록들은 여러 명의 설계자들에게 분할되고 이 중 마이크로프로세서 설계의 대부분의 시간을 소비하게 되는 각종 제어기의 설계는 여러 블록이 공동으로 제어 신호를 공유하게 된다. 이 신호에 의해 전체 시스템의 정확성(correctness)이 결정되므로 제어기예서 각 블록에 공급하는 제어 신호는 적절할 타이밍에 정확한 값을 가져야만 한다. 따라서 본 논문은 마이크로프로세서에서의 각 블록에 공급하는 제어 신호는 적절한 타이밍에 정확한 값을 가져야만 한다. 따라서 본 논문은 마이크로프로세서의 FBD를 모델링할 수 있는 시각도구를 제안함으로써 제어 신호에 따른 전체 블록의 유기적인 데이터 흐름을 한 눈에 파악할 수 있도록 한다. 이는 설계초기부터 각 블록들을 설계하는 설계자들간의 공통의 다이어그램인 FBD를 중심으로 설계를 해나감으로써 대화 오류를 감소시키고 제어신호 디버깅을 용이하게 하여 설계시간을 단축시키는 것을 목표로 한다.

• Proceedings of the Korean Institute of Information and Commucation Sciences Conference
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• 2017.10a
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• pp.569-570
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• 2017

Bitcoin-based blockchain technology provides an infrastructure that enables anonymous smart contracts, low-cost remittances, and online payments. However, the block-chain technology that implements the bitcoin has scalability constraints in tradeoffs between throughput and latency. To solve these problems, the Byzantine fault tolerant block-chain technique has been proposed. This technique improves throughput without increasing latency by selecting a leader and constructing many microblocks that do not contain proofs of work within the existing block by the leader. However, this technique may be less secure than existing techniques in selecting the reader. In this paper, we propose a technique for scalability of the blockchain technology by using microblock technology and parallel execution technique. Within one microblock there is information about several transactions. In the proposed scheme, the throughput of the microblocks can be increased by performing concurrently.

• Convergence Security Journal
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• v.20 no.3
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• pp.71-78
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• 2020

Bitcoin-based blockchain technology provides an infrastructure that enables anonymous smart contracts, low-cost remittances, and online payments. However, the block-chain technology that implements the bitcoin has scalability constraints in tradeoffs between throughput and latency. To solve these problems, the Byzantine fault tolerant block-chain technique has been proposed. This technique improves throughput without increasing latency by selecting a leader and constructing many microblocks that do not contain proofs of work within the existing block by the leader. However, this technique may be less secure than existing techniques in selecting the reader.

• Proceedings of the Korea Institutes of Information Security and Cryptology Conference
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• 1997.11a
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• pp.303-314
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• 1997

계산능력이 제한된 8비트 마이크로프로세서에 적합하도록 모든 기본 연산을 8비트 단위로 처리하는, 블록 크기는 64비트, 키 크기는 128비트인, Feistel 구조의 블록 암호 알고리즘을 제시한다. 이 알고리즘의 안전도는 잘 알려진 two-key triple-DES[ANSI86]나 IDEA[Lai92]와 비견할 만하며, 처리속도는 single-DES[NBS77]보다도 10∼20배 빠르다. 본 논문에서는 이 알고리즘의 설계원칙 및 안전성 분석에 대하여 설명하였고, 다른 알고리즘과의 통계적 특성 및 성능에 대해서도 비교하였다.

• Journal of the Korea Institute of Information Security & Cryptology
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• v.11 no.2
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• pp.3-12
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• 2001

Currently, the superscalar architecture dominates todays microprocessor marketplase. As, more transistors are integrated onto larger die, however, an on-chip multiprocessor is regarded as a promising alternative to the superscalar microprocessor. This paper examines the behavior of the next generation block encryption algorithms RC6 and Rijndael on the on-chip multiprocessing microprocessor. Based on the simulation results by using a program-driven simulator, the on-chip multiprocessor can exploit thread level parallelism effectively and overcome the limitation of instruction level parallelism in the next generation block encryption algorithms.

• Review of KIISC
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• v.16 no.3
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• pp.63-74
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• 2006

본 논문에서는 한국 산업규격 KS 표준 블록암호 알고리즘인 ARIA의 핵심논리들을 64비트 프로세서 환경에서 효율적으로 구현하는 방법을 제안하고, 제안된 방법으로 구현된 ARIA를 대표적인 64비트 마이크로프로세서인 Intel Pentium4 x64, Intel Itanium, Intel XEON(EM64T)을 이용하여 그 효율성을 평가하였으며, 32비트 프로세서에 적합하게 구현된 ARIA와 효율성을 비교하고 문제점을 분석하였다.

• Proceedings of the Korean Information Science Society Conference
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• 2005.07a
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• pp.625-627
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• 2005

본 논문은 인텔사의 IXP2400 네트워크 프로세서를 이용하여 IPv6 multicast-enabled 라우터 개발의 예비단계로서 IPv6 멀티캐스트 모듈의 전체적인 설계 및 구현을 다룬다. 특히, 마이크로 엔진할당, IPv6 멀티캐스트 마이크로 블록 및 패킷 복사 마이크로 블록에 중점을 둔다. 우리의 IPv6 멀티캐스트 포워딩 모듈의 성능측정 결과는 이론적 한계치의 $86\%$였다.

• Proceedings of the Korea Information Processing Society Conference
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• 2016.04a
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• pp.197-200
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• 2016

세계 완구시장에 있어서 조립형 완구는 높은 점유율을 차지하고 있고 많은 인기를 얻어왔다. 특히 Lego와 같은 조립형 블록은 최근 마이크로 블록이라는 이름으로 다시 유행하고 있으며 PC용 프로그램 뿐만 아니라 웹 사이트에서도 가상 블록 조립 환경을 마우스 사용에 특화된 인터페이스로 제공하고 있다. 하지만 모바일 기기의 터치 인터페이스에서 마우스에 특화된 인터페이스를 사용한 블록 조립은 매우 제한적일 수밖에 없다. 본 논문에서는 모바일 기기 중에서도 태블릿의 터치 인터페이스를 사용하여 빠르게 자신이 원하는 모양을 만들 수 있는 가상 블록 조립 환경에 대하여 설명한다.

• Journal of the Microelectronics and Packaging Society
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• v.12 no.2 s.35
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• pp.181-186
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• 2005

We fabricated thin films of polystyrene-block-poly(methyl methacrylate)(PS -b-PMMA) on the self-assembled monolayers(SAM) of 3-(p-methoxyphenyl)propyltrichlorosilane(MPTS) on silicon wafers. Cylindrical nanodomains of PMMA or PS were oriented perpendicular to the surface of silicon wafers due to the neutral affinity of the SAM to PS and PMMA blocks. By selective removal of the PMMA block with UV irradiation and washing, nanoporous films and nanorod assemblies were produced. The nanoporous film can be used for a nanolithographical mask.

• Proceedings of the KSME Conference
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• 2007.05b
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• pp.2426-2431
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• 2007

The microchannel waterblock has a good capability in the cooling of electronic devices. The object of this paper is to estiblish the scheme of design for the microchannel waterblock. The effects of flow rate and channel size on the cooling performances are investigated. It was found that the optimum flow rates were ragned from 0.7 lpm to 1.4 lpm. The thermal resistance at 2.0 lpm and 100 W was 0.13 $^{\circ}C$/W. Decrease in the width of channels is more effective for the improvement in the cooling performances of microchannel waterblock than increase in the height of channels. The increase of pressure drop resulted from decrease in the width of channels can be decreased by increasing the hight of channels.