Proceedings of the Korean Vacuum Society Conference
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2010.02a
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pp.281-281
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2010
ITER 블랑켓 시험모듈(TBM)의 액체형 증식재 성능 시험용 루프의 설계를 완료하였고 현재시험용 루프를 제작 및 설치중이다. 액체형 증식재 성능 시험용 루프의 핵심 구성 부품인 액체 저장용 탱크, 전자석, EM 펌프들과 이들 장치들의 전원장치 및 제어장치를 제작 완료하였다. 액체형 증식재 성능 시험용 루프 설치를 위한 데크를 제작하였으며, 제작된 실험 데크의 총 지지하중은 10 톤 이상이다. 루프설치대 위에 성능 시험용 루프가 설치되며 루프 설치대는 $3\;m\;{\times}\;2.4\;m$ 의 직사각형으로 제작되었으며, 실험 종료 및 유지 보수 시 액체증식재의 drain을 고려하여 전체 루프는 각도 조절이 가능하도록 제작되었다. 루프내의 유량을 측정하기 위한 유량계, 전자석 자장의 변화에 따른 압력의 변화를 측정하기 위한 차압센서가 전자석의 양단에 설치되며, 시험용 루프에 흐르는 액체금속(PbLi) 및 루프관의 온도를 측정하기 위한 열전대가 설치된다. 루프 설치대를 기울였을 때 루프의 최상부에 액체금속 저장고 및 레벨센서를 설치하여 루프 내에 액체금속이 가득 채워졌는지를 레벨센서로 확인하며 루프 내에 잔존하는 기체가 저장고를 통하여 외부로 배출되게 하였다. 액체형 증식재 성능 시험용 루프 설치 후 실험은 고체 상태의 PbLi를 액체 저장용 탱크에 장착한 후 탱크의 열선의 온도 제어에 의한 PbLi의 용융점 확인, 시험용 루프에서의 전자펌프 성능 평가 등의 시험의 기본적인 실험을 수행한 후 자기장 환경에서 MHD 평가, 증식재의 순도 유지, 구조재의 부식 등의 시험을 수행할 예정이다.
The Journal of Korea Institute of Information, Electronics, and Communication Technology
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v.14
no.6
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pp.479-486
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2021
In this paper, an ultra small phase locked loop (PLL) with a single capacitor loop filter has been proposed by adding a signal sensing circuit (SSC). In order to extremely reduce the size of the PLL, the passive element loop filter, which occupies the largest area, is designed with a very small single capacitor (2pF). The proposed PLL is designed to operate stably by the output of the internal negative feedback loop including the SSC acting as a negative feedback to the output of the single capacitor loop filter of the external negative feedback loop. The SSC that detects the PLL output signal change reduces the excess phase shift of the PLL output frequency by adjusting the capacitance charge of the loop filter. Although the proposed structure has a capacitor that is 1/78 smaller than that of the existing structure, the jitter size differs by about 10%. The PLL is designed using a 1.8V 180nm CMOS process and the Spice simulation results show that it works stably.
계측 시스템이나 시스템 식별을 수행할 때 정확히 모델링 되는 플랜트를 가정할 경우, 입출력 신호간 혹은 상태 변수들 사이의 비선형 함수 관계를 유도해 낼 수 있다. 그런데 특히 비선형 함수가 매우 복잡하여 해를 닫힌 형태로 구할 수 없을 경우 고려하는 변수들 양자간의 수학적 모델링을 기반으로 루프내 변수가 방정식의 해로 수렴하는 대수 루프를 구성할 수 있다. 이는 모델을 정확히 아는 시스템에 대하여 출력으로부터 입력을 추정하는 역시스템(inverse system)을 구성하는 것과 유사하다. 이러한 개념을 응용한 간단한 예로 용량형 센서의 입출력 비선형성을 제거해주는 역시스템을 대수 루프를 통하여 구현하였다. 또한 구현한 루프가 항상 유일한 해로 수렴할 수 있도록 하는 조건을 구하였다. 해석된 결과를 바탕으로 구현된 루프가 컴퓨터 시뮬레이션 및 아날로그 회로 실험에서도 잘 동작함을 검증하였다. 시뮬레이션 결과로 보인 잡음에 대한 강인성과 실제 회로 실험 결과는 대수 루프의 구현이 실제 용량형 센서 등에 용이하게 적용될 수 있음을 보여준다.
3대의 인버터를 이용한 루프형 LSM 소형 시험장치의 섹션전환 기법의 모델링 방법에 대한 연구를 수행하였다. 원통형 동기 전동기를 선형 전동기로 변환하여 모델링을 하였다. 3대의 인버터가 교차되어 있는 형태이므로 Section Change시 변하는 역기전력에 따른 Force변화와 Jerk에 대해 시뮬레이션을 통하여 결과를 도출하였다.
The paper is a phase controlled loop antenna for multi-media devices. We developed a phase control loop pattern arrangement methods for loop antenna in mobile devices like as a cell phone and PCS, WCDMA. In the loop antenna pattern, arrange close adhesive the loop antenna pattern $180^\circ$ cycle in wave length, the radiated electro-magnetic wave from close adhesive loop pattern become to coherent wave than the phase controlled loop antenna has high efficiency and high radiation gain. To acquire a wide band width on phase controlled loop antenna, we arrange a multiple phase controlled loop pattern that has a different length each other. Different length for each other loop pattern cause a different frequency that we can acquire a wide band width for loop antenna from close adhesive phase control. In experiment, we designed a CDMA850 mobile multi-media antenna in 20mm$\times$20mm area thickness 0.4mm, the radiation efficiency is over 60% and radiation gain is over 0dBi.
Proceedings of the Korean Information Science Society Conference
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2006.06a
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pp.316-318
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2006
루프버퍼는 루프의 부하를 줄이기 위해 일반적으로 사용되고 있는 구조이다. 본 논문은 EISC 내장형 프로세서의 에너지 소모를 줄이기 위하여 변형된 루프버퍼를 제안한다. 제안하는 루프버퍼는 EISC 프로세서가 갖는 특수 명령어의 수행 횟수를 감소시켜, 주요 에너지 소모원인 메모리 접근을 추가로 감소시킨다. 시뮬레이션 결과, 제안하는 루프버퍼는 설계한 프로세서의 수행시간을 $5%{\sim}13.6%$ 감소시키며, 메모리 접근횟수를 $14.9{\sim}37.8%$ 감소시키는 것을 관찰하였다. 변형된 루프버퍼는 $0.18{\mu}m$, 1.8V 공정 표준 셀 라이브러리를 사용하여 악 2792 개의 등가 게이트에 해당하는 면적에서 구현할 수 있다.
We need an enormous amount of memories for name spaces as well as additional processors if we are to effectively exploit a massively parallelism in nested loops of functional languages such as Id. If there is no sufficient amount of memories enough to exploit that parallelism, the execution of programs can be aborted during the unfolding of loops. Additionally, if loops are overunfolded, compared with the number of processors available, the system performance can be degraded severely due to the overhead of loop unfolding. This paper suggests and analyzes an algorithm which can be used to effectively unfold nested loops of functional languages on multithreaded architectures. This algorithm has a feature to unfold a given nested loop safely and near optimally, considering the system resources of processors and memories available when the loop is to be unfolded.
Proceedings of the Acoustical Society of Korea Conference
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autumn
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pp.219-220
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2004
최근 중대형 세단이나 SW 차량의 썬루프 개구량이 증대되고 사양의 고급화가 진행되면서 기존의 판형 디플렉터를 대신하여 새로이 튜브형 디플렉터의 이용이 늘어나고 있다. 본 연구에서는 실차 무향 풍동을 이용한 실차 썬루프 바람소리 실험을 통하여 튜브형 디플렉터의 특성을 확인하였다. 튜브형 디플렉터의 성능에 영향을 줄 수 있는 인자들의 최적화를 통하여 초기 설계 사양 및 경쟁차보다 우수한 썬루프 바람소리 성능을 얻을 수 있었다.
Journal of the Institute of Electronics Engineers of Korea TC
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v.45
no.1
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pp.97-102
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2008
A new internal antenna for GSM/DCS/Bluetooth application is proposed by using a folded loop resonator. Both feed leg and shorting leg are symmetrically implemented at the center of the folded loop, thus leading to produce resonances at integer frequencies of quarter wavelength. An open stub added at one end of the folded loop can reduce resonant frequencies. The open stub play a role in generating PIFA structure at a GSM band, thus increasing bandwidth, Two resonances at the GSM band are observed at folded ring and PIFA, respectively.
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[게시일 2004년 10월 1일]
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